JPS61165101A - 制御システム暴走防止回路 - Google Patents
制御システム暴走防止回路Info
- Publication number
- JPS61165101A JPS61165101A JP729285A JP729285A JPS61165101A JP S61165101 A JPS61165101 A JP S61165101A JP 729285 A JP729285 A JP 729285A JP 729285 A JP729285 A JP 729285A JP S61165101 A JPS61165101 A JP S61165101A
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- Japan
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- circuit
- processing circuit
- control device
- reset
- runaway
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- Pending
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
く技術分野〉
本発明は、電子レンジ等の電子機器を制御するだめの処
理回路を含むマイクロコンピュータ製制御装置に関する
。
理回路を含むマイクロコンピュータ製制御装置に関する
。
〈従来技術〉
近年、電気機器、特に電子レンジの機能の向上に伴ない
、マイクロコンピュータなどで実現される処理回路を２
個以上使用したコントローラーシステムか増力１ける傾
向にある。しかしながら温度、雑音、静電気などにより
処理回路が暴走し、システムかループに入ってデッドロ
ックとなったときや、正規外のルートを暴走するような
と柊があり、最悪状態ではマグネトロンやヒータなどの
熱源が加熱状態のままになるなと非常に危険な状態が起
こり得る。
、マイクロコンピュータなどで実現される処理回路を２
個以上使用したコントローラーシステムか増力１ける傾
向にある。しかしながら温度、雑音、静電気などにより
処理回路が暴走し、システムかループに入ってデッドロ
ックとなったときや、正規外のルートを暴走するような
と柊があり、最悪状態ではマグネトロンやヒータなどの
熱源が加熱状態のままになるなと非常に危険な状態が起
こり得る。
上記事実を具体的に説明すると、第６，７図の如く、マ
イクロコンピュータなどで実現される処理回路１１に接
続されているリセット回路は、前記処理回路１１をリセ
ットさせる回路である。そして処理回路１１は加熱エネ
ルギー発生手段（マグネトロン）、キー入力回路及び表
示回路に接続されている。しかし前記処理回路１１に接
続今れているリセット回路では、マイクロコンピュータ
の電源投入（ＰＯＷＥＲＯＮ）時のみ処理回路１１をリ
セ゛ントさせ、予め轡己慮されたプログラム１こよりシ
ステムが動作する様に設計されていた。
イクロコンピュータなどで実現される処理回路１１に接
続されているリセット回路は、前記処理回路１１をリセ
ットさせる回路である。そして処理回路１１は加熱エネ
ルギー発生手段（マグネトロン）、キー入力回路及び表
示回路に接続されている。しかし前記処理回路１１に接
続今れているリセット回路では、マイクロコンピュータ
の電源投入（ＰＯＷＥＲＯＮ）時のみ処理回路１１をリ
セ゛ントさせ、予め轡己慮されたプログラム１こよりシ
ステムが動作する様に設計されていた。
すなわち第７図に示す様に処理回路１１のリセット入力
端子電圧＼７Ｒが電源投入後にＶ ｉ Ｉ−（’）セッ
ト入力端子の低レベル判定電圧）より低い電圧（＼１ｒ
ｅｓｅｔを含む）になったとき、処理回路１１は動作し
、電源０ＦＦ（ＰＯＷＥＲＯＦＦ時）後ニリセット入力
端子電圧Ｖ Ｒが＼／ｉＨ（リセット入力端子の高レベ
ル判定電圧）より高い電圧になったとき処理回路１１は
リセットされる。第６図の回路において、電源ＯＦＦ時
のコンデンサーＣａの電位が零であるので、電源ＯＮに
なるとツェナーダイオードＺＤａを通してコンデンサー
Ｃａに負の電荷が蓄積され、＼７Ｒ＜＼ｌｉＬになると
リセットが解除される。ツェナーダイオードＺＤａは定
電圧特性かあり、＼７ｒ・ｅｓｅＬとＺＤａの電圧を加
えたものが一＼７Ｐに等しくなるので、＼’ ｒｅｓｅ
ｔの電位を（）と−＼ＩＰの間に設定する。
端子電圧＼７Ｒが電源投入後にＶ ｉ Ｉ−（’）セッ
ト入力端子の低レベル判定電圧）より低い電圧（＼１ｒ
ｅｓｅｔを含む）になったとき、処理回路１１は動作し
、電源０ＦＦ（ＰＯＷＥＲＯＦＦ時）後ニリセット入力
端子電圧Ｖ Ｒが＼／ｉＨ（リセット入力端子の高レベ
ル判定電圧）より高い電圧になったとき処理回路１１は
リセットされる。第６図の回路において、電源ＯＦＦ時
のコンデンサーＣａの電位が零であるので、電源ＯＮに
なるとツェナーダイオードＺＤａを通してコンデンサー
Ｃａに負の電荷が蓄積され、＼７Ｒ＜＼ｌｉＬになると
リセットが解除される。ツェナーダイオードＺＤａは定
電圧特性かあり、＼７ｒ・ｅｓｅＬとＺＤａの電圧を加
えたものが一＼７Ｐに等しくなるので、＼’ ｒｅｓｅ
ｔの電位を（）と−＼ＩＰの間に設定する。
結局、電源Ｑ Ｎ後しばらくの間（〜Ｉ Ｒ＝ （ｌが
らＶ ｉ Ｌになるまでの間）リセット信号を発生する
役割を持つ。
らＶ ｉ Ｌになるまでの間）リセット信号を発生する
役割を持つ。
このため、電源投入後においては処理回路１１が暴走等
の状態になった場合でも、それを検知上処理回路１１を
リセットするという動作は含まれていなかった。
の状態になった場合でも、それを検知上処理回路１１を
リセットするという動作は含まれていなかった。
〈 目 的 〉
本発明の目的は、上述の技術的課題を解決し、制御装置
の暴走状態を常に検知し、その検知時に制御装置に含ま
れる処理回路を強制的にリセットさせ、暴走の危険を防
止する制御システム暴走防止回路の提供にある。
の暴走状態を常に検知し、その検知時に制御装置に含ま
れる処理回路を強制的にリセットさせ、暴走の危険を防
止する制御システム暴走防止回路の提供にある。
〈実施例〉
以下、本発明の実施例を第１〜５図に基いて説明すると
、制御システム暴走防止回路は、電子レンジ等の電子機
器を制御するための処理回路１１を含むマイクロコンピ
ュータ製制御装置において、該制御装置または処理回路
１１には、正常時に連続する矩形波等のパルス信号を出
力する機能と、＝３− リセット信号の入力時には前記処理回路１１を強制的に
リセットする機能とが有せしめられ、本回路１５には、
前記パルス信号を倍電圧整流する整流回路Ｆが設けられ
、該整流回路Ｆからの動作信号により動作状態となりか
つそれ以外では非動作状態となるスイッチング素子であ
るトランジスタＴｒｉか設けられ、該トランジスタＴｒ
ｌの動作状態でリセツ１解除信号が制御装置に入力され
、前記トランジスタＴｒｉの非動作状態で前記リセット
信号が制御装置に入力されるよう構成され、制御装置（
または処理回路１１）が正規のプログラム外のルートを
暴走したとぎに強制的に処理回路１１をリセットするよ
うにされでいる。
、制御システム暴走防止回路は、電子レンジ等の電子機
器を制御するための処理回路１１を含むマイクロコンピ
ュータ製制御装置において、該制御装置または処理回路
１１には、正常時に連続する矩形波等のパルス信号を出
力する機能と、＝３− リセット信号の入力時には前記処理回路１１を強制的に
リセットする機能とが有せしめられ、本回路１５には、
前記パルス信号を倍電圧整流する整流回路Ｆが設けられ
、該整流回路Ｆからの動作信号により動作状態となりか
つそれ以外では非動作状態となるスイッチング素子であ
るトランジスタＴｒｉか設けられ、該トランジスタＴｒ
ｌの動作状態でリセツ１解除信号が制御装置に入力され
、前記トランジスタＴｒｉの非動作状態で前記リセット
信号が制御装置に入力されるよう構成され、制御装置（
または処理回路１１）が正規のプログラム外のルートを
暴走したとぎに強制的に処理回路１１をリセットするよ
うにされでいる。
なお、図中ｒ、） １ 、 Ｄ ２は整流用ダイオード
、Ｃ１は交流用カップリングコンデンサー、Ｃ２は平滑
用コンデンサーであり、これらにより前記倍電圧整流回
路Ｆが形成され、トランジスタＴｒ１のベース電流が得
られる。ＺＤｉはツェナーダイオードであり、そのツェ
ナー電圧ＶＺＤＩだけＶｒｅｓｅｔ電圧を−＼ｌＤＤよ
りＯボルト側に保つ。Ｒ４−４＝ は電源ＯＦＦの時にコンデンサーＣ３の電荷を放電させ
るだめの抵抗である。またリセット入力端子に接続され
たリセット回路は、マイクロコンピュータなどで実現さ
れる処理回路１１をリセットさせる回路である。そして
処理回路１１は加熱エネルギー発生手段１２、キー入力
回路１３及び表示回路１４に接続されている。
、Ｃ１は交流用カップリングコンデンサー、Ｃ２は平滑
用コンデンサーであり、これらにより前記倍電圧整流回
路Ｆが形成され、トランジスタＴｒ１のベース電流が得
られる。ＺＤｉはツェナーダイオードであり、そのツェ
ナー電圧ＶＺＤＩだけＶｒｅｓｅｔ電圧を−＼ｌＤＤよ
りＯボルト側に保つ。Ｒ４−４＝ は電源ＯＦＦの時にコンデンサーＣ３の電荷を放電させ
るだめの抵抗である。またリセット入力端子に接続され
たリセット回路は、マイクロコンピュータなどで実現さ
れる処理回路１１をリセットさせる回路である。そして
処理回路１１は加熱エネルギー発生手段１２、キー入力
回路１３及び表示回路１４に接続されている。
すなわち、本発明では処理回路１１が８３図に示すパル
ス信号を常時出力し、出力のある限りトランジスタＴｒ
ｉをＯＮさせ、リセット端子にＶＤＤ−Ｖｃｅｓ（Ｔｒ
ｌ）の低電圧を入力させることができる。このためパル
ス信号が出力されている時はシステムは動作（ＲＵＮ）
状態となる。
ス信号を常時出力し、出力のある限りトランジスタＴｒ
ｉをＯＮさせ、リセット端子にＶＤＤ−Ｖｃｅｓ（Ｔｒ
ｌ）の低電圧を入力させることができる。このためパル
ス信号が出力されている時はシステムは動作（ＲＵＮ）
状態となる。
したかつて、第２図に示す様に処理回路１１のリセット
入力端子電圧ＶＲが電源投入後にＶ ｉ Ｌ （’）セ
ット入力端子の低レベル判定電圧）より低い電圧（Ｖｒ
ｅｓｅｔを含む）になったとき、処理回路１１は動作し
、暴走時後または電源０ＦＦ（ＰＯＷＥＲＯＦＦ時）後
にリセット入力端子電圧Ｖ ＲがＶｉＨ（リセット入力
端子の高レベル判定電圧）より高い電圧になったとき処
理回路１１はリセットされる。
入力端子電圧ＶＲが電源投入後にＶ ｉ Ｌ （’）セ
ット入力端子の低レベル判定電圧）より低い電圧（Ｖｒ
ｅｓｅｔを含む）になったとき、処理回路１１は動作し
、暴走時後または電源０ＦＦ（ＰＯＷＥＲＯＦＦ時）後
にリセット入力端子電圧Ｖ ＲがＶｉＨ（リセット入力
端子の高レベル判定電圧）より高い電圧になったとき処
理回路１１はリセットされる。
次に動作を説明すると、第５図の如く、電子レンツの使
用者がキー入力回路１３の各キーを操作すると、その入
力は表示回路１４に表示される。
用者がキー入力回路１３の各キーを操作すると、その入
力は表示回路１４に表示される。
これと同時にキー操作に対応して予め記憶されている調
理プログラムか処理回路１１により実施されるので加熱
エネルギー発生手段（マグネトロン）２かＯＮｔ、同時
に処理回路１１よりパルス信号が出力される。この様に
処理回路１１からのパルス信号出力か第３図の様に正常
な場合は、本回路１５のＡ、Ｂ、Ｃ，Ｄ点の各電圧波形
は、第４図（Ａ）〜（１））と変化し、トランジスタＴ
ｒｉはＯＮｔ、ツェナーダイオードＺｌ）１を通して一
定電圧信号がリセット回路に入力され処理回路１１は動
作する。これに対しパルス信号出力に異常が生じた場合
は、例えば第３図の波形が＼７ＤＤ一定の低レベル状態
、或いはＧ Ｎ Ｄ一定の高レベル状態が持続するとい
う状態が生しると、これは、電解コンデンサーＣ１で遮
断され電流がストップし、第４図（Ａ）〜（Ｄ）に示す
電圧が発生しなくなり、トランジスタＴｒｉはＯＦＦと
なり、そのため、ツェナーダイオードＺＤ１か動作せず
、その結果、処理回路１１のリセット入力はＧＮＤ（高
レベル）となる。この状態を示したものが第２図である
。
理プログラムか処理回路１１により実施されるので加熱
エネルギー発生手段（マグネトロン）２かＯＮｔ、同時
に処理回路１１よりパルス信号が出力される。この様に
処理回路１１からのパルス信号出力か第３図の様に正常
な場合は、本回路１５のＡ、Ｂ、Ｃ，Ｄ点の各電圧波形
は、第４図（Ａ）〜（１））と変化し、トランジスタＴ
ｒｉはＯＮｔ、ツェナーダイオードＺｌ）１を通して一
定電圧信号がリセット回路に入力され処理回路１１は動
作する。これに対しパルス信号出力に異常が生じた場合
は、例えば第３図の波形が＼７ＤＤ一定の低レベル状態
、或いはＧ Ｎ Ｄ一定の高レベル状態が持続するとい
う状態が生しると、これは、電解コンデンサーＣ１で遮
断され電流がストップし、第４図（Ａ）〜（Ｄ）に示す
電圧が発生しなくなり、トランジスタＴｒｉはＯＦＦと
なり、そのため、ツェナーダイオードＺＤ１か動作せず
、その結果、処理回路１１のリセット入力はＧＮＤ（高
レベル）となる。この状態を示したものが第２図である
。
以」−の様にして、マイクロコンピュータの処理回路１
１に異常が発生すると、本回路１５によって制御装置は
強制的にリセットされ、加熱エネルギー発生手段１２は
ＯＦＦされる。
１に異常が発生すると、本回路１５によって制御装置は
強制的にリセットされ、加熱エネルギー発生手段１２は
ＯＦＦされる。
なお、本発明は、上記実施例に限定されるものではなく
、本発明の範囲内で」二記実施例に多くの修正および変
更を加え得ることは勿論である。
、本発明の範囲内で」二記実施例に多くの修正および変
更を加え得ることは勿論である。
〈効果〉
以−１−の説明から明らかな通り、本発明は、電子
゛機器を制御するための処理回路を含む制御装置におい
て、該制御装置または処理回路には、正常時に連続する
パルス信号を出力する機能と、リセット信号の入力時に
は前記処理回路を強制的にリセットする機能とが有せし
められ、本回路に−は、前記パルス信号を整流する整流
回路か設けられ、該整流回路からの動作信号により動作
状態となりかつそれ以外では非動作状態となるスイッチ
ング素子か設けられ、該スイッチング素子の動作状態で
リセット解除信号が制御装置に入力されまた前記スイッ
チング素子の非動作状態で前記リセット信号が制御装置
に人力されるよう構成されたことを特徴とする制御シス
テム暴走防止回路に関するものである。
゛機器を制御するための処理回路を含む制御装置におい
て、該制御装置または処理回路には、正常時に連続する
パルス信号を出力する機能と、リセット信号の入力時に
は前記処理回路を強制的にリセットする機能とが有せし
められ、本回路に−は、前記パルス信号を整流する整流
回路か設けられ、該整流回路からの動作信号により動作
状態となりかつそれ以外では非動作状態となるスイッチ
ング素子か設けられ、該スイッチング素子の動作状態で
リセット解除信号が制御装置に入力されまた前記スイッ
チング素子の非動作状態で前記リセット信号が制御装置
に人力されるよう構成されたことを特徴とする制御シス
テム暴走防止回路に関するものである。
したかつて、本発明によると、パルス信号、整流回路お
よびスイッチング素子等の働きにより制御装置の暴走状
態を常に検知し、その検知時に制御装置に含まれる処理
回路を強制的にリセットさせ、暴走の危険を防止できる
優れた効果がある。
よびスイッチング素子等の働きにより制御装置の暴走状
態を常に検知し、その検知時に制御装置に含まれる処理
回路を強制的にリセットさせ、暴走の危険を防止できる
優れた効果がある。
第１図は本発明制御システム暴走防１に回路の実施例を
具えた電子レンツ制御装置の電子回路図、第２図は同し
く処理回路の暴走時リセットタイミングを示す線図、第
３図は同じくパルス信号の電圧波形図、第・１図（Ａ）
〜（Ｄ）はそれぞれ第１図のｌ＼〜■）点における電圧
波形図、第５図は同しく制＝８− 御装置のフローチャート、第６図は従来の制御装置の電
子回路図、第７図は同しく処理回路のリセットタイミン
グを示す線図である。 Ｆ：整流回路、］］：処理回路、１２：加熱エネルキー
発生手段、１３：キー入力回路、１４：表示回路、１５
：本回路、Ｃ１，Ｃ２：コンデンサー、Ｄｌ、Ｄ２：整
流用ダイオード、Ｒ１，Ｒ２，Ｒ３゜Ｒ４，Ｒ５：抵抗
、Ｔｒｌ、：）ランジスタ、ＺＤＩ：ツェナーダイオー
ド。
具えた電子レンツ制御装置の電子回路図、第２図は同し
く処理回路の暴走時リセットタイミングを示す線図、第
３図は同じくパルス信号の電圧波形図、第・１図（Ａ）
〜（Ｄ）はそれぞれ第１図のｌ＼〜■）点における電圧
波形図、第５図は同しく制＝８− 御装置のフローチャート、第６図は従来の制御装置の電
子回路図、第７図は同しく処理回路のリセットタイミン
グを示す線図である。 Ｆ：整流回路、］］：処理回路、１２：加熱エネルキー
発生手段、１３：キー入力回路、１４：表示回路、１５
：本回路、Ｃ１，Ｃ２：コンデンサー、Ｄｌ、Ｄ２：整
流用ダイオード、Ｒ１，Ｒ２，Ｒ３゜Ｒ４，Ｒ５：抵抗
、Ｔｒｌ、：）ランジスタ、ＺＤＩ：ツェナーダイオー
ド。
Claims (1)
- 電子機器を制御するための処理回路を含む制御装置にお
いて、該制御装置または処理回路には、正常時に連続す
るパルス信号を出力する機能と、リセット信号の入力時
には前記処理回路を強制的にリセットする機能とが有せ
しめられ、本回路には、前記パルス信号を整流する整流
回路が設けられ、該整流回路からの動作信号により動作
状態となりかつそれ以外では非動作状態となるスイッチ
ング素子が設けられ、該スイッチング素子の動作状態で
リセット解除信号が制御装置に入力されまた前記スイッ
チング素子の非動作状態で前記リセット信号が制御装置
に入力されるよう構成されたことを特徴とする制御シス
テム暴走防止回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP729285A JPS61165101A (ja) | 1985-01-17 | 1985-01-17 | 制御システム暴走防止回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP729285A JPS61165101A (ja) | 1985-01-17 | 1985-01-17 | 制御システム暴走防止回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS61165101A true JPS61165101A (ja) | 1986-07-25 |
Family
ID=11661956
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP729285A Pending JPS61165101A (ja) | 1985-01-17 | 1985-01-17 | 制御システム暴走防止回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS61165101A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS63184629A (ja) * | 1987-01-28 | 1988-07-30 | 松下電器産業株式会社 | 衛生洗浄装置 |
-
1985
- 1985-01-17 JP JP729285A patent/JPS61165101A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS63184629A (ja) * | 1987-01-28 | 1988-07-30 | 松下電器産業株式会社 | 衛生洗浄装置 |
| JPH0754008B2 (ja) * | 1987-01-28 | 1995-06-07 | 松下電器産業株式会社 | 衛生洗浄装置 |
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