JPS61153104U - - Google Patents

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JPS61153104U
JPS61153104U JP3587785U JP3587785U JPS61153104U JP S61153104 U JPS61153104 U JP S61153104U JP 3587785 U JP3587785 U JP 3587785U JP 3587785 U JP3587785 U JP 3587785U JP S61153104 U JPS61153104 U JP S61153104U
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JP
Japan
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bias
switches
turned
oscillation circuit
switch
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JP3587785U
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Description

【図面の簡単な説明】
第1図は本考案の一実施例を示す回路図、第2
図は従来の回路図である。 R,R,R……抵抗、QA,QB……ト
ランジスタ、S,S……スイツチ、INV
,INV……インバータ、OSC……バイアス
発振回路。

Claims (1)

    【実用新案登録請求の範囲】
  1. 発振バイアス電圧の異なる第1、第2、第3の
    カセツトテープに対応して、録再時のバイアス発
    振回路のバイアス電圧を設定するため並列接続さ
    れた第1、第2、第3のバイアス回路それに前記
    第1、第2、第3のカセツトテープの装着時にこ
    れらのカセツトテープに対応してオン・オフする
    第1および第2のスイツチを備え、前記第1のカ
    セツトテープを装着したときには前記第1および
    第2のスイツチがオンして前記第1のバイアス回
    路のバイアス電圧で前記バイアス発振回路を駆動
    し、前記第2のカセツトテープを装着したときは
    前記第1のスイツチをオフ、第2のスイツチをオ
    ンして前記第1および第2のバイアス回路の並列
    のバイアス電圧で前記バイアス発振回路を駆動し
    、前記第3のカセツトテープを装着したときには
    前記第1および第2のスイツチをオフし、前記第
    1、第2それに第3のバイアス回路との並列のバ
    イアス電圧で前記バイアス発振回路を駆動したこ
    とを特徴とするオートテープセレクタ回路。
JP3587785U 1985-03-13 1985-03-13 Pending JPS61153104U (ja)

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JP3587785U JPS61153104U (ja) 1985-03-13 1985-03-13

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JPS61153104U true JPS61153104U (ja) 1986-09-22

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ID=30540556

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JP3587785U Pending JPS61153104U (ja) 1985-03-13 1985-03-13

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