JPS6093967U - 表示回路 - Google Patents

表示回路

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JPS6093967U
JPS6093967U JP18455883U JP18455883U JPS6093967U JP S6093967 U JPS6093967 U JP S6093967U JP 18455883 U JP18455883 U JP 18455883U JP 18455883 U JP18455883 U JP 18455883U JP S6093967 U JPS6093967 U JP S6093967U
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JP
Japan
Prior art keywords
display circuit
clock signal
frequency
counter
divides
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP18455883U
Other languages
English (en)
Inventor
一博 林
Original Assignee
パイオニア株式会社
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Publication date
Application filed by パイオニア株式会社 filed Critical パイオニア株式会社
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Pending legal-status Critical Current

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  • Measuring Frequencies, Analyzing Spectra (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図ａ、ｂは従来のピッチ表示回路の説明に供するブ
ロック図、第２図は本考案の一実施例の構成を示すブロ
ック図、第３図ａｘｄは本考案の一実施例の作用の説明
に供するタイミング図である。 １１〜１４・・・・・・ＢＣＤカウンタ、１５〜１８・
・・・・・ラッチ回路、１９・・・・・・分周器、２０
・・・・・・パルス発生回路、２１・・・・・・遅延回
路、２２〜２５・・・・・・数字表示素子。

Claims (1)

    【実用新案登録請求の範囲】
  1. 第１および第２のクロック信号の周波数比を表示する表
    示回路であって、第１のクロック信号の周波数を分周す
    る分周器と、分周器の出力パルスの１周期間における第
    ２のクロック信号のパルス数を計数するカウンタと、カ
    ウンタの出力を表示する表示手段とを備えてなることを
    特徴とする表示回路。
JP18455883U 1983-12-01 1983-12-01 表示回路 Pending JPS6093967U (ja)

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JP18455883U JPS6093967U (ja) 1983-12-01 1983-12-01 表示回路

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JP18455883U JPS6093967U (ja) 1983-12-01 1983-12-01 表示回路

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JPS6093967U true JPS6093967U (ja) 1985-06-26

Family

ID=30399138

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JP18455883U Pending JPS6093967U (ja) 1983-12-01 1983-12-01 表示回路

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