JPS6084038A - 符号誤り制御方式 - Google Patents
符号誤り制御方式Info
- Publication number
- JPS6084038A JPS6084038A JP9657483A JP9657483A JPS6084038A JP S6084038 A JPS6084038 A JP S6084038A JP 9657483 A JP9657483 A JP 9657483A JP 9657483 A JP9657483 A JP 9657483A JP S6084038 A JPS6084038 A JP S6084038A
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- Facsimile Image Signal Circuits (AREA)
- Detection And Prevention Of Errors In Transmission (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
Ｔａ） 発明の技術分野
本発明は符号誤り制御方式、特にファクシミリ画信号を
構成するライン毎の入力ライン情報を第１および第２の
ラインメモリに交互に蓄積した後、定められた順序に従
って読出し、出力ライン情報を生成して送出する符号誤
り制御方式に関す。
構成するライン毎の入力ライン情報を第１および第２の
ラインメモリに交互に蓄積した後、定められた順序に従
って読出し、出力ライン情報を生成して送出する符号誤
り制御方式に関す。
（ｂｌ 技術の背景
互いに紙型の異なるファクシミリ端末相互間にファクシ
ミリ通信を行はせるファクシミリ通信システムにおいて
は、発信ファクシミリ端末から伝達されるファクシミリ
画信号を構成するライン毎の情報（以後ライン情報と称
す）を一旦Ｍ積し、定められた順序で読出し、出力ライ
ン情報を生成して着信ファクシミリ端末に送出する画面
変換装置を具備することが公知である。
ミリ通信を行はせるファクシミリ通信システムにおいて
は、発信ファクシミリ端末から伝達されるファクシミリ
画信号を構成するライン毎の情報（以後ライン情報と称
す）を一旦Ｍ積し、定められた順序で読出し、出力ライ
ン情報を生成して着信ファクシミリ端末に送出する画面
変換装置を具備することが公知である。
（Ｃ） 従来技術と問題点
第１図はこの種画面変換装置における従来ある符号誤り
制御方式の一例を示す図で“あり、第２図は第１図にお
けるライン情報の変換形式の一例を示す図である。なお
第２図は、Ａ４版画面から８５版画面へ変換する場合の
変換形式を示す。第１図および第２図において、ゲート
２は入力端子１から伝達される人力ライン情報Ｌ１乃至
Ｌ６を、第１のラインメモリ３および第２のラインメモ
リ４に交互に蓄積する。その結果ラインメモリ３には入
力ライン情報Ｌ１、Ｂ３およびＢ５がＭ積され、またラ
インメモリ４には入力ライン情報Ｌ２、Ｂ４およびＢ６
が蓄積された状態となる。かがる状態において、ゲート
６はラインメモリ３に最初に蓄積された人力ライン情報
Ｌ１を読出し、出力端子７から出力ライン情報Ｌｌとし
て送出する。
制御方式の一例を示す図で“あり、第２図は第１図にお
けるライン情報の変換形式の一例を示す図である。なお
第２図は、Ａ４版画面から８５版画面へ変換する場合の
変換形式を示す。第１図および第２図において、ゲート
２は入力端子１から伝達される人力ライン情報Ｌ１乃至
Ｌ６を、第１のラインメモリ３および第２のラインメモ
リ４に交互に蓄積する。その結果ラインメモリ３には入
力ライン情報Ｌ１、Ｂ３およびＢ５がＭ積され、またラ
インメモリ４には入力ライン情報Ｌ２、Ｂ４およびＢ６
が蓄積された状態となる。かがる状態において、ゲート
６はラインメモリ３に最初に蓄積された人力ライン情報
Ｌ１を読出し、出力端子７から出力ライン情報Ｌｌとし
て送出する。
次にゲート６は、ラインメモリ３がら入力ライン情報Ｌ
３を、ラインメモリ４がら入力ライン情報Ｌ２をそれぞ
れ読出し、対応する画素の論理和を行うことにより出力
ライン情報Ｌ２＋Ｌ３を生成し、出力端子７から送出す
る。次にゲート６は、ラインメモリ４から入力ライン情
報Ｌ４を続出し、出力端子７から出力ライン情報Ｌ４と
して出力する。次にゲー１−６は、ラインメモリ３がら
入力ライン情報Ｌ５を、ラインメモリ４がら入力ライン
情報Ｌ６をそれぞれ読出し、対応する画素の論理和を行
うことにより出カライン情１１３ Ｌ ５ ＋ Ｌ ６
を生成し、出力端子７から送出する。−力検出器５は、
入力端手工から伝達される各人カライン情報Ｌｌ乃至Ｌ
６を構成する画素数を計数し、所定値と比較して誤りの
有無を検査する。例えば入力ライン情報Ｌ４に誤りが検
出された場合には、検出器５ばラインメモリ４に蓄積さ
れた入力ライン情報Ｌ４に読出し禁止を示す符号を付加
する。かがる状態においては、ゲート６ば出力ライン情
報Ｌ２＋Ｌ３を出力した後に、ラインメモリ４がら入ｉ
Ｊライ：／１ｒｔｆＨＬ ４を読出す代りにラインメモ
リ３から入力ライン情報Ｌ３を読出し、出力ライン情報
として出力する。
３を、ラインメモリ４がら入力ライン情報Ｌ２をそれぞ
れ読出し、対応する画素の論理和を行うことにより出力
ライン情報Ｌ２＋Ｌ３を生成し、出力端子７から送出す
る。次にゲート６は、ラインメモリ４から入力ライン情
報Ｌ４を続出し、出力端子７から出力ライン情報Ｌ４と
して出力する。次にゲー１−６は、ラインメモリ３がら
入力ライン情報Ｌ５を、ラインメモリ４がら入力ライン
情報Ｌ６をそれぞれ読出し、対応する画素の論理和を行
うことにより出カライン情１１３ Ｌ ５ ＋ Ｌ ６
を生成し、出力端子７から送出する。−力検出器５は、
入力端手工から伝達される各人カライン情報Ｌｌ乃至Ｌ
６を構成する画素数を計数し、所定値と比較して誤りの
有無を検査する。例えば入力ライン情報Ｌ４に誤りが検
出された場合には、検出器５ばラインメモリ４に蓄積さ
れた入力ライン情報Ｌ４に読出し禁止を示す符号を付加
する。かがる状態においては、ゲート６ば出力ライン情
報Ｌ２＋Ｌ３を出力した後に、ラインメモリ４がら入ｉ
Ｊライ：／１ｒｔｆＨＬ ４を読出す代りにラインメモ
リ３から入力ライン情報Ｌ３を読出し、出力ライン情報
として出力する。
以上の説明から明らかな如く、従来ある画面変換装置に
おける符号誤り制御方式においては、入力ライン情報Ｌ
４に誤りが検出された時には、前回入力された入力ラ
イン情報Ｌ３が代りに出力ライン情報として送出される
ことと成り、高品質の画面を実現する出力ライン情報が
得られぬ欠点が有る。
おける符号誤り制御方式においては、入力ライン情報Ｌ
４に誤りが検出された時には、前回入力された入力ラ
イン情報Ｌ３が代りに出力ライン情報として送出される
ことと成り、高品質の画面を実現する出力ライン情報が
得られぬ欠点が有る。
（ｄｌ 発明の目的
本発明の目的は、前述の如き従来ある画面変換装置にお
りる符号誤り制御力式の欠点を除去し、入力ライン情報
に誤りが検出された場合にも、高品質の画面を実現する
出力ライン情報を送出し得る手段の実現に在る。
りる符号誤り制御力式の欠点を除去し、入力ライン情報
に誤りが検出された場合にも、高品質の画面を実現する
出力ライン情報を送出し得る手段の実現に在る。
＋１１１ 発明の構成
この目的は、ファクシミリ画信号を構成するライン毎の
入力ライン情報を第１および第２のラインメモリに交互
に蓄積した後、定められた順序に従って読出し、出力ラ
イン情報を生成して送出する画面変換装置において、第
３のラインメモリを設り、前記入力ライン情報に誤りが
検出されぬ場合は該入力ライン情報により生成された前
記出力ライン情報を送出すると同時に前記第３のライン
メモリにＮ積し、前記入力ライン情報に誤りが検出され
た場合は該入力ライン情報による前記出力ライン情報の
生成を中止し、前回送出した出力ライン情報をＭｉＪ記
第３のラインメモリから読出し送出することにより、誤
りラインを補正することにより達成される。
入力ライン情報を第１および第２のラインメモリに交互
に蓄積した後、定められた順序に従って読出し、出力ラ
イン情報を生成して送出する画面変換装置において、第
３のラインメモリを設り、前記入力ライン情報に誤りが
検出されぬ場合は該入力ライン情報により生成された前
記出力ライン情報を送出すると同時に前記第３のライン
メモリにＮ積し、前記入力ライン情報に誤りが検出され
た場合は該入力ライン情報による前記出力ライン情報の
生成を中止し、前回送出した出力ライン情報をＭｉＪ記
第３のラインメモリから読出し送出することにより、誤
りラインを補正することにより達成される。
（ｆｌ 発明の実施例
以下、本発明の一実施例を図面により説明する。
第３図は、本発明の一実施例による符号誤り制御方式を
示す図であり、第４図は第３図にお＆、Ｊるライン情報
の変換形式の一例を示す図である。なお、企図を通じて
同一符号は同一対象物を示す。また第４図は、第２図に
おけると同様に、Ａ４版画面からＢ５版画面へ変換する
場合の変換形式を示す。
示す図であり、第４図は第３図にお＆、Ｊるライン情報
の変換形式の一例を示す図である。なお、企図を通じて
同一符号は同一対象物を示す。また第４図は、第２図に
おけると同様に、Ａ４版画面からＢ５版画面へ変換する
場合の変換形式を示す。
第３図においては、ゲート６と出力端子７との間に、第
３のラインメモリ８およびゲート９が設Ｌｄられている
。入力端子ｌから伝達されるライン情報ＬＬ乃至Ｌ６は
、第１図におりると同様にティンメモリ３および４にそ
れぞれＭ積される。また検出器５も第１図同様、人力ラ
イン情報Ｌ１乃至Ｌ６を検査し、誤りを検出した入力ラ
イン情報に読出し禁止を示す符号を付加する。人力ライ
ン情報Ｌ１乃至Ｌ６から何れも誤りが検出されぬ場合に
は、ゲート６は第１図同様、ラインメモリ３および４か
ら所定の順序に従って入力ライン情報１゜１乃至Ｌ６を
順次読出し、出力ライン情報Ｌ１、Ｌ ２ ＋ Ｌ ３
、Ｌ４およびＬ５＋Ｌ６を順次生成し、ラインメモリ８
およびゲート９に伝達する。ゲー１−９はゲート６から
伝達される前記各出力ライン情報Ｌ１．．Ｌ２＋Ｌ３、
Ｌ４およびＬ５＋Ｌ６を出力端子７から送出する。また
ラインメモリ８はゲート６から伝達される前記各出力ラ
イン情報Ｌ１、Ｌ２＋Ｌ３、Ｌ４およびＬ５＋Ｌ６を１
頂次蓄積する。一方、例えば入力ライン情報Ｌ４に誤り
が検出された場合には、ゲート６ば出力ライン情報Ｌ２
＋Ｌ３を生成した後に入力ライン情報Ｌ４を読出さず、
ゲート９にラインメモリ８に蓄積されている前回送出し
た出力ライン情報Ｌ２＋Ｌ３を読゛出させ、出力ライン
情報Ｌ４０代りに送出させる。
３のラインメモリ８およびゲート９が設Ｌｄられている
。入力端子ｌから伝達されるライン情報ＬＬ乃至Ｌ６は
、第１図におりると同様にティンメモリ３および４にそ
れぞれＭ積される。また検出器５も第１図同様、人力ラ
イン情報Ｌ１乃至Ｌ６を検査し、誤りを検出した入力ラ
イン情報に読出し禁止を示す符号を付加する。人力ライ
ン情報Ｌ１乃至Ｌ６から何れも誤りが検出されぬ場合に
は、ゲート６は第１図同様、ラインメモリ３および４か
ら所定の順序に従って入力ライン情報１゜１乃至Ｌ６を
順次読出し、出力ライン情報Ｌ１、Ｌ ２ ＋ Ｌ ３
、Ｌ４およびＬ５＋Ｌ６を順次生成し、ラインメモリ８
およびゲート９に伝達する。ゲー１−９はゲート６から
伝達される前記各出力ライン情報Ｌ１．．Ｌ２＋Ｌ３、
Ｌ４およびＬ５＋Ｌ６を出力端子７から送出する。また
ラインメモリ８はゲート６から伝達される前記各出力ラ
イン情報Ｌ１、Ｌ２＋Ｌ３、Ｌ４およびＬ５＋Ｌ６を１
頂次蓄積する。一方、例えば入力ライン情報Ｌ４に誤り
が検出された場合には、ゲート６ば出力ライン情報Ｌ２
＋Ｌ３を生成した後に入力ライン情報Ｌ４を読出さず、
ゲート９にラインメモリ８に蓄積されている前回送出し
た出力ライン情報Ｌ２＋Ｌ３を読゛出させ、出力ライン
情報Ｌ４０代りに送出させる。
以上の説明から明らかな如く、本実施例によれば、入カ
ライン情＠Ｌ４に誤りが検出された場合、ラインメモリ
８に蓄積されている前回送出した出カライン情＋ｌ！Ｌ
２＋Ｌ３が代りに送出されることと成り、高品質の画面
を実現することが出来る。
ライン情＠Ｌ４に誤りが検出された場合、ラインメモリ
８に蓄積されている前回送出した出カライン情＋ｌ！Ｌ
２＋Ｌ３が代りに送出されることと成り、高品質の画面
を実現することが出来る。
なお、第３図および第４図はあく迄本発明の一実施例に
過ぎず、例えば画面の変換はＡ４版から８５版へ実施す
るものに限定されることは無く、他に幾多の変形が考慮
されるが、何れの場合にも本発明の効果は変らない。
過ぎず、例えば画面の変換はＡ４版から８５版へ実施す
るものに限定されることは無く、他に幾多の変形が考慮
されるが、何れの場合にも本発明の効果は変らない。
１ｇ） 発明の効果
以上、本発明によれば、前記画面変換装置において、入
力ライン情報に誤りが検出された場合に、該入力ライン
情報に基づき生成される出力ライン情報の代りに、席に
前回出力された出力ライン情報が送出されることと成り
、高品質の画面を実現することが出来る。
力ライン情報に誤りが検出された場合に、該入力ライン
情報に基づき生成される出力ライン情報の代りに、席に
前回出力された出力ライン情報が送出されることと成り
、高品質の画面を実現することが出来る。
第１図は画面変換装置にお＆Ｊる従来ある符号誤り制御
方式の一例を示す図、第２図は第１図におけるライン情
報の変換形式の一例を示ず図、第３図は本発明の一実施
例による符号誤り制御方式を示す図、第４図は第３図に
おけるライン情報の変換形式の一例を示ず図である。 図において、■は入力端子、２．６および９はゲー１１
．３．４および８はラインメモリ、５は検出器、Ｌｌ乃
至Ｌ６、Ｌ２＋Ｌ３およびＬ５＋Ｌ６は入力または出力
ライン情報、を示ず。 第 １ 図 第 ２ 図 第 ５１￥１ 入力ライン ’３ Ｌｔ −Ｌｌ− ＡｊＬ２昔ＬヲＬコＩＬ５ ｔＳ ム４ Ｌ２φＬ５− 、Ｊ −１５◆Ｌ＆ −１５す１１− 夢 ４ Ｎ
方式の一例を示す図、第２図は第１図におけるライン情
報の変換形式の一例を示ず図、第３図は本発明の一実施
例による符号誤り制御方式を示す図、第４図は第３図に
おけるライン情報の変換形式の一例を示ず図である。 図において、■は入力端子、２．６および９はゲー１１
．３．４および８はラインメモリ、５は検出器、Ｌｌ乃
至Ｌ６、Ｌ２＋Ｌ３およびＬ５＋Ｌ６は入力または出力
ライン情報、を示ず。 第 １ 図 第 ２ 図 第 ５１￥１ 入力ライン ’３ Ｌｔ −Ｌｌ− ＡｊＬ２昔ＬヲＬコＩＬ５ ｔＳ ム４ Ｌ２φＬ５− 、Ｊ −１５◆Ｌ＆ −１５す１１− 夢 ４ Ｎ
Claims (1)
- ファクシミリ画信号を構成するライン毎の入力ライン情
報を第１および第２のラインメモリに交互に蓄積した後
、定められた順序に従って読出し、出力ライン情報を生
成して送出する画面変換装置において、第３のラインメ
モリを設け、前記入力ライン情報に誤りが検出されぬ場
合は該入力ライン情報により生成された前記出力ライン
情報を送出すると同時に前記第３のラインメモリに蓄積
し、前記入力ライン情報に誤りが検出された場合は該入
力ライン情報による前記出力ライン情報の生成を中止し
、前回送出した出力ライン情報を前記第３のラインメモ
リから読出し送出することにより、誤りラインを補正す
ることを特徴とする符号誤り制御方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9657483A JPS6084038A (ja) | 1983-05-31 | 1983-05-31 | 符号誤り制御方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9657483A JPS6084038A (ja) | 1983-05-31 | 1983-05-31 | 符号誤り制御方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6084038A true JPS6084038A (ja) | 1985-05-13 |
Family
ID=14168755
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP9657483A Pending JPS6084038A (ja) | 1983-05-31 | 1983-05-31 | 符号誤り制御方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6084038A (ja) |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS52149914A (en) * | 1976-06-09 | 1977-12-13 | Toshiba Corp | Facsimile reception |
| JPS5671808A (en) * | 1979-11-16 | 1981-06-15 | Toshiba Corp | Processing system for reproduction signal |
-
1983
- 1983-05-31 JP JP9657483A patent/JPS6084038A/ja active Pending
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS52149914A (en) * | 1976-06-09 | 1977-12-13 | Toshiba Corp | Facsimile reception |
| JPS5671808A (en) * | 1979-11-16 | 1981-06-15 | Toshiba Corp | Processing system for reproduction signal |
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