JPS6082817U - ミユ−テイング回路 - Google Patents

ミユ−テイング回路

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Publication number
JPS6082817U
JPS6082817U JP17361583U JP17361583U JPS6082817U JP S6082817 U JPS6082817 U JP S6082817U JP 17361583 U JP17361583 U JP 17361583U JP 17361583 U JP17361583 U JP 17361583U JP S6082817 U JPS6082817 U JP S6082817U
Authority
JP
Japan
Prior art keywords
transistor
muting circuit
emitter
collector
muting
Prior art date
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Pending
Application number
JP17361583U
Other languages
English (en)
Inventor
潤 小山
Original Assignee
日本電気アイシーマイコンシステム株式会社
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Publication date
Application filed by 日本電気アイシーマイコンシステム株式会社 filed Critical 日本電気アイシーマイコンシステム株式会社
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Publication of JPS6082817U publication Critical patent/JPS6082817U/ja
Pending legal-status Critical Current

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Landscapes

  • Control Of Amplification And Gain Control (AREA)
  • Amplifiers (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は従来の回路を示す回路図、第２図は従来の他の
回路を示す回路図である。第３図は未考案の一実施例に
よる回路図である。 １．６・・・入力端子、２，１０・・・ミューティング
Ｎ流源、３，８．９・・くニーティング・トランジスタ
、４，５・・・差動トランジスタ、７・・・コンデンサ
、１１・・・出力端子、１２．１３・・・抵抗。

Claims (1)

    【実用新案登録請求の範囲】
  1. 差動増幅器の一方の入力端子に第一のトランジスタのコ
    レクタおよび第二のトランジスタのエミッタを接続し、
    前記差動増幅器の他方の入力端子に前記第一のトランジ
    スタのエミッタおよび前記第二のトランジスタのコレク
    タを接続し、前記第一および第二のトランジスタのベー
    スを共通としてミューティング制御端子に接続したこと
    を特徴としたミューティング回路。
JP17361583U 1983-11-09 1983-11-09 ミユ−テイング回路 Pending JPS6082817U (ja)

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JP17361583U JPS6082817U (ja) 1983-11-09 1983-11-09 ミユ−テイング回路

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JPS6082817U true JPS6082817U (ja) 1985-06-08

Family

ID=30378170

Family Applications (1)

Application Number Title Priority Date Filing Date
JP17361583U Pending JPS6082817U (ja) 1983-11-09 1983-11-09 ミユ−テイング回路

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Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS57208716A (en) * 1981-06-19 1982-12-21 Hitachi Ltd Gain controlling circuit

Patent Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS57208716A (en) * 1981-06-19 1982-12-21 Hitachi Ltd Gain controlling circuit

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