JPS5893038U - 遅延回路 - Google Patents
遅延回路Info
- Publication number
- JPS5893038U JPS5893038U JP1981188443U JP18844381U JPS5893038U JP S5893038 U JPS5893038 U JP S5893038U JP 1981188443 U JP1981188443 U JP 1981188443U JP 18844381 U JP18844381 U JP 18844381U JP S5893038 U JPS5893038 U JP S5893038U
- Authority
- JP
- Japan
- Prior art keywords
- amplifier circuit
- differential amplifier
- transistor
- emitter follower
- delay circuit
- Prior art date
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- Pending
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
第１図は本考案による実施例の回路構成を示す図、第２
図は実施例における各部の信号波形を示す図である。 第１図において、Ｔｒ□〜Ｔｒ、はトランジスタ、Ｒ□
〜Ｒ□３は抵抗、Ｃ１と０２はトランジスタのベース−
コレクタ間接合部に形成されるコンデンサであ、−る。
図は実施例における各部の信号波形を示す図である。 第１図において、Ｔｒ□〜Ｔｒ、はトランジスタ、Ｒ□
〜Ｒ□３は抵抗、Ｃ１と０２はトランジスタのベース−
コレクタ間接合部に形成されるコンデンサであ、−る。
Claims (1)
- 一 外部信号入力部を有し、１対のトランジスタから
なる第１の差動増幅回路と、該第１の差動増幅回路の一
方のトランジスタのコレクタに抵抗を通してそのベース
が接続される第１のエミツタフオ゛ ロワ・トランジ
スタと、該第１のエミッタフォロワ・トランジスタのエ
ミッタにその入力部が接続される１対のトランジスタか
らなる第２の差動増幅回路と、該第２ｂ差動増幅回路の
一方のトランジスタのコレクタに抵抗を通してそのベー
スが接続される第２のエミッタフォロワ・トランジスタ
とを有することを特徴とする遅延回路。 ゛
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1981188443U JPS5893038U (ja) | 1981-12-17 | 1981-12-17 | 遅延回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1981188443U JPS5893038U (ja) | 1981-12-17 | 1981-12-17 | 遅延回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS5893038U true JPS5893038U (ja) | 1983-06-23 |
Family
ID=29992018
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1981188443U Pending JPS5893038U (ja) | 1981-12-17 | 1981-12-17 | 遅延回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5893038U (ja) |
-
1981
- 1981-12-17 JP JP1981188443U patent/JPS5893038U/ja active Pending
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