JPS607906B2 - DC-DC converter circuit - Google Patents

DC-DC converter circuit

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JPS607906B2
JPS607906B2 JP9186679A JP9186679A JPS607906B2 JP S607906 B2 JPS607906 B2 JP S607906B2 JP 9186679 A JP9186679 A JP 9186679A JP 9186679 A JP9186679 A JP 9186679A JP S607906 B2 JPS607906 B2 JP S607906B2
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switching
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武克 森本
政和 山本
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Matsushita Electric Industrial Co Ltd
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    • HELECTRICITY
    • H02GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
    • H02MAPPARATUS FOR CONVERSION BETWEEN AC AND AC, BETWEEN AC AND DC, OR BETWEEN DC AND DC, AND FOR USE WITH MAINS OR SIMILAR POWER SUPPLY SYSTEMS; CONVERSION OF DC OR AC INPUT POWER INTO SURGE OUTPUT POWER; CONTROL OR REGULATION THEREOF
    • H02M3/00Conversion of dc power input into dc power output
    • H02M3/02Conversion of dc power input into dc power output without intermediate conversion into ac
    • H02M3/04Conversion of dc power input into dc power output without intermediate conversion into ac by static converters
    • H02M3/10Conversion of dc power input into dc power output without intermediate conversion into ac by static converters using discharge tubes with control electrode or semiconductor devices with control electrode
    • H02M3/145Conversion of dc power input into dc power output without intermediate conversion into ac by static converters using discharge tubes with control electrode or semiconductor devices with control electrode using devices of a triode or transistor type requiring continuous application of a control signal
    • H02M3/155Conversion of dc power input into dc power output without intermediate conversion into ac by static converters using discharge tubes with control electrode or semiconductor devices with control electrode using devices of a triode or transistor type requiring continuous application of a control signal using semiconductor devices only

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  • Engineering & Computer Science (AREA)
  • Power Engineering (AREA)
  • Dc-Dc Converters (AREA)
  • Electronic Switches (AREA)

Description

【発明の詳細な説明】 本発明はDC−DCコンバータ回路に関する。[Detailed description of the invention] The present invention relates to a DC-DC converter circuit.

第1図にトランジス外こよるスイッチングを用いたDC
−DCコンバータによる定電圧回路の従来例を示す。ト
ランジスタQ,.,Q,2はダーリント接続されたスイ
ッチング出力段で、コレクタ接地型に構成され、トラン
ジスタQ,3を介してモノマルチバイブレータ(以下モ
ノマルチと称す)2に接続される。従って出力段のトラ
ンジスタQ,2のスイッチングの導適期間はモノマルチ
2の時定数に対応する。モノマルチ2はアステーフルマ
ルチバイプレータ(以下アステーブルマルチと称す)1
によりトリガーされ、電圧比較器3によりデューテイを
コントロールされる。トランジスタQ,2によりスイッ
チングされた電圧はダイオードD,.、ィンンダクタン
スL,、コンデンサC,.で構成されるフィルタ部5に
より整流され、DC電圧として出力され、フィードバッ
ク用のDCアンプ3を介してモノマルチ2をコントロー
ルすることにより定電圧回路を形成する。第1図に示す
DC−DCコンバータによる定電圧回路の効率について
定性的に説明するために、スイッチングトランジスタQ
,2のデユーテイを50%とし、非安定電圧を12Vで
あると仮定する。
Figure 1 shows a DC using external switching.
- A conventional example of a constant voltage circuit using a DC converter is shown. Transistor Q, . , Q, 2 are Darlint-connected switching output stages, configured to have a common collector, and connected to a mono-multi vibrator (hereinafter referred to as "mono-multi") 2 via transistors Q, 3. Therefore, the switching conduction period of the transistor Q,2 in the output stage corresponds to the time constant of the monomultiplier 2. Mono Multi 2 is Astable Multi Viprator (hereinafter referred to as Astable Multi) 1
The voltage comparator 3 controls the duty. The voltage switched by transistor Q,2 is applied to diodes D, . , inductance L, , capacitor C, . A constant voltage circuit is formed by controlling the monomulti 2 via the DC amplifier 3 for feedback. In order to qualitatively explain the efficiency of the constant voltage circuit using the DC-DC converter shown in FIG.
, 2 is assumed to be 50%, and the unstable voltage is assumed to be 12V.

トランジスタQ8のヱミッタの電圧を第2図に示す。す
なわちトランジスタQ,2がON状態で出力電流が例え
ば30仇hAとする。トランジスタQ,.,Q,2の電
流増幅率を100とすると、スイッチング出力段の制御
電流であるトランジスタQ,2のベース電流「は300
′100≠3hAとなり、従ってトランジスタQ,.の
ベース電流は0.0知れとなる。抵抗r幻をIKQ〜鉱
0に設定すると抵抗ら,による電圧降下はトランジスタ
Q,.,Q,2のベースェミツ夕接合の電圧降下の約0
.7Vに比べて無視できる。従って導適時のトランジス
タQ,2のェミッ夕電位は10.6V‘こなる。またト
ランジスタQ,2が導通から非導通に切り換った瞬間、
ィンダクタンスL,.の電流はその作用により連続性を
保ちつづける方向に動作するので、トランジスタQ.2
が非導通にな‐Jた瞬間からインダクタンスL,.には
ダイオードD,.を介してアースから供給される。従っ
てトランジスタQ,2のカットオフ時はトランジスタQ
,2の電位はアース電位によりダイオードD,.の順方
向電圧降下分約0.8V下る。従ってトランジスタQ,
2が50%のデューテイで、ON,〇FFしたとすると
、トランジスタQ,2の平均電圧は第2図のVaに示す
ように竿主デ多=49Vになる。出力電流を30仇hA
とすると、トランジスタQ,2に流れる電流はデューテ
ィが50%であるため約15伍hAとなる。またトラン
ジスタQ,2のスイッチングを制御する回路1,2,3
の回路電流を1靴Aとする。またィンダクタンスL,.
の抵抗分を0.60と仮定し、スイッチングが過渡現象
がなく完全にON,○FFしたとし、第1図の入出力の
効率を計算する。トランジスタQ,2の平均電圧yaは
第2図に示すように4.9Vであるが「 インンダクタ
ンスL,.の抵抗分0.6Qのために第1図のコンバー
タ回路の出力電圧はVa−06×0.3〒4.7V、従
って出力電力は4.7×0.3=1.41Wとなる。し
かるに入力電力はトランジスタQ,2には12V×0.
3×0.5(デユー7ィ)=1.8Wとなる。また抵抗
r2,を松0とするとトランジスタQ,3を介してトラ
ンジスタQ,2の非導適時にアースされるため抵抗r2
,で12′3×0.5=2hA消費する。従って竃,2
,3の回路電流と合わせて17mA×12V≠0.2W
消費することになる。従って入出力の効率は;畠生;;
o‐7o5となり、約70%という従来のスイッチング
電源の一般的な効率になる。本発明は上記効率をさらに
90%程度に上げ得る回路構成を実現するものであり、
以下その一実施例を図面に基づいて説明する。
The voltage at the emitter of transistor Q8 is shown in FIG. That is, assume that the transistors Q and 2 are in the ON state and the output current is, for example, 30 hA. Transistor Q, . , Q,2, the base current of transistor Q,2, which is the control current of the switching output stage, is 300.
'100≠3hA, so transistors Q, . The base current of is known as 0.0. When the resistor r is set to IKQ~0, the voltage drop due to the resistor is equal to the voltage drop of the transistor Q, . , Q, about 0 of the voltage drop across the base semiconductor junction of 2
.. It can be ignored compared to 7V. Therefore, the emitter potential of transistor Q,2 when conductive is 10.6V'. Also, the moment transistors Q and 2 switch from conducting to non-conducting,
Inductance L,. Because the current of transistor Q. operates in the direction of maintaining continuity due to its action, the current of transistor Q. 2
From the moment -J becomes non-conducting, the inductance L, . are diodes D, . Supplied from ground via. Therefore, when transistor Q,2 is cut off, transistor Q
, 2 is connected to the diode D, . The forward voltage drop is approximately 0.8V. Therefore, the transistor Q,
2 is turned ON and FF with a duty of 50%, the average voltage of the transistor Q and 2 becomes 49V as shown by Va in FIG. Output current: 30hA
Then, the current flowing through the transistors Q and 2 is approximately 15 hA since the duty is 50%. Also, circuits 1, 2, and 3 that control switching of transistors Q and 2
Let the circuit current of 1 shoe be A. Also, the inductance L, .
Assuming that the resistance component is 0.60, and assuming that the switching is completely ON and FF without any transient phenomenon, calculate the input/output efficiency shown in FIG. The average voltage ya of the transistor Q, 2 is 4.9V as shown in Figure 2, but the output voltage of the converter circuit in Figure 1 is Va-06 due to the resistance of the inductance L, 0.6Q. ×0.3〒4.7V, so the output power is 4.7×0.3=1.41W. However, the input power is 12V×0.
3×0.5 (Due7i)=1.8W. Also, if the resistor r2 is set to 0, the resistor r2 is grounded through the transistor Q,3 when the transistor Q,2 is not conductive.
, consumes 12'3 x 0.5 = 2hA. Therefore, the stove, 2
, 17mA x 12V≠0.2W in combination with the circuit current of 3.
It will be consumed. Therefore, the input/output efficiency is; Hatao;;
o-7o5, which is a typical efficiency of conventional switching power supplies of about 70%. The present invention realizes a circuit configuration that can further increase the efficiency to about 90%,
One embodiment will be described below based on the drawings.

第3図はスイッチング出力段をェミッ夕接地型にするこ
とにより導適時のスイッチング素子での電圧降下を低下
できる構成を示す。
FIG. 3 shows a configuration in which the voltage drop across the switching element during conduction can be reduced by making the switching output stage emitter-grounded.

この場合第1図の従来例と全く同一の負荷電流30加A
、デューティ50%、電源電圧12Vとして説明すると
「トランジスタQ,のベース電流として抵抗r,を介し
て18hA程度を流すことにより、トランジスタQ,の
電圧降下は0.2V程度以下に減少できる。この場合第
4図に示すように導適時のトランジスタQ,のコレクタ
電位を11.8Vにできる。OFF時の電位を−Q8V
とすると、平均電位Vaは三主;多85.5Vとなる。
出力電流を30仇hA、ィンダクタンスLの抵抗分を0
.60とすると、出力電圧は5.5−0.6×0.3±
5.3Vとなり、出力電力は5.3×0.3=1.59
Wとなる。i,2,3(第1図と同様)の回路電流を合
わせて18hAとし、トランジスタQ,のベース電流が
デューティ50%のため15′2=7.5mAとすると
、合計15十7.5字23hAとなり、またトランジス
タQ,の入力電流は50%のデューティであるために3
00/2=15mhAとなる。従って入力電力は12×
(150十23>字2.1Wとなり「効率は約76%と
なって従来例の第1図よりは高くできる。第5図は本発
明による構成例を示し「 これにより効率をさらに約9
0%にまで高めることができる。第2図の構成ではスイ
ッチング出力段のベース電流を抵抗て,とトランジスタ
Q2を介して消費していたのを「トランジスタQ,のベ
ース電流を直接アースには流さないで、ダイオードQを
通してッェナーダィオードD2とコンデソサC2に流し
、ここで定電圧に整流して回路1,2よりなる制御回路
の電源として使用することにより回路電流として使用す
ることを特徴としている。第5図の場合、電源電圧を1
2Vとし、トランジスタQ,のベース電流を15hAと
し、ツェナーダィオードD2のッェナー電位を6Vとす
ると、抵抗r3として約4000程度の値を選ぶことに
より設定できる。第6図は本発明を用いた定電圧回路の
具体例を示す。トランジスタQ4,Q5はアステーフル
マルチーを構成し、トランジスタQ4のコレクタ波形を
第7図aに示す。この発振周波数は約30KHZとし、
トランジスタ・のスイッチング周波数を決定する。トラ
ンジスタQ5のコレクタよりコンデンサC8、抵抗r,
7の微分回路を介して第7図aに示す後縁で発生する負
のパルスによりトランジスタQ,Q7で構成するモノマ
ルチ2をトリガーする。トランジスタQ?の出力波形を
第7図bに示す。抵抗r2,r4を介して第7図のa,
bの波形がトランジスタQ2のベースに印加され、トラ
ンジスタQ2は第7図cに示すto期間導適する。従っ
てし期間にトランジスタQ3のベース電流が抵打ロ.と
トランジスタQ2を介して流れることにより、トランジ
スタQ,のベース電流がトランジスタQ3のェミツター
コレクタ間および抵#ロ3を通してッェナーダイオード
D2、コンデンサC2に印力0され、整流される。トラ
ンジスタQ,のコレクタ電位は第7図dに示すようにc
に対応したスイッチング電圧となり、ダイオードD,、
ィンダクタンスL、コンデンサC,のフィルタ部で平均
化され、さらにインダクタンスL2、コンデンサC6で
リツプル分を減少され、出力電圧Voutを得る。出力
電圧は電圧調整ボリュームVR,を介して電圧比較トラ
ンジスタ偽のベースに印加され、トランジスタQ9のェ
ミッタに接続されたッェナーダィオードD2のッェナー
電位と比較される。出力電圧Vonが設定値より高くな
ればトランジスタQのベース電流がより多く流れること
によりトランジスタQ9のコレクタ電位が下り、トラン
ジスタQ8のベース電流が多く流れ、つれてトランジス
タQのコレクタ電流が多く流れることにより、第7図b
に示すモノマルチ2の時定数bmが小さくなる。従って
トランジスタQ2の導適期間(ta+血)が少なくなり
、つれてトランジスタQ,の導適期間が少なくなり、ト
ランジスタQ,のデュ−ティが小さくなって平均電圧が
下る方向にコントロールされる。出力電圧Voutが設
定値より下ると、上記説明とは逆方向に補正される。な
お抵抗rは初期発振用であり、いま該抵抗rがなければ
、入力電圧Vinを印加した瞬間はコンデンサC2の電
位が零のため、トランジスタQ4,Q7のコレクタ電位
は零電位であり、トランジスタQ2がカットオフであり
、トランジスタQ3のベース電流が流れ、トランジスタ
Q,は導通しない。従ってコンデンサC2には充電され
ず、トランジスタQ,法は発振しない。抵抗rを入れる
ことによりコンデソサC2を充電し、トランジスタQ4
,Q5のアステーフルマルチ1を発振させることにより
トランジスタQ.を導通させ、かつベース電流により抵
抗r3を介してコンデンサC2をッェナーダイオードD
2のッェナ−電位まで充電させることができる。従って
抵抗rは抵抗r3より充分大きな値でよく、抵抗rによ
る消費電力は充分少なくできる。また第6図の説明から
明らかなように、ッヱナーダイオードD2によりトラン
ジスタQ,のベース電流を定電圧に整流し、1,2の回
路電源として使用すると同時に、電圧比較器の基準電圧
としても利用している。
In this case, the load current is 30 A, which is exactly the same as the conventional example shown in Figure 1.
, assuming a duty of 50% and a power supply voltage of 12V, ``By flowing about 18 hA as the base current of transistor Q through resistor r, the voltage drop of transistor Q can be reduced to about 0.2V or less.In this case. As shown in Fig. 4, the collector potential of the transistor Q can be set to 11.8V when it is turned on.The potential when it is OFF can be set to -Q8V.
Then, the average potential Va is 85.5V.
The output current is 30 hA, and the resistance of inductance L is 0.
.. 60, the output voltage is 5.5-0.6×0.3±
It becomes 5.3V, and the output power is 5.3 x 0.3 = 1.59
It becomes W. If the circuit currents of i, 2, and 3 (same as in Figure 1) are 18 hA in total, and the base current of transistor Q is 15'2 = 7.5 mA since the duty is 50%, the total is 15 + 7.5 characters. 23 hA, and since the input current of transistor Q is 50% duty, it is 3 hA.
00/2=15 mhA. Therefore, the input power is 12×
(The efficiency is approximately 76%, which is higher than the conventional example shown in Figure 1.) Figure 5 shows an example of the configuration according to the present invention.
It can be increased to 0%. In the configuration shown in Figure 2, the base current of the switching output stage was consumed through the resistor and transistor Q2. It is characterized in that it is used as a circuit current by flowing it through the diode D2 and the capacitor C2, rectifying it to a constant voltage there, and using it as a power source for the control circuit consisting of circuits 1 and 2. In the case of FIG. voltage 1
If the voltage is 2V, the base current of the transistor Q is 15hA, and the Zener potential of the Zener diode D2 is 6V, the resistance r3 can be set by selecting a value of about 4000. FIG. 6 shows a specific example of a constant voltage circuit using the present invention. Transistors Q4 and Q5 constitute an asteful multiplier, and the collector waveform of transistor Q4 is shown in FIG. 7a. This oscillation frequency is approximately 30KHz,
Determine the switching frequency of the transistor. From the collector of transistor Q5, capacitor C8, resistor r,
A negative pulse generated at the trailing edge shown in FIG. 7a through a differential circuit of 7 triggers a monomulti 2 consisting of transistors Q and Q7. Transistor Q? The output waveform of is shown in FIG. 7b. a in FIG. 7 through resistors r2 and r4,
The waveform b is applied to the base of transistor Q2, and transistor Q2 conducts during the to period shown in FIG. 7c. Therefore, during this period, the base current of transistor Q3 becomes low. Flows through the transistor Q2, so that the base current of the transistor Q is applied to the Zener diode D2 and the capacitor C2 through the emitter-collector of the transistor Q3 and the resistor 3, and is rectified. The collector potential of transistor Q is c as shown in Figure 7d.
The switching voltage corresponds to the diode D, ,
The output voltage Vout is averaged by a filter section including an inductance L and a capacitor C, and further reduced by an inductance L2 and a capacitor C6 to obtain an output voltage Vout. The output voltage is applied to the base of the voltage comparison transistor false via the voltage adjustment volume VR, and is compared with the Zener potential of the Zener diode D2 connected to the emitter of the transistor Q9. When the output voltage Von becomes higher than the set value, more base current of transistor Q flows, which lowers the collector potential of transistor Q9, more base current flows of transistor Q8, and as a result, more collector current of transistor Q flows. , Figure 7b
The time constant bm of the monomulti 2 shown in FIG. Therefore, the conduction period (ta+blood) of the transistor Q2 becomes shorter, the conduction period of the transistor Q becomes shorter, the duty of the transistor Q becomes smaller, and the average voltage is controlled to decrease. When the output voltage Vout falls below the set value, it is corrected in the opposite direction to that described above. Note that the resistor r is for initial oscillation, and if the resistor r were not present, the potential of the capacitor C2 would be zero at the moment when the input voltage Vin was applied, so the collector potential of the transistors Q4 and Q7 would be zero potential, and the collector potential of the transistor Q2 would be zero. is cutoff, the base current of transistor Q3 flows, and transistor Q is not conductive. Therefore, capacitor C2 is not charged and transistor Q does not oscillate. The capacitor C2 is charged by inserting a resistor r, and the transistor Q4
, Q5's Asteful Multi 1 oscillates. conducts, and the base current connects capacitor C2 to Zener diode D via resistor r3.
It can be charged up to a potential of 2. Therefore, the resistance r may have a sufficiently larger value than the resistance r3, and the power consumption by the resistance r can be sufficiently reduced. Furthermore, as is clear from the explanation of Fig. 6, the base current of the transistor Q is rectified into a constant voltage by the energizing diode D2, and is used as the circuit power supply for circuits 1 and 2, and at the same time as the reference voltage of the voltage comparator. We are using.

さらに本発明ではスイッチング出力部のダイオードD,
にショットキーダィオードを使用することにより定電圧
回路の効率を約92%と非常に高い効率に設計できる。
また当然であるが、出力電流が大きくなった場合は、ト
ランジスタQ,のベース電流を整流した電圧で1,2よ
りなる制御回路の回路電源のみならず、他の回路6(第
5図)への電源として使用できる。またスイッチング素
子はトランジス外こ限られるものではない。以上本発明
によれば、スイッチング出力段をェミツタ接地構成とし
、かつスイッチング出力段のスイッチング素子の制御電
流を整流して該スイッチング出力段の少なくとも制御回
路の回路電源電流としたので、入出力効率を約90%に
まで高めることができるものである。
Furthermore, in the present invention, the diode D of the switching output section,
By using a Schottky diode, the constant voltage circuit can be designed to have a very high efficiency of about 92%.
Naturally, when the output current becomes large, the voltage obtained by rectifying the base current of the transistor Q is used not only to supply the circuit power supply of the control circuit consisting of 1 and 2, but also to the other circuit 6 (Fig. 5). It can be used as a power source. Furthermore, the switching element is not limited to transistors. As described above, according to the present invention, the switching output stage has an emitter-grounded configuration, and the control current of the switching element of the switching output stage is rectified to be used as the circuit power supply current of at least the control circuit of the switching output stage, so that the input/output efficiency can be improved. This can be increased to about 90%.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図は従来例の回路図、第2図はその各部の波形図、
第3図はスイッチング出力段をェミッタ接地型にして導
適時のスイッチング素子での電圧降下の低下を説明する
構成図、第4図はその各部の波形図、第5図は本発明の
一実施例を示す構成図、第6図は具体回路例図、第7図
はその各部の波形図である。 1……アステーブルマルチバイブレータ、2…・・・モ
ノマルチバィブレータ、3・・・・・・電圧比較器、Q
,…・・・スイッチング出力段(ュミッタ接地型)、D
2・…”ツエナーダイオード。 第1図 第2図 第3図 第4図 第5図 第6図 第7図
Figure 1 is a circuit diagram of the conventional example, Figure 2 is a waveform diagram of each part,
Fig. 3 is a configuration diagram illustrating the reduction in voltage drop in the switching element when the switching output stage is emitter-grounded and conductive, Fig. 4 is a waveform diagram of each part, and Fig. 5 is an embodiment of the present invention. FIG. 6 is a diagram showing a specific circuit example, and FIG. 7 is a waveform diagram of each part thereof. 1... Astable multivibrator, 2... Mono multivibrator, 3... Voltage comparator, Q
,...Switching output stage (mitter grounded type), D
2.…” Zener diode. Fig. 1 Fig. 2 Fig. 3 Fig. 4 Fig. 5 Fig. 6 Fig. 7

Claims (1)

【特許請求の範囲】 1 スイツチング出力段をエミツタ接地構成にし、かつ
スイツチング出力段のスイツチング素子の制御電流を整
流して該スイツチング出力段の少なくとも制御回路の回
路電源電流としたことを特徴とするDC−DCコンバー
タ回路。 2 スイツチング素子の制御電流をツエナーダイオード
とコンデンサを用いて一定電圧に整流して回路電源とす
るとともに定電圧制御の基準電圧としたことを特徴とす
る特許請求の範囲第1項記載のDC−DCコンバータ回
路。
[Scope of Claims] 1. A DC device characterized in that the switching output stage has an emitter-grounded configuration, and the control current of the switching element of the switching output stage is rectified to be used as the circuit power supply current of at least the control circuit of the switching output stage. -DC converter circuit. 2. The DC-DC according to claim 1, characterized in that the control current of the switching element is rectified to a constant voltage using a Zener diode and a capacitor to serve as a circuit power supply and as a reference voltage for constant voltage control. converter circuit.
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