JPS6074336U - パルス発生装置 - Google Patents

パルス発生装置

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Publication number
JPS6074336U
JPS6074336U JP16639783U JP16639783U JPS6074336U JP S6074336 U JPS6074336 U JP S6074336U JP 16639783 U JP16639783 U JP 16639783U JP 16639783 U JP16639783 U JP 16639783U JP S6074336 U JPS6074336 U JP S6074336U
Authority
JP
Japan
Prior art keywords
pulse generator
storage section
clock signal
signal
counter circuit
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP16639783U
Other languages
English (en)
Inventor
北村　慎一
Original Assignee
富士通株式会社
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Filing date
Publication date
Application filed by 富士通株式会社 filed Critical 富士通株式会社
Priority to JP16639783U priority Critical patent/JPS6074336U/ja
Publication of JPS6074336U publication Critical patent/JPS6074336U/ja
Pending legal-status Critical Current

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  • Pulse Circuits (AREA)
  • Manipulation Of Pulses (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は従来のパルス発生装置のブロック図、第２図は
従来のパルス発生装置を説明するための波形図、第３図
は本考案のパルス発生装置のブロック図、第４図は本考
案のパルス発生装置を説明するための波形図である。 図において１はクロック信号発生回路、２はカウンタ回
路、３はフリップフロップ回路、３　ａ　ｚ３ｂはＮＡ
ＮＤゲート、４はフリップフロップ回路の入力端子、５
はフリップフロップ回路の他の入力端子、６はカウンタ
回路の出力端子、７はタウンタ回路の制御端子、８は記
憶部、Ｋ１〜Ｋｎは計数部である。

Claims (1)

    【実用新案登録請求の範囲】
  1. 一定周期のクロック信号を発生するクロック信号発生回
    路と、外部よりの起動、停止信号により前記クロック信
    号を計数するカウンタ回路と、所定のパルス信号を記憶
    する記憶部とが設けられ、前記カウンタ回路の計数値を
    前記記憶部のアドレスとして前記記憶部に記憶された所
    定のパルス信号を出力することを特徴とするパルス発生
    装置。
JP16639783U 1983-10-26 1983-10-26 パルス発生装置 Pending JPS6074336U (ja)

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JP16639783U JPS6074336U (ja) 1983-10-26 1983-10-26 パルス発生装置

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JPS6074336U true JPS6074336U (ja) 1985-05-24

Family

ID=30364294

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JP16639783U Pending JPS6074336U (ja) 1983-10-26 1983-10-26 パルス発生装置

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JP (1) JPS6074336U (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2004511053A (ja) * 2000-10-06 2004-04-08 コーニンクレッカ　フィリップス　エレクトロニクス　エヌ　ヴィ アップスケールされたクロックをメモリに供給し並列波を作る集積回路

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2004511053A (ja) * 2000-10-06 2004-04-08 コーニンクレッカ　フィリップス　エレクトロニクス　エヌ　ヴィ アップスケールされたクロックをメモリに供給し並列波を作る集積回路

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