JPS6068386A - Envelope controller - Google Patents

Envelope controller

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JPS6068386A
JPS6068386A JP58159999A JP15999983A JPS6068386A JP S6068386 A JPS6068386 A JP S6068386A JP 58159999 A JP58159999 A JP 58159999A JP 15999983 A JP15999983 A JP 15999983A JP S6068386 A JPS6068386 A JP S6068386A
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JP
Japan
Prior art keywords
envelope
waveform
data
output
latch
Prior art date
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Pending
Application number
JP58159999A
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Japanese (ja)
Inventor
川島 忠
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Casio Computer Co Ltd
Original Assignee
Casio Computer Co Ltd
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Publication date
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  • Electrophonic Musical Instruments (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
(57) [Summary] This bulletin contains application data before electronic filing, so abstract data is not recorded.

Description

【発明の詳細な説明】 〔発明の技術分野〕 本発明はエンベロープ制御装置に関する。[Detailed description of the invention] [Technical field of invention] The present invention relates to an envelope control device.

〔従来技術〕[Prior art]

従来、電子楽器等のエンベループ制御装置としては、カ
ウンタの入力クロックの周波数をエンベループの各状態
ごとに切換えることにより指数関数波形に近似したエン
ベロープ波形を得るものが知られている。
2. Description of the Related Art Conventionally, as an envelope control device for an electronic musical instrument or the like, one is known that obtains an envelope waveform that approximates an exponential function waveform by switching the frequency of an input clock of a counter for each state of the envelope.

〔従来技術の問題点〕[Problems with conventional technology]

しかしながら、上記のものでは楽音波形の山又は谷の部
分でエンベロープデータ値の切換えを行うことが多く、
楽音波形の山又は谷の途中でエンベロープデータ値を切
換えると、波形の振幅が突然変化し波形が歪んで雑音の
発生原因となっていた。
However, in the above methods, the envelope data value is often switched at the peak or valley of the musical sound waveform.
When the envelope data value is changed in the middle of a peak or valley of a musical sound waveform, the amplitude of the waveform suddenly changes, causing distortion of the waveform and causing noise.

〔発明の目的〕[Purpose of the invention]

本発明は、上述した事情を背景としてなされたもので、
その目的はエンベループデータ値の切換えにあたって、
波形が歪まず、雑音の発生の少ないエンベロープ制御装
置を提供することにある。
The present invention was made against the background of the above-mentioned circumstances, and
Its purpose is to switch envelope data values.
An object of the present invention is to provide an envelope control device that does not distort a waveform and generates less noise.

〔発明の要点〕[Key points of the invention]

上記目的を達成するため、本発明は、波形の振幅が零レ
ベルとなる零点においてエンベロープデータ値の切換え
を行うようにして、波形が歪むのを防止したことを要点
とするものである。
In order to achieve the above object, the main point of the present invention is to prevent the waveform from being distorted by switching the envelope data value at the zero point where the amplitude of the waveform becomes zero level.

〔実施例〕〔Example〕

以下本発明の一実施例につき図面を参照して詳述する。 An embodiment of the present invention will be described in detail below with reference to the drawings.

第1図および第2図において、1は音階順に配列された
鍵盤(図示せず)の押鍵が制御部2で検出されて、その
押鍵データが制御部2より与えられる周波数情報発生部
であり、この周波数情報発生部1は上記制御部2からの
押鍵データに基づき、周波数情報を音階クロック発生部
3に与える。音階クロック発生部3は、アドレスカウン
タ4内のハーフアダー5のC工、端子に音階周波数に対
応した信号であるエクスキュート信号E X、Cを与え
る。
In FIGS. 1 and 2, reference numeral 1 denotes a frequency information generating section to which the control section 2 detects the depression of keys on a keyboard (not shown) arranged in the order of musical scales and receives the key depression data from the control section 2. The frequency information generating section 1 provides frequency information to the scale clock generating section 3 based on the key press data from the control section 2. The scale clock generator 3 supplies execute signals EX and C, which are signals corresponding to the scale frequency, to the C terminal of the half adder 5 in the address counter 4.

ここで、アドレスカウンタ4の構成を説明すると、アド
レスカウンタ4は上記ハーフアダー5の他、アンドゲー
ト群AGI及びラッチ6からなっている。ハーフアダー
5は7ビツトのシフトレジスタを、例えば8音ポリフオ
ニツクの時分割処理方式の楽器の場合、8段縦続接続し
て成るラッチ6の出力を入力端子A。−A6に取り入れ
、上記CIN端子に入力されるエクスキュー)i号EX
Oにより「+1」ずつの加算を行い、その結果データを
出力端子S。−86から出力するものである。
Here, the structure of the address counter 4 will be explained. In addition to the half adder 5 described above, the address counter 4 includes an AND gate group AGI and a latch 6. The half adder 5 has an input terminal A that receives the output of a latch 6 formed by cascading 8 stages of 7-bit shift registers, for example in the case of an 8-note polyphonic time-division processing instrument. -Excue taken into A6 and input to the above CIN terminal) i-EX
O performs addition in increments of "+1", and the resulting data is output to terminal S. -86 output.

また、ラッチ6はハーフアダー5の出力を7つのアンド
ゲートよりなるアンドゲート群AGIを介して、クロッ
クパルスφの出力時に取り入れてラッチし、アンドゲー
ト群AGIは上記制御部2がらのリセット信号Rにより
開閉制御されている。
In addition, the latch 6 takes in and latches the output of the half adder 5 via an AND gate group AGI consisting of seven AND gates at the time of output of the clock pulse φ, and the AND gate group AGI receives the reset signal R from the control section 2. Opening/closing is controlled.

このため、アドレスカウンタ4は、エクスキュート信号
EXO印加のたびにラッチ6の出力である7ビツトのア
ドレスデータを「1」ずつ歩進させるようになっている
Therefore, the address counter 4 is configured to increment the 7-bit address data, which is the output of the latch 6, by "1" each time the execute signal EXO is applied.

このアドレスカウンタ4のラッチ6の出力であるアドレ
スデータは波形ROM(リードオンリメモリ)部7及び
波形零点検出部8にそれぞれ与えられる。波形ROM部
7は、与えられるアドレスデータに基づいて順次楽音波
形を示す波形データを乗算部9に出力するものである。
Address data, which is the output of the latch 6 of the address counter 4, is provided to a waveform ROM (read only memory) section 7 and a waveform zero point detection section 8, respectively. The waveform ROM section 7 sequentially outputs waveform data representing musical tone waveforms to the multiplication section 9 based on the supplied address data.

また、波形零点検出部8は、アントゲ−)10及びオア
ゲート11からなっている。アンドゲート10は、上記
ラッチ6の7ビツトのアドレスデータ出力のうち下位6
ビツトの出力と上記制御部2からのエクスキュート信号
EXQとの論理積をとり、アドレスカラントイ直がro
llllll(63)」とrlllllll(127)
Jの時、すなわち楽音波形が半周期目の零点と1周期口
の零点において、エクスキュート信号EXO出力のタイ
ミングで「1」を後述する零点信号OGAとして出力す
るものである。またオアゲート11は、上記アンドゲー
ト10の出力と上記制御部2からのプリセット信号PR
との論理和をとっている。
Further, the waveform zero point detecting section 8 is made up of an anti-game) 10 and an OR gate 11. The AND gate 10 outputs the lower 6 of the 7-bit address data output from the latch 6.
The output of the bit is ANDed with the execute signal EXQ from the control section 2, and the address current input is
lllllll (63)” and rllllllll (127)
J, that is, at the zero point of the half cycle and the zero point of the first cycle of the tone waveform, "1" is output as a zero point signal OGA, which will be described later, at the timing of outputting the execute signal EXO. Further, the OR gate 11 outputs the output of the AND gate 10 and the preset signal PR from the control section 2.
It is logically ORed with.

一方、上記制御部2では鍵盤(図示せず)の操作鍵のオ
ン、オフ状態に応じた所定データをエンへo −7’ 
状gの変化に応じてエンベロープクロック発生部12に
与える。エンベロープクロック発生部12は上記制御部
2からのデータに基づきエンベp−ブタロック信fEN
V−OKをエンベ胃−ブカウンタ13内のハーフアダー
14のC工、端子に与える。
On the other hand, the control section 2 sends predetermined data to the engine according to the on/off state of the operating keys of the keyboard (not shown).
The signal is applied to the envelope clock generator 12 in accordance with the change in the state g. The envelope clock generator 12 generates an envelope p-button lock signal fEN based on the data from the controller 2.
Apply V-OK to the C terminal of the half adder 14 in the envelope counter 13.

ここで、エンベロープカウンタ13の構成を説明すると
、エンベロープカウンタ13は上記ハーフアダー14の
他、アンドゲート群AG2、ラッチ15及びインバータ
群16からなっている。ハーフアダー14は7ビツトの
シフトレジスタ8段のラッチ15の出力を入力端子A。
Here, the configuration of the envelope counter 13 will be explained. In addition to the half adder 14 described above, the envelope counter 13 includes an AND gate group AG2, a latch 15, and an inverter group 16. The half adder 14 receives the output of the latch 15 of eight stages of 7-bit shift registers at the input terminal A.

−A、に取り入れ、上記CIN端子に入力されるエンベ
ロープクルツク信号FiNV−OKにより「+1」ずつ
の加算を行い、その結果データを出力端子So −8゜
から出力するものである。また、ラッチ15はハーフア
ダー14の出力を7つのアンドゲートよりなるアンドゲ
ート群AG2を介して、クロックパルスφの出力時に取
り入れてラッチし、アンドゲート群AG2は上記制御部
2からのリセット信号Rにより開閉制御されている。さ
らに、インバータ群16は7つのインバータよりなり、
上記ラッチ15の出力を反転したデータをエンベシープ
データとしてゲー)TGIを介して7ビツトのシフトレ
ジスタ8段から成るラッチ17に与えている。
-A, and is added in increments of "+1" by the envelope clock signal FiNV-OK input to the CIN terminal, and the resulting data is output from the output terminal So -8°. Furthermore, the latch 15 takes in and latches the output of the half adder 14 through an AND gate group AG2 made up of seven AND gates at the time of output of the clock pulse φ, and the AND gate group AG2 receives the reset signal R from the control section 2. Opening/closing is controlled. Furthermore, the inverter group 16 consists of seven inverters,
Data obtained by inverting the output of the latch 15 is applied as envelope data to a latch 17 consisting of eight stages of 7-bit shift registers via a game TGI.

このため、エンベループカウンタ13は、エンベシープ
クロック信号]11NV・OK印加のたびにラッチ15
の出力データを「1」ずつ歩進させ、結局インバータ群
16を介した出力データを「1」ずつ減カウントするよ
うになっている。
Therefore, the envelope counter 13 latches the latch 15 every time the envelope clock signal]11NV/OK is applied.
The output data of the inverter group 16 is incremented by 1, and the output data via the inverter group 16 is then decremented by 1.

上記ゲー)TGIは7つのトランスファゲートからなり
、上記波形零点検出部8の出力である零点信号OGAに
より開閉制御されている。そして、上記ラッチ17はエ
ンベロープカウンタ13からのエンベロープデータをり
四ツクパルスφの出力時に取り入れてラッチし、そのラ
ッチ出力を7つのアンドゲートよりなるアンドゲート群
AG3を介して上記乗算部9に与えるとともに、7つの
トランスファゲートよりなるゲー)Te3を経てラッチ
17の入力端に帰還している。ゲー)’L”G2は上記
波形零点検出部8の出力、零点信号がインバータ18を
経た出力により開閉制御されている。
The above-mentioned TGI consists of seven transfer gates, which are controlled to open and close by the zero point signal OGA which is the output of the waveform zero point detection section 8. The latch 17 takes in and latches the envelope data from the envelope counter 13 at the time of outputting the four-clock pulse φ, and provides the latch output to the multiplier 9 via an AND gate group AG3 consisting of seven AND gates. , and is fed back to the input terminal of the latch 17 via the gate (gate) Te3 consisting of seven transfer gates. The opening/closing of 'L'G2 is controlled by the output of the waveform zero point detection section 8 and the output of the zero point signal passed through the inverter 18.

このため、ラッチ17は楽音波形が零点に達して波形零
点検出部8より出力がある時にゲー)TGlが開いてエ
ンベロープデータを取り入れるが、それ以外の時は取り
入れたエンベロープデータをゲー)Te3を介して帰還
保持している。また上記アンドゲート群AG3は上記制
御部2からのエクスキュート信号EXOにより開閉制御
されている0 上記乗算部9は波形ROM部7からの波形データと上記
ラッチ17からのエンベロープデータとを乗算しその乗
算結果データを累算部19に与える。累算部19は乗算
部9より与えられるデータを順次累算してその累算結果
データを時分割処理動作の1周期の終り毎にデジタルア
ナログ変換器(DAO)2Qに与える。デジタルアナロ
グ変換器20は累算部19から与えられるデータをアナ
四グ楽音信号に変換し、アンプ21を介して増幅させ、
スピーカ22より放音させる。
For this reason, when the musical waveform reaches the zero point and there is an output from the waveform zero point detection section 8, the latch 17 opens the TG1 and takes in the envelope data, but at other times, it takes in the envelope data through the Te3. It keeps me coming back. Further, the AND gate group AG3 is controlled to open and close by the execute signal EXO from the control section 2. The multiplication section 9 multiplies the waveform data from the waveform ROM section 7 and the envelope data from the latch 17. The multiplication result data is given to the accumulator 19. The accumulator 19 sequentially accumulates the data provided by the multiplier 9 and provides the accumulated result data to the digital-to-analog converter (DAO) 2Q at the end of each cycle of the time-division processing operation. The digital-to-analog converter 20 converts the data given from the accumulator 19 into an analog/4G musical tone signal, amplifies it via the amplifier 21,
Sound is emitted from the speaker 22.

次に以上のように構成された本実施例の動作について述
べる。
Next, the operation of this embodiment configured as above will be described.

まず、電源投入により制御部2より各ラッチ6.15.
17にクロックパルスφが印加される。そして鍵盤(図
示せず)の押鍵により制御部2よりリセット信号πが出
力してアンドゲート群AGI、AG2が閉成され、ラッ
チ6.15にはオール「0」が取り込まれ、次いで制御
部2よりプリセット信号PRが波形零点検出部8のオア
ゲート11に与えられ、オアゲート11より零点信号が
出力してゲー)TGIが開成される。すると、エンベロ
ープカウンタ13のラッチ15の出力はオール「0」で
あるから、インバー々群16で反転され、開成されたゲ
ー)TGIを通じてラッチ17にオール「1」すなわち
「1llllllJが取り入れられる。
First, when the power is turned on, the control unit 2 controls each latch 6.15.
A clock pulse φ is applied to 17. Then, by pressing a key on a keyboard (not shown), a reset signal π is output from the control section 2, and the AND gate groups AGI and AG2 are closed, all "0"s are taken into the latch 6.15, and then the control section 2, the preset signal PR is applied to the OR gate 11 of the waveform zero point detection section 8, and the OR gate 11 outputs a zero point signal to open the gate TGI. Then, since the outputs of the latch 15 of the envelope counter 13 are all "0", they are inverted by the inverter group 16, and all "1", that is, "1llllllJ" are taken into the latch 17 through the opened gate TGI.

そして、ラッチ6の出力はオールrOJで、アンドゲー
ト10の出力も「0」となっているから、プリセット信
号PR出力後、零点信号OGAは「0」となり、ゲー)
’I!Glは閉成され、代わりにゲー)’[’G2が開
成される。従って、ラッチ17にはエンベロープデータ
rl 111111Jが第3図((3)の区間1に示す
ように循環保持され続け、乗算部9に一定のエンベロー
プデータ「1111111Jが与え続けられる。
Then, the output of the latch 6 is all rOJ, and the output of the AND gate 10 is also "0", so after the preset signal PR is output, the zero point signal OGA becomes "0", and the output of the AND gate 10 is "0".
'I! Gl is closed and G2 is opened instead. Therefore, the envelope data rl 111111J continues to be cyclically held in the latch 17 as shown in section 1 of FIG.

次いで、リセット信号πが解除されアントゲ−)群AG
1、AG2が開成される。そして、クロックパルスφ4
発に1発の割合のエクスキュート信号EXOが制御部2
よりアドレスカウンタ4のハーフアダー5のC工、端子
に与えられ始め、ラッチ6の出力であるアドレスデータ
のオール「0」に対し順次「+1」の加算を行ってラッ
チ6の内容を薔き換えていき、それに応じて波形ROM
部7の指定アドレスを歩進させて、それにより順次読み
出される波形データが乗算部9に与えられていく。
Then, the reset signal π is released and the animation group AG
1. AG2 is opened. And clock pulse φ4
Execute signal EXO at a rate of one per shot is sent to the control unit 2.
Then, the address data starts to be applied to the C terminal of the half adder 5 of the address counter 4, and the contents of the latch 6 are changed by sequentially adding "+1" to all "0" of the address data which is the output of the latch 6. waveform ROM accordingly.
The designated address of section 7 is incremented, and the waveform data sequentially read out thereby is supplied to multiplication section 9.

こうして、乗算s9では波形データとエンベロープデー
タとを乗算し、その後累算、D−A変換されて、楽音が
増幅放音される。
In this way, in the multiplication s9, the waveform data and the envelope data are multiplied, and then accumulated and D/A converted, and the musical tone is amplified and emitted.

この間に、エンベロープカウンタ13のハーフアダーの
Cエヨ端子にはエンベ胃−プクロック信号ENV・OK
が与えられており、ラッチ15の出力データに対し順次
「+1」の加算を行ってラッチ15の内容を書き換えて
いき、それに応じてインバータ群工6を経たエンベルー
プデータ出力が第3図(A)に示すように順次rl 1
11111」、l”1111110J、l’−1111
101Jというように減カウントされていく。しかしこ
の時、ゲー)TGIは閉じているので、上述のようにエ
ンベロープデータが減カウントされていくにもかかわら
ず、ラッチ17にはこのエンベロープデータが取り入れ
られることはない。
During this time, the envelope clock signal ENV OK is sent to the C terminal of the half adder of the envelope counter 13.
is given, and the contents of the latch 15 are rewritten by sequentially adding "+1" to the output data of the latch 15, and accordingly, the envelope data output that has passed through the inverter group 6 is shown in Fig. 3 (A ) sequentially as shown in rl 1
11111'', l''1111110J, l'-1111
The count is decremented to 101J. However, since the game TGI is closed at this time, the envelope data is not taken into the latch 17 even though the envelope data is decremented as described above.

そうして、上記アドレスカウンタ4が歩進されていき、
例えばラッチ6の出力が第4図に示すようにrolll
lllJとなると、エクスキュート信号EXOの出力タ
イミングで波形零点検出部8のアンドゲート10の出力
が「1」となり、オアゲート11より零点信号OGAが
出力して、ゲ−)TGIが開成する。すると、その時の
減カウントされていたエンベロープデータrlloo。
Then, the address counter 4 is incremented,
For example, the output of latch 6 is set to roll as shown in FIG.
When 11J is reached, the output of the AND gate 10 of the waveform zero point detection section 8 becomes "1" at the output timing of the execute signal EXO, the zero point signal OGA is output from the OR gate 11, and the gate) TGI is opened. Then, the envelope data rlloo that was being decremented at that time.

00」がラッチ17に取り入れられ、その後すぐエクス
キュート信号EXOが「0」となり、零点信号OGAも
「0」となるから、ゲート’I!GIGま閉成さ0代わ
りにゲー)’I’G2が開成され、このため、ラッチ1
7にはエンベロープデータ「1100000Jが新たに
第3図(0)区間2に示すように循環保持され続け、乗
算部9に一定のエンベロープデータrllo0000J
が与えられ続けられる。
00" is taken into the latch 17, and immediately thereafter the execute signal EXO becomes "0" and the zero point signal OGA also becomes "0", so the gate 'I! Instead of GIG being closed, G2 is opened, so latch 1 is opened.
7, the envelope data "1100000J" continues to be circulated and held as shown in section 2 (0) of FIG.
continues to be given.

こうして、アドレスデータがr o o o o o 
o o −1からl’−0111111jになるまで、
すなわち楽音波形が第3図(E)に示すように半周期分
の山が生成放音される間、エンベロープカウンタ13の
出力は第3図(A)のように減カウントしているにもか
かわらず、乗算されるエンベループデータは第3図(0
)に示すようにrllllllljが保持されつづけ、
楽音波形が半周期時の零点経過時においてはじめて、エ
ンベループデータが切り換えられる0これは、アドレス
データが[1111111Jすなわち1周期目の零点経
過時でも同様であり、結局乗算されるエンベループデー
タは第3ffi(0)に示すように、楽音波形が零点を
通過する時のみに切り換って区間3.4・・・と階段状
になる。従って楽音波形が歪むことがなくなる。
In this way, the address data is r o o o o o
From o o -1 to l'-0111111j,
In other words, while the musical sound waveform generates a half-period peak as shown in FIG. 3(E) and is emitted, the output of the envelope counter 13 is decreasing as shown in FIG. 3(A). The envelope data to be multiplied is shown in Figure 3 (0
), rllllllllj continues to be held,
The envelope data is switched for the first time when the musical sound waveform passes the zero point in half a period. This is the same even when the address data is [1111111J, that is, the zero point in the first period has passed, and the envelope data to be multiplied is the first one. As shown in 3ffi(0), the tone waveform switches only when it passes through the zero point, and becomes step-like in sections 3, 4, and so on. Therefore, the musical sound waveform will not be distorted.

なお、本実施例は一波形の全ての零点を検出して半周期
ごとにエンベ四−ブ切換制御をしたが、−波に一つの零
点を検出して全周期ごとに制御してもよいことはもちろ
んである。また、上記実施例では楽音即ち音階音の波形
に対するエンベロープ制御に本発明を適用したが、自動
リズム演奏装置などにおいて、リズム音(打楽器音)を
ディジタル的に発生し、その際エンベロープを付加する
ときにも、同様にこの発明を適用することが出来る。
In this embodiment, all the zero points of one waveform are detected and the envelope switching control is performed every half cycle, but it is also possible to detect one zero point in the - wave and control every half cycle. Of course. Furthermore, in the above embodiment, the present invention is applied to envelope control for the waveform of musical tones, that is, scale tones. The present invention can be similarly applied to.

〔発明の効果〕〔Effect of the invention〕

以上述べたように本発明は、波形の零点においてエンベ
ロープの各状態の切換えを行うようにしたから、波形が
歪んでしまうことがなく、波形歪みによる雑音の発生を
防止できる等の効果を奏する0
As described above, since the present invention switches each state of the envelope at the zero point of the waveform, the waveform is not distorted and the generation of noise due to waveform distortion can be prevented.

【図面の簡単な説明】[Brief explanation of the drawing]

図面は本発明の一実施例を示すもので、第1図はエンベ
ロープ制御装置を備えた電子楽器のブロック回路図、第
2図はエンベロープ制御装置の具体的な回路図、第3図
は実際にカウントされているエンベロープデータ、楽音
波形、乗算されているエンベロープデータの関係を示す
図、第4図は第2図のエンベロープ制御装置の各部のタ
イムチャート図である。 4・・・・・・アドレスカウンタ、8・・・・・・波形
零点検出部、10・・・・・・アンドゲート、11・・
・・・・オアゲート、13・・・・・・エンベロープカ
ウンタ、17・・・・・・ラッチ、TGl、’[’G2
・・・・・・ゲート。 特許出願人 カシオ計算機株式会社
The drawings show one embodiment of the present invention; FIG. 1 is a block circuit diagram of an electronic musical instrument equipped with an envelope control device, FIG. 2 is a specific circuit diagram of the envelope control device, and FIG. 3 is an actual circuit diagram of the envelope control device. FIG. 4 is a diagram showing the relationship between counted envelope data, musical sound waveforms, and multiplied envelope data. FIG. 4 is a time chart diagram of each part of the envelope control device of FIG. 2. 4...Address counter, 8...Waveform zero point detection section, 10...And gate, 11...
...OR gate, 13...Envelope counter, 17...Latch, TGl, '['G2
······Gate. Patent applicant Casio Computer Co., Ltd.

Claims (1)

【特許請求の範囲】[Claims] 波形をエンベロ−プデータに基づきエンベロープ制御す
る装置において、エンベロープデータ発生手段と、波形
零点検出手段と、この波形零点検出手段が零点を検出す
ると上記エンベロープデータ発生手段からエンベロープ
データを取込み、次の零点が検出されるまではこのエン
ベロープデータによりエンベループ制御する手段とを具
備することを特徴とするエンベロープ制御装置。
A device that performs envelope control of a waveform based on envelope data includes an envelope data generation means, a waveform zero point detection means, and when the waveform zero point detection means detects a zero point, the envelope data is fetched from the envelope data generation means and the next zero point is detected. 1. An envelope control device comprising means for performing envelope control using the envelope data until detection.
JP58159999A 1983-08-31 1983-08-31 Envelope controller Pending JPS6068386A (en)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP58159999A JPS6068386A (en) 1983-08-31 1983-08-31 Envelope controller

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP58159999A JPS6068386A (en) 1983-08-31 1983-08-31 Envelope controller

Publications (1)

Publication Number Publication Date
JPS6068386A true JPS6068386A (en) 1985-04-18

Family

ID=15705784

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JP58159999A Pending JPS6068386A (en) 1983-08-31 1983-08-31 Envelope controller

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JP (1) JPS6068386A (en)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH09179558A (en) * 1995-12-21 1997-07-11 Yamaha Corp Musical tone generating method

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JPH09179558A (en) * 1995-12-21 1997-07-11 Yamaha Corp Musical tone generating method

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