JPS60644U - デ−タ入力回路 - Google Patents

デ−タ入力回路

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JPS60644U
JPS60644U JP8674183U JP8674183U JPS60644U JP S60644 U JPS60644 U JP S60644U JP 8674183 U JP8674183 U JP 8674183U JP 8674183 U JP8674183 U JP 8674183U JP S60644 U JPS60644 U JP S60644U
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JP
Japan
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input
flip
terminal
switching signal
flop
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JP8674183U
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寺田　元治
秋葉　修
義春 鈴木
隆 佐伯
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Panasonic Electric Works Co Ltd
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Matsushita Electric Works Ltd
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は従来のデータ入力回路の一例の回路図、第２図
は同上の他の例の回路図、第３図ａ〜ｄはそれぞれ第２
図の特性図、第４図は本考案の一実施例の回路図、第５
図ａ、　　ｂは同上のクロック波形図である。 １・・・・・・入力端子、３・・・・・・３ステートバ
ツプア、６・・・・・・Ｄフリップフロップ、７・・・
・・・切換回路、Ｒｐ・・・・・・入力プルダウン抵抗
。

Claims (1)

    【実用新案登録請求の範囲】
  1. 入力端子をＤ端子に入力するとともにＣＫ端子に入力切
    換信号により切換えられる複数種のサンプリングクロッ
    クを入力するようにしたＤフリップフロップと、前記入
    力端子に入力プルダウン抵抗を介して接続した３ステー
    トバツフアとより成り、一般入力時は入力切換信号をＬ
    レベルにして通常のサンプリングクロックでＤフリップ
    フロップをサンプリングするとともに３ステートバツフ
    アをオンにし、高速応答が必要な入力時はへ力切換信号
    をＨレベルにして高速サンプリングクロックでＤフリッ
    プフロップをサンプリングするとともに３ステートバツ
    フアをオフにする如くして成るデータ入力回路。
JP8674183U 1983-06-07 1983-06-07 デ−タ入力回路 Granted JPS60644U (ja)

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JP8674183U JPS60644U (ja) 1983-06-07 1983-06-07 デ−タ入力回路

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JP8674183U JPS60644U (ja) 1983-06-07 1983-06-07 デ−タ入力回路

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Publication Number Publication Date
JPS60644U true JPS60644U (ja) 1985-01-07
JPH049641Y2 JPH049641Y2 (ja) 1992-03-10

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ID=30216665

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JP8674183U Granted JPS60644U (ja) 1983-06-07 1983-06-07 デ−タ入力回路

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Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5884330A (ja) * 1981-11-13 1983-05-20 Canon Inc マイクロプロセツサの入力回路

Patent Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5884330A (ja) * 1981-11-13 1983-05-20 Canon Inc マイクロプロセツサの入力回路

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JPH049641Y2 (ja) 1992-03-10

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