JPS604395A - Ａｃｃ回路 - Google Patents
Ａｃｃ回路Info
- Publication number
- JPS604395A JPS604395A JP11325983A JP11325983A JPS604395A JP S604395 A JPS604395 A JP S604395A JP 11325983 A JP11325983 A JP 11325983A JP 11325983 A JP11325983 A JP 11325983A JP S604395 A JPS604395 A JP S604395A
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- JP
- Japan
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- value
- circuit
- supplied
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- Granted
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Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N9/00—Details of colour television systems
- H04N9/64—Circuits for processing colour signals
- H04N9/68—Circuits for processing colour signals for controlling the amplitude of colour signals, e.g. automatic chroma control circuits
Landscapes
- Engineering & Computer Science (AREA)
- Multimedia (AREA)
- Signal Processing (AREA)
- Processing Of Color Television Signals (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
産業上の利用分野
本発明は、映像信号をデジタル化して処理を行うように
したテレビ受像機に使用されるＡＣＣ回路に関する。
したテレビ受像機に使用されるＡＣＣ回路に関する。
背景技術とその問題点
映像信号をデジタル化して処理を行うようにしたテレビ
受像機が提案されている。そのような場合に、いわゆる
ＡＣＣを行おうとすると、クロマ信号のビット数が少な
いために正確な制御を行うことができない。
受像機が提案されている。そのような場合に、いわゆる
ＡＣＣを行おうとすると、クロマ信号のビット数が少な
いために正確な制御を行うことができない。
すなわち制御のｉｐ４差を少なくするためには多くのビ
ット数が必要となり、それができない場合には、バース
トのレベルがスレショルド付近の場合に制御値のＬＳＢ
が変化することによって色飽和度が変化し、画面上でち
らつきとなって見えζしまう。
ット数が必要となり、それができない場合には、バース
トのレベルがスレショルド付近の場合に制御値のＬＳＢ
が変化することによって色飽和度が変化し、画面上でち
らつきとなって見えζしまう。
発明の目的
本発明はこのような点にかんがみ、ビット数が少なくて
も安定な動作が行われるようにするものである。
も安定な動作が行われるようにするものである。
発明の概要
本発明は、デジタル化されたクロマ信号のバースト部分
から検出された制御値を記憶し、この記憶値と新に検出
された上記制御値とを比較し、この差が所定値以上のと
き上記記憶値を書き替えると共に、上記記憶値をフィー
ドバックして上記クロマ信号に乗算するようにしたＡＣ
Ｃ回路であって、これによればビット数が少なくても安
定な動作が行わ−れる。
から検出された制御値を記憶し、この記憶値と新に検出
された上記制御値とを比較し、この差が所定値以上のと
き上記記憶値を書き替えると共に、上記記憶値をフィー
ドバックして上記クロマ信号に乗算するようにしたＡＣ
Ｃ回路であって、これによればビット数が少なくても安
定な動作が行わ−れる。
実施例
図において、（１）は例えば８ビットでデジタル化され
たクロマ信号の供給される入力端子であって、この入力
端子（１）からの１４号が乗算回路（２）を通じて出力
端子（３）に取り出される。この乗算回路（２）の出力
信号がバースト期間の最大及び最小のピーク値を検出す
る検出回路（４）に供給される。この検出された値の平
均値が減算回路（５）に供給され、入力端子（６）に供
給される第１の参照値から減算される。
たクロマ信号の供給される入力端子であって、この入力
端子（１）からの１４号が乗算回路（２）を通じて出力
端子（３）に取り出される。この乗算回路（２）の出力
信号がバースト期間の最大及び最小のピーク値を検出す
る検出回路（４）に供給される。この検出された値の平
均値が減算回路（５）に供給され、入力端子（６）に供
給される第１の参照値から減算される。
この減算出力が加算回路（７）に供給される。この加算
回路（７）からの信号が記憶用のＤフリップフロップ（
８）に供給され、入力端子（９）から供給される水平パ
ルスのタイミングで記憶される。この第１の記憶値（制
御値）が加算回路（７）に供給されて減算回路（５）か
らの稙に加算される。
回路（７）からの信号が記憶用のＤフリップフロップ（
８）に供給され、入力端子（９）から供給される水平パ
ルスのタイミングで記憶される。この第１の記憶値（制
御値）が加算回路（７）に供給されて減算回路（５）か
らの稙に加算される。
さらにＤフリップフロップ（８）からの第１の記憶値（
制御値）が記憶用のＤフリップフロップ０ωに供給され
る。このＤフリップフロップα０）の入力端の第１の記
憶値と出力側の第２の記憶値とが減算回１ｉ（１１）に
供給される。この減算回路（１１）からの２つの値の差
の誹色対値が比較回路（１２）に供給され、入力端子（
Ｉ３）に供給される第２の参照値と比較される。そして
減算回路（１１）からの差の絶対値が第２の参照値より
大きいとき、刊き込み制御信司がＤフリップフロップ０
０）に供給され、入力端子（９）から供給される水平パ
ルスのタイミングで、Ｄフリップフロップ（８）からの
第１の記憶値に記憶内容（第２の記憶値）が書き替えら
れる。
制御値）が記憶用のＤフリップフロップ０ωに供給され
る。このＤフリップフロップα０）の入力端の第１の記
憶値と出力側の第２の記憶値とが減算回１ｉ（１１）に
供給される。この減算回路（１１）からの２つの値の差
の誹色対値が比較回路（１２）に供給され、入力端子（
Ｉ３）に供給される第２の参照値と比較される。そして
減算回路（１１）からの差の絶対値が第２の参照値より
大きいとき、刊き込み制御信司がＤフリップフロップ０
０）に供給され、入力端子（９）から供給される水平パ
ルスのタイミングで、Ｄフリップフロップ（８）からの
第１の記憶値に記憶内容（第２の記憶値）が書き替えら
れる。
そしてこの第２の記憶値が乗算回路（２）に供給される
。
。
この回路において、検出回路（４）からの平均値が第１
の参照値より大きいときは、減算回路（５）の出力が負
となり、加算回路（７）に°ζ前の制御値からこの減算
値骨減った値がＤフリップフロップ（８）に記憶され、
制御値（第１の記憶値）が小さくされる。
の参照値より大きいときは、減算回路（５）の出力が負
となり、加算回路（７）に°ζ前の制御値からこの減算
値骨減った値がＤフリップフロップ（８）に記憶され、
制御値（第１の記憶値）が小さくされる。
また平均値が小さいとき減算出力が正となり、制御値が
大きくされる。この制御値がＤフリップフロップ０ωに
記憶され、この第２の記憶値と新に検出された制御値と
が比較され、この差が所定値以」−のときに第２の記憶
値が書き替えられる。この第２の記憶値にてクロマ信号
レベルが制御されるごとにより、バースト期間の平均値
のレベルが第１の参照値に近づくようにフィードバンク
によるＡＣＣが行われる。
大きくされる。この制御値がＤフリップフロップ０ωに
記憶され、この第２の記憶値と新に検出された制御値と
が比較され、この差が所定値以」−のときに第２の記憶
値が書き替えられる。この第２の記憶値にてクロマ信号
レベルが制御されるごとにより、バースト期間の平均値
のレベルが第１の参照値に近づくようにフィードバンク
によるＡＣＣが行われる。
そしてこの回路において、Ｄフリップフロップ００）は
、制御値が所定値以上大幅に変化したときのみ書き替え
が行われるので、Ｌ Ｓ Ｂ等の小幅な変化は無視され
、これによるちらつき等が発生ずることがなく、安定し
た動作が行われる。
、制御値が所定値以上大幅に変化したときのみ書き替え
が行われるので、Ｌ Ｓ Ｂ等の小幅な変化は無視され
、これによるちらつき等が発生ずることがなく、安定し
た動作が行われる。
発明の効果
本発明によれば、ビット数が少なくても安定な動作が行
われるようになった。
われるようになった。
図は本発明の一例の構成図である。
（１）は入力端子、（２）は乗算回路、（３）は出力端
子、（４）はバーストビーク値検出回路、（５）、（１
１）は減算回路、（６）、（１３）は参照値の人力端子
、（７）は加算回路、（８）、００）は記憶用のＤフリ
ップフロップ、（９）は水平パルスの入力端子、（１２
）は比較回路である。 ζ−
子、（４）はバーストビーク値検出回路、（５）、（１
１）は減算回路、（６）、（１３）は参照値の人力端子
、（７）は加算回路、（８）、００）は記憶用のＤフリ
ップフロップ、（９）は水平パルスの入力端子、（１２
）は比較回路である。 ζ−
Claims (1)
- デジタル化されたクロマ信号のバースト部分から検出さ
れた制御値を記憶し、この記憶値と新に検出された上記
制御値とを比較し、この差が所定値以上のとき上記記憶
値を書き替えると共に、上記記憶値をフィードバックし
て上記クロマ信号に乗算するようにしたＡＣＣ回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58113259A JPH0638666B2 (ja) | 1983-06-23 | 1983-06-23 | Ａｃｃ回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58113259A JPH0638666B2 (ja) | 1983-06-23 | 1983-06-23 | Ａｃｃ回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS604395A true JPS604395A (ja) | 1985-01-10 |
| JPH0638666B2 JPH0638666B2 (ja) | 1994-05-18 |
Family
ID=14607614
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP58113259A Expired - Lifetime JPH0638666B2 (ja) | 1983-06-23 | 1983-06-23 | Ａｃｃ回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0638666B2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0537951A (ja) * | 1991-07-29 | 1993-02-12 | Victor Co Of Japan Ltd | デジタルａｃｃ回路 |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5844883A (ja) * | 1981-06-10 | 1983-03-15 | シ−メンス・アクチエンゲゼルシヤフト | デイジタル色信号調整方法および装置 |
| JPS5856593A (ja) * | 1981-09-12 | 1983-04-04 | エヌ ベー フイリップス フルーイランペンフアブリケン | 信号振幅比調整回路 |
-
1983
- 1983-06-23 JP JP58113259A patent/JPH0638666B2/ja not_active Expired - Lifetime
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5844883A (ja) * | 1981-06-10 | 1983-03-15 | シ−メンス・アクチエンゲゼルシヤフト | デイジタル色信号調整方法および装置 |
| JPS5856593A (ja) * | 1981-09-12 | 1983-04-04 | エヌ ベー フイリップス フルーイランペンフアブリケン | 信号振幅比調整回路 |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0537951A (ja) * | 1991-07-29 | 1993-02-12 | Victor Co Of Japan Ltd | デジタルａｃｃ回路 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0638666B2 (ja) | 1994-05-18 |
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