JPS60226776A - Converter - Google Patents
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- JPS60226776A JPS60226776A JP59082507A JP8250784A JPS60226776A JP S60226776 A JPS60226776 A JP S60226776A JP 59082507 A JP59082507 A JP 59082507A JP 8250784 A JP8250784 A JP 8250784A JP S60226776 A JPS60226776 A JP S60226776A
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- H02—GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
- H02M—APPARATUS FOR CONVERSION BETWEEN AC AND AC, BETWEEN AC AND DC, OR BETWEEN DC AND DC, AND FOR USE WITH MAINS OR SIMILAR POWER SUPPLY SYSTEMS; CONVERSION OF DC OR AC INPUT POWER INTO SURGE OUTPUT POWER; CONTROL OR REGULATION THEREOF
- H02M7/00—Conversion of ac power input into dc power output; Conversion of dc power input into ac power output
- H02M7/42—Conversion of dc power input into ac power output without possibility of reversal
- H02M7/44—Conversion of dc power input into ac power output without possibility of reversal by static converters
- H02M7/48—Conversion of dc power input into ac power output without possibility of reversal by static converters using discharge tubes with control electrode or semiconductor devices with control electrode
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- Engineering & Computer Science (AREA)
- Power Engineering (AREA)
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Abstract
Description
【発明の詳細な説明】
〔発明の技術分野〕
本発明は交流電源を順変換器で直流に変換し、逆変換器
で可変電圧、可変周波数出力に変換する変換装置、特に
制御回路を上記交流電源の断続でリセットする変換装置
に関するものである。[Detailed Description of the Invention] [Technical Field of the Invention] The present invention relates to a conversion device that converts an AC power source into a DC power source using a forward converter and converts it into variable voltage and variable frequency output using an inverse converter, and in particular a control circuit that converts an AC power source into a DC power source using a forward converter and converts the AC power source into a variable voltage and variable frequency output using an inverse converter. The present invention relates to a conversion device that is reset by intermittent power supply.
第1図は従来の変換装置の概略構成を示すブロック図で
ある。同図において、1は交流電源Vaを可変電圧、可
変周波数出力vbに変換する変換手段としてのインバー
タ主回路部であシ、順変換器1a、平惰コンデンサlb
、逆変換器1cから成っている。また、2は直流直流変
換器、3はインバータ主回路部1の制御回路であ)、直
流直流変換器2はインバータ主回路部lのインバータ直
流部電位VCを検出し、これを所定の直流電圧Vdに変
換して上記制御回路3の電源入力として供給する。なお
、上記制御回路3は第2図に示すように構成されている
。同図において、3aは速度指令f1に対し所定の時間
でインバータ出力周波数foを追随させるソフト加減速
処理部、3bは上記出力周波数fOに対応した電圧vO
を決定する’V/f変換部、3cは上記出力周波数fo
、出力電圧vOにもとづきインパーク主回路部1のトラ
/シスメト2イブ信号fpを発生させ、出力周波数fo
、出力電圧vOの条件下でのトランジスタのスイッチン
グモードを決定するPWM信号発生器である。なお3d
は本装置の負荷の異常状態検出回路であシ、図示しない
電流、!圧あるいは電源レベル等の検出器からの検出値
によシ、異常状態を検出してPWM信号発生器3cを制
御して本装置のインバータ動作を停止させる。FIG. 1 is a block diagram showing a schematic configuration of a conventional conversion device. In the figure, 1 is an inverter main circuit unit as a conversion means for converting AC power supply Va to variable voltage, variable frequency output vb, a forward converter 1a, and a flat inertia capacitor lb.
, and an inverse converter 1c. Further, 2 is a DC/DC converter, 3 is a control circuit of the inverter main circuit section 1), the DC/DC converter 2 detects the inverter DC section potential VC of the inverter main circuit section 1, and converts it into a predetermined DC voltage. It is converted into Vd and supplied as a power input to the control circuit 3. Note that the control circuit 3 is configured as shown in FIG. In the figure, 3a is a software acceleration/deceleration processing unit that makes the inverter output frequency fo follow the speed command f1 at a predetermined time, and 3b is a voltage vO corresponding to the output frequency fO.
The V/f converter 3c determines the output frequency fo.
, based on the output voltage vO, generates the track/sysmet 2 signal fp of the impark main circuit section 1, and adjusts the output frequency fo.
, a PWM signal generator that determines the switching mode of the transistor under the conditions of output voltage vO. Furthermore, 3d
is the abnormal state detection circuit for the load of this device, and the current (not shown) is ! An abnormal state is detected based on the detected value from the voltage or power level detector, and the PWM signal generator 3c is controlled to stop the inverter operation of this device.
以上のように構成された従来例の動作を次に説明する。The operation of the conventional example configured as above will be explained next.
交流電源Vaが供給されると、インバータ直流部電位V
cは交流電源Vaに比例したレベルまで上昇するので、
直流直流変換器2はインバータ制御回路3に電源Vdを
供給する。従って交流電源Vaが供給されればインバー
タ制御回路3の電源Vdが確保され、インバータ動作が
可能となる。次に第7図に示すタイムチャートを用いて
交流電源が任意時間(T off )オフになったとき
の動作について説明する。時間t1において交流電源V
aがオフとなると、インバータ直流部電位Vcは下降し
はじめるが、平渭コンデンサlbに電荷が蓄積されてい
るので、その時の制御電源負荷及びインバータ負荷と平
渭コンデンサ1bの容量によシ決定される減衰時定数に
よシ減衰する。When the AC power supply Va is supplied, the inverter DC section potential V
Since c rises to a level proportional to AC power supply Va,
The DC-DC converter 2 supplies a power supply Vd to the inverter control circuit 3. Therefore, if the AC power source Va is supplied, the power source Vd of the inverter control circuit 3 is secured, and the inverter operation becomes possible. Next, using the time chart shown in FIG. 7, the operation when the AC power source is turned off for an arbitrary time (T off ) will be described. At time t1, AC power supply V
When a is turned off, the inverter DC section potential Vc begins to fall, but since charge is accumulated in the Hirayui capacitor 1b, the voltage is determined by the control power supply load at that time, the inverter load, and the capacitance of the Hirayui capacitor 1b. It decays due to the decay time constant.
従ってインバータ制御回路3の電源Vdが確保されない
レベルまで減衰するに要する時間は、その時の上記負荷
条件によシ異なることになる。Therefore, the time required for the power supply Vd of the inverter control circuit 3 to attenuate to an unsecured level will vary depending on the above-mentioned load conditions at that time.
一方、本装置にである負荷を駆動中に、例えば過電流、
過電圧等の異常状態が生じた場合、第2図の保護回路と
しての異常状態検出回路3dが動作し、インバータ動作
を停止させ、保護する。このとき、制御回路3には電源
Vdが供給され続け、保護状態は継続される。従ってこ
の停止状態から再びインバータ動作を開始させるために
は第3図に示すリセット回路を用いて制御1路3をリセ
ットして保護状態を解除する必要がある。上記解除は通
常インバータ制御回路3全体をリセットし、完全な初期
状態に復帰させておこなう。このインバータ制御回路3
のリセットには、電源Vdの立ち°上がシ時に自動的に
かけるリセットと、電源Vdが確保されている状態で、
外部操作あるいは外部信号にてかけるリセットの2種類
がある。運転中に何らかの理由で前者のリセット方法を
用いてリセットをかける必要性が生じた場合、従来の装
置は前記したように電源Vdの減衰状態が負荷条件で異
なるので交流電源Vaを一度オフし、再びオンするに要
する時間を十分確保しなければならず、またその時間も
負荷条件で異なるので、敏速なリセット操作が行なえな
かった。On the other hand, when this device is driving a certain load, for example, an overcurrent
When an abnormal state such as overvoltage occurs, the abnormal state detection circuit 3d as a protection circuit shown in FIG. 2 operates to stop the inverter operation and protect it. At this time, the power supply Vd continues to be supplied to the control circuit 3, and the protected state continues. Therefore, in order to restart the inverter operation from this stopped state, it is necessary to reset the control 1 path 3 using the reset circuit shown in FIG. 3 to release the protected state. The above cancellation is normally performed by resetting the entire inverter control circuit 3 and returning it to a complete initial state. This inverter control circuit 3
For resetting, there is a reset that is automatically applied when the power supply Vd rises, and a reset that is applied automatically when the power supply Vd is secured.
There are two types of reset: external operation or external signal. If it becomes necessary to use the former reset method for some reason during operation, the conventional device turns off the AC power supply Va once, since the attenuation state of the power supply Vd differs depending on the load conditions as described above. A sufficient amount of time must be ensured to turn it on again, and this time also varies depending on the load conditions, making it impossible to perform a quick reset operation.
さらに、従来例における上記リセット動作を第3図ない
し第4図を用いて説明する。第3図は従来のリセット回
路、第4図はその動作を説明するタイムチャートである
。即ち、抵抗4、コンデンサ5によシ設定されるCRの
時定数で電源Vdの立ち上がりよシ遅延させた出力Aが
インバー、タロのスレッシュホールドレベルvLに達す
るまでの期間Toでリセット信号Bを成牛ずる。従って
この回路においてリセット信号Bを発生させるには電源
Vdを十分に減衰させ、再び上昇させる必要がある。し
かしながら、インバータ直流部から直流直流変換器2を
介してインバータ制御回路3の電源Vdを供給する本装
置においてはインバータ直流部電位Vcと電源Vdは第
4図に示す関係にあるので、直流部電位Vcが十分に減
衰しないと電源Vdは減衰せず、図示したように電源オ
フ時間が時間T1と長い場合はリセットがかけられるが
、T2と短い場合には電源を再投してもリセットがかけ
られなかった。従って、従来装置においてはインバータ
直流部電位Vcが十分に減衰するまで交流電源Vaのオ
フ時間を確保しなければならず、その時間は負荷条件に
より異なるから、最も軽負荷条件でも必ずリセットがか
かる時間を確保することになり敏速なリセット操作には
適合しないという欠点を有していた。Furthermore, the above-mentioned reset operation in the conventional example will be explained with reference to FIGS. 3 and 4. FIG. 3 is a conventional reset circuit, and FIG. 4 is a time chart explaining its operation. That is, the reset signal B is generated in the period To until the output A, which is delayed from the rise of the power supply Vd by the time constant of CR set by the resistor 4 and the capacitor 5, reaches the threshold level vL of the Inverter and Talo. Cow cheating. Therefore, in order to generate the reset signal B in this circuit, it is necessary to sufficiently attenuate the power supply Vd and then raise it again. However, in this device which supplies the power supply Vd of the inverter control circuit 3 from the inverter DC section via the DC-DC converter 2, the inverter DC section potential Vc and the power supply Vd have the relationship shown in FIG. 4, so the DC section potential If Vc is not sufficiently attenuated, the power supply Vd will not be attenuated, and as shown in the figure, if the power off time is long (T1), a reset will be applied, but if the power off time is short (T2), a reset will not be applied even if the power is turned on again. I couldn't. Therefore, in the conventional device, it is necessary to secure an off time for the AC power source Va until the inverter DC section potential Vc is sufficiently attenuated, and since that time varies depending on the load condition, it is necessary to ensure the time required for resetting even under the lightest load condition. This has the disadvantage that it is not suitable for quick reset operations.
本発明は交流電源の無通電状態を検出し、無通電状態と
なってから、所定時間後通電状態となったときにリセッ
ト信号を出力して制御手段をリセットするリセット信号
発生手段を備えることによシ上記欠点を除去するもので
あシ、以下実施例を用いて詳細に説明する。The present invention includes a reset signal generating means that detects a non-energized state of the AC power source and outputs a reset signal to reset the control means when the AC power supply becomes energized after a predetermined period of time after the AC power supply becomes non-energized. The present invention is intended to eliminate the above-mentioned drawbacks, and will be explained in detail below using examples.
第5口拡本発明による変換装置の一実施例の概略構成を
示すブロック図であシ、第1図と同一部分には同一符号
を用いその説明は省略する。同図において10はインバ
ータ主回路部1への交流電源Vaの供給状態を絶縁し、
検出する電源検出器、11は上記電源検出器10の出力
Cを受けて交流電源Vaが所定期間以上オフし、その後
再びオンすればリセット信号を発生するリセット信号発
生器であシ、上記電源検出器10とリセット信号発生器
11でリセット信号発生手段12が構成されている。第
6図は上記リセット信号発生手段12の一実施例を示す
回路図である。同図において、電源検出器10は交流電
源VaのR相S相間に接続された単相単波整流器13と
その半波整流信号によシ交流電源Vaの供給状態を検出
する光絶縁素子14から成シ、第7図に示す出力信号C
を出力する。またリセット信号発生器11は上記出力信
号Cを入力とし、■レベルからLレベルへの変化をトリ
ガとし、抵抗15とコンデンサ16によ力設定される期
間、Hレベルの信号りを出力する単安定マルチバイブレ
ータ17と、上記信号りを入力して抵抗18とコンデン
サ19により設定される期間リセット信号Eを出力する
単安定マルチバイブレータ20から成っている。Fifth Expansion This is a block diagram showing a schematic configuration of an embodiment of the converting device according to the present invention, and the same parts as in FIG. In the figure, 10 insulates the supply state of AC power Va to the inverter main circuit section 1;
The power supply detector 11 for detecting is a reset signal generator that receives the output C of the power supply detector 10 and generates a reset signal when the AC power supply Va is turned off for a predetermined period or more and then turned on again. The reset signal generator 10 and the reset signal generator 11 constitute a reset signal generating means 12. FIG. 6 is a circuit diagram showing an embodiment of the reset signal generating means 12. In the figure, a power supply detector 10 includes a single-phase single-wave rectifier 13 connected between R and S phases of an AC power source Va, and an optical insulating element 14 that detects the supply state of the AC power source Va based on its half-wave rectified signal. output signal C shown in FIG.
Output. The reset signal generator 11 receives the above output signal C as an input, uses the change from the ■ level to the L level as a trigger, and outputs a monostable signal at the H level for a period in which the power is set by the resistor 15 and the capacitor 16. It consists of a multivibrator 17 and a monostable multivibrator 20 which inputs the above signal and outputs a reset signal E for a period set by a resistor 18 and a capacitor 19.
次に以上のように構成された本実施例の動作を第7図に
示すタイムチャートを併用して説明する。Next, the operation of this embodiment configured as described above will be explained with reference to the time chart shown in FIG. 7.
交流電源V’aが投入され、主回路直流部の平渭コンデ
ンサ1bに電荷が蓄積され、直流直流変換器2によシイ
ンパータ制御回路3に電源Vdが供給され、インバータ
動作が継続しているとき、異常が発生し、インバータ動
作が停止されたとする。When the AC power supply V'a is turned on, charge is accumulated in the Hirayoshi capacitor 1b of the main circuit DC section, the power supply Vd is supplied to the inverter control circuit 3 through the DC/DC converter 2, and the inverter operation continues. Assume that an abnormality occurs and the inverter operation is stopped.
このとき、交流電源Vhの切9人にょシインパータ制御
回路3のリセットが必要となる。まず時間t1にて交流
電源Vaをオフにし、上記交流電源Vaの半サイクル時
間よりも十分長く、また本装置において設計目標とする
瞬時停電時のインバータ動作継続時間よシ長く設定され
たT off時間後めt2にて再び復帰させたとする。At this time, it is necessary to turn off the AC power supply Vh and reset the inverter control circuit 3. First, at time t1, the AC power supply Va is turned off, and the Toff time is set to be sufficiently longer than the half cycle time of the AC power supply Va, and also longer than the inverter operation continuation time during a momentary power outage, which is the design target of this device. Assume that it is returned again later at t2.
このとき第7図に示すようにインバータ直流部電位Vc
が減衰することなく、十分なレベルであっても以下に示
す動作によりリセットが可能となる。即ち、交流電源V
aが供給されているときは、電源検出器10からは第7
図に示すような出力信号Cとして交流電源Vaと同一周
期でHレベル、tレベルが繰返し出力されるが、リセッ
ト信号発生回路11の前段の単安定マルチバイブレータ
17においては抵抗15及びコンデンサ16によシ出力
信号りのパルス幅は交流電源Vaの半サイクルよシ長く
設定されているので電源半サイクルの不導通相当期間は
不感となシ正常運転続行にはさしつかえない。At this time, as shown in FIG. 7, the inverter DC section potential Vc
Even at a sufficient level without attenuation, it is possible to reset by the operation described below. That is, AC power supply V
When a is being supplied, the seventh
As the output signal C shown in the figure, H level and t level are repeatedly output in the same cycle as the AC power supply Va, but in the monostable multivibrator 17 at the front stage of the reset signal generation circuit 11, the resistor 15 and capacitor 16 Since the pulse width of the output signal is set to be longer than the half cycle of the AC power supply Va, the period corresponding to the non-continuity of the power supply half cycle is insensitive and does not pose a problem for continuing normal operation.
ここで、交流電源Vaをリセット動作を目的に定められ
た時間以上オフすると、単安定マルチバイブレータ17
のトリガが入力されず、出力信号りは設定されたパルス
幅のtllの時点でHレベルからLレベルに転じる。そ
してT off時間経過後t2の時点で交流電源V&が
復帰されると出力信号CはHレベルからLレベルに転じ
、それに応じて出力信号りはLレベルからHレベルに転
じる。従って、単安定マルチバイブレータ18の出力信
号Eは、このときLレベルからHレベルに転じ、抵抗1
8とコンデンサ19によシ設定された期間だけHレベル
のリセット信号Eを発生する。このようにして本実施例
によるインバータ装置は交流電源の切9人によ多負荷条
件にかかわらずインバータ制御回路3がリセットされ、
再びインバータ動作を開始することができる。Here, if the AC power supply Va is turned off for a predetermined time or more for the purpose of reset operation, the monostable multivibrator 17
The trigger is not input, and the output signal changes from the H level to the L level at the set pulse width tll. When the AC power supply V& is restored at time t2 after the Toff time has elapsed, the output signal C changes from the H level to the L level, and accordingly, the output signal C changes from the L level to the H level. Therefore, the output signal E of the monostable multivibrator 18 changes from L level to H level at this time, and the resistor 1
8 and a capacitor 19, a reset signal E of H level is generated for a period set by the capacitor 19. In this way, in the inverter device according to this embodiment, the inverter control circuit 3 is reset regardless of the heavy load condition when the AC power is turned off.
Inverter operation can be started again.
なお、上記実施例においては電源検出器10には単相半
波整流回路13と光絶縁素子14を用いたが、単相全波
、3相半波、3相全波等の整流回路や他の絶縁手段を用
いてもよい。またリセット信号発生回路11は単安定マ
ルチバイブレータ17.20で構成したがカウンター等
の他の時間管理手段を用いてもよい。In the above embodiment, the single-phase half-wave rectifier circuit 13 and the optical insulation element 14 were used in the power supply detector 10, but single-phase full-wave, three-phase half-wave, three-phase full-wave, etc. rectifier circuits and other Insulating means may also be used. Furthermore, although the reset signal generation circuit 11 is composed of monostable multivibrators 17 and 20, other time management means such as a counter may be used.
以上説明したように本発明による変換装置によれば交流
電流の無通電状態を検出し、無通電状態となってから所
定時間後通電状態となったときにリセット信号を出力し
て制御手段をリセットするリセット信号発生手段を備え
たことにより、できるという効果がある。As explained above, according to the converter according to the present invention, a non-conducting state of alternating current is detected, and when a predetermined period of time after the non-conducting state becomes energized, a reset signal is outputted to reset the control means. By providing a reset signal generating means to
第1図及び第2図は従来の変換装置の一例を示すブロッ
ク図、第3図は同じくリセット回路の回路図、第4図は
同じくリセット動作を示すタイムチャート、第5図及び
第6図は本発明による変換装置の一実施例を示すブロッ
ク図及び回路図、第7図は従来例及び本実施例の動作を
示すタイムチャートである。
1・・・インバータ主回路部、2・・・直流直流変換器
、3・・・インバータ制御回路、10・・・電源検出器
、11・・・リセット信号発生器、12・・elJセッ
ト信号発生手段、なお図中、同一または相当部分には同
一符号を用いている。
第6図
第7図
手続補正書(自発
2、発明の名称
変換装置
3、補正をする者
事件との関係 特許出願人
住 所 東京都千代田区丸の内二丁目2番3号名 称
(601)三菱電機株式会社
代表者片山仁八部
4、代理人
住 所 東京都千代田区丸の内二丁目2番3号三菱電機
株式会社内
5、補正の対象
発明の詳細な説明の欄。
6、補正の内容
(11明細書第2頁第10行目「VCを検出し」とある
のをrVcを入力とし」と補正する。
(2)同書第2頁第19行目[ランシスタトライブ」と
あるのを[ランジスタドライブ」と補正する。
(3)同書第6頁第4行目「再投しても」とあるのを「
再投入しても」と補正する。
(4)同書第7頁第13行目「単相単波」とあるのを「
単相半波」と補正する。
以上1 and 2 are block diagrams showing an example of a conventional conversion device, FIG. 3 is a circuit diagram of the reset circuit, FIG. 4 is a time chart showing the reset operation, and FIGS. 5 and 6 are A block diagram and a circuit diagram showing one embodiment of the conversion device according to the present invention, and FIG. 7 are time charts showing the operations of the conventional example and the present embodiment. DESCRIPTION OF SYMBOLS 1... Inverter main circuit section, 2... DC-DC converter, 3... Inverter control circuit, 10... Power supply detector, 11... Reset signal generator, 12... elJ set signal generation In the figures, the same reference numerals are used for the same or corresponding parts. Figure 6 Figure 7 Procedural amendment (self-initiation 2, invention name conversion device 3, relationship with the case of the person making the amendment Patent applicant address 2-2-3 Marunouchi, Chiyoda-ku, Tokyo Name)
(601) Mitsubishi Electric Corporation Representative Hitoshi Katayama 4, Agent address Mitsubishi Electric Corporation 5, 2-2-3 Marunouchi, Chiyoda-ku, Tokyo, Column for detailed explanation of the invention subject to amendment. 6. Contents of correction (11 Specification, page 2, line 10, "Detect VC" is corrected to "rVc is input"). (2) Page 2, line 19 of the same document ” has been corrected to read “ransistor drive.” (3) In the same book, page 6, line 4, “even if re-thrown” has been changed to “
Even if it is re-injected,” he corrected. (4) On page 7, line 13 of the same book, replace the phrase “single phase single wave” with “
Corrected as "single-phase half-wave."that's all
Claims (1)
波数出力に変換する変換手段と、この変換手段を制御す
る制御手段と、上記変換手段の直流を上記制御手段の電
源として供給する直流直流変換手段とを備えた変換装置
において、上記交流電源の無通電状態を検出し、交流電
源が無通電状態となってから所定時間後通電状態となっ
たときにリセット信号を出力して上記制御手段をリセッ
トするリセット信号発生手段を備えたことを特徴とする
変換装置。A conversion means for converting AC power into DC and converting the DC into a variable voltage, variable frequency output, a control means for controlling the conversion means, and a DC for supplying the DC of the conversion means as a power source for the control means. a converting device comprising a converting means, which detects a non-energized state of the AC power source, and outputs a reset signal when the AC power source becomes energized after a predetermined period of time after the AC power source becomes a non-energized state; 1. A conversion device comprising reset signal generating means for resetting.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP59082507A JPS60226776A (en) | 1984-04-24 | 1984-04-24 | Converter |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP59082507A JPS60226776A (en) | 1984-04-24 | 1984-04-24 | Converter |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS60226776A true JPS60226776A (en) | 1985-11-12 |
Family
ID=13776418
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP59082507A Pending JPS60226776A (en) | 1984-04-24 | 1984-04-24 | Converter |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS60226776A (en) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH02193571A (en) * | 1989-01-19 | 1990-07-31 | Toyo Electric Mfg Co Ltd | Reset of control circuit of power converting device |
Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS58190232A (en) * | 1982-04-28 | 1983-11-07 | 富士通株式会社 | Power source instantaneous disconnection detector circuit |
-
1984
- 1984-04-24 JP JP59082507A patent/JPS60226776A/en active Pending
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