JPS60195470A - Stc circuit of radar receiver - Google Patents
Stc circuit of radar receiverInfo
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- JPS60195470A JPS60195470A JP59050494A JP5049484A JPS60195470A JP S60195470 A JPS60195470 A JP S60195470A JP 59050494 A JP59050494 A JP 59050494A JP 5049484 A JP5049484 A JP 5049484A JP S60195470 A JPS60195470 A JP S60195470A
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- Radar Systems Or Details Thereof (AREA)
Abstract
Description
本発明は、レーダ受信機のS T O(Sens自iv
i tyTime 0ontrol)回路、特にSTO
信号カーブ?予めメモリに記憶しておき、メモリに記憶
さn、ているこのSTO信号カーブのデータから所望の
5T(N信号を発生させるレーダ受信機のS T 0回
路に関するものである。
レーダ、1片に船舶に使用さnるレーダにおいてfdM
f面の状態により海面反射妨害といわする強い反射妨害
が生じる。この海面反射妨害を抑圧するために、870
回路が使用さnている。レーダの受信機に入力する反射
信号の強度は、距離の4乗または3乗に逆反例1.て遠
くに行くほど小さくなるので、近距離からの強い反射信
号に対The present invention provides a radar receiver STO (Sensor IV)
i tyTime 0ontrol) circuit, especially STO
Signal curve? This is related to the ST 0 circuit of the radar receiver that generates the desired 5T (N signal) from the data of this STO signal curve stored in the memory in advance and stored in the memory. fdM in radars used on ships
Depending on the condition of the f-plane, strong reflected interference called sea surface reflected interference occurs. In order to suppress this sea surface reflection disturbance, 870
The circuit is used. The intensity of the reflected signal input to the radar receiver is the fourth or third power of the distance.Example 1. The farther away the
【7てけ受信機の感度?抑制し、遠距離に行に従
がって受信機の感度を上げるようVCS T (1回路
分動作させ、物標信号全検出できるようにしている。実
用に肖っては受信機中間周波増幅器の初段に第1図に示
さnた8 T O信号波形に各調整信号で調整した信号
が制御信号として印加さnる。第1図において、矢印へ
は最小感度Ak1MP(Min 5ensNivily
)、矢印Bけ最小利1:I範囲Q (Min gain
duration)、矢印0けスロープ調整(Rec
overy 5lopel’(z表わしており、こnら
の調整が行える870回路によって使用条件VC,適応
したS′「0信号を虻生させるようにしている。
従来の5T(1回路は、第1図に示さf′lたスロープ
調整の部分、すなわち前記説明の距離の4乗まfCは3
乗に反比例して感度が減少して行(S T O信号波形
をコンデンサの放[176形ケ利用して作成していた。
そのため希望する感りn′特性が得ら1しず、例えば第
2図図示の如く範囲D″′Cは感度が下りすぎのためそ
の領域に物標が存在していても映像が映らない事態が発
生し、入力信号に、適応した感度特性カーブ全作成する
ことが困稚であった。また受信機の受信部が改良等によ
り変更さnる都度、STO回路も変更しなけnばならず
、さらに使用情況により異なったSTO信号カーブ全使
用したい場合に、きめ細い対応した感1「特性が得ら几
ない等の欠点があった。
本発明は上記の欠点を解決すること全目的とし。
ており、受信機への入力信号に適応したSTO信号カー
ブのデータを予めメモリに記憶しておき、使用情況に応
じて適宜のSTO信号カーブのデータをメモリから耽出
し、そ几をアナログ化することにより所望のSTO信号
を発生し得るレーダ受信部の8TO回路?提供すること
全目的と(7ている。以下図面全参照しながら本発明の
レーダ受信機のSTO回路を説明する。
第3図は本発明に係るレーダ受信機のSTO回路の一実
施例構成、第4図は第3図の動作を説明(7ているタイ
ムチャート、第5図は本発明の具体的(ロ)路の一実施
例回路構成を示している。
第3図において、1はメモリ、2けアドレスコントロー
ル部、3はディジタル−アナログ変換部、4け加勢器金
表わしている。
メモリ1には受信機への入力信号?こ適応したSTO信
号カーブのデータが予め記憶さ几ている。
STO信号カーブのデータは、距離の4乗または距離の
3乗に反比例して変化する波形の信号を発生器等で発生
させ、その発生した信号全アナログ−ディジタル費換器
を用いてディジタル化しメモリ】に記憶さnたものであ
る。メモリ1に記憶さnるSTO信号カーブは信号発生
器等?用いて発生させているので、任意のSTO信号波
形を記憶させておくことができ、従がって受信機への入
力信号に適応したSTO信号信号カーブ心得とができる
。
アドレスコントロール部2はメモリlのアドレス全出力
する。こ′n5によりアドレスコントロール部2が出力
するメモリ1のアドレス上に記憶さrl。
ているSTO信号カーブのデータがIIk′(次読出さ
ILる。アドレスコントロール部2はトリガ信号全骨け
ることによりアドレスを順次歩進させ、STO有効距離
範囲信号の受領によってアドレスの歩進を停止させる。
ディジタル−アナログ変換部3はメモリ1から読出さn
、た8 ’I” O信号カーブのデータ全アナログ化す
る。そしてこのディジタル−アナログ変換部3ではS
T Oレベル;!I14整、すなわち第1図に示さnた
ST’Oレベル調整C矢印人)が行わ1する。
加算器4はS T (]レベル調整が行わnた8TC信
号にゲイン調整信号のrM流分を1督する回路であって
、ゲインコントロール調整が行わnる。このゲインコン
トロール調整が行わrlたSTO信号が受信部の中間周
波増幅器の初段に制御信号として加えら几る。
このように構成さnている本発明の動作會第4図のタイ
ムチャートに用いて説明する。
レーダのアンテナから送信ノぞルスを発射すると同時に
アドレスコントロール部2ヘトリガ伯号力;送らnてく
る(第4図:=)。こ几によりアドレスコントロール部
2はメモリ1に対するアドレスを歩進させる。′i!た
メモリ1に対し読出しのメモリコントロール信号が送ら
nてくることにより(第4図イ)、メモリ1から8TO
信号カーブのデータが順次読出さn、る。こILらのS
TOイg号カーブのデータはディジタル−アナログ変換
部3でアナログ信号に変換さ几ると共に、STOレベル
調整が行わ几る。時間の経過に伴なってアドレスコント
ロール部2へSTO有効距離範囲信号が送らfしてくる
と(第4図)\のE)、メモリ1のアドレスの歩進は停
止させらnる。メモリ1に対し読出しのメモリコントロ
ール信号が依然として送らnてくるので、メモリ1から
その停止したアドレス上のSTO信号カーブのデータが
引き続き読出さ几る(第4図ホのF)。メモリ1へ胱、
出しのメモリコントロール信号が送ら几て来なくなると
(i4図イのGl、アドレスコントロール部2のアドレ
スはクリアーさn−る。このようにしてメモリ1に対す
る絖ul L、 (7) 1サイクルが終了するが、再
びレーダのアンテナから送信・ゼルス全発q4するとm
1時にアドレスコントロール部2ヘトリガ伯号が送らn
てぐることにより次のサイクルが開始する。
ディジタル−アナログ変換部3でアナログ化さn、かつ
STOレベル調整さnたSTO信号は、加算器4でゲイ
ン焦(整信号のjH流分が重畳さnC第4図へ)、ゲイ
ンコントロール調整さn2て受信部の中間周波増幅器の
初段に制御信号としてノ111えらnる。
第5図り第3図の具体的回路の一実施例であり、陣1図
のメモリ1、アドレスコントロール部2、ディジタル−
アナログ変換部3、加11−器4け第3図のものに対応
している。
アドレスコントロール部2はフリップフロップ11、モ
ノマルチバイブレータ12、カウンタ13、切換回路1
4、フリツゾフロツゾ15等で構成さnている。トリガ
信号が入力するフリップフロップ】1はモノマルチバイ
ブレータ12の発振及びカウンタ13のカウントをそn
ぞれ制御する。モノマルチバイブレータ12はコンデン
サ16と抵抗18による時定数のモノマルチバイブレー
タと、コンデンサ17と切換回路140両定により決定
さnる抵抗19ないし22のいずILかの抵抗によるモ
ノマルチツマイブレータとを備えており、こnらの2つ
のモノマルチバイブレータが直列に接続さ几発振周波数
が可変な発振器となっている。カウンタ13はメモリ1
のアドレスを指定し、フリップフロップ15は第4図ホ
に示さn、たSTO有効距離範囲全コントロールする。
ディジタル−アナログ変換部3には掛洒器付ディジタル
ーアナログ変換器24が用いらn、ている。
この掛算器付ディジタル−アナログ変換器24は抵抗2
5會介して入力するSTOレベル調整信号に基づき、メ
モリ1から読出さnた8T(1信号カーブのデータに所
定の倍lq 5掛は合せた上でそのデータ全アナログ化
し、STOレベル調整を行っている。
加算器4には演算増幅器25が用いら11.ており、こ
の演算増幅器25に入力するS1゛0信号と直流分のゲ
イン調整信号と全演算増幅器25は加勢(7ている。
第5図の動作は第3図で説明した動作と同様である。ス
イッチ26を切換えることによりメモリ1の上位アドレ
スA7が変化し、メモリ1に記憶さnているSTO信号
カーブのデータが2通り読出すことができる。すなわち
スイッチ26はSTO信号切換スイッチであり、このス
イッチ26によりメモリ1の上位アドレスが変化するよ
うにしておけば、メモリ1から枚数側のSTO信号會発
生させることができる。こ1.により情況に応じたST
O信号を発生させて海面に生じている波浪と物標とを弁
別することができるようになる。
上記の説明においてSTO信号カーブのデータが記憶さ
nるメモリ1は通常ROMを使用するが、ROMに代え
EBPROMやRAMを使用することもできる。この場
合はユーザがSTO信号カーブのデータを記憶させるこ
ととなり、使用者が希望する受信感度特性をもつSTO
信号カーブが得らnる。
また受信部には通常リニアアンプ?使用しているが、近
年実用性が増大しつつあるログアンプに対しても対応で
きるため、メモリ1にログアンプ用のSTO信号カーブ
のデータ全記憶させておけば、リニアアンプとログアン
プとの切換えて使用することも容易に行うことができる
。
ディジタル−アナログ変換部3に使用さ几るディジタル
−アナログ変換器は掛算器付を必ずしも使用(7なくて
もよく、別構成で所望の8′POレベル調整金行っても
よいことは言う捷でもない。
以上説明した如く、本発明VCよnげ、STO回路のS
TO信号カーブの発生をディジタルメモリにより実現し
たので、各種受信機の特性に容易に対応できるとともに
、STO信号カーブ全任意に作成することができ、捷た
情況にLl・、−じたSTO信号カーブ全選択すること
ができ、従って海面反射の妨害除去が可能となる。[7. Sensitivity of the receiver? In order to increase the sensitivity of the receiver as the distance increases, one circuit of VCST (VCST) is operated to enable detection of all target signals.In practical use, the receiver intermediate frequency amplifier A signal adjusted by each adjustment signal to the 8 TO signal waveform shown in Fig. 1 is applied as a control signal to the first stage of the control signal.
), Arrow B Minimum profit 1: I range Q (Min gain
duration), arrow 0 slope adjustment (Rec
The conventional 5T (1 circuit is shown in Fig. The part of the slope adjustment shown in
The sensitivity decreases in inverse proportion to the power of As shown in Figure 2, the sensitivity in range D'''C is too low, so even if there is a target in that area, no image is displayed. Therefore, it is necessary to create a sensitivity characteristic curve that is adapted to the input signal. In addition, each time the receiving section of the receiver was changed due to improvements, the STO circuit had to be changed, and furthermore, if you wanted to use all of the STO signal curves that differed depending on the usage situation, you would have to change the STO circuit. The object of the present invention is to solve the above-mentioned drawbacks. The 8TO circuit of the radar receiving section can generate the desired STO signal by storing the data in advance in the memory, extracting appropriate STO signal curve data from the memory according to the usage situation, and converting the curve into analog. The STO circuit of the radar receiver according to the present invention will be explained below with reference to all the drawings. FIG. 3 shows the configuration of an embodiment of the STO circuit of the radar receiver according to the present invention. FIG. 4 is a time chart explaining the operation of FIG. 3 (7), and FIG. , a 2-digit address control section, 3 a digital-to-analog conversion section, and a 4-digit auxiliary device.In the memory 1, data of the STO signal curve adapted to the input signal to the receiver is stored in advance. STO signal curve data is obtained by generating a signal with a waveform that changes in inverse proportion to the fourth power of the distance or the cube of the distance using a generator, etc., and digitizing the generated signal using an all-analog-to-digital converter. The STO signal curve stored in memory 1 is generated using a signal generator, etc., so any STO signal waveform can be stored and Therefore, the STO signal signal curve can be adjusted to suit the input signal to the receiver.The address control section 2 outputs all the addresses of the memory 1.This causes the address control section 2 to output all the addresses of the memory 1. The data of the STO signal curve stored in rl is IIk' (next read IL).The address control section 2 sequentially increments the address by disabling all the trigger signals, and changes the address by receiving the STO effective distance range signal. stop the progress of The digital-to-analog converter 3 reads n from the memory 1.
, 8 'I'' All the data of the O signal curve are converted into analog data.Then, in this digital-to-analog converter 3, the S
TO level;! I14 adjustment, that is, the ST'O level adjustment shown in FIG. The adder 4 is a circuit that outputs the rM flow of the gain adjustment signal to the 8TC signals that have been subjected to level adjustment, and performs gain control adjustment. The signal is added as a control signal to the first stage of the intermediate frequency amplifier in the receiving section. At the same time as the signal is emitted, a trigger signal is sent to the address control unit 2 (Figure 4: =). Through this process, the address control unit 2 increments the address for memory 1. By sending a read memory control signal to (Fig. 4A), memories 1 to 8 TO
Data of the signal curve is read out sequentially. This IL et al.'s S
The data of the TO Ig curve is converted into an analog signal by the digital-to-analog converter 3, and the STO level is adjusted. As time elapses, when the STO effective distance range signal is sent to the address control section 2 (FIG. 4), the incrementing of the addresses in the memory 1 is stopped. Since the read memory control signal is still sent to the memory 1, the data of the STO signal curve at the stopped address is continuously read from the memory 1 (F in FIG. 4). Bladder to memory 1,
When the initial memory control signal is no longer sent (Gl in Figure 4), the address of address control section 2 is cleared. In this way, the voltage for memory 1 is set to L, (7) 1 cycle is completed. However, when transmitting again from the radar antenna and firing all Zels q4, m
At 1 o'clock, a trigger signal is sent to the address control section 2.
The next cycle starts by turning. The STO signal converted into analog and STO level-adjusted by the digital-to-analog converter 3 is converted into a gain focus by the adder 4 (the jH flow of the rectified signal is superimposed on it to Fig. 4), and the gain control is adjusted. A control signal 111 is sent to the first stage of the intermediate frequency amplifier of the receiving section. Figure 5 is an embodiment of the specific circuit shown in Figure 3, and includes the memory 1, address control section 2, and digital circuit shown in Figure 1.
The analog converter 3 and the adder 11 correspond to the four adders shown in FIG. The address control section 2 includes a flip-flop 11, a mono multivibrator 12, a counter 13, and a switching circuit 1.
4. It is composed of 15 pieces of Fritz. Flip-flop 1 to which the trigger signal is input controls the oscillation of the mono multivibrator 12 and the counting of the counter 13.
control each. The mono multivibrator 12 includes a mono multivibrator with a time constant made up of a capacitor 16 and a resistor 18, and a mono multivibrator with a time constant of a capacitor 17 and a switching circuit 140, and a mono multivibrator with a resistor IL of n and resistors 19 to 22 determined by the capacitor 17 and the switching circuit 140. These two mono multivibrators are connected in series to form an oscillator with variable oscillation frequency. Counter 13 is memory 1
The flip-flop 15 controls the entire STO effective distance range shown in FIG. The digital-to-analog converter 3 includes a digital-to-analog converter 24 with a converter. This digital-to-analog converter 24 with a multiplier has a resistor 2
Based on the STO level adjustment signal inputted through 5 sessions, the signal is read out from memory 1 and multiplied by 8T (1 signal curve data by a predetermined factor of 1q 5 times), and the data is all analogized and the STO level is adjusted. An operational amplifier 25 is used in the adder 4, and the S1'0 signal input to the operational amplifier 25, the DC component gain adjustment signal, and the entire operational amplifier 25 are added (7th. The operation in Fig. 5 is the same as the operation explained in Fig. 3. By switching the switch 26, the upper address A7 of the memory 1 changes, and the data of the STO signal curve stored in the memory 1 can be read in two ways. That is, the switch 26 is an STO signal changeover switch, and if the upper address of the memory 1 is changed by this switch 26, the STO signal for the number of sheets can be generated from the memory 1. 1. ST depending on the situation
By generating an O signal, it becomes possible to distinguish between waves occurring on the sea surface and targets. In the above description, the memory 1 in which the data of the STO signal curve is stored usually uses a ROM, but an EBPROM or a RAM can also be used instead of the ROM. In this case, the user has to memorize the data of the STO signal curve, and the STO signal curve with the reception sensitivity characteristics desired by the user is stored.
A signal curve is obtained. Also, is the receiving section usually a linear amplifier? However, it is also compatible with log amplifiers, which have become increasingly practical in recent years, so if you store all the data of the STO signal curve for log amplifiers in memory 1, you can easily connect linear amplifiers and log amplifiers. It can also be easily switched and used. The digital-to-analog converter used in the digital-to-analog converter 3 does not necessarily have to be equipped with a multiplier (it is also possible to adjust the desired 8'PO level with a separate configuration). As explained above, the S of the VC and STO circuit of the present invention
Since the generation of the TO signal curve is realized using digital memory, it can easily correspond to the characteristics of various receivers, and the STO signal curve can be created arbitrarily. All can be selected, thus making it possible to remove interference from sea surface reflections.
第1図は5T(1信月波形の峠明図、第2図は受信機の
感度特性と入力色−号との相違を糾明するための特性曲
線図、第3図は本発明に係るレーダ受信機のSTO回路
の一実施例構成、第4図は第3図の動作を説明するため
のタイムチャート、第5図は本発明の具体的回路の一実
施例回路構成分示す。
図中、1#″tメモリ、2はアドレスコントロール部、
3けディジタ/l−アナログ変換部% 4にし加算1L
11tj、フリップフロップ、12ir、モノマルチバ
イブレータ、13はカウンタ、14Vtν)換回路、1
5はフリップフロップ、24は掛賛器付ディジタルーア
ナログ変換益、25り演t>増幅器、26はスイッチで
ある。
特許出願人 安立電気株式会社
第1 図
第2図Figure 1 is a diagram of the 5T waveform, Figure 2 is a characteristic curve diagram for clarifying the difference between the sensitivity characteristics of the receiver and the input color signal, and Figure 3 is a diagram of the radar according to the present invention. FIG. 4 shows a time chart for explaining the operation of FIG. 3, and FIG. 5 shows the configuration of an embodiment of the STO circuit of the receiver. 1#''t memory, 2 is address control section,
3 digit digit/l-analog converter% 4 and add 1L
11tj, flip-flop, 12ir, mono multivibrator, 13 is counter, 14Vtν) switching circuit, 1
5 is a flip-flop, 24 is a digital-to-analog conversion circuit with a multiplier, 25 is an amplifier, and 26 is a switch. Patent applicant Anritsu Electric Co., Ltd. Figure 1 Figure 2
Claims (1)
反射波全抑制するレーダ受信機の870回路において:
前記受信機への入力信号に適応した8TO信号カーブの
データを予め記憶jまたメモリ1と;メモリ1に記憶さ
几ているSTO信号カー フ+7) −y −p 2読
出すアドレスコントロール部2と;メモリ1から耽出さ
nたSTO信号カーブのデータをアナログ化するディジ
タル−アナログ変換部3と分有すること全特徴とするレ
ーダ受信機の870回路。In the 870 circuit of a radar receiver that lowers the receiver sensitivity immediately after the transmission pulse is emitted and completely suppresses the waves reflected from the sea surface at a short distance:
An address control section 2 which stores in advance the data of the 8TO signal curve adapted to the input signal to the receiver and reads out the STO signal curve stored in the memory 1; 870 circuit of a radar receiver, which is characterized in that it has a digital-to-analog converter 3 for converting the data of the STO signal curve extracted from the memory 1 into analog.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP59050494A JPS60195470A (en) | 1984-03-16 | 1984-03-16 | Stc circuit of radar receiver |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP59050494A JPS60195470A (en) | 1984-03-16 | 1984-03-16 | Stc circuit of radar receiver |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS60195470A true JPS60195470A (en) | 1985-10-03 |
Family
ID=12860481
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP59050494A Pending JPS60195470A (en) | 1984-03-16 | 1984-03-16 | Stc circuit of radar receiver |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS60195470A (en) |
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