JPS60113284A - 映像信号合成回路 - Google Patents
映像信号合成回路Info
- Publication number
- JPS60113284A JPS60113284A JP58221040A JP22104083A JPS60113284A JP S60113284 A JPS60113284 A JP S60113284A JP 58221040 A JP58221040 A JP 58221040A JP 22104083 A JP22104083 A JP 22104083A JP S60113284 A JPS60113284 A JP S60113284A
- Authority
- JP
- Japan
- Prior art keywords
- input signal
- video
- input
- signal
- output
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
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- Position Input By Displaying (AREA)
- Controls And Circuits For Display Device (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
（ａ）発明の技術分野
本発明は、規定の輝度を持ってブラウン管面上に表示す
る３種類の映像入力信号を合成する映像信号合成回路？
３に関する。
る３種類の映像入力信号を合成する映像信号合成回路？
３に関する。
（ｔ））技術の１？ＩＴ
ｔ？ｊ ９ＦＪ処）！ｌｊシステムで使用される表示装
置は文字。
置は文字。
記号９図形を可視像で表示する装置で１人間と機械との
情報交換を図る入出力装置である。
情報交換を図る入出力装置である。
表示素子としては液晶、プラズマパネル等が可なり実用
化されつつあるが、現在は陰極線管（以下ＣＲＴと称す
る）が主力となっている。
化されつつあるが、現在は陰極線管（以下ＣＲＴと称す
る）が主力となっている。
従来１表示装置は特殊な分野で使用されていたが、情報
処理システムの発達に伴い急速に普及発展して来た。
処理システムの発達に伴い急速に普及発展して来た。
最近の集積回路技術の急速な進歩と、利用範囲の拡大は
より高信頼度でより廉価な表示装置を提供することが一
段と強く要請されるようになって来た。
より高信頼度でより廉価な表示装置を提供することが一
段と強く要請されるようになって来た。
（ｃ）従来技術と問題点
従来の映像信号合成回路をＣＩ？Ｔ用映像信号合成回路
を例にきり１図面を参照して説明する。
を例にきり１図面を参照して説明する。
第１図は従来のＣＲＴ用映像映像信号合成回路す。
図において、１はｌ−ランジスタスイノチング部。
２は映像増幅部、３．４は輝度差調整部、 Ｌｌは線輪
、Ｒ１−Ｒ８は１１（抗器、 ＲＶＩは再度抵抗器、
ＴＲＩ 〜ＴＲ３はトランジスタをそれぞれ示す。尚、
ａ、ｂ。
、Ｒ１−Ｒ８は１１（抗器、 ＲＶＩは再度抵抗器、
ＴＲＩ 〜ＴＲ３はトランジスタをそれぞれ示す。尚、
ａ、ｂ。
Ｃは入力端子で入力端子ａには所定輝度入力信号（以下
入力信号へと称する）が、入力端子すには人力信男へよ
り明るい高輝度入力信号（以下入力信号１３と称する）
が、入力端子Ｃにはライトペン検知用で一番明るい高輝
度人力信号（以下入力信号−〇と称する）を入力する端
子、ｄは映像信号出力端子、＋ＶＢ１．＋Ｖ［１２は電
源電圧をそれぞれ示す。
入力信号へと称する）が、入力端子すには人力信男へよ
り明るい高輝度入力信号（以下入力信号１３と称する）
が、入力端子Ｃにはライトペン検知用で一番明るい高輝
度人力信号（以下入力信号−〇と称する）を入力する端
子、ｄは映像信号出力端子、＋ＶＢ１．＋Ｖ［１２は電
源電圧をそれぞれ示す。
第１図の回路は入力信号Ａ、入力信号Ｂが人力された時
、トランジスタスイッチング部１をスイッチング動作さ
せ、その出力を映像増幅部２のトランジスタＴＲＩ又は
輝度差調整部３のトランジスタＴＲ２のエミッタに接続
し、それぞれのエミッタ電流を制御することにより映像
信号出力を制御する。又、入力信号Ｃが入力さた時は抵
抗器Ｒ７を経由しトランジスタＴ１？１のエミッタに接
続して映像信り出力を制御する。尚輝度差調整部３，４
は人力信号へと人力信号Ｂによる輝度差を制御する働き
をする。
、トランジスタスイッチング部１をスイッチング動作さ
せ、その出力を映像増幅部２のトランジスタＴＲＩ又は
輝度差調整部３のトランジスタＴＲ２のエミッタに接続
し、それぞれのエミッタ電流を制御することにより映像
信号出力を制御する。又、入力信号Ｃが入力さた時は抵
抗器Ｒ７を経由しトランジスタＴ１？１のエミッタに接
続して映像信り出力を制御する。尚輝度差調整部３，４
は人力信号へと人力信号Ｂによる輝度差を制御する働き
をする。
以上の回路は安定した実績を持つ回路構成ではあるが、
各入力信号処理回路毎にトランジスタ素子と多数の抵抗
、コンデンサを必要とすることより、実装スペースが大
きくなる。又回路を構成する部品点数が多いことにより
障害の発生率が高くなり、製品の信頼度向上には限界が
あると言う問題点があった。
各入力信号処理回路毎にトランジスタ素子と多数の抵抗
、コンデンサを必要とすることより、実装スペースが大
きくなる。又回路を構成する部品点数が多いことにより
障害の発生率が高くなり、製品の信頼度向上には限界が
あると言う問題点があった。
（ｄ）発明の目的
本発明は、上記問題点を解消した新規な映像信号合成回
路を提供することを目的とし、特に映像信号合成回路の
部品点数を減少させることにより。
路を提供することを目的とし、特に映像信号合成回路の
部品点数を減少させることにより。
製品の信頼度をより向上さセると共に小型で廉価な映像
信号合成回路を実現することにある。
信号合成回路を実現することにある。
（ｅ）発明の構成
本発明は、ブラウン管面上に所定輝度で表示する映像入
力信号を増幅する映像増幅回路において。
力信号を増幅する映像増幅回路において。
前記所定輝度でブラウン管面上に表示する映像入力信号
と、前記ブラウン管面上の表示映像の一定部分を強調す
るための高輝度映像入力信号と、ライトペンの動作モー
ドとなったときに前記高輝度映像入力信号より更に高輝
度のライ１−ペン映像人力信号とを否定論理積素子で合
成することにより。
と、前記ブラウン管面上の表示映像の一定部分を強調す
るための高輝度映像入力信号と、ライトペンの動作モー
ドとなったときに前記高輝度映像入力信号より更に高輝
度のライ１−ペン映像人力信号とを否定論理積素子で合
成することにより。
前記映像増幅回路の信頼度をより一層向上させると共に
小型化、低価格化が可能となることを特徴とする映像信
号合成回路により達成することが出来る。
小型化、低価格化が可能となることを特徴とする映像信
号合成回路により達成することが出来る。
（「）発明の実施例
以下本発明を図面を参照して説明する。
第２図は本発明に係る映像増幅回路の一実施例テ、（Ａ
） ハ回１？ｌ［ｌ、（Ｂ）は波形図をそれぞれ図にお
い°ζ、５はスイッチング回路、６はビデオアンプ回路
、７は否定論理積素子ブロック、 Ｒ９−１２１６は抵
抗器、１ｃ１〜ＩＣ４は否定論理積素子。
） ハ回１？ｌ［ｌ、（Ｂ）は波形図をそれぞれ図にお
い°ζ、５はスイッチング回路、６はビデオアンプ回路
、７は否定論理積素子ブロック、 Ｒ９−１２１６は抵
抗器、１ｃ１〜ＩＣ４は否定論理積素子。
ＴＩ＋４はトランジスタをそれぞれ示す。
尚第１図と同一記号は同一内容を示し、又Ｔｏ〜Ｔ５は
所定条件の波形出刃期間、 ＶＯＩ〜ＶＯ３は映像信号
出力電圧をそれぞれ示す。
所定条件の波形出刃期間、 ＶＯＩ〜ＶＯ３は映像信号
出力電圧をそれぞれ示す。
本実施例は入力信１−Ａ、Ｂ、ｃが入力した時ス号をＣ
ＲＴの図示してないカソード又はグリフ）へ出力するビ
デオアンプ回路６．スイッチング回路５内にあり入力信
号Ａ、Ｂ、Ｃが入力した時スイッチング動作をするオー
プンコレクク型否定論理積素子集禎回路で構成されてい
る否定論理積素子ブロック７から構成されている。
ＲＴの図示してないカソード又はグリフ）へ出力するビ
デオアンプ回路６．スイッチング回路５内にあり入力信
号Ａ、Ｂ、Ｃが入力した時スイッチング動作をするオー
プンコレクク型否定論理積素子集禎回路で構成されてい
る否定論理積素子ブロック７から構成されている。
否定論理積素子ブロック７には３つの入力信号。
即ち入力信号Ａ、入力信号Ｂ、入力信号Ｃが接続される
。入力信号へには通常の表示を行うための通電輝度信号
、入力信号Ｂには通常輝度信号で表示した特定部分を強
調するための高輝度信号、入力信号Ｃにはライトペン検
知用高輝度信号（３つの入力信号の内で一番高輝度信号
）がそれぞれ入力される。各入力信号Ａ、Ｂ、ＣはＩＣ
Ｉ 、 ＩＣ３，ＩＣ４よりそれぞれ出力され、直接又
は抵抗器Ｒ１４，可変抵抗器ＲＶＩを経由して出力トラ
ンジスタＴＲ４のヘースに接続される。
。入力信号へには通常の表示を行うための通電輝度信号
、入力信号Ｂには通常輝度信号で表示した特定部分を強
調するための高輝度信号、入力信号Ｃにはライトペン検
知用高輝度信号（３つの入力信号の内で一番高輝度信号
）がそれぞれ入力される。各入力信号Ａ、Ｂ、ＣはＩＣ
Ｉ 、 ＩＣ３，ＩＣ４よりそれぞれ出力され、直接又
は抵抗器Ｒ１４，可変抵抗器ＲＶＩを経由して出力トラ
ンジスタＴＲ４のヘースに接続される。
ＩＣＩの１つの入力端子には入力信ち一層が、他の入力
端子には人力信号Ｂ及びｌｃ２の出力が接続され（入力
信号ＢとＩＣ２の出力はワイアード論理和される）１人
力する信号の論理積を取ると共に位相ズレを最小にする
よう動作する。ＩＣ３の１つの入力端子には入力信号Ｂ
が、他の入力端子には入力信号Ｃを接続し、入力する信
号の論理積を取ると共に位相ズレを最小にするよう動作
する。ＴＩ？１は否定論理積素子ブロック７からの出力
を電圧増幅するもので、電圧増幅した出力波形を線輪１
，１で波形整形してＣＲＴの図示してないカソード又は
グリ、トヘ出力する。
端子には人力信号Ｂ及びｌｃ２の出力が接続され（入力
信号ＢとＩＣ２の出力はワイアード論理和される）１人
力する信号の論理積を取ると共に位相ズレを最小にする
よう動作する。ＩＣ３の１つの入力端子には入力信号Ｂ
が、他の入力端子には入力信号Ｃを接続し、入力する信
号の論理積を取ると共に位相ズレを最小にするよう動作
する。ＴＩ？１は否定論理積素子ブロック７からの出力
を電圧増幅するもので、電圧増幅した出力波形を線輪１
，１で波形整形してＣＲＴの図示してないカソード又は
グリ、トヘ出力する。
各入力信ｑＡ、Ｂ、Ｃの入力レベルは通常トランジスタ
・トランジスタ・ロジック（ＴＴＬ ）のハイレー、ル
パ１”であり、映像をＣＲＴ （図示してない）に表示
する場合に“Ｏ”となる。
・トランジスタ・ロジック（ＴＴＬ ）のハイレー、ル
パ１”であり、映像をＣＲＴ （図示してない）に表示
する場合に“Ｏ”となる。
次に本実施例の動作を第２図（Ｂ）にもとすき説明する
。
。
各入力信号Ａ、Ｂ、Ｃが全゛ζ“】”の条件を持つ期間
ＴｏではＩＣＩの１つの入力端子には入力信号へが、他
の入力端子には［２の出力信号と入力信υ１３共に°“
１”であるからＲ１”が入力する。従って、 ＩＣＩの
出力はパＯ”となり出力トランジスタＴＩ？４がカント
オフされ、出力トランジスタＴｌ１４のコレクタ電位は
略＋ＶＢ２となる。
ＴｏではＩＣＩの１つの入力端子には入力信号へが、他
の入力端子には［２の出力信号と入力信υ１３共に°“
１”であるからＲ１”が入力する。従って、 ＩＣＩの
出力はパＯ”となり出力トランジスタＴＩ？４がカント
オフされ、出力トランジスタＴｌ１４のコレクタ電位は
略＋ＶＢ２となる。
次に入力信号Ａのみ“（１”の期間Ｔ１の場合はｒｃ３
、ＩＣ４出力は“θ″のままであり、且つＩＣ２出力も
“■１のままであるため、’ＩＣ２出力とＪＣ３人力の
ワイアード論理和によりＩＣＩのもう１つの入力は“１
″となる。即ち、 ＴＣＩは“０”と“１″の論理積に
より出力はパ１”となる。この時の出力トランジスタＴ
Ｒ４のヘース電圧をＶＴＩ とすると。
、ＩＣ４出力は“θ″のままであり、且つＩＣ２出力も
“■１のままであるため、’ＩＣ２出力とＪＣ３人力の
ワイアード論理和によりＩＣＩのもう１つの入力は“１
″となる。即ち、 ＴＣＩは“０”と“１″の論理積に
より出力はパ１”となる。この時の出力トランジスタＴ
Ｒ４のヘース電圧をＶＴＩ とすると。
ＶＴＩ ＃Ｒ１４−ＶＢＩ ／１１１３ ＋Ｒ１４とな
り、出力トランジスタＴＲ４のコレクタにはＶＯ１の電
圧が現われる。
り、出力トランジスタＴＲ４のコレクタにはＶＯ１の電
圧が現われる。
次に期間Ｔ２の場合は入力信号Ａ、Ｂが“０゛。
入力信号Ｃが“１”の場合であり、 ＩＣＩの入力は“
０”と“１”、 ｌｃ３の人力は”０”と“１″。
０”と“１”、 ｌｃ３の人力は”０”と“１″。
ＩＣ４の入力は１″と“１″ （従ってＩＣ２の出力は
１″となり、 ＩｃＩの１つの入力端子はＩＣ２出力“
１″とＩＣ３人力”Ｏ”とのワイアード論理和によりｌ
″が入力する）となり、 Ｉ（：１ とＩＣ３の出力が
Ｒ１”、 ＩＣ４の出力がＲ０”となる。この時の出力
トランジスタＴＲ４のヘース電圧をＶＴ２とすれば、
ＶＴ２ ＝ （Ｒ１４＋ＲＶ１ ） −ＶＢＩ ／Ｒ１
３＋Ｒ１４＋ｌ？ＶＩ（但し、 ＶＴｌ＜ＩＩＴ２とな
る）となり、出力トランジスタ几４のコレクタにはＶＯ
２の電圧が現われる。
１″となり、 ＩｃＩの１つの入力端子はＩＣ２出力“
１″とＩＣ３人力”Ｏ”とのワイアード論理和によりｌ
″が入力する）となり、 Ｉ（：１ とＩＣ３の出力が
Ｒ１”、 ＩＣ４の出力がＲ０”となる。この時の出力
トランジスタＴＲ４のヘース電圧をＶＴ２とすれば、
ＶＴ２ ＝ （Ｒ１４＋ＲＶ１ ） −ＶＢＩ ／Ｒ１
３＋Ｒ１４＋ｌ？ＶＩ（但し、 ＶＴｌ＜ＩＩＴ２とな
る）となり、出力トランジスタ几４のコレクタにはＶＯ
２の電圧が現われる。
次に期間Ｔ３の場合は入力信号Ａ、Ｂ、Ｃが“０”の場
合であり、 ＩｃＩ、ＩＣ３，ＩＣ４ともに入力は“０
” （従ってＩＣ２の出力は“０″）となり、従って出
力も全て“１”となる。この時の出カドランシア！、夕
Ｔｌｒ４ （７）ヘ−，１，電圧をＶＴ３とすれば、
ＶＴ３ ＃ＶＢ１ （但し、 ＶＴｔ ＜ｖＴ２ ＜Ｖ
Ｔ３ ）−ｈなり、出力トランジスタＴ１？４のコレク
タにはＶＯ３の電圧が現われる。
合であり、 ＩｃＩ、ＩＣ３，ＩＣ４ともに入力は“０
” （従ってＩＣ２の出力は“０″）となり、従って出
力も全て“１”となる。この時の出カドランシア！、夕
Ｔｌｒ４ （７）ヘ−，１，電圧をＶＴ３とすれば、
ＶＴ３ ＃ＶＢ１ （但し、 ＶＴｔ ＜ｖＴ２ ＜Ｖ
Ｔ３ ）−ｈなり、出力トランジスタＴ１？４のコレク
タにはＶＯ３の電圧が現われる。
次に期間１゛４の場合は入力信号Ａ、Ｃが“０”の場合
であり、 ＩＣＩ、ＩＣ４の入力は共に“Ｒ０”、 Ｉ
Ｃ３の人力は“１”と“０”であり、従って出力は全て
“１”となり５期間Ｔ３の場合と同一となる。又期間Ｔ
５の場合も出力は全て“ｌ”となり１期間Ｔ３の場合と
同一となる。
であり、 ＩＣＩ、ＩＣ４の入力は共に“Ｒ０”、 Ｉ
Ｃ３の人力は“１”と“０”であり、従って出力は全て
“１”となり５期間Ｔ３の場合と同一となる。又期間Ｔ
５の場合も出力は全て“ｌ”となり１期間Ｔ３の場合と
同一となる。
以上の動作で見たように、入力信号Ａを通審輝度信号と
して使用して、−足部分を高輝度にしたい場合は入力信
号Ｂを０″にすることにより入力信号Ａ４こは無関係に
高輝度にすることが出来る。
して使用して、−足部分を高輝度にしたい場合は入力信
号Ｂを０″にすることにより入力信号Ａ４こは無関係に
高輝度にすることが出来る。
又同様に、入力信号Ｃは入力信号Ａ、入力信号Ｂには無
関係に入力信号Ｂよりさらに高輝度を得ることが出来る
。尚Ｒν１を可変することにより、入力信号Ａと入力信
号Ｂとの輝度差を制御することも可能である。
関係に入力信号Ｂよりさらに高輝度を得ることが出来る
。尚Ｒν１を可変することにより、入力信号Ａと入力信
号Ｂとの輝度差を制御することも可能である。
（ｇ＞発明の効果
以上のような本発明によれば、小型で廉価でしかも高信
頼度な映像信号合成回路を提供出来ると言う効果がある
。
頼度な映像信号合成回路を提供出来ると言う効果がある
。
第１図は従来のＣＲＴ用映像映像信号合成回路２図は本
発明に係る映像増幅回路の一実施例をそれぞれ示す。 図において、１はトランジスタスイッチング部。 ２は映像増幅部、３，４は輝度差調整部、５はスイ・ノ
チング回路、６はビデオアンプ回路、７は否定論理積素
子ブロック、 Ｌｌは線輪、 Ｒ１−Ｒ１６は抵抗器、
Ｒν１は可変抵抗器、 ＴＲｌ−ＴＲ４はトランジスタ
、 ＩＣＩ〜ＩＣ４は否定論理積素子をそれぞれ示す。 イニ １ １沖〈１ 芽２ 町 （Ｂ）
発明に係る映像増幅回路の一実施例をそれぞれ示す。 図において、１はトランジスタスイッチング部。 ２は映像増幅部、３，４は輝度差調整部、５はスイ・ノ
チング回路、６はビデオアンプ回路、７は否定論理積素
子ブロック、 Ｌｌは線輪、 Ｒ１−Ｒ１６は抵抗器、
Ｒν１は可変抵抗器、 ＴＲｌ−ＴＲ４はトランジスタ
、 ＩＣＩ〜ＩＣ４は否定論理積素子をそれぞれ示す。 イニ １ １沖〈１ 芽２ 町 （Ｂ）
Claims (1)
- 【特許請求の範囲】 ブラウン管面上に所定輝度で表示する映像入力信号を増
幅する映像増幅回路において、前記所定輝度でブラウン
管面上に表示する映像入力信号と。 ｒｉｆ記ブラウン管面上の表示映像の一定部分を強調す
るための高輝度映像入力信号と、ライトペンの動作モー
ドとなった時に前記高輝度映像入力信号より更に高輝度
のライトペン映像入力信号とを否定論理積素子で合成す
ることを特徴とする映像信号合成回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58221040A JPS60113284A (ja) | 1983-11-24 | 1983-11-24 | 映像信号合成回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58221040A JPS60113284A (ja) | 1983-11-24 | 1983-11-24 | 映像信号合成回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS60113284A true JPS60113284A (ja) | 1985-06-19 |
| JPH0443272B2 JPH0443272B2 (ja) | 1992-07-16 |
Family
ID=16760541
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP58221040A Granted JPS60113284A (ja) | 1983-11-24 | 1983-11-24 | 映像信号合成回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS60113284A (ja) |
-
1983
- 1983-11-24 JP JP58221040A patent/JPS60113284A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0443272B2 (ja) | 1992-07-16 |
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