JPS5994441U - 電源投入時リセツト回路 - Google Patents
電源投入時リセツト回路Info
- Publication number
- JPS5994441U JPS5994441U JP19018382U JP19018382U JPS5994441U JP S5994441 U JPS5994441 U JP S5994441U JP 19018382 U JP19018382 U JP 19018382U JP 19018382 U JP19018382 U JP 19018382U JP S5994441 U JPS5994441 U JP S5994441U
- Authority
- JP
- Japan
- Prior art keywords
- power
- reset circuit
- circuit
- resistor
- input
- Prior art date
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- Pending
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- Electronic Switches (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
第１図は従来例の回路図、第２図は同上の要部 ２回路
図、第３図は本考案−実施例の回路図、第４図は同上の
動作説明図、第５図は同上の他の実施例の回路図である
。 １は定電圧電源回路、２はロジン・り回路、ＺＤｌはツ
ェナダイオード、Ｒ６は抵抗、Ｑ３はトランジスタ、Ｒ
８はリセット端子である。
図、第３図は本考案−実施例の回路図、第４図は同上の
動作説明図、第５図は同上の他の実施例の回路図である
。 １は定電圧電源回路、２はロジン・り回路、ＺＤｌはツ
ェナダイオード、Ｒ６は抵抗、Ｑ３はトランジスタ、Ｒ
８はリセット端子である。
Claims (1)
- 定電圧電源回路の電圧設定用ツェナダイオードに抵抗を
直列接続し、該抵抗の両端電圧がベース・エミッタ間に
印加されたトランジスタの一コレクタ出力をロジック回
路のリセット端子に入力して成る電源投入時リセット回
路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP19018382U JPS5994441U (ja) | 1982-12-15 | 1982-12-15 | 電源投入時リセツト回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP19018382U JPS5994441U (ja) | 1982-12-15 | 1982-12-15 | 電源投入時リセツト回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS5994441U true JPS5994441U (ja) | 1984-06-27 |
Family
ID=30409845
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP19018382U Pending JPS5994441U (ja) | 1982-12-15 | 1982-12-15 | 電源投入時リセツト回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5994441U (ja) |
-
1982
- 1982-12-15 JP JP19018382U patent/JPS5994441U/ja active Pending
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