JPS5994244A - 光デイスク装置 - Google Patents
光デイスク装置Info
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- JPS5994244A JPS5994244A JP20476882A JP20476882A JPS5994244A JP S5994244 A JPS5994244 A JP S5994244A JP 20476882 A JP20476882 A JP 20476882A JP 20476882 A JP20476882 A JP 20476882A JP S5994244 A JPS5994244 A JP S5994244A
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- JP
- Japan
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- data
- pattern
- circuit
- mark
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-
- G—PHYSICS
- G11—INFORMATION STORAGE
- G11B—INFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
- G11B20/00—Signal processing not specific to the method of recording or reproducing; Circuits therefor
- G11B20/10—Digital recording or reproducing
- G11B20/18—Error detection or correction; Testing, e.g. of drop-outs
- G11B20/1833—Error detection or correction; Testing, e.g. of drop-outs by adding special lists or symbols to the coded information
-
- G—PHYSICS
- G11—INFORMATION STORAGE
- G11B—INFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
- G11B7/00—Recording or reproducing by optical means, e.g. recording using a thermal beam of optical radiation by modifying optical properties or the physical structure, reproducing using an optical beam at lower power by sensing optical properties; Record carriers therefor
- G11B7/004—Recording, reproducing or erasing methods; Read, write or erase circuits therefor
- G11B7/005—Reproducing
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- Engineering & Computer Science (AREA)
- Signal Processing (AREA)
- Optical Recording Or Reproduction (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は光デイスク装置に関し、特にデジタル・データ
を記録再生する光デイスク装置に関する。
を記録再生する光デイスク装置に関する。
従来の光デイスク装置においては同期用パターン（ＰＬ
Ｏ５ＹＮＣ）と呼ばれる一定の周期の周波数引込み用パ
ターンの後、１バイトのデータ（例えば１９Ｍ−）等を
検出すると、次のデータからは実際に必要なデータであ
るという認識方式をとっていた。
Ｏ５ＹＮＣ）と呼ばれる一定の周期の周波数引込み用パ
ターンの後、１バイトのデータ（例えば１９Ｍ−）等を
検出すると、次のデータからは実際に必要なデータであ
るという認識方式をとっていた。
この方式におけるエラー・レート（データ誤り率）の良
い装置では充分使用できるが、高密度記録になるとエラ
ー・レートが悪化するため同期引込みパターンよ〕最初
のデータの検出ができ力〈なる場合が多くなりて来た。
い装置では充分使用できるが、高密度記録になるとエラ
ー・レートが悪化するため同期引込みパターンよ〕最初
のデータの検出ができ力〈なる場合が多くなりて来た。
一般にこの種の装置はデータ部の最初が正しければその
後数十ビットのドロップが発生してもエラー訂正回路を
使用することで修正できるが、データの最初の位置が誤
まると、エラー訂正回路の効果は期待でない。したがっ
て、従来の装置では境界パターン１バイトにドロップビ
ットがあると、それに対応するデータを処理することが
できないという欠点があった。
後数十ビットのドロップが発生してもエラー訂正回路を
使用することで修正できるが、データの最初の位置が誤
まると、エラー訂正回路の効果は期待でない。したがっ
て、従来の装置では境界パターン１バイトにドロップビ
ットがあると、それに対応するデータを処理することが
できないという欠点があった。
本発明の目的は、従来の装置におけるかかる欠点を除去
すると共に高密度記録に適した信頼性の高い光デイスク
装置を提供することにある。
すると共に高密度記録に適した信頼性の高い光デイスク
装置を提供することにある。
本発明によれば、デジタル・データを記録再生する光デ
イスク装置において、各トラック及びセクタ・アドレス
を示すＩＤ部、又はデータ部に周波数引込み用同期パタ
ーンに、続いて同期パターンとデータ部の境界を示すパ
ターンを複数バイト設け、その各バイトにデータ部にな
い第１のコードのパターンと、最初のデータ位置までの
バイト数を示すコードを持りた第２のパターンとを有す
る境界パターンを書込む手段と、読出し時これらのバイ
トからデータの最初のバイトを検出する手段と、誤って
検出した場合数ビットのドロップが、境界パターン内に
ありてもデータの最初の位置を検出し、正しく処理でき
るようにしたことを特徴とする光デイスク装置が得られ
る。
イスク装置において、各トラック及びセクタ・アドレス
を示すＩＤ部、又はデータ部に周波数引込み用同期パタ
ーンに、続いて同期パターンとデータ部の境界を示すパ
ターンを複数バイト設け、その各バイトにデータ部にな
い第１のコードのパターンと、最初のデータ位置までの
バイト数を示すコードを持りた第２のパターンとを有す
る境界パターンを書込む手段と、読出し時これらのバイ
トからデータの最初のバイトを検出する手段と、誤って
検出した場合数ビットのドロップが、境界パターン内に
ありてもデータの最初の位置を検出し、正しく処理でき
るようにしたことを特徴とする光デイスク装置が得られ
る。
更に本発明によれば、データの最初のバイトを検出する
手段は前記境界パターンの少なくとも規定数以上のパタ
ーンを検出することによシ最初のデータ位置を判断する
装置であることを特徴とする特許請求の範囲第（１）項
記載の光デイスク装置が得られる。
手段は前記境界パターンの少なくとも規定数以上のパタ
ーンを検出することによシ最初のデータ位置を判断する
装置であることを特徴とする特許請求の範囲第（１）項
記載の光デイスク装置が得られる。
次に、本発明の一実施例について図面を参照して詳細に
説明する。
説明する。
第１図は本発明の実施例である光デイスク装置を示す。
第１図において１本実施例はディジタル・データを記録
、再生する光デイスク装置で、上位装置（図示せず）か
らの書込み命令１０２を受けるコントロール回路工と周
波数引込み用同期パターン及び同期パターンとデータ部
（又はＩＤ部）の境界を認識するマーク・パターンを発
生する同期マーク（ＳＹＮＣ−ＭＡＲＫ）発生回路３と
、上位装置からの書込みデータ１０１を受け、たとえば
ＭＦＭ変調する変８Ｉ！回路２と、同期パターン・マー
ク（ＳＹＮＣ−ＭＡＲＫ）発生回路３からの信号１０６
と変調回路２からの信号１０５を選択するセレクタ４と
、セレクタ４からの信号１０７を媒体（図示せず）に書
込み、かつ媒体からデータを読取るリード／ライトヘッ
ド部５と、該ヘッド部５からの読取シ信号１０８を受け
、クロックとデータとを分けるフェイズロックド・ルー
プ（ＰＬＬ）回路と、同期信号によシ弁別された信号１
０９からマークを検出するマーク検出回路７と、マーク
を誤って検出した場合にデータ部にないパターンを検出
し、その旨を制御回路１に送出するマーク検出チェック
回路７と、マーク検出チェック回路９からの信号１１０
を受け、上位装置に正しいデータ１０３を送出するエラ
ー訂正回路とを含んでいる。
、再生する光デイスク装置で、上位装置（図示せず）か
らの書込み命令１０２を受けるコントロール回路工と周
波数引込み用同期パターン及び同期パターンとデータ部
（又はＩＤ部）の境界を認識するマーク・パターンを発
生する同期マーク（ＳＹＮＣ−ＭＡＲＫ）発生回路３と
、上位装置からの書込みデータ１０１を受け、たとえば
ＭＦＭ変調する変８Ｉ！回路２と、同期パターン・マー
ク（ＳＹＮＣ−ＭＡＲＫ）発生回路３からの信号１０６
と変調回路２からの信号１０５を選択するセレクタ４と
、セレクタ４からの信号１０７を媒体（図示せず）に書
込み、かつ媒体からデータを読取るリード／ライトヘッ
ド部５と、該ヘッド部５からの読取シ信号１０８を受け
、クロックとデータとを分けるフェイズロックド・ルー
プ（ＰＬＬ）回路と、同期信号によシ弁別された信号１
０９からマークを検出するマーク検出回路７と、マーク
を誤って検出した場合にデータ部にないパターンを検出
し、その旨を制御回路１に送出するマーク検出チェック
回路７と、マーク検出チェック回路９からの信号１１０
を受け、上位装置に正しいデータ１０３を送出するエラ
ー訂正回路とを含んでいる。
第２図は本発明の実施例に用いられる記録のフォーマッ
トを示す。第２図において、媒体に記録５− されるフォーマットはセクタＮ−１，Ｎ、Ｎ＋１を有し
、各セクタはトラック番号、セクタ番号を示すインデッ
クス（ＩＤ）部２２とデータ（ＤＡＴＡ）部２３とを有
しておシ、更にＩＤ部２２とデータ部２３は各々同期用
パターン（ＰＬＯ５ＹＮＣ）部２０および境界パターン
２１を有している。この境界パターン２１はパターン２
０とデータ部２３（又はＩＤ部２２）との境界を示すパ
ターンである。なお、データ部２３はその後にデータ終
了パターン部２４を有している。
トを示す。第２図において、媒体に記録５− されるフォーマットはセクタＮ−１，Ｎ、Ｎ＋１を有し
、各セクタはトラック番号、セクタ番号を示すインデッ
クス（ＩＤ）部２２とデータ（ＤＡＴＡ）部２３とを有
しておシ、更にＩＤ部２２とデータ部２３は各々同期用
パターン（ＰＬＯ５ＹＮＣ）部２０および境界パターン
２１を有している。この境界パターン２１はパターン２
０とデータ部２３（又はＩＤ部２２）との境界を示すパ
ターンである。なお、データ部２３はその後にデータ終
了パターン部２４を有している。
境界パターン部２１はたとえば３バイトのマークＭＡＲ
Ｋ２．ＭＡＲＫＩ 、およびＭＡＲＫＯを有していて、
各マークＭＡＲＫはデータ部にないコード（すなわちイ
レーガル・コード） １．Ｃおよびイレーガル・コード
に無関係で、かつ２ビツトで構成され、最初のデータま
でのバイト数を示すコード（Ｃ＝２ 、 Ｃ−１、Ｃ＝
Ｏ）を有している。
Ｋ２．ＭＡＲＫＩ 、およびＭＡＲＫＯを有していて、
各マークＭＡＲＫはデータ部にないコード（すなわちイ
レーガル・コード） １．Ｃおよびイレーガル・コード
に無関係で、かつ２ビツトで構成され、最初のデータま
でのバイト数を示すコード（Ｃ＝２ 、 Ｃ−１、Ｃ＝
Ｏ）を有している。
この最初のデータまでのバイト数を示すコードは、たと
えばＣ＝２の場合は２バイトであシ、Ｃ＝１の場合は１
バイ）Ｃ−００場合を示している。
えばＣ＝２の場合は２バイトであシ、Ｃ＝１の場合は１
バイ）Ｃ−００場合を示している。
６一
境界パターンの他の例としては、第３図に示すようにイ
レーガル・コード１．Ｃと最初のデータ位置を示すコー
ドＣとの順序を入れ替えたノくターンでマーク（ＭＡＲ
Ｋ）２Ａは２バイトマーク（ＭＡＲＫ）ＩＡは１バイト
およびｉ−り（ＭＡＲＫ）ＯＡは０バイト後に最初のデ
ータがある位置を示す。
レーガル・コード１．Ｃと最初のデータ位置を示すコー
ドＣとの順序を入れ替えたノくターンでマーク（ＭＡＲ
Ｋ）２Ａは２バイトマーク（ＭＡＲＫ）ＩＡは１バイト
およびｉ−り（ＭＡＲＫ）ＯＡは０バイト後に最初のデ
ータがある位置を示す。
第４図は本実施例におけるマーク検出回路７およびマー
ク検出チェック回路９で、第４図を参照して本実施例の
動作を説明する。第４図において第２図に示すフォーマ
ットで書込まれている媒体をリードする場合にリード／
ライトヘッド部５で読取られたリードデータ１０８はＰ
ＬＬ回路８に供給される。ＰＬＬ回路８はクロックビッ
トとデータビットを分離され、それぞれのビットをマー
ク検出回路７に供給する。このクロックビット２０１は
、クロック２０２によシクロツクビットシフトレジスタ
５１に取込まれ、データビット２０８はクロック２０９
によりデータビットシフトレジスタ５６に取込まれる。
ク検出チェック回路９で、第４図を参照して本実施例の
動作を説明する。第４図において第２図に示すフォーマ
ットで書込まれている媒体をリードする場合にリード／
ライトヘッド部５で読取られたリードデータ１０８はＰ
ＬＬ回路８に供給される。ＰＬＬ回路８はクロックビッ
トとデータビットを分離され、それぞれのビットをマー
ク検出回路７に供給する。このクロックビット２０１は
、クロック２０２によシクロツクビットシフトレジスタ
５１に取込まれ、データビット２０８はクロック２０９
によりデータビットシフトレジスタ５６に取込まれる。
クロック・ビット用シフトレジスタ５１の出力はデコー
ド回路５２に入ル、イレーガル・クロック・パターンを
検出すると、最初のイレーガル・クロック・パターン検
出フリップフロップ５３をセットする。最初のイレーガ
ル・り賞ツク・パターン検出フリップフロップ５３がセ
ットされると。
ド回路５２に入ル、イレーガル・クロック・パターンを
検出すると、最初のイレーガル・クロック・パターン検
出フリップフロップ５３をセットする。最初のイレーガ
ル・り賞ツク・パターン検出フリップフロップ５３がセ
ットされると。
ゲート回路５４は開き、バイト・カウンタ回路５５を作
動させる。その後１バイト間隔でカウンタ５７．５８を
カウント・ダウンするクロックを発生する。
動させる。その後１バイト間隔でカウンタ５７．５８を
カウント・ダウンするクロックを発生する。
データ・ビットは、シフトレジスタ５６にクロック２０
９でロードされる。イレーガル・クロック・パターンを
検出した時のタイミング・クロック２１１，２１２によ
り、第１のカウンター５フ。
９でロードされる。イレーガル・クロック・パターンを
検出した時のタイミング・クロック２１１，２１２によ
り、第１のカウンター５フ。
および第２のカウンタ５８にロードされる。正常の場合
は第１のカウンター５７にはＭＡＲＫ２の時１２＠がロ
ードされ、第２のカウンター５８はＭＡＲＫ １の時、
１１１がロードされる。ＡＮＤ回路５９は、ＭＡＲＫＯ
の時１０Ｉが入力される。
は第１のカウンター５７にはＭＡＲＫ２の時１２＠がロ
ードされ、第２のカウンター５８はＭＡＲＫ １の時、
１１１がロードされる。ＡＮＤ回路５９は、ＭＡＲＫＯ
の時１０Ｉが入力される。
第１のカウンター５７は、ＭＡＲＫＩのタイミングでカ
ウント・ダウン・クロック２０７によ）、カウント値が
１１＠となり、ＭＡＲＫＯのタイミングで１０１となる
。
ウント・ダウン・クロック２０７によ）、カウント値が
１１＠となり、ＭＡＲＫＯのタイミングで１０１となる
。
同様に、第２のカウンターはＭＡＲＫＯのタイミングで
カウント値Ａ１０１となる。カウンター５７゜５８およ
びＡＮＤ回路５９はそれぞれカウント値が０、又は入力
Ｊｔｃ Ｉ ｏ ｌ値が入った場合に出力２１４゜２１
５および２１６を発生し、その出力をＯＲ回路６０に供
給する。ＯＲ回路６０はその出力２１７によ）データ・
エリア検出フリップフロップ６１をセットする。
カウント値Ａ１０１となる。カウンター５７゜５８およ
びＡＮＤ回路５９はそれぞれカウント値が０、又は入力
Ｊｔｃ Ｉ ｏ ｌ値が入った場合に出力２１４゜２１
５および２１６を発生し、その出力をＯＲ回路６０に供
給する。ＯＲ回路６０はその出力２１７によ）データ・
エリア検出フリップフロップ６１をセットする。
スナワち、ＭＡＲＫ ２ 、ＭＡＲＫ １ 、ＭＡＲＫ
Ｏの内のうち少なくとも規定数以上たとえば１個のパタ
ーンが正しければ、データ・エリア検出フリップフロッ
プ６１はセットされ、最初のデータ位置を判断すること
ができる。
Ｏの内のうち少なくとも規定数以上たとえば１個のパタ
ーンが正しければ、データ・エリア検出フリップフロッ
プ６１はセットされ、最初のデータ位置を判断すること
ができる。
次に、データ・エリアを早く誤検出した場合は。
イレーガル・クロック・カウンタ６２で、その後何個の
イレーガル・クロック・パターンを検出したかをカウン
トする。このカウント値により、デ９− −タ・エリアを早く検出した場合には、再位置あわせの
ため、コントロール回路１とエラー訂正回路６で、最初
の１〜２バイトを削除する動作を行う。
イレーガル・クロック・パターンを検出したかをカウン
トする。このカウント値により、デ９− −タ・エリアを早く検出した場合には、再位置あわせの
ため、コントロール回路１とエラー訂正回路６で、最初
の１〜２バイトを削除する動作を行う。
以上によｐ、ＭＡＲＫパターン３個の内いづれか１個が
正しければ、同期引込用パターン部２０と、ＤＡＴＡ部
２３ （ＩＤ部２２）を区分する位置を判断できる。ま
た誤って検出した場合も、位置修正が可能となる。
正しければ、同期引込用パターン部２０と、ＤＡＴＡ部
２３ （ＩＤ部２２）を区分する位置を判断できる。ま
た誤って検出した場合も、位置修正が可能となる。
再び、第１図を参照すると、マーク検出回路７は複数の
境界バイトの内の規定数以上が正しければ、最初のデー
タ位置がバイト内のパターンよシ決定され、またマーク
を誤って検出した場合で次にさらにデータ部にないパタ
ーンが検出されると、マーク検出・チェック回路９では
、信号１１１を制御回路１に送シ、何バイト早めにデー
タ部を検出したかがわかり、エラー訂正回路６内でこの
余計なバイトを切ルすてる。その後のデータ部内でのド
ロップは、エラー訂正回路６で訂正され、正しいデータ
が信号１０３を通して上位装置に送られる。
境界バイトの内の規定数以上が正しければ、最初のデー
タ位置がバイト内のパターンよシ決定され、またマーク
を誤って検出した場合で次にさらにデータ部にないパタ
ーンが検出されると、マーク検出・チェック回路９では
、信号１１１を制御回路１に送シ、何バイト早めにデー
タ部を検出したかがわかり、エラー訂正回路６内でこの
余計なバイトを切ルすてる。その後のデータ部内でのド
ロップは、エラー訂正回路６で訂正され、正しいデータ
が信号１０３を通して上位装置に送られる。
１０−
したがって、本実施例では多少のドロップビット（デー
タ欠落）があってもデータの読取ルを可能とするもので
ある。
タ欠落）があってもデータの読取ルを可能とするもので
ある。
本発明は以上説明したように、同期パターンと。
データ部の間に複数バイトの境界パターンをおき。
その各々に特異性を持たせることにより、境界パターン
の一部にドロップがあってもデータ部の最初のバイトの
検出を誤らないこという効果がある。
の一部にドロップがあってもデータ部の最初のバイトの
検出を誤らないこという効果がある。
第１図は本発明の実施例を示すブロック図、第２図は本
実施例に用いられるＭＦＭ変調における境界パターンを
示す図、第３図は他の境界パターンを示す図、第４図は
本発明の実施例におけるマーク検出回路とマーク検出チ
ェック回路を示す図である。 １・・・・・・制御回路、２・・・・・・変調回路、３
・・・・・・同期・マーク発生回路、４・・・・・・セ
レクタ、５・・・・・・リート／ライト・ヘッド部、６
・・・・・・エラー訂正回路、７・・・・・・マーク検
出回路、８・・・・・・ＰＬＬ回路、９・・・・・・マ
ーク検出チェック回路、５１．５６・・・・・・シフト
レジスタ、５２・・・・・・ヂコータ、５３・・・・・
・クリップフロップ、５４・・団・ゲート回路、５７．
５８・・団・カウンタ、５９・・・・・・ＡＮＤ回路、
６０・・・・・・ＯＲ回路、６１・・・・・・データエ
リア検出回路、６２・旧・・イレーガル・クロック・カ
ウンタ。 ＭＡＲ〆 ２Ａ ／ ００００ ｆＣ ＭＡｌ？Ｋ ／Ａ ｏｏｏｏｔ ！（ 六ＡＲＩ＜ ０Ａ １０００ｏ／ １、Ｃ ２４９− ／ ０ １００ １ ＯＯ
実施例に用いられるＭＦＭ変調における境界パターンを
示す図、第３図は他の境界パターンを示す図、第４図は
本発明の実施例におけるマーク検出回路とマーク検出チ
ェック回路を示す図である。 １・・・・・・制御回路、２・・・・・・変調回路、３
・・・・・・同期・マーク発生回路、４・・・・・・セ
レクタ、５・・・・・・リート／ライト・ヘッド部、６
・・・・・・エラー訂正回路、７・・・・・・マーク検
出回路、８・・・・・・ＰＬＬ回路、９・・・・・・マ
ーク検出チェック回路、５１．５６・・・・・・シフト
レジスタ、５２・・・・・・ヂコータ、５３・・・・・
・クリップフロップ、５４・・団・ゲート回路、５７．
５８・・団・カウンタ、５９・・・・・・ＡＮＤ回路、
６０・・・・・・ＯＲ回路、６１・・・・・・データエ
リア検出回路、６２・旧・・イレーガル・クロック・カ
ウンタ。 ＭＡＲ〆 ２Ａ ／ ００００ ｆＣ ＭＡｌ？Ｋ ／Ａ ｏｏｏｏｔ ！（ 六ＡＲＩ＜ ０Ａ １０００ｏ／ １、Ｃ ２４９− ／ ０ １００ １ ＯＯ
Claims (2)
- （１）デジタル・データを記録再生する光デイスク装置
において、各トラック及びセクター・アドレスを示すＩ
Ｄ部、又はデータ部に周波数引込み用同期パターンに続
いて、同期パターンとデータ部（又はＩＤ部）の境界を
示すパターンを複数バイト設け、その各バイトにデータ
部にないコードの第１のパターンと、最初のデータ位置
までのバイト数を示すコードを持った第２のパターンと
を有する境界パターンを書込む手段と、読出し時これら
のバイトからデータの最初の位置を検出する手段とを含
み誤って、検出した場合数ビットのドロップが、境界パ
ターン内にあってもデータの最初の位置を検出し、正し
く処理できるようにしたことを特徴とする光デイスク装
置。 - （２）データの最初のバイトを検出する装置は前記境界
パターンの少なくとも規定数以上のパターンを検出する
ことＫよシ最初のデータ位置を判断する装置であること
を特徴とする特許請求の範囲第（１）項記載の光デイス
ク装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP20476882A JPS5994244A (ja) | 1982-11-22 | 1982-11-22 | 光デイスク装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP20476882A JPS5994244A (ja) | 1982-11-22 | 1982-11-22 | 光デイスク装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS5994244A true JPS5994244A (ja) | 1984-05-30 |
Family
ID=16496019
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP20476882A Pending JPS5994244A (ja) | 1982-11-22 | 1982-11-22 | 光デイスク装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5994244A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6059541A (ja) * | 1983-09-13 | 1985-04-05 | Matsushita Electric Ind Co Ltd | 光学的情報記録再生装置 |
-
1982
- 1982-11-22 JP JP20476882A patent/JPS5994244A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6059541A (ja) * | 1983-09-13 | 1985-04-05 | Matsushita Electric Ind Co Ltd | 光学的情報記録再生装置 |
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