JPS5980020A - Timer with time limit display - Google Patents

Timer with time limit display

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Publication number
JPS5980020A
JPS5980020A JP19135282A JP19135282A JPS5980020A JP S5980020 A JPS5980020 A JP S5980020A JP 19135282 A JP19135282 A JP 19135282A JP 19135282 A JP19135282 A JP 19135282A JP S5980020 A JPS5980020 A JP S5980020A
Authority
JP
Japan
Prior art keywords
time
circuit
display
time limit
timer
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP19135282A
Other languages
Japanese (ja)
Inventor
Yuji Takada
裕司 高田
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Panasonic Electric Works Co Ltd
Original Assignee
Matsushita Electric Works Ltd
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Filing date
Publication date
Application filed by Matsushita Electric Works Ltd filed Critical Matsushita Electric Works Ltd
Priority to JP19135282A priority Critical patent/JPS5980020A/en
Publication of JPS5980020A publication Critical patent/JPS5980020A/en
Pending legal-status Critical Current

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    • GPHYSICS
    • G04HOROLOGY
    • G04FTIME-INTERVAL MEASURING
    • G04F1/00Apparatus which can be set and started to measure-off predetermined or adjustably-fixed time intervals without driving mechanisms, e.g. egg timers
    • G04F1/005Apparatus which can be set and started to measure-off predetermined or adjustably-fixed time intervals without driving mechanisms, e.g. egg timers using electronic timing, e.g. counting means

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  • Physics & Mathematics (AREA)
  • General Physics & Mathematics (AREA)
  • Electronic Switches (AREA)

Abstract

PURPOSE:To reduce the current consumption as well as a misdecision from other displays, by displaying that the time is limited only when the minimum unit is set at >=1min for the time limit display time of a timer. CONSTITUTION:A timer circuit 1 performs a time limiting action from the set contents of a timer range setting part 2 and a time limit time setting part 3. At the same time, a time range discriminating circuit 4 receives the data from the part 2 and decides whether the minimum time is >=1min for the time limit display time of a timer. Then the circuit 4 delivers an output when the minimum unit of display time is >=1min. This output is supplied to a discriminaton circuit 5 for time limit display together with the time limit output given from the circuit 1. Then a time limit display circuit 6 is actuated by the ouptut of the circuit 5 to display a time limit mode.

Description

【発明の詳細な説明】 本発明は、マルチしンジデジタル表示タイマーにおいて
限時中であること全表示する限時表示付タイマーに関す
るものである。
DETAILED DESCRIPTION OF THE INVENTION The present invention relates to a multi-display digital display timer with a time limit display that fully indicates that the time is running out.

従来のマルチレンジ′デジタル表示タイマーは、例えば
、第1図(a)のように、最小表示時間単位が1秒の場
合は、時間経過とともに1秒毎に表示数字が変化して限
時動作中であるご(が容易にヤ」別できるが、第1図(
b)のように、最小表示時間単位が1分の場合には、最
大1分間時たなければ表示が変化しないため、限時動作
中か、外部からの制御イさ号を待ちている状態なのかが
判別できないという欠点を有していた。
In conventional multi-range 'digital display timers, for example, when the minimum display time unit is 1 second as shown in Figure 1(a), the displayed number changes every second as time elapses, indicating that the timer is in limited operation. Although it is easy to distinguish between
As in b), if the minimum display time unit is 1 minute, the display will not change until a maximum of 1 minute has elapsed, so is it in a timed operation or is it waiting for an external control signal? It has the disadvantage that it cannot be determined.

本発明はかかる点に鑑みてなさnたもので、その目的と
するところは、最小表示時間単位が1分以上であっても
限時中動作であること全容易に表示できる上、最小表示
時間単位か1分以上である場合のみ限時空表示を行なう
ため、いかなる時間レシジにおいても限時空表示をする
場合に比べて消*電+’At、が少なくなり、父、他の
表示と児戯る誤ヤj断ケ低減することにある。以下失施
例により不発り1」金tff、細に説明する。
The present invention has been made in view of the above points, and its purpose is to enable operation for a limited time even if the minimum display time unit is one minute or more. Since the time-limited space display is performed only when the time period is 1 minute or more, there are fewer extinguishing +'At's than when the time-limited space display is used for any time register, and there is a risk of miscommunication with other displays. The goal is to reduce breakage. The following is a detailed explanation of failure 1'' gold tff based on a failed example.

第2気において、(1)はタイマ回路で、時間し′:J
ジ設定都(2)と限時時@I設定都(3)の設定内容に
より眠FPf削作をするものである。(4)は時間しン
ジ判別回路で、時間レンジ設定部(2)からのデータを
受け、タイマ限時表示時間の最小単位か1分以上である
かを判別し、1分以上の場合に出力を出す。
In the second Qi, (1) is a timer circuit, and the time is ′:J
The sleep FPf is reduced according to the setting contents of the time setting city (2) and the time limit @I setting city (3). (4) is a time range discrimination circuit that receives data from the time range setting section (2) and discriminates whether the timer limit display time is the minimum unit or one minute or more, and outputs an output if it is one minute or more. put out.

(6)は限時中表示判別回路で、時間レンジ判別回路(
4)からの出力とタイマ回路11)の限時中出力とを入
力し、両者の出力が一致する場合に出力?出す。
(6) is a time limit display discrimination circuit, and a time range discrimination circuit (
Input the output from 4) and the output during time limit of the timer circuit 11), and output when both outputs match? put out.

+6) fd限時中表示回路で、限時中表示やj別回路
(6)の出力を受け、限時切作中であることを表示する
ものである。(7)は1奴時時間表示都である。
+6) The fd time limit display circuit receives the time limit display and the output of the j-separate circuit (6) to indicate that the time limit is off. (7) is the 1st hour time display capital.

今、時間レンジ設定部(2)と限時時間設定部(3)と
の設定内容によりタイマ回路(1)か限時切作才し、限
り時間表示部(7)K時間全表示する。このとき、最小
表示時間単位か1分以上の場合には、時間レンジf41
別回路(4)より出力金山し、この出力とタイマ回路1
117)・らの限時中出力とを阻時中表示tJ別回路(
51に入力し、その出力で限時中表示回WI +61 
+1作させて限時中であること全表示−rる。
Now, depending on the settings of the time range setting section (2) and the time limit setting section (3), the timer circuit (1) is set to a time limit mode, and the time display section (7) displays the entire time K. At this time, if the minimum display time unit is 1 minute or more, time range f41
Output from another circuit (4), and this output and timer circuit 1
117)・A separate circuit (
51, and its output is the time-limited display times WI +61
+1 to make it, all indications that it is for a limited time -r.

第3図は・本発明の実施例の具体回路で、スイッチ(8
)により時間レンジ設定部(2)と構成し、例えば、接
点a′t?O○00秒、接点すで00分00秒、接点C
で○○時○○分を設定するようにしたものである。した
がって、スイッチ(8)ヲ接点cK接続することにより
最小表示時間単位が1分以上になり、この接点ceNA
NDl路(9)の一方の入力に接続することにより時間
レンジ判別回路(4)全形成できる。NAND回路(9
)は限時中表示判別回路(5)全構成し、タイマ回路1
1)の限時中出力を入力する0又、トランジスタ(lO
)と発光タイオード(Illとで限時中表示回路(6)
全構成している。
Figure 3 shows a specific circuit of an embodiment of the present invention, and shows a switch (8
) constitutes a time range setting section (2), for example, a contact a't? O○00 seconds, contact is already 00 minutes 00 seconds, contact C
This allows you to set ○○ hour ○○ minute. Therefore, by connecting switch (8) to contact cK, the minimum display time unit becomes 1 minute or more, and this contact ceNA
By connecting to one input of the NDl path (9), the entire time range discrimination circuit (4) can be formed. NAND circuit (9
) consists of the time limit display discrimination circuit (5) and the timer circuit 1.
1) A transistor (lO
) and light emitting diode (Ill) to display circuit (6)
It is fully configured.

今、スイッチ(8)が接点cK接続さ扛ている場  。Now, switch (8) is connected to contact cK.

台、表示時間の最小中位が1分であり、NAND回路(
9)の入力端子dか1H″となり、タイマ回路tllか
限時中出力’ H”l”発生すると、トランジスタ(+
01 ’にオンにしてつら光タイオード(1り全点灯し
、限時中であることを表示できる。
The minimum and medium display time is 1 minute, and the NAND circuit (
When the input terminal d of the transistor (+
When turned on to 01', the light diode (1 light) will light up completely to indicate that the timer is running.

第4凶はタイマ回路(りにマイクロコンピュータ?使用
したもので、第5図のようなプ0タラムフD−によりて
限時中表示回路(6)の発光タイオード(1すを点灯す
る。第5凶の仮鞠で囲んだ部分が本発明において附加し
た部分である。つまり、最小表示時間単位が1分以上で
あるか會P3を見ることによりヤ]断し、その結果、P
*’7オンすることにより出力する。この出力によりト
ランジスタ(lO)全オンにし、発光タイオード(Il
lを点灯して限時中であること?表示できる。
The fourth circuit is a timer circuit (using a microcomputer), and the light-emitting diode (1) of the time limit display circuit (6) is lit by the programmer D- as shown in Figure 5. The part surrounded by a box is the part added in the present invention.In other words, it is determined by looking at the meeting P3 whether the minimum display time unit is 1 minute or more, and as a result, P
*'7 Output by turning on. This output turns on all the transistors (lO) and turns on the light emitting diode (lO).
Does it mean that the time limit is reached when the l is lit? Can be displayed.

斜上のように本発明は、時間レンジ設定部と限時時間設
定部の設定内容により限時動作するタイマ回路と、前記
時間レンジ設定部からのデータを受はタイマ限時表示時
間の最小単位が1分以上であることt判別する時間レン
ジ中j別回路と、ntj記時間レンし’t−1+別回路
の出力とタイマ回路の限時中出力と金入力して出力する
限時中表示判別回路と、前記阻時中表示ヤ」別回路の出
力により限時中である表示をする限時中表示回路とより
成る刀・ら、最小表示時間単位が1分以上であっても限
時中WJ作であることt容易に表示できる上、最小表示
時間単位が1分以上である場合のみ限時中表示紫盲なう
ため、いかなる時間レンジにおいても限時中表示?する
場合に比べて消費電流?少なくでき、文、他の表示と児
戯る課刊l#Tt低減できるという効果ヲ突するもので
ある。
As shown above, the present invention includes a timer circuit that operates for a limited time depending on the settings of the time range setting section and the time limit setting section, and a timer circuit that receives data from the time range setting section, and the minimum unit of the time limit display time is one minute. A separate circuit for determining the time range, ntj, the output of the other circuit for the time range 't-1+, the output of the timer circuit during the time limit, and a time limit display discriminating circuit that inputs and outputs the above-mentioned It is easy to make a time limit WJ product even if the minimum display time unit is 1 minute or more. In addition, if the minimum display time unit is 1 minute or more, the time-limited display becomes violet blind, so the time-limited display can be displayed in any time range. Current consumption compared to when? This has the advantage of being able to reduce the amount of text and other information displayed in the curriculum.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図(a) (b)はそnそn従来のタイマーの限時
時間表示内容説明図、第2図は木4+:明の一実施例の
ブロック回路図、第3図は同上の一実施例の具体回路図
、第4凶は向上の他の実施例の具体回路図、第5図は同
上の70−チセートである。 fil・・・タイマ回路、(2)・・・時開レン、;設
定都、(3)・・・限時時間設定部、(4)・・・時間
レンジやj別回路、(5)・・・限時中表示′14J別
回路、(6)・・・眠四゛中表示回路。 代理人 弁理士  石 出 艮 七 第3図 第5図
Figures 1 (a) and (b) are explanatory diagrams of the time limit display contents of a conventional timer, Figure 2 is a block circuit diagram of an embodiment of the tree 4+: Figure 3 is an implementation of the same as above. The specific circuit diagram of the example, the fourth example is a specific circuit diagram of another embodiment of the improvement, and FIG. 5 is the 70-chisate same as above. fil...Timer circuit, (2)...Time opening range, ;Setting capital, (3)...Time limit setting section, (4)...Time range and j-specific circuit, (5)...・Separate circuit for display during time limit '14J, (6)...Circuit for display during sleep. Agent Patent Attorney Ai Ishide Figure 7 Figure 3 Figure 5

Claims (1)

【特許請求の範囲】[Claims] 111  時間レンジ設定部と限時時間設定部の設定内
容により限時動作するタイマ回路と、前記時間レンジ設
定部からのデータ全党はタイマ限時表示時間の最小単位
が1分以上であるかを苧」別する時間レー、Iジ杓別回
路と、前記時間レフジャ1911回路の出力とタイマ回
路のIIJI中出力とを入力して出力する限時中表示判
別回路と、前記阻時中表示モ」別回路の出力により限時
中である表示をする限時中表示回路とより成ることを特
徴とする限時表示付タイマー。
111 A timer circuit that operates for a limited time depending on the settings of the time range setting section and the time limit setting section, and all data from the time range setting section are determined whether the minimum unit of time limit display time is one minute or more. a circuit for distinguishing between time relays and I-jumps; a time-limiting display discriminating circuit that inputs and outputs the output of the time reflexor 1911 circuit and the IIJI-medium output of the timer circuit; and an output of the "blocking mode" circuit. A timer with a time limit display, comprising a time limit display circuit that indicates that the time is running.
JP19135282A 1982-10-30 1982-10-30 Timer with time limit display Pending JPS5980020A (en)

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Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5430927U (en) * 1977-08-03 1979-02-28

Patent Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5430927U (en) * 1977-08-03 1979-02-28

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