JPS5923852U - マイクロコンピユ−タのインタラプト回路 - Google Patents

マイクロコンピユ−タのインタラプト回路

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JPS5923852U
JPS5923852U JP11732682U JP11732682U JPS5923852U JP S5923852 U JPS5923852 U JP S5923852U JP 11732682 U JP11732682 U JP 11732682U JP 11732682 U JP11732682 U JP 11732682U JP S5923852 U JPS5923852 U JP S5923852U
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JP
Japan
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signal
flip
circuit
microcomputer
output
Prior art date
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JP11732682U
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JPS6234354Y2 (ja
Inventor
大江 秀美
Original Assignee
日本電気ホームエレクトロニクス株式会社
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第1図は従来のマイクロコンピュータのインクラブド回
路の一例を示す回路図、第2図はこの考案によるマイク
ロコンピュータのインクラブド回路の一実施例を示す回
路−1第3図は第2図に示す回路の動作を示すフローチ
ャートである。 1.2・・・第1、第2フリップフロップ回路、3・・
・マイクロコンピュータ、4a、  4b・・・オアゲ
ート、5・・・アンドゲート、6a、  6b・・・遅
延回路。

Claims (1)

    【実用新案登録請求の範囲】
  1. 各入力信号によってセットされる複数のフリップフロッ
    プ回路と、この各フリップフロップ回路にそれぞれ対応
    して設けられたインクラブド禁止信号発生用の出力ポー
    トおよびインクラブド信号取り込み用の入力ポートを有
    するマイクロコンピュータと、前記各フリップフロップ
    回路のセット時の出力と前記各フリップフロップ回路に
    対応する前記マイクロコンピュータの出力ポートから発
    生されるインタラブド禁止信号とを入力としてそれぞれ
    論理積出力を発生する第1ゲート回路と、この各第1ゲ
    ート回路の出力信号を入力として論理和出力を発生して
    前記マイクロコンピュータにインクラブド信号として供
    給する第2ゲート回路と、前記マイクロコンピュータの
    各出力ポートから発生されるインタラブド禁止信号をt
    。時間遅延してそれぞれ対応するフリップフロップ回路
    のリセット信号入力端に供給する遅延回路とを備え、前
    記マイクロコンピュータはインタラブドモード時に各出
    力ポートから発生されるインクラブド禁止信号を選択的
    に出力してその時のインクラブタ信号の状態によってイ
    ンタラブド制御中の入力信号を判別するとともに、前記
    各フリップフロップ回路のリセットに際しては前記遅延
    回路の遅延時間T。以上の期間にわたってインタラブド
    禁止信号を発生することを特徴とするマイクロコンピュ
    ータのインタラブド回路。   ゛
JP11732682U 1982-07-31 1982-07-31 マイクロコンピユ−タのインタラプト回路 Granted JPS5923852U (ja)

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JP11732682U JPS5923852U (ja) 1982-07-31 1982-07-31 マイクロコンピユ−タのインタラプト回路

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JPS5923852U true JPS5923852U (ja) 1984-02-14
JPS6234354Y2 JPS6234354Y2 (ja) 1987-09-02

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