JPS59185792U - 高速メモリアドレツシング装置 - Google Patents

高速メモリアドレツシング装置

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Publication number
JPS59185792U
JPS59185792U JP8019183U JP8019183U JPS59185792U JP S59185792 U JPS59185792 U JP S59185792U JP 8019183 U JP8019183 U JP 8019183U JP 8019183 U JP8019183 U JP 8019183U JP S59185792 U JPS59185792 U JP S59185792U
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JP
Japan
Prior art keywords
high speed
speed memory
memory addressing
addressing device
circuit
Prior art date
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Pending
Application number
JP8019183U
Other languages
English (en)
Inventor
杉本　守二
Original Assignee
株式会社日立製作所
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Filing date
Publication date
Application filed by 株式会社日立製作所 filed Critical 株式会社日立製作所
Priority to JP8019183U priority Critical patent/JPS59185792U/ja
Publication of JPS59185792U publication Critical patent/JPS59185792U/ja
Pending legal-status Critical Current

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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は、従来のメモリアドレッシング方式である加算
（または減算）回路によるメモリアドレッシング方式の
ブロック図、第２図は、ガロア体ＧＦ２の拡大体ＧＦ２
．．．のｍ次の多項式をシフトレジスタで表現したブロ
ック図、第３図は、本考案の一実施例のシフトレジスタ
によるメモリアドレッシング方式を示したブロック図で
ある。 １・・・トリガ信号、２・・・加算（または減算）回路
、３・・・イモリアドレス、４・・・メモリ回路、５・
・・ラッチ回路。

Claims (1)

    【実用新案登録請求の範囲】
  1. シリアルにデータを書き込み、または読出すメモリ回路
    と、そのメモリ回路へのアドレスを供給するアドレッシ
    ング回路において、アドレッシング回路をシフトレジス
    タで構成したことを特徴とする高速メモリアドレッシン
    グ装置。　　−
JP8019183U 1983-05-30 1983-05-30 高速メモリアドレツシング装置 Pending JPS59185792U (ja)

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JP8019183U JPS59185792U (ja) 1983-05-30 1983-05-30 高速メモリアドレツシング装置

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JP8019183U JPS59185792U (ja) 1983-05-30 1983-05-30 高速メモリアドレツシング装置

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JPS59185792U true JPS59185792U (ja) 1984-12-10

Family

ID=30210184

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JP8019183U Pending JPS59185792U (ja) 1983-05-30 1983-05-30 高速メモリアドレツシング装置

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