JPS59165584A - テレビジヨン信号の符号化装置 - Google Patents
テレビジヨン信号の符号化装置Info
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- JPS59165584A JPS59165584A JP58038557A JP3855783A JPS59165584A JP S59165584 A JPS59165584 A JP S59165584A JP 58038557 A JP58038557 A JP 58038557A JP 3855783 A JP3855783 A JP 3855783A JP S59165584 A JPS59165584 A JP S59165584A
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- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N19/00—Methods or arrangements for coding, decoding, compressing or decompressing digital video signals
- H04N19/50—Methods or arrangements for coding, decoding, compressing or decompressing digital video signals using predictive coding
- H04N19/503—Methods or arrangements for coding, decoding, compressing or decompressing digital video signals using predictive coding involving temporal prediction
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- Engineering & Computer Science (AREA)
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- Signal Processing (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明はテレビジョン信号の符号化装置に関するもので
ある。
ある。
従来テレビジョン信号をブロック化して符号化を行なう
場合のブロックサイズは、たとえば二宮による論文「フ
レーム間符号化における動き補正」（１９７８年５月２
６日電子通信学会技術研究報告ＩＥ７８−６〜１２ ）
では、８ライン×ｎサンプル（ｎは８，１６．３２）で
あった。サンプリング周波数を６４０ ｈ （ｈは水平
走査周波数）にした場合、１ラインの画素数は６４０サ
ンプルになる。この場合水平方向には８，１６．３２と
もに割シ切れるが、垂直方向にはライン数が５２５なの
で８で割ると、６５あまシ５となる。したがってあま多
処理用の特別のコントロール信号が必要になシ、回路構
成が複雑になる。
場合のブロックサイズは、たとえば二宮による論文「フ
レーム間符号化における動き補正」（１９７８年５月２
６日電子通信学会技術研究報告ＩＥ７８−６〜１２ ）
では、８ライン×ｎサンプル（ｎは８，１６．３２）で
あった。サンプリング周波数を６４０ ｈ （ｈは水平
走査周波数）にした場合、１ラインの画素数は６４０サ
ンプルになる。この場合水平方向には８，１６．３２と
もに割シ切れるが、垂直方向にはライン数が５２５なの
で８で割ると、６５あまシ５となる。したがってあま多
処理用の特別のコントロール信号が必要になシ、回路構
成が複雑になる。
第１図にテレビの１フレームの画面を示す。
ブロックサイズをｎサンプル×ｍラインとする。
ある正整数をｋとし、ｎＸｋ＝６４０の時、図の右端斜
線部に端数が出る。
線部に端数が出る。
またある正整数を！とし、ｍ×ノ〜５２５の時、図の下
端斜線部に端数が出るが、ｎＸｋ＝６４０、一般的には
標本化周波数＝Ｎ−ｆＨで走査線数がＭ本とする時、ｎ
Ｘ ｋ＝Ｎ 、 ｍＸ４ ＝Ｍとなるような、ｍ、ｎ。
端斜線部に端数が出るが、ｎＸｋ＝６４０、一般的には
標本化周波数＝Ｎ−ｆＨで走査線数がＭ本とする時、ｎ
Ｘ ｋ＝Ｎ 、 ｍＸ４ ＝Ｍとなるような、ｍ、ｎ。
を選ぶことによシ、図の右端及び下端の斜線部の端数が
なくなる。
なくなる。
端数があると、端数部分は変則的な処理すなわちあま多
処理が必要になる。またあ−２多処理のための変則的な
制御信号も必要となり、規則的な制御信号と変則的な制
御信号が混在する。このためハードウェアの構成が複雑
化１回路の増加、検査の手間がかかるなどの欠点がある
。
処理が必要になる。またあ−２多処理のための変則的な
制御信号も必要となり、規則的な制御信号と変則的な制
御信号が混在する。このためハードウェアの構成が複雑
化１回路の増加、検査の手間がかかるなどの欠点がある
。
本発明の目的は、このような従来の欠点を除去し、ハー
ドウェアの簡単化、小型化、検査時間の短縮をすること
にある。
ドウェアの簡単化、小型化、検査時間の短縮をすること
にある。
本発明の符号化装置はＮの約数の−をｎ１Ｍの約数の−
をｍとする時前記テレビジョン信号よりｎ画素×ｍライ
ンのブロックを構成する手段、このブロック化されたテ
レビジョン信号よシ穴長性を除去あるいは抑圧する符号
化手段、この符号化手段出力を平均的にみて短い符号に
て表現する手段からなる。
をｍとする時前記テレビジョン信号よりｎ画素×ｍライ
ンのブロックを構成する手段、このブロック化されたテ
レビジョン信号よシ穴長性を除去あるいは抑圧する符号
化手段、この符号化手段出力を平均的にみて短い符号に
て表現する手段からなる。
本発明によれば、画面をたて、よこ、に区切ってブロッ
ク化する際に、サンプル数（水平方向）の約数及びライ
ン数（垂直方向）の約数を用いることにより、あま多処
理は不必要になシ、ハードウェアの簡単化、小型化、検
査時間の短縮が得られる。
ク化する際に、サンプル数（水平方向）の約数及びライ
ン数（垂直方向）の約数を用いることにより、あま多処
理は不必要になシ、ハードウェアの簡単化、小型化、検
査時間の短縮が得られる。
以下本発明についての実施例を図面を参照して詳しく説
明する。
明する。
第２図はブロック単位で符号化・復号化を行なうテレビ
ジョン信号のフレーム間符号化回路の一実施例を示すブ
ロック図である。入力信号線１によシ、ディジタル化さ
れたテレビジョン信号が走査変換回路２に供給され、走
査変換（以下ブロック化と称す）されたデーターが信号
線３に出力され、フレーム間符号化回路８の中の引算器
９の入力となる。引算器のもう一方の入力は、フレーム
メモリ１２の出力すなわち、１フレ一ム時間前のデータ
ーが入る、引算器９の出力すなわち予測誤差信号は線１
３に出力された後量子化器１０で量子化され、可変長符
号器１４及び加算器１１に入る。加算器１１のもう一方
の入力は、フレームメモリー１２の出力すなわち、１フ
レ一ム時間前のデーターである。加算器１１で加算され
たデーターは、局部復号信号としてフレームメモリー１
２の入力となる。
ジョン信号のフレーム間符号化回路の一実施例を示すブ
ロック図である。入力信号線１によシ、ディジタル化さ
れたテレビジョン信号が走査変換回路２に供給され、走
査変換（以下ブロック化と称す）されたデーターが信号
線３に出力され、フレーム間符号化回路８の中の引算器
９の入力となる。引算器のもう一方の入力は、フレーム
メモリ１２の出力すなわち、１フレ一ム時間前のデータ
ーが入る、引算器９の出力すなわち予測誤差信号は線１
３に出力された後量子化器１０で量子化され、可変長符
号器１４及び加算器１１に入る。加算器１１のもう一方
の入力は、フレームメモリー１２の出力すなわち、１フ
レ一ム時間前のデーターである。加算器１１で加算され
たデーターは、局部復号信号としてフレームメモリー１
２の入力となる。
可変長符号器１４でハフマン符号などの不等長符号をも
ちいて可変長符号化された信号は、符号器出力となシ、
伝送路１５を通シ、後号器の入力となシ、可変長復号器
１６に入る。可変長復号器で復号された誤差信号は、フ
レーム間復号器２０の加算器１７に入る。加算器のもう
一方の入力には、フレームメモリー１８から１フレ一ム
時間前の信号が送られて来る。よって加算器１７からは
、フレーム間復号信号が線１９を介して出力され、走査
逆変換回路２１に供給され、ブロック化されている信号
をもとの走査方式に従うテレビジョン信号にもどす。つ
ぎにブロック化回路の詳細について第３，４図を参照し
て説明する。
ちいて可変長符号化された信号は、符号器出力となシ、
伝送路１５を通シ、後号器の入力となシ、可変長復号器
１６に入る。可変長復号器で復号された誤差信号は、フ
レーム間復号器２０の加算器１７に入る。加算器のもう
一方の入力には、フレームメモリー１８から１フレ一ム
時間前の信号が送られて来る。よって加算器１７からは
、フレーム間復号信号が線１９を介して出力され、走査
逆変換回路２１に供給され、ブロック化されている信号
をもとの走査方式に従うテレビジョン信号にもどす。つ
ぎにブロック化回路の詳細について第３，４図を参照し
て説明する。
本説明は、サンプリング周波数４５５・ｆＨ（１ライン
４５５サンプル）とし、ブロックサイズを、５− ５サンプル×５ラインとした場合を一例として説明する
。入力信号１は、ラインメモリー２２及び２３に供給さ
れる。この場合のラインメモリーの容量は、ブロックサ
イズを５サンプル×５ラインとしたため、少なくとも５
ライン分の容量が必要となる。
４５５サンプル）とし、ブロックサイズを、５− ５サンプル×５ラインとした場合を一例として説明する
。入力信号１は、ラインメモリー２２及び２３に供給さ
れる。この場合のラインメモリーの容量は、ブロックサ
イズを５サンプル×５ラインとしたため、少なくとも５
ライン分の容量が必要となる。
書き込みアドレスカウンタ２４及び読み出しアドレスカ
ウンタ２５は、コントロール回Ｎ２６から線２７を介し
て供給されるリセット信号にょシ５ライン毎にリセット
される。
ウンタ２５は、コントロール回Ｎ２６から線２７を介し
て供給されるリセット信号にょシ５ライン毎にリセット
される。
書き込みアドレスカウンタ２４は、５ライン分のアドレ
スを、水平方向には１サンプルづつ垂直方向には、１ラ
インづつ数え上げる。読み出しアドレスカウンタ２５は
、第４図に示すようにブロック的に読み出す様にアドレ
スを発生する。まず第１ブロツクについて第１ラインの
第１サンプルから第５サンプルの順にアドレス発生し、
次に第２ラインの第１サンプルから第５サンプル、次に
第３ライン、第４ライン、第５ラインの順に、５サンプ
ル毎に次のラインへ進む。第５ラインの第６− ５サンプルの次は、第２ブロツクの第１ラインの第６サ
ンプルから第１０サンプルへ移シ、以下同様に５サンプ
ル毎に次のラインへ移）進み第９１ブロツクの最終サン
プルを読み出すと、次のサンプル時刻では、コントロー
ル回路２６からのリセット信号により第１ブロツクの最
初のサンプルを読み出すアドレスを発生する。また、リ
セット信号が入力されると、同じタイミングでコントロ
ール回路２６から線２８を介して供給される書き込み、
読み出し切換信号の極性が切換わり、アドレス切換スイ
ッチ２９から出力される書き込みアドレスと読み出しア
ドレスが入れ換って、アドレス信号線３０及び３１を介
して、ラインメモリーモリ−２２に書き込みアドレスが
供給されている場合、もう一方のラインメモリー２３に
は、アドレス信号線３１を介して読み出しアドレスが供
給されている。そして一方のラインメモリー２２が書き
込みを行なっている場合、もう一方のラインメモリー２
３は、読み出しを行なうように制御し、５ライン毎に曹
き込み、読み出しが反転する。
スを、水平方向には１サンプルづつ垂直方向には、１ラ
インづつ数え上げる。読み出しアドレスカウンタ２５は
、第４図に示すようにブロック的に読み出す様にアドレ
スを発生する。まず第１ブロツクについて第１ラインの
第１サンプルから第５サンプルの順にアドレス発生し、
次に第２ラインの第１サンプルから第５サンプル、次に
第３ライン、第４ライン、第５ラインの順に、５サンプ
ル毎に次のラインへ進む。第５ラインの第６− ５サンプルの次は、第２ブロツクの第１ラインの第６サ
ンプルから第１０サンプルへ移シ、以下同様に５サンプ
ル毎に次のラインへ移）進み第９１ブロツクの最終サン
プルを読み出すと、次のサンプル時刻では、コントロー
ル回路２６からのリセット信号により第１ブロツクの最
初のサンプルを読み出すアドレスを発生する。また、リ
セット信号が入力されると、同じタイミングでコントロ
ール回路２６から線２８を介して供給される書き込み、
読み出し切換信号の極性が切換わり、アドレス切換スイ
ッチ２９から出力される書き込みアドレスと読み出しア
ドレスが入れ換って、アドレス信号線３０及び３１を介
して、ラインメモリーモリ−２２に書き込みアドレスが
供給されている場合、もう一方のラインメモリー２３に
は、アドレス信号線３１を介して読み出しアドレスが供
給されている。そして一方のラインメモリー２２が書き
込みを行なっている場合、もう一方のラインメモリー２
３は、読み出しを行なうように制御し、５ライン毎に曹
き込み、読み出しが反転する。
ラインメモリー２２及び２３から読み出された信号は、
メモリー出力信号線３２及び３３を介して出力選択スイ
ッチ３４に供給される。出力選択スイッチ３４は、コン
トロール回路２６から供給される書き込み、読み出し切
換信号によシ、読み出しを行なっている方のラインメモ
リー出力を選ぶ。
メモリー出力信号線３２及び３３を介して出力選択スイ
ッチ３４に供給される。出力選択スイッチ３４は、コン
トロール回路２６から供給される書き込み、読み出し切
換信号によシ、読み出しを行なっている方のラインメモ
リー出力を選ぶ。
出力信号選択スイッチ３４の出力は、ブロック化回路出
力信号線２を介して、フレーム間符号器８に供給される
。フレーム間復号器２０で復号された信号１９は、走査
逆変換回路２１でもとの走査となる様に逆変換処理を行
なうが、この時の動作は、以上述べたブロック化におけ
る読み出しアドレスを書き込みアドレスに、書き込みア
ドレスを読み出しアドレスとして、それぞれ用いると、
第３図のブロック化回路２が走査逆変換回路２１として
使用できる。
力信号線２を介して、フレーム間符号器８に供給される
。フレーム間復号器２０で復号された信号１９は、走査
逆変換回路２１でもとの走査となる様に逆変換処理を行
なうが、この時の動作は、以上述べたブロック化におけ
る読み出しアドレスを書き込みアドレスに、書き込みア
ドレスを読み出しアドレスとして、それぞれ用いると、
第３図のブロック化回路２が走査逆変換回路２１として
使用できる。
本説明は、ブロックサイズを５サンプル×５ラインとし
たが、サンプル方向及びライン方向に割シ切れる数たと
えば７サンプル×７ライン、１３サンプル×７ラインな
ど、どのようなブロックサイズでもよい。
たが、サンプル方向及びライン方向に割シ切れる数たと
えば７サンプル×７ライン、１３サンプル×７ラインな
ど、どのようなブロックサイズでもよい。
本実施例においては、８ 、２０ 、の符号器・復号器
として、フレーム間符号器・復号器を使用した例をとっ
た。この他に、アダマールやコサイン変換などの直交変
換を用いてもよい。なおその場合には、８，２０．を直
交変換符号器・復号器とする。
として、フレーム間符号器・復号器を使用した例をとっ
た。この他に、アダマールやコサイン変換などの直交変
換を用いてもよい。なおその場合には、８，２０．を直
交変換符号器・復号器とする。
以上詳しく説明したように本発明を用いると、さもなく
ば、さけられないブロック間の不連続な継ぎ目の発生を
なくしてしまうことができるので、符号化処理が大巾に
容易となるため、本発明を実用に供するとその効果はき
わめて太きい。
ば、さけられないブロック間の不連続な継ぎ目の発生を
なくしてしまうことができるので、符号化処理が大巾に
容易となるため、本発明を実用に供するとその効果はき
わめて太きい。
第１図は従来の走査変換を説明する図、第２図は本発明
の一実施例を示すブロック図、第３図は走査変換回路を
説明するブロック図、第４図はブロック単位の読み出し
方を説明する図である。 ９− 図において参照数字は次のものを示す。 ２・・・走査変換回路 ８・・・フレーム間符号器
９・・・引算器 １０・・・量子化器１１・
・・ｊＪＩｌ 算器１２・・・フレームメモリー１４・
・・可変長符号器 １５・・・伝送路１６・・・可
変長復号器 １７・・・加算器１８・・・フレーム
メモリー ２０・・・フレーム間復号器２１・・・走査
逆変換回路 ２２−・・ラインメモリー２３・・・２
インメモリー ２４・・・書き込みアドレスカウンタ ２５・・・読み出しアドレスカウンタ ２６・・・コントロール回路 ２９・・・アドレス切換スイッチ ３４・・・出力信号選択スイッチ 代理人弁理士内原 晋 一１〇− 第１図 城 澱 塚 裂 λ
の一実施例を示すブロック図、第３図は走査変換回路を
説明するブロック図、第４図はブロック単位の読み出し
方を説明する図である。 ９− 図において参照数字は次のものを示す。 ２・・・走査変換回路 ８・・・フレーム間符号器
９・・・引算器 １０・・・量子化器１１・
・・ｊＪＩｌ 算器１２・・・フレームメモリー１４・
・・可変長符号器 １５・・・伝送路１６・・・可
変長復号器 １７・・・加算器１８・・・フレーム
メモリー ２０・・・フレーム間復号器２１・・・走査
逆変換回路 ２２−・・ラインメモリー２３・・・２
インメモリー ２４・・・書き込みアドレスカウンタ ２５・・・読み出しアドレスカウンタ ２６・・・コントロール回路 ２９・・・アドレス切換スイッチ ３４・・・出力信号選択スイッチ 代理人弁理士内原 晋 一１〇− 第１図 城 澱 塚 裂 λ
Claims (1)
- 水平方向にはＮ画素、垂直方向にはＭ本の走査線からな
るテレビジョン信号の符号化を複数ラインにまたがる２
次元ブロックを用いて行なうに当って、Ｎの約数の−を
ｎ、Ｍの約数の−をｍとする時、前記テレビジョン信号
よりｎ画素×ｍラインのブロックを構成する手段、この
ブロック化されたテレビジョン信号よシ大長性を除去あ
るいは抑圧する符号化手段、この符号化手段出力を平均
的にみて短い符号にて表現する手段、とを具備すること
を特徴とするテレビジョン信号の符号化装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58038557A JPS59165584A (ja) | 1983-03-09 | 1983-03-09 | テレビジヨン信号の符号化装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58038557A JPS59165584A (ja) | 1983-03-09 | 1983-03-09 | テレビジヨン信号の符号化装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS59165584A true JPS59165584A (ja) | 1984-09-18 |
Family
ID=12528588
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP58038557A Pending JPS59165584A (ja) | 1983-03-09 | 1983-03-09 | テレビジヨン信号の符号化装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS59165584A (ja) |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5447513A (en) * | 1977-09-22 | 1979-04-14 | Oki Electric Ind Co Ltd | Encoding system for television signal |
-
1983
- 1983-03-09 JP JP58038557A patent/JPS59165584A/ja active Pending
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5447513A (en) * | 1977-09-22 | 1979-04-14 | Oki Electric Ind Co Ltd | Encoding system for television signal |
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