JPS59160383A - 固体撮像素子 - Google Patents
固体撮像素子Info
- Publication number
- JPS59160383A JPS59160383A JP58033764A JP3376483A JPS59160383A JP S59160383 A JPS59160383 A JP S59160383A JP 58033764 A JP58033764 A JP 58033764A JP 3376483 A JP3376483 A JP 3376483A JP S59160383 A JPS59160383 A JP S59160383A
- Authority
- JP
- Japan
- Prior art keywords
- solid
- transistor
- horizontal
- output
- vertical
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N5/00—Details of television systems
- H04N5/30—Transforming light or analogous information into electric information
Landscapes
- Engineering & Computer Science (AREA)
- Multimedia (AREA)
- Signal Processing (AREA)
- Transforming Light Signals Into Electric Signals (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
夾亙至Ｉ
本発明は固体撮像素子、とくに、撮像セルの配列を走査
することによって時系列映像信号を出力する固体撮像素
子に関するものである。とりわけＭＯＳ型の固体撮像素
子に有利に適用される。
することによって時系列映像信号を出力する固体撮像素
子に関するものである。とりわけＭＯＳ型の固体撮像素
子に有利に適用される。
１１韮遺
従来のＭＯＳ型固体撮像素子は、撮像セルを走査するた
めのスイッチ用ＭＯ５、）ランジスタの寄生容量に起因
する固定パターンノイズ（ＦＰ、Ｎ）が発生する欠点が
あった。
めのスイッチ用ＭＯ５、）ランジスタの寄生容量に起因
する固定パターンノイズ（ＦＰ、Ｎ）が発生する欠点が
あった。
とりわけ高速で動作するスイ・ンチ用トランジスタ、す
なわち水平走査用のＭＯＳ ）ランジスタのゲートΦソ
ース間、およびゲート拳ドレーン間番と寄生容量が存在
する。水平走査を行なうため番と、これらのＭＯＳトラ
ンジスタのゲート番こ付勢ノくルスを高速で順次印加し
てゆくと、それらの寄生容量を通してこの付勢パルスが
スノくイクノイズの形でＭＯ３’ ）ランジスタの出力
端、すなわち映像信号出力端に現われる。これらのＭＯ
Ｓ 、）ランジスタのしきい値や寄生容量は各トランジ
スタ素子ご゛と番と均一でないので、このスノ々イクノ
イズの大きさｔｔ画素ごとにばらつく。したがって、こ
れらのスノぐイクノイズの包絡ｉは低周波成分を含み、
映像信号出力端の先に設けられた低域フィルタを通過す
る。そこで、この映像信号を再生すると、水平力０向の
位置が固定されたパターン（例えばＴＶ再生系で再生す
る場合に、たてじま状のスジとなる。＜ターン）を有す
るノイズ、すなわち固定ノくターンノイズとなって再生
画像に現れる。
なわち水平走査用のＭＯＳ ）ランジスタのゲートΦソ
ース間、およびゲート拳ドレーン間番と寄生容量が存在
する。水平走査を行なうため番と、これらのＭＯＳトラ
ンジスタのゲート番こ付勢ノくルスを高速で順次印加し
てゆくと、それらの寄生容量を通してこの付勢パルスが
スノくイクノイズの形でＭＯ３’ ）ランジスタの出力
端、すなわち映像信号出力端に現われる。これらのＭＯ
Ｓ 、）ランジスタのしきい値や寄生容量は各トランジ
スタ素子ご゛と番と均一でないので、このスノ々イクノ
イズの大きさｔｔ画素ごとにばらつく。したがって、こ
れらのスノぐイクノイズの包絡ｉは低周波成分を含み、
映像信号出力端の先に設けられた低域フィルタを通過す
る。そこで、この映像信号を再生すると、水平力０向の
位置が固定されたパターン（例えばＴＶ再生系で再生す
る場合に、たてじま状のスジとなる。＜ターン）を有す
るノイズ、すなわち固定ノくターンノイズとなって再生
画像に現れる。
１−一一旬
本発明はこめような従来技術の欠点を解消し、スイッチ
用トランジスタの寄生容量に起因した固定パターンノイ
ズを発生することのない固体撮像素子を提供することを
目的とする。
用トランジスタの寄生容量に起因した固定パターンノイ
ズを発生することのない固体撮像素子を提供することを
目的とする。
１更五１ＬＩＴｔ
本発明によれば、入射光に応じたキャリアを発生する撮
像セルが複数配列された撮像セル配列と、選択されると
撮像セルのキャリアに応じた映像信号を出力信号線に出
力する出力手段と、出力手段を択一的に順次選択する選
択手段とを含む固体撮像素子において、出力手段は、出
力信号線を撮像セルからインピーダンス分離して出力信
号線に低いインピーダンスを与えるインピーダンス変換
回路を含む。
像セルが複数配列された撮像セル配列と、選択されると
撮像セルのキャリアに応じた映像信号を出力信号線に出
力する出力手段と、出力手段を択一的に順次選択する選
択手段とを含む固体撮像素子において、出力手段は、出
力信号線を撮像セルからインピーダンス分離して出力信
号線に低いインピーダンスを与えるインピーダンス変換
回路を含む。
本発明の態様によれば、撮像セル配列は、撮像セルが水
平行および垂直列に配列された２次元配列であり、出力
手段は、垂直列に含まれる各撮像セルの出力を共通にイ
ンピーダンス変換回路に接続した第１のトランジスタと
、インピーダンス変換回路の出力を水平行の方向に共通
に出力信号線に接続した第２のトランジスタとを含み、
選択手段は、第１のトランジスタを水平行ごとに垂直方
向に順次付勢する垂直走査回路と、１つの水平行の第１
のトランジスタが付勢されている間、第２のトランジス
タを末子方向に順次付勢する水平走査回路とを含んでも
よい。
平行および垂直列に配列された２次元配列であり、出力
手段は、垂直列に含まれる各撮像セルの出力を共通にイ
ンピーダンス変換回路に接続した第１のトランジスタと
、インピーダンス変換回路の出力を水平行の方向に共通
に出力信号線に接続した第２のトランジスタとを含み、
選択手段は、第１のトランジスタを水平行ごとに垂直方
向に順次付勢する垂直走査回路と、１つの水平行の第１
のトランジスタが付勢されている間、第２のトランジス
タを末子方向に順次付勢する水平走査回路とを含んでも
よい。
支り爽ｍ
次に添伺図面を参照して本発明による固体撮像素子の実
施例を詳細に説明する。
施例を詳細に説明する。
第１図に概略回路図で示す本発明による固体撮像素子の
実施例は、Ｍ列の垂直列、Ｎ行の水平行（ＭおよびＮは
自然ａ）のアレイ状に配列された撮像セルＰＤを含み、
２次元の撮像セル配列を構成している。各撮像セルＰＤ
はたとえばフォトダイオードなどの感光素子である。
実施例は、Ｍ列の垂直列、Ｎ行の水平行（ＭおよびＮは
自然ａ）のアレイ状に配列された撮像セルＰＤを含み、
２次元の撮像セル配列を構成している。各撮像セルＰＤ
はたとえばフォトダイオードなどの感光素子である。
本実施例では、撮像セルＰＤは陽極が基準電位、たとえ
ばグランドに接続され、陰極はＭＯＳ トランジスタＱ
Ｖのソース争ドレーン路を通して垂直信号線１０に接続
されている。ＭＯＳトランジスタＱＶは垂直走査用のト
ランジスタであり、各トランジスタＱＶのゲートは水平
行ごとに共通に垂直選択線１２によってシフトレジスタ
ＳＲＶの１つの段に接続されている。シフトレジスタＳ
ＲＶは水平同期パルスＨＤ（第２図）に応動して歩進し
、垂直選択線１２を順次択一的に選択する垂直走査回路
である。
ばグランドに接続され、陰極はＭＯＳ トランジスタＱ
Ｖのソース争ドレーン路を通して垂直信号線１０に接続
されている。ＭＯＳトランジスタＱＶは垂直走査用のト
ランジスタであり、各トランジスタＱＶのゲートは水平
行ごとに共通に垂直選択線１２によってシフトレジスタ
ＳＲＶの１つの段に接続されている。シフトレジスタＳ
ＲＶは水平同期パルスＨＤ（第２図）に応動して歩進し
、垂直選択線１２を順次択一的に選択する垂直走査回路
である。
垂直信号線１０は、各垂直列ごとに共通にトランジスタ
ＱＶのドレーンを８．０’Ｓ ）ランジスタＱ２のゲ
ートに接続している。トランジスタＱ２は、ドレーンが
電源ＶＤＤに接続され、ソースは定電流源として機能す
るＭＯＳトランジスタＱ１を介して接地され、全体とし
てソースフォロワを構成している。垂直信号線ｌＯはま
た、リセ・ント用トランジスタＱＲのソース・ドレーン
路を通してリセット電源ＶＲＤに接続されている。
ＱＶのドレーンを８．０’Ｓ ）ランジスタＱ２のゲ
ートに接続している。トランジスタＱ２は、ドレーンが
電源ＶＤＤに接続され、ソースは定電流源として機能す
るＭＯＳトランジスタＱ１を介して接地され、全体とし
てソースフォロワを構成している。垂直信号線ｌＯはま
た、リセ・ント用トランジスタＱＲのソース・ドレーン
路を通してリセット電源ＶＲＤに接続されている。
トランジスタＱ２のソースはまた、他のＭＯＳ ）ラン
ジスタＱ）Ｉのソース・ドレーン路を通して水平信号線
すなわち出力信号線１６に接続されている。
ジスタＱ）Ｉのソース・ドレーン路を通して水平信号線
すなわち出力信号線１６に接続されている。
ＭＯＳ トランジスタＱ）Ｉは水平走査用のトランジス
タであり、各トランジスタＱＨのゲートは共通にシフト
レジスタＳＲＨの１つの段に接続されている。シフトレ
ジスタＳ ＲＨはピクセルクロックパルスＰＣ（第２″
図）に応動して歩進し、トランジスタＱＨを順次択一的
に付勢する水平走査回路である。このシフトレジスタＳ
ＲＨはＭ列の垂直信号線列に相当する段数Ｍに加えて更
にＸ÷１番目の段が形成されており、このＭ＋１段はリ
セット線１４によって前記各リセット用トランジスタＱ
Ｒのゲートに共通に接続され、リセット回路を形成して
いる。従ってリセット用トランジスタＱＲは１つの垂直
謳選択線１２が選択されている期間内にこれに接続され
ている撮像セルＰａｌを各垂直信号線１０と共にリセッ
トすることとなる。
タであり、各トランジスタＱＨのゲートは共通にシフト
レジスタＳＲＨの１つの段に接続されている。シフトレ
ジスタＳ ＲＨはピクセルクロックパルスＰＣ（第２″
図）に応動して歩進し、トランジスタＱＨを順次択一的
に付勢する水平走査回路である。このシフトレジスタＳ
ＲＨはＭ列の垂直信号線列に相当する段数Ｍに加えて更
にＸ÷１番目の段が形成されており、このＭ＋１段はリ
セット線１４によって前記各リセット用トランジスタＱ
Ｒのゲートに共通に接続され、リセット回路を形成して
いる。従ってリセット用トランジスタＱＲは１つの垂直
謳選択線１２が選択されている期間内にこれに接続され
ている撮像セルＰａｌを各垂直信号線１０と共にリセッ
トすることとなる。
各垂直走査トランジスタＱＨのドレーンは共通に水平信
号線１６を通して前置増幅器２０の入力に接続される。
号線１６を通して前置増幅器２０の入力に接続される。
前置増幅器２０の出力は映像信号帯域の低域フィルタ（
ｔ、ｐｎ ２４を通して映像出力端子２６に接続されて
いる。
ｔ、ｐｎ ２４を通して映像出力端子２６に接続されて
いる。
ところで、従来のＫＯ３型固体撮像素子では、本実施例
におけるトランジスタＱ１およびＱ２が設けられておら
ず、垂直信号線１０が直接トランジスタＱＨのソースに
接続されていた。−力、水平走査用のスイッチングトラ
ンジスタＱＨは、そのゲート−ドレーン間およびゲート
・ソース間に寄生容量を伴なっている。したがって、水
平走査シフトレジスタＳＲＨの出力する水平走査パルス
はこれらの寄生容量を通して信号線１０および１Ｂにス
パイクノイズの形で現われる。信号線ｌＯおよび１６、
ならびにトランジスタＱＨのソース・ドレーン路は何ら
かの値の抵抗ないしはインピーダンスを有しているので
、これらに漏れ込んだスパイクノイズは、前述の寄生容
量とこれらの抵抗ないしはインピーダンスの値との積で
決まる時定数で減衰する。従来の固体撮像素子では信号
転送路の抵抗ないしはインピーダンスがある程度の値を
有していたので、このスパイクノイズが画素信号に対し
てかなりの時間継続していた。
におけるトランジスタＱ１およびＱ２が設けられておら
ず、垂直信号線１０が直接トランジスタＱＨのソースに
接続されていた。−力、水平走査用のスイッチングトラ
ンジスタＱＨは、そのゲート−ドレーン間およびゲート
・ソース間に寄生容量を伴なっている。したがって、水
平走査シフトレジスタＳＲＨの出力する水平走査パルス
はこれらの寄生容量を通して信号線１０および１Ｂにス
パイクノイズの形で現われる。信号線ｌＯおよび１６、
ならびにトランジスタＱＨのソース・ドレーン路は何ら
かの値の抵抗ないしはインピーダンスを有しているので
、これらに漏れ込んだスパイクノイズは、前述の寄生容
量とこれらの抵抗ないしはインピーダンスの値との積で
決まる時定数で減衰する。従来の固体撮像素子では信号
転送路の抵抗ないしはインピーダンスがある程度の値を
有していたので、このスパイクノイズが画素信号に対し
てかなりの時間継続していた。
本発明によれば信号線ｌＯと１６は、２つのトランジス
タＱ１およびＱ２からなるインピーダンス変換回路によ
ってインピーダンス分離されている。このインピーダン
ス変換回路は、前述のスパイクノイズの時定数を決める
信号線のインピーダンスを低くする機能を果している。
タＱ１およびＱ２からなるインピーダンス変換回路によ
ってインピーダンス分離されている。このインピーダン
ス変換回路は、前述のスパイクノイズの時定数を決める
信号線のインピーダンスを低くする機能を果している。
さらにソースフォロワによっ、てインピーダンス変換回
路を構成しているので、各ＭＯ３ｈランジスタＱｌ、Ｑ
２の電流増幅率がばらついても、電圧増幅率がほぼｌで
あるため、各ＭＯＳトランジスタＱｌ 、 Ｑ２に起因
した固定パターンノイズは発生しない。なお水平走査ト
ランジスタＱＨをバイポーラトランジスタで構成した場
合は、インピーダンス変換回路はバイポーラトランジス
タによるエミッタフォロワ回路で構成することができる
。
路を構成しているので、各ＭＯ３ｈランジスタＱｌ、Ｑ
２の電流増幅率がばらついても、電圧増幅率がほぼｌで
あるため、各ＭＯＳトランジスタＱｌ 、 Ｑ２に起因
した固定パターンノイズは発生しない。なお水平走査ト
ランジスタＱＨをバイポーラトランジスタで構成した場
合は、インピーダンス変換回路はバイポーラトランジス
タによるエミッタフォロワ回路で構成することができる
。
第２図に示すタイミング図を参照して本装置の動作を説
明する。水平同期信号ＨＤに応動して垂直走査回路ＳＲ
Ｖが１番目の水平行を選択し、そのｌ走査（ｌ Ｈ）８
間中、第１行のトランジスタＱＶを一斉に付勢する。こ
のＩＨ期間中、水モ走査回路ＳＲＨはビクセルクロック
パルスＰＣに応動して水平走査トランジスタＱＨを順次
駆動し、第＼１行に含まれるＭ個の撮像セルＰＤに発生
した光キャ゛リアに応じた画素信号がインピーダンス変
換回路Ｑｌ、Ｑ２を介して順次信号線１６に出力される
。これは前置増幅器２０およびＩ、ＰＦ、２４を通し２
て映像信号出力端子２６に順次、映像信号として出力さ
れる。
明する。水平同期信号ＨＤに応動して垂直走査回路ＳＲ
Ｖが１番目の水平行を選択し、そのｌ走査（ｌ Ｈ）８
間中、第１行のトランジスタＱＶを一斉に付勢する。こ
のＩＨ期間中、水モ走査回路ＳＲＨはビクセルクロック
パルスＰＣに応動して水平走査トランジスタＱＨを順次
駆動し、第＼１行に含まれるＭ個の撮像セルＰＤに発生
した光キャ゛リアに応じた画素信号がインピーダンス変
換回路Ｑｌ、Ｑ２を介して順次信号線１６に出力される
。これは前置増幅器２０およびＩ、ＰＦ、２４を通し２
て映像信号出力端子２６に順次、映像信号として出力さ
れる。
本実施例においては垂直走査回路ＳＲｖによって１つの
水平行を選択している期間の最終において、読み出した
水平行の、すなわちこの例では１番目の行に接続された
撮像セルＰＤ及び各垂直信号線１０が一斉にリセットさ
れる。このリセットは水平走査回路５Ｒ）ｌがに＋１段
に歩進してリセットパルスがリセット用トランジスタＱ
Ｒのゲートに与えられてリセット用トランジスタＱＲが
一斉に駆動されることによって１番目の行に接続された
裸像セルＰＤに蓄積されていた光キャリア、及び各垂直
信号線１０に残留していたキャリアが電源ＶＤＤに排出
され、リセット動作が行なわれる。
水平行を選択している期間の最終において、読み出した
水平行の、すなわちこの例では１番目の行に接続された
撮像セルＰＤ及び各垂直信号線１０が一斉にリセットさ
れる。このリセットは水平走査回路５Ｒ）ｌがに＋１段
に歩進してリセットパルスがリセット用トランジスタＱ
Ｒのゲートに与えられてリセット用トランジスタＱＲが
一斉に駆動されることによって１番目の行に接続された
裸像セルＰＤに蓄積されていた光キャリア、及び各垂直
信号線１０に残留していたキャリアが電源ＶＤＤに排出
され、リセット動作が行なわれる。
このようにして第１番目の水平行に接続された撮像セル
ＰＤの読出しが行なわれた後、次の水平同期パルスＨＤ
が発生して次のＩＨ期間にはいると、組直走査回路ＳＲ
’Ｖはこれに応動して１段歩進し、２番目の水平行を選
択し、同様の出力動作が行なわれる。
ＰＤの読出しが行なわれた後、次の水平同期パルスＨＤ
が発生して次のＩＨ期間にはいると、組直走査回路ＳＲ
’Ｖはこれに応動して１段歩進し、２番目の水平行を選
択し、同様の出力動作が行なわれる。
このよう１こして、水平行ごとに順次読出しが行なわれ
、読出しの完了した水平行は順次リセットされ、Ｎ行ｘ
Ｍ画素のラスク走査が行なわれる。
、読出しの完了した水平行は順次リセットされ、Ｎ行ｘ
Ｍ画素のラスク走査が行なわれる。
第３図は本発明の固体撮像素子の他の実施例を示す。こ
の実施例は、第１図に示した固体撮像素子に更にフォー
カルプレーン型のシャ・ンタ機能を付加したものである
。この例においては、撮像セルＰＤの陰極が更に他のＭ
ＯＳ ）ランジスタＱＲ２のソース・ドレーン路を通し
てリセット電源ＶＲＤ２に接続されている。ＭＯＳトラ
ンジスタＱＲ２はリセ・ント用のトランジスタであり、
各トランジスタＱＲ２のゲートは水平行ごとに共通にリ
セット線１８によってシフトレジスタＳＲＲの１つの段
に接続され、リセット回路を構成している。シフトレジ
スタＳＲＲは例えば垂直シフトレジスタＳＲＶに入力さ
れる水平同期パルスＨＤ（第２図）に互いに異なる位相
となるように応動して歩進し、リセット線１４を順次択
一的に付勢するシフトレジスタ回路である。このリセッ
トパルスＨＲは水平同期パルス＋（’Ｄに対して位相を
自在に設定しうるようになっており、１つの行を読み出
した噸の任意の期間でリセットさせることにより読出し
動作とリセット動作との位相差に応じた露出時間のフォ
ーカルプレーンシャッタ機能が電子的に実現される。
の実施例は、第１図に示した固体撮像素子に更にフォー
カルプレーン型のシャ・ンタ機能を付加したものである
。この例においては、撮像セルＰＤの陰極が更に他のＭ
ＯＳ ）ランジスタＱＲ２のソース・ドレーン路を通し
てリセット電源ＶＲＤ２に接続されている。ＭＯＳトラ
ンジスタＱＲ２はリセ・ント用のトランジスタであり、
各トランジスタＱＲ２のゲートは水平行ごとに共通にリ
セット線１８によってシフトレジスタＳＲＲの１つの段
に接続され、リセット回路を構成している。シフトレジ
スタＳＲＲは例えば垂直シフトレジスタＳＲＶに入力さ
れる水平同期パルスＨＤ（第２図）に互いに異なる位相
となるように応動して歩進し、リセット線１４を順次択
一的に付勢するシフトレジスタ回路である。このリセッ
トパルスＨＲは水平同期パルス＋（’Ｄに対して位相を
自在に設定しうるようになっており、１つの行を読み出
した噸の任意の期間でリセットさせることにより読出し
動作とリセット動作との位相差に応じた露出時間のフォ
ーカルプレーンシャッタ機能が電子的に実現される。
処−一一芽
本発明による固体撮像素子はこのように構成されたこと
により、スイッチイング用トランジスタの寄生容量に起
因する固定パターンノイズを映像信号から除去すること
ができる。また固体撮像素子の撮像セルは、読出しによ
ってもその蓄積電荷がυ１出されることがなく、基本的
に非破壊読出しが可能である。
により、スイッチイング用トランジスタの寄生容量に起
因する固定パターンノイズを映像信号から除去すること
ができる。また固体撮像素子の撮像セルは、読出しによ
ってもその蓄積電荷がυ１出されることがなく、基本的
に非破壊読出しが可能である。
なお、本発明による固体撮像素子をＭＯ３型２次元撮像
セル配列の特定の実施例について説明したが、本発明は
これに限定されるものではない。
セル配列の特定の実施例について説明したが、本発明は
これに限定されるものではない。
第１図は本発明による固体撮像素子の実施例を示す概略
回路図、 第２図は、第１図の装置の動作を説明するためのタイミ
ング図、 第３図は本発明による固体撮像素子の他の実施例を示す
概略回路図である。 一戸部）の１号の１ １０、、、垂直信号線 １２、、、垂直選択線 １４、、、リセット線 １Ｂ、、、水平信号線 ＰＤ、’、 、撮像セル Ｑｌ、Ｑ２． 、インピーダンス変換回路ＱＨ，，，水
平走査トランジスタ ＱＲ，、、リセットトランジスタ ＱＶ、、、垂直走査トランジスタ ＳＲＶ、、、、垂直走査回路 ｓＲｉ＋、、、水平走査回路 ＶＲ，、、リセット電圧
回路図、 第２図は、第１図の装置の動作を説明するためのタイミ
ング図、 第３図は本発明による固体撮像素子の他の実施例を示す
概略回路図である。 一戸部）の１号の１ １０、、、垂直信号線 １２、、、垂直選択線 １４、、、リセット線 １Ｂ、、、水平信号線 ＰＤ、’、 、撮像セル Ｑｌ、Ｑ２． 、インピーダンス変換回路ＱＨ，，，水
平走査トランジスタ ＱＲ，、、リセットトランジスタ ＱＶ、、、垂直走査トランジスタ ＳＲＶ、、、、垂直走査回路 ｓＲｉ＋、、、水平走査回路 ＶＲ，、、リセット電圧
Claims (1)
- 【特許請求の範囲】 １ 入射光に応したキャリアを発生する撮像セルが複数
配列された撮像セル配列と、 Ｓ ＋Ｒされると該撮像セルのキャリアに応じた映像信
号を出力信号線に出力する出力手段と、該出力手段を４
Ｒ−的に順次訳釈する選釈−Ｌ段とを含む固体撮像素子
において、 前記出力り段は、前記出力信号線を撮像セルからインピ
ーダンス分列して該出力信号線に低いインピータンスを
与えるインピータンス変換回路を含むことを特徴とする
固体撮像素子。 ２、特許請求の範囲第１項記載の固体撮像素子において
、 前記撮像セル配列は、撮像セルが水平行およびＩＩ′ｒ
的列に配列された２次元配列であり、前記出力手段は、
該垂直列に含まれる各撮像セルの出力をノ（通に前記イ
ンピーダンス変換回路に接続した第１のトランジスタと
、 該インピータンス変換回路の出力な水１）−行の方向に
共通に前記出力信号線に接続した第２のトランジスタと
を含み、 前記逆捩手段は、第１のトランジスタを水中−行ことに
垂直方向・に順次付勢する垂直走査回路と、 １つの水平行の第１のトランジスタがイ・ｊ勢されてい
る間、第２のトランジス゛りを水平ノｊ向に順次イ・］
勢する水平走査回路とを含むことを特徴とする１−８体
撮像素子。 ３、特許請求の範囲第２項記載の固体撮像素子において
、該固体撮像素子はＭＯＳ型の固体撮像素（−であり、
前記インピーダンス変換回路はソースフォロワを含″む
ことを特徴とする固体撮像素ｒ。 ４、特許請求の範囲第３項記載の固体撮像素子において
、前記第１のトランジスタが伺勢ｙれている期間内に、
前記撮像セルのキャリアを排出させる１）セット手段を
含むことを４１ｆ徴とする固体撮像素子。 ５、特許請求の範囲第２項乃至第４項のいずれかに記載
の固体撮像素子において、前記撮像セルのキャリアを水
平行ごとに排出させるリセット回路を含むことを特徴と
する固体撮像素子。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58033764A JPS59160383A (ja) | 1983-03-03 | 1983-03-03 | 固体撮像素子 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58033764A JPS59160383A (ja) | 1983-03-03 | 1983-03-03 | 固体撮像素子 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS59160383A true JPS59160383A (ja) | 1984-09-11 |
Family
ID=12395500
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP58033764A Pending JPS59160383A (ja) | 1983-03-03 | 1983-03-03 | 固体撮像素子 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS59160383A (ja) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS62296675A (ja) * | 1986-06-17 | 1987-12-23 | Fuji Photo Film Co Ltd | 固体撮像素子 |
| JPS6376583A (ja) * | 1986-09-19 | 1988-04-06 | Canon Inc | 固体撮像装置 |
| US6747699B2 (en) | 1985-11-15 | 2004-06-08 | Canon Kabushiki Kaisha | Solid state image pickup apparatus |
-
1983
- 1983-03-03 JP JP58033764A patent/JPS59160383A/ja active Pending
Cited By (3)
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