JPS587190B2 - スイシヨウドケイ - Google Patents

スイシヨウドケイ

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JPS587190B2
JPS587190B2 JP48135301A JP13530173A JPS587190B2 JP S587190 B2 JPS587190 B2 JP S587190B2 JP 48135301 A JP48135301 A JP 48135301A JP 13530173 A JP13530173 A JP 13530173A JP S587190 B2 JPS587190 B2 JP S587190B2
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JP
Japan
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speed
standard time
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沼部仁美
千原博幸
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Suwa Seikosha KK
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Suwa Seikosha KK
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    • H03—ELECTRONIC CIRCUITRY
    • H03K—PULSE TECHNIQUE
    • H03K23/00—Pulse counters comprising counting chains; Frequency dividers comprising counting chains
    • H03K23/64—Pulse counters comprising counting chains; Frequency dividers comprising counting chains with a base or radix other than a power of two
    • H03K23/66—Pulse counters comprising counting chains; Frequency dividers comprising counting chains with a base or radix other than a power of two with a variable counting base, e.g. by presetting or by adding or suppressing pulses
    • H03K23/662—Pulse counters comprising counting chains; Frequency dividers comprising counting chains with a base or radix other than a power of two with a variable counting base, e.g. by presetting or by adding or suppressing pulses by adding or suppressing pulses
    • G—PHYSICS
    • G04—HOROLOGY
    • G04G—ELECTRONIC TIME-PIECES
    • G04G3/00—Producing timing pulses
    • G04G3/02—Circuits for deriving low frequency timing pulses from pulses of higher frequency
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    • G—PHYSICS
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    • G06F7/00—Methods or arrangements for processing data by operating upon the order or content of the data handled
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    • G06F7/68—Methods or arrangements for performing computations using a digital non-denominational number representation, i.e. number representation without radix; Computing devices using combinations of denominational and non-denominational quantity representations, e.g. using difunction pulse trains, STEELE computers, phase computers using pulse rate multipliers or dividers pulse rate multipliers or dividers per se

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Description

【発明の詳細な説明】 本発明は水晶時計の歩度緩急に関する。
本発明の目的は、歩度緩急を自動的に行なう水晶時計を
提供することにある。
歩度の緩急は水晶時計の精度を最終的に決定するもので
あり、重要な操作である。
従来の水晶時計に於ては、トリマーコンデンサの容量の
可変により発振周波数を変化させて歩度の緩急が行なわ
れていた。
しかし、トリマーコンデンサは可動部があるために信頼
性上の欠点を持ち、しかも決められた小型の寸法のもの
では容量変化が限られるため発振周波数の変化が小さく
、したがって水晶振動子に許容される周波数範囲は非常
に厳しいものであり、更には機械的に可動させなければ
ならないために緩急の自動化はきわめて困難であった。
最近の水晶時計の普及に伴い、低価格化のために安価な
水晶振動子を使用することになり、その結果、広範囲の
周波数調整が要求され、更に歩度緩急の自動化が要求さ
れている。
周波数調整範囲を広げるでだてとして、水晶発振器の信
号を分周する分周回路の分周比を可変して歩度緩急する
方式があるが、これまでに考えられた方式では周波数調
整が広範囲にできるかわりに、緩急量を設定する入力端
子が多くなり時計の小型化、低価格化に不利になるばか
りか、緩急する操作が複雑になり不利な点が多かった。
本発明はかかる点にかんがみ、前記方式の特徴を生かし
、しかも緩急量の設定を自動的に行なう構成を与えるも
のである。
本発明からなる水晶時計のブロツクダイアグラムの基本
構成例を第一図に示す。
１は水晶発振器２は分周回路、３は表示手段、４は前記
水晶発振器１の発振周波数と前記分周回路２から定まる
ところの基本発振周波数との差、すなわち周波数偏差を
測定する周波数偏差測定回路、５は前記周波数偏差測定
回路４で測定した周波数偏差、或いはコード変換された
周波数偏差を記憶する周波数偏差記憶回路、６は前記周
波数偏差記憶回路５に記憶されたデーターで分周比を制
御して緩急を行なう緩急回路、７は時計体外部からの標
準時計信号を受信する受信手段、８は前記各々の回路及
び手段を制御する制御回路、９は緩急ロックスイッチで
ある。
この動作を説明するに、最初に緩急設定について説明す
れば、緩急ロックスイッチ９をＯＮにすると緩急ロック
が解除され、制御回路８のａからリセット信号がでて周
波数偏差測定回路４がリセットされる。
この状態で外部から時間間隔が１秒或いは２秒等の標準
時間信号を受信手段７に送ってやると、ｂの周波数偏差
測定指令信号により周波数偏差測定回路４で水晶発信周
波数の周波数偏差を測定し、Ｃの記憶指令信号により周
波数偏差を周波数偏差記憶回路５に記憶して緩急の設定
は終了する。
ここで緩急ロックスイッチ９をＯＦＦにすることにより
、雑音による緩急量の誤設定が避けられる。
次に緩急について説明すると、周波数偏差記憶回路５に
記憶されたデーターは、水晶発振器１の発振周波数の基
本周波数に対する偏差であるために、その偏差にみあう
分だけ分局比を変えてやれば歩度の緩急ができることに
なる。
この動作を行なっているのが緩急回路６であり、周波数
偏差記憶回路５のデーターにより分周比を制御して歩度
の緩急を行なう。
このように本発明によれば標準時間信号を発生する装置
さえ用意すれば、緩急ロックの解除という簡単な操作を
するだけで、あとは外部標準時間信号を受けて自動的に
歩度緩急ができるのである。
次に一実施例に基づいて説明を行なう。
実施例の原理を示す図第２図において、標準時間信号発
生装置１１が発生した標準時間信号（本実施例では２秒
の時間間隔）は、送信コイルＬ２で電気磁気変換され、
Ｌ２と磁気結合をしている時計体の受信コイルＬｌ（本
実施例では受信コイルＬ１は電気機械変換器の駆動コイ
ルを兼用する）に送られる。
時計体電子回路１０は、Ｌ１で再び電気信号となった標
準時間信号によシ水晶発振器の周波数偏差を測定し、自
動的に緩急設定を行なう。
第３図は、第２図に於ける時計体電子回路１０を具体的
に示したものである。
ＦＦ１〜ＦＦ２６は、マスタースレイブ型フリツプフロ
ップで、その詳細を第４図に示す。
Ｄはデータ一入力端子、ＣＬはクロック入力端子、ＱＭ
はマスター信号出力端子、ＱＭはＱＭと位相反転してい
るマスター信号出力端子、Ｑｓはスレイブ信号出力端子
、ＱｓはＱｓと位相反転しているスレイブ信号出力端子
、Ｒはリセット端子である。
第３図に於いて特に指定なきＤ，Ｒ端子はＤとＱｓ、Ｒ
とＧＮＤ（−電位）に結線されているものとする。
ＦＦ１〜ＦＦ１８は分周回路でこのうちＦＦ１〜ＦＦ５
は周波数偏差測定回路を兼ねている。
Ｅ１〜Ｅ５，Ａ１〜Ａ５は緩急回路で分周回路の帰還ル
ープを形成する。
帰還量、即ち緩急量はＡ１〜Ａ５の開閉により制御し、
緩急量はＦＦ２０〜ＦＦ２４の周波数偏差記憶回路に記
憶される。
ＦＦ１９は遅延回路を形成し、Ｑｓ１８と嬬から変換器
駆動用パルス電圧を形成する。
ＴＰ１，ＴＰ２，ＴＮｌ，ＴＮ２は駆動用ＭＯＳトラン
ジスターで比較的大きな電流を流す。
ＦＦ２５，ＦＦ２６及びＯ２は制御回路であり、Ｏ１は
緩急設定中は緩急を停止させるだめのゲートである。
今、リセットスイッチＳ（緩急ロック機能を兼ねている
）が閉じられ、分周回路がリセットされて時計が停止し
た状態を考えると、ＴＮ１がＯＮ，ＴＮ２，ＴＰ１，Ｔ
Ｐ２がＯＦＦになるため、駆動コイルＬ１はＡ点がＧＮ
Ｄ（−電位）に落ちＢ点が浮いた状態になるので、駆動
コイルＬ１は受信コイルの機能となって外部からの信号
を受けることができる。
Ｂ点に発生した標準時間信号はダイオードＤＩ，，Ｄ２
でクランプ整形され、制御回路に送られる。
動作時のタイミングチャート図を第５図に示す。
１２がリセットスイッチＳの端子電圧、１３が外部標準
時間信号、１４が分周回路のリセット信号、１５が記憶
指令信号である。
リセットスイッチＳが閉じられた時間ｔ１から外部標準
時間信号が入るｔ２以前までは、分周回路はリセットさ
れている。
外部標準時計信号が入ったｔ２からリセットが解除され
て周波数偏差測定回路（分周回路ＦＦ１〜ＦＦ５）はカ
ウントをし始め、それと同時に記憶指令信号により周波
数偏差記憶回路は周波数偏差測定回路のデーターを書き
始める。
書き込みはｔ２からあらかじめ定められた時間間隔で２
発目の外部標準時間信号が入るｔ３まで行なわれ、ｔ３
と同時に書き込みは停止され周波数偏差記憶回路には周
波数偏差（本体施例では周波数偏差がそのまま緩急設定
量となる）が、記憶されて自動緩急が終了する。
分周回路はｔ３で再度リセットがかけられリセット解除
のｔ４から通常動作が始まる。
なお、本実施例では緩急回路による分周比の可変が分周
回路の基本分周比に対して増大する方向なので、発振器
の発振周波数の分布を分周回路の基本分周比から算定さ
れる基本発振周波数より高い周波数に分布させる必要が
ある。
しかし、それは実用上なんら障害とならず、またもし必
要ならば分周比を小さくする緩急回路を併用すればよい
。
以上、詳述した如く、本発明によれば標準時間信号を発
生する簡単な装置を用いるだけでケース外部から容易に
自動緩急ができ、しかも緩急巾の大きい、信頼性の高い
緩急ができるため、その効果は大きい。
【図面の簡単な説明】
第１図は、本発明から成る水晶時計のブロツクダイアグ
ラムの基本構成例を示した図である。 １・・・水晶発振器、２・・・分周回路、３・・・表示
手段、４・・・周波数偏差測定回路、５・・・周波数偏
差記憶回路、６・・・緩急回路、７・・・受信手段、８
・・・制御回路、９・・・緩急ロックスイッチ。 第２図は、本発明の一実施例の原理を示す図である。 １０・・・時計体電子回路、１１・・・標準時間信号発
生装置、Ｌ１・・・受信コイル、Ｌ２・・・送信コイル
。 第３図は、第２図に於ける時計体電子回路１０の詳細図
である。 ＦＦ１〜ＦＦ２６・・・マスタースレイプ型フリツプフ
ロツフ゜、Ａ１〜Ａ５・・・ＮＡＮＤゲート、Ｅ１〜Ｅ
５・・・ＥＸ−ＯＲゲート、Ｏ１，Ｏ２・・・ＮＯＲグ
ート、ＴＰ１，ＴＰ２，ＴＮ１，ＴＮ２・・・ＭＯＳト
ランジスター、Ｄ１，Ｄ２・・・ダイオード、Ｌ１・・
・コイル、Ａ，Ｂ・・・コイル端子、Ｓ・・・リセット
スイッチ。 第４図は、マスタースレイズ型フリングフロツプの詳細
図である。 Ｄ・・・データ一入力端子、ＣＬ・・・クロック入力端
子、ＱＭ，ＱＭ・・・マスター出力端子、ＱＳ，ＱＳ・
・・スレイブ出力端子、Ｒ・・・リセット端子。 第５図は、第３図に示す時計体電子回路のタイミングチ
ャート図である。 １２・・・リセットスイッチの端子電圧、１３・・・外
部標準時間信号、１４・・・分局回路のリセット信号、
１５・・・記憶指令信号。

Claims (1)

    【特許請求の範囲】
  1. １ 水晶発振器、分周回路を含む電子回路、表示手段か
    ら成る水晶時計に於で、外部標準時間信号を受信する受
    信手段、前記受信手段からの外部標準時間信号で水晶発
    振器の発振周波数の基本周波数に対する周波数偏差を測
    定する周波数偏差測定回路、前記周波数偏差測定回路で
    測定した周波数偏差、或いはコード変換された周波数偏
    差番記憶する周波数偏差記憶回路、前記周波数偏差記憶
    回路のデーターで分周比を可変することにより歩度緩急
    を行なう緩急回路を有し、前記受信手段が水晶時計の電
    気機械変換機の磁気回路から成る水晶時計。
JP48135301A 1973-12-05 1973-12-05 スイシヨウドケイ Expired JPS587190B2 (ja)

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