JPS585083U - 図形表示装置 - Google Patents

図形表示装置

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JPS585083U
JPS585083U JP9906181U JP9906181U JPS585083U JP S585083 U JPS585083 U JP S585083U JP 9906181 U JP9906181 U JP 9906181U JP 9906181 U JP9906181 U JP 9906181U JP S585083 U JPS585083 U JP S585083U
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井上　忠也
浅香　孝雄
雄二 山口
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横河電機株式会社
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は、本考案装置の一実施例を示す構成図である。 第２図はリフレッシュメモリ２のアドレス割当ての例を
示す図、第３図は切り出し回路の一実施例を示す電気的
接続図である。 １・・・ＣＰＵ、　’２・・・リフレッシュメモリ、３
・・・ＣＲＴインターフェイス、４・・・ＣＲＴ、１０
・・・表示開始レジスタ、１１・・・リフレッシュカウ
ンタ、１２・・・排他的論理和ゲート、２０・・・切り
出し回路。

Claims (1)

    【実用新案登録請求の範囲】
  1. ＣＲＴの画素の数より多いメモリ容量をもつリフレッシ
    ュメモリを具えた図形表示装置において、前記リフレッ
    シユメ千りの表示開始用先頭アドレスを記憶する表示開
    始レジスタと、該レジスタの並列出力を受は垂直帰線信
    号によりその出力を取込むと共に、そのキャリー出力が
    次段の入力に接続されるように構成された複数個のリプ
    ルカウンタとによりなるリフレッシュカウンタをその途
    中から第１群及び第２群に２分し、第１群のキャリー出
    力と水平帰線信号との排他的論理和出力を第２群の入力
    部に入力するように構成されたりフレッシュカウンタを
    もち、該リフレッシュカウンタの出力を前記リフレッシ
    ュメモリのアドレス入力としたことを特徴とする図形表
    示装置。
JP9906181U 1981-07-02 1981-07-02 図形表示装置 Granted JPS585083U (ja)

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JP9906181U JPS585083U (ja) 1981-07-02 1981-07-02 図形表示装置

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JP9906181U JPS585083U (ja) 1981-07-02 1981-07-02 図形表示装置

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JPS585083U true JPS585083U (ja) 1983-01-13
JPS6237263Y2 JPS6237263Y2 (ja) 1987-09-22

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ID=29893807

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JPS6237263Y2 (ja) 1987-09-22

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