JPS5838626Y2 - Printed board - Google Patents

Printed board

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Publication number
JPS5838626Y2
JPS5838626Y2 JP7384580U JP7384580U JPS5838626Y2 JP S5838626 Y2 JPS5838626 Y2 JP S5838626Y2 JP 7384580 U JP7384580 U JP 7384580U JP 7384580 U JP7384580 U JP 7384580U JP S5838626 Y2 JPS5838626 Y2 JP S5838626Y2
Authority
JP
Japan
Prior art keywords
hole
pin
resist layer
substrate
diameter
Prior art date
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Expired
Application number
JP7384580U
Other languages
Japanese (ja)
Other versions
JPS57968U (en
Inventor
盛 多田
Original Assignee
株式会社エイト工業
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Filing date
Publication date
Application filed by 株式会社エイト工業 filed Critical 株式会社エイト工業
Priority to JP7384580U priority Critical patent/JPS5838626Y2/en
Publication of JPS57968U publication Critical patent/JPS57968U/ja
Application granted granted Critical
Publication of JPS5838626Y2 publication Critical patent/JPS5838626Y2/en
Expired legal-status Critical Current

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Description

【考案の詳細な説明】 本考案は改良したスルーホールを有するプリント基板に
関する。
DETAILED DESCRIPTION OF THE INVENTION The present invention relates to a printed circuit board with improved through holes.

第1図に従来のプリント基板の構造を示す。FIG. 1 shows the structure of a conventional printed circuit board.

1は基板、2は基板1上に印刷された導体である。1 is a substrate, and 2 is a conductor printed on the substrate 1.

3は導体2および基板1に形成されたスルーホール6上
に形成された無電解メッキ層、4は無電解メッキ層3上
に形成された電解メッキ層である。
3 is an electroless plating layer formed on the conductor 2 and the through hole 6 formed in the substrate 1, and 4 is an electrolytic plating layer formed on the electroless plating layer 3.

両メッキ層3,4により基板10両面の各導体2が相互
に電気的に接続される。
The conductors 2 on both sides of the substrate 10 are electrically connected to each other by both plating layers 3 and 4.

無電解メッキ層3のみでは充分な強度および電気的接続
を確保することができないので、電解メッキ層4を無電
解メッキ層3上に形成してメッキ層を二重構造にしてい
る。
Since sufficient strength and electrical connection cannot be ensured with the electroless plating layer 3 alone, the electrolytic plating layer 4 is formed on the electroless plating layer 3 to form a double layer structure.

電解メッキ層40部品装着面(図においては上面)には
さらに・・ンダの付着を防止するレジスト層5が形成さ
れている。
A resist layer 5 is further formed on the component mounting surface (the upper surface in the figure) of the electrolytic plating layer 40 to prevent adhesion of dirt.

レジスト層5にはスルーホール6と対応して孔5aが形
成されており、この孔5aの径は、部品(図示せず)の
ピンIが挿入された際ハンダによる接着を確実なものと
するため、スルーホール6の径より太きく形成しである
A hole 5a is formed in the resist layer 5 in correspondence with the through hole 6, and the diameter of the hole 5a is set to ensure secure adhesion with solder when a pin I of a component (not shown) is inserted. Therefore, the diameter of the through hole 6 is larger than that of the through hole 6.

従来の斯かるプリント基板においては、レジスト層5の
孔5aの径がスルーホール6の径より太きく形威しであ
るため、部品のピン7がスルーホール6内に挿入される
際メッキ層3,4を損傷し、電気的接続が不充分となる
場合があった。
In such a conventional printed circuit board, the diameter of the hole 5a of the resist layer 5 is larger than the diameter of the through hole 6, so when the pin 7 of the component is inserted into the through hole 6, the plated layer 3 , 4, resulting in insufficient electrical connection.

また基板1の・・ンダ付着面(図においては下面)側か
ら・・ンダを付着してピンIをスルーホール6内に接着
スる際、フラックスがスルーホール6を通って部品装着
面側に流れ、ボリウムの可動部分やICソケット等の接
触不良の原因となっていた。
Also, when attaching the solder from the solder attachment surface (lower surface in the figure) of the board 1 and gluing the pin I into the through hole 6, the flux passes through the through hole 6 to the component mounting surface side. This caused flow and poor contact with the moving parts of the volume, IC sockets, etc.

そのため蒸気洗浄等を行う必要があった。Therefore, it was necessary to perform steam cleaning, etc.

本考案は上記欠点を除去し、スルーホールが損傷されず
、フラックスのもれがないプリント基板を提供すること
を目的とする。
An object of the present invention is to eliminate the above-mentioned drawbacks and provide a printed circuit board with no damage to through holes and no leakage of flux.

以下本考案の一実施例を第2図および第3図を参照して
説明する。
An embodiment of the present invention will be described below with reference to FIGS. 2 and 3.

これらの図において第1図と対応する部分には同一符号
が付してあり、その説明、は省略する。
In these figures, parts corresponding to those in FIG. 1 are designated by the same reference numerals, and their explanations will be omitted.

第1図と異なる点はレジスト層5にスルーホール6と対
応する孔が形成されていない点である(第2図参照)。
The difference from FIG. 1 is that holes corresponding to the through holes 6 are not formed in the resist layer 5 (see FIG. 2).

部品のピンγはその径(スルーホール6の径より小さい
)に対応する径の孔5aをレジスト層5に形成しつつ、
スルーホール6内に挿入されることになる(第3図参照
)。
While forming a hole 5a in the resist layer 5 with a diameter corresponding to the diameter of the pin γ of the component (smaller than the diameter of the through hole 6),
It will be inserted into the through hole 6 (see Figure 3).

従ってレジスト層5が一線の保護膜となって、スルーホ
ール6内のメッキ層3,4がピン7によって破損される
おそれが少なくなる。
Therefore, the resist layer 5 serves as a continuous protective film, and the possibility that the plating layers 3 and 4 in the through hole 6 will be damaged by the pin 7 is reduced.

部品のピン7は自動挿入機(図示せず)によりスルーホ
ール6内に挿入されるが、基板1上のスルーホール6の
位置は自動挿入機により正確に数値制御されているので
、レジスト層5にあらかじめ孔5aが形成されていなく
ともピン7を挿入するのに支障はない。
The pin 7 of the component is inserted into the through hole 6 by an automatic insertion machine (not shown), but since the position of the through hole 6 on the substrate 1 is accurately numerically controlled by the automatic insertion machine, the resist layer 5 There is no problem in inserting the pin 7 even if the hole 5a is not formed in advance.

また人的操作によりピン7を挿入する場合においても、
通常レジスト層5は透明であるから、視覚によりスルー
ホール6の位置は充分確認することかできる。
Also, when inserting pin 7 by manual operation,
Since the resist layer 5 is usually transparent, the position of the through hole 6 can be visually confirmed.

さらにピン7をスルーホール6内にて・1ンダ付げする
際、レジスト層5にはピン7に対応した径の孔5aが用
いているのみであるから、フラノ、クスが部品側にもれ
るおそれが少い。
Furthermore, when attaching the pin 7 in the through hole 6, since only the hole 5a with the diameter corresponding to the pin 7 is used in the resist layer 5, the flannel and slag will leak onto the component side. There is little risk.

このことはレジスト層5に適度の粘性を持たせることに
より一層確実なものとなる。
This can be further ensured by providing the resist layer 5 with appropriate viscosity.

尚レジスト層5はピン7挿入前において、スルーホール
6を必ずしも完全に閉塞する状態にある必要はなく、ピ
ン7の径と同一か若干小さい径の孔が開いている状態、
すなわちスルーホール6の一部を被覆する状態であって
もよい。
Note that the resist layer 5 does not necessarily need to be in a state where the through hole 6 is completely closed before the pin 7 is inserted, but may be in a state where the hole is the same as or slightly smaller in diameter than the pin 7.
That is, it may be in a state where a part of the through hole 6 is covered.

以上の如く本考案においては、部品のピンでスルーホー
ルが損傷されるおそれが少なく、ハンダ付着時における
スラックスのもれも少なくなることができる。
As described above, in the present invention, there is less risk of through-holes being damaged by component pins, and leakage of slack during solder attachment can be reduced.

また・・ンダが部品装着面側に必要以上に上り過ぎるお
それも少なくなる。
In addition, there is less possibility that the particles will rise excessively to the component mounting surface side than necessary.

【図面の簡単な説明】[Brief explanation of drawings]

第1図は従来のプリント基板の断面図、第2図および第
3図は本考案に係るプリント基板の断面図を各々表わす
。 1・・・・・・基板、2・・・・・・導体、3・・・・
・・無電解メッキ層、4・・・・・・電解メッキ層。
FIG. 1 is a cross-sectional view of a conventional printed circuit board, and FIGS. 2 and 3 are cross-sectional views of a printed circuit board according to the present invention. 1...Substrate, 2...Conductor, 3...
... Electroless plating layer, 4... Electrolytic plating layer.

Claims (1)

【実用新案登録請求の範囲】[Scope of utility model registration request] 基板と、該基板に形成されたスルーホールと、該基板上
に形成された導体と、該スルーホールの少くとも一部を
被覆するレジスト層とを有することを特徴とするプリン
ト基板。
A printed circuit board comprising a substrate, a through hole formed in the substrate, a conductor formed on the substrate, and a resist layer covering at least a portion of the through hole.
JP7384580U 1980-05-30 1980-05-30 Printed board Expired JPS5838626Y2 (en)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP7384580U JPS5838626Y2 (en) 1980-05-30 1980-05-30 Printed board

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP7384580U JPS5838626Y2 (en) 1980-05-30 1980-05-30 Printed board

Publications (2)

Publication Number Publication Date
JPS57968U JPS57968U (en) 1982-01-06
JPS5838626Y2 true JPS5838626Y2 (en) 1983-09-01

Family

ID=29436588

Family Applications (1)

Application Number Title Priority Date Filing Date
JP7384580U Expired JPS5838626Y2 (en) 1980-05-30 1980-05-30 Printed board

Country Status (1)

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JP (1) JPS5838626Y2 (en)

Families Citing this family (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5925313U (en) * 1982-08-10 1984-02-16 株式会社神戸製鋼所 Wire rod guidance device

Also Published As

Publication number Publication date
JPS57968U (en) 1982-01-06

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