JPS5820939Y2 - Potential fluctuation detection circuit - Google Patents

Potential fluctuation detection circuit

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JPS5820939Y2
JPS5820939Y2 JP9292478U JP9292478U JPS5820939Y2 JP S5820939 Y2 JPS5820939 Y2 JP S5820939Y2 JP 9292478 U JP9292478 U JP 9292478U JP 9292478 U JP9292478 U JP 9292478U JP S5820939 Y2 JPS5820939 Y2 JP S5820939Y2
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JP
Japan
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resistor
transistor
potential
capacitor
circuit
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JP9292478U
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JPS5511510U (en
Inventor
強司 近藤
Original Assignee
株式会社東芝
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Description

【考案の詳細な説明】 本考案は、階段状に電位が変動する到来信号の立ち上が
り、立下がりを検出する為の電位変動検出回路に関する
DETAILED DESCRIPTION OF THE INVENTION The present invention relates to a potential fluctuation detection circuit for detecting the rise and fall of an incoming signal whose potential varies stepwise.

従来、到来信号中の電位の変動、いいかえると信号の立
ち上がり及び立ち下がりを検出し、電位の立ち上がり回
数、立ち下がり回数を計数して所定の処理を行う回路に
おいて、その電位変動は第1図に示した手段により検出
していた。
Conventionally, in a circuit that detects fluctuations in the potential in an incoming signal, or in other words, the rise and fall of the signal, counts the number of times the potential rises and falls, and performs a predetermined process, the potential fluctuation is shown in Figure 1. It was detected by the means shown.

つまり、従来の電位変動検出回路では、入力端子1より
電位が変動する信号が印加され、この信号はコンデンサ
2,3に各々供給される。
That is, in the conventional potential fluctuation detection circuit, a signal whose potential fluctuates is applied from the input terminal 1, and this signal is supplied to the capacitors 2 and 3, respectively.

前記コンデンサ2,3の各々には抵抗5,6が接続され
ており、それぞれ微分回路6,7を形成する。
Resistors 5 and 6 are connected to each of the capacitors 2 and 3, forming differentiating circuits 6 and 7, respectively.

そして、前記微分回路6の出力は、電源端子と基準電位
間に直列に接続されたダイオード8,9の接続点に接続
され、この接続点には電位の立ち上がりを微分したパル
スを発生し立ち上がりパルス計数回路に立ち上がりの回
数に応じたパルスが供給される。
The output of the differentiating circuit 6 is connected to the connection point of diodes 8 and 9 connected in series between the power supply terminal and the reference potential, and a pulse obtained by differentiating the rise of the potential is generated at this connection point. A pulse corresponding to the number of rises is supplied to the counting circuit.

また、微分回路7の出力点が接続されたダイオード11
゜12の接続点では、信号中の立下がりを微分したパル
スが得られ、このパルスを立下がり計数回路13で計数
する。
In addition, a diode 11 connected to the output point of the differentiating circuit 7
At the connection point 12, a pulse is obtained by differentiating the falling edge of the signal, and this pulse is counted by the falling edge counting circuit 13.

しかしながら、このような構成の従来の電位変動検出回
路では、立ち上がり計数回路10、或は立ち下がり計数
回路13に供給されるパルスの閾値は、入力信号の電位
変動レベルよりも低く計数回路を十分に駆動し得す計数
動作が正常に行なわれない場合が多々あり、これに対処
するにはパルス増幅器を計数回路の前段に設ける必要が
ある。
However, in the conventional potential fluctuation detection circuit with such a configuration, the threshold value of the pulse supplied to the rising counting circuit 10 or the falling counting circuit 13 is lower than the potential fluctuation level of the input signal, and the counting circuit is sufficiently controlled. There are many cases where the counting operation that can be driven is not performed normally, and to deal with this, it is necessary to provide a pulse amplifier at the front stage of the counting circuit.

更に、計数回路の入力インピーダンスが低い場合には必
要パルス巾を得るためコンテ゛ンサ2,3の容量値を大
きくする必要があり、この為、充放電時に信号源に微分
回路6,7の影響が及ぶ。
Furthermore, when the input impedance of the counting circuit is low, it is necessary to increase the capacitance of capacitors 2 and 3 to obtain the necessary pulse width, and for this reason, the signal source is affected by the differentiating circuits 6 and 7 during charging and discharging. .

本考案は、上記の難点を解消し、確実に入力信号の電供
変動に応じたパルスを発生する電位変動検出回路を提供
することを目的とする。
SUMMARY OF THE INVENTION An object of the present invention is to solve the above-mentioned difficulties and provide a potential fluctuation detection circuit that reliably generates a pulse in response to fluctuations in the power supply of an input signal.

以下、図面を参照し、本考案の代表的実施例について説
明する。
Hereinafter, typical embodiments of the present invention will be described with reference to the drawings.

第2図は本考案の代表的な一実施例を示す回路図であり
、電位が変動する(立ち上がり部、立ち下がり部を有す
る)信号が印加される入力端子20には各々抵抗R1,
R2の一端が接続され、抵抗R1の他端はトランジスタ
Q1のベースに、抵抗R2の他端はトランジスタQ2の
ベースに接続されている。
FIG. 2 is a circuit diagram showing a typical embodiment of the present invention, and an input terminal 20 to which a signal whose potential fluctuates (having a rising part and a falling part) is applied with a resistor R1,
One end of resistor R2 is connected, the other end of resistor R1 is connected to the base of transistor Q1, and the other end of resistor R2 is connected to the base of transistor Q2.

前記トランジスタのQlのエミッタと基準電位間には前
記抵抗R1と相俟つ微分回路を形成するコンテ゛ンサC
1が接続され、トランジスタQ1のコレクタと電源■1
間には抵抗R3が接続されている。
Between the emitter of Ql of the transistor and the reference potential, there is a capacitor C which together with the resistor R1 forms a differential circuit.
1 is connected, and the collector of transistor Q1 and power supply ■1
A resistor R3 is connected between them.

そして前記トランジスタQ1のベースとエミッタ間には
エミッタ側にアノードが接続されたダイオードD1が接
続されている。
A diode D1 whose anode is connected to the emitter side is connected between the base and emitter of the transistor Q1.

また、前記抵抗R2の他端と前記トランジスタQ2のエ
ミッタ間にはダイオードD2が接続されており、更にエ
ミッタと基準電位間にはコンデンサC2が接続され、コ
レクタと基準電位間には抵抗R4が接続されている。
Further, a diode D2 is connected between the other end of the resistor R2 and the emitter of the transistor Q2, a capacitor C2 is connected between the emitter and a reference potential, and a resistor R4 is connected between the collector and the reference potential. has been done.

このトランジスタQ2のコレクタはダイオードD3を介
して電源V2に接続されるとともに、人力信号の電位変
動のうち、立ち下がりを検出する立ち下がりパルス計数
回路30の人力に接続されている。
The collector of this transistor Q2 is connected to the power supply V2 via a diode D3, and is also connected to the human power of a falling pulse counting circuit 30 that detects the fall of the potential fluctuation of the human power signal.

そして、トランジスタQ1のコレクタは入力信号の電位
変動のうち立ち上がりを検出する立ち上がりパルス計数
回路40の入力端に接続され、更に前記入力端は電源V
2と基準電位間に直列に介在接続されているダイオード
D4.抵抗R5の接続点に接続されている。
The collector of the transistor Q1 is connected to the input terminal of a rising pulse counting circuit 40 that detects the rising edge of the potential fluctuation of the input signal, and the input terminal is connected to the power supply V
A diode D4.2 is connected in series between D4.2 and the reference potential. It is connected to the connection point of resistor R5.

尚、立ち上がり計数回路40には、電源v2が接続され
ている。
Note that the rise counting circuit 40 is connected to a power source v2.

上記の回路構成である本考案の一実施例について説明す
ると、先ず、トランジスタQ1は入力信号の立ち上がり
部分で動作し、トランジスタQ2は入力信号の立ち上が
り部で動作する。
An embodiment of the present invention having the above circuit configuration will be described. First, the transistor Q1 operates at the rising edge of the input signal, and the transistor Q2 operates at the rising edge of the input signal.

いま、入力信号として第3図に示すように立ち上がり部
51が2回、立ち下がり部52が2回の電位変動をする
入力信号が到来した場合について考える。
Now, let us consider the case where an input signal arrives with potential fluctuations in the rising portion 51 twice and the falling portion 52 twice as shown in FIG.

ここで、便宜上、立ち下がり部の計数動作についてみる
と、時刻toでの立ち上がり部51でダイオードD2は
導通し、抵抗R2,ダイオードD2を介してコンテ゛ン
サC2をvlの電位まで充電する。
Here, for convenience, looking at the counting operation in the falling part, the diode D2 becomes conductive in the rising part 51 at time to, and charges the capacitor C2 to the potential of vl via the resistor R2 and the diode D2.

時刻t1で入力信号は立ち下がりダイオードD2が遮断
するとともにトランジスタQ2は導通し、コンデンサC
2に充電された電荷はトランジスタQ2のエミッタ、コ
レクタ電流路及び抵抗R4を介して前記トランジスタQ
2のエミッタの電圧レベルが■2になるように放電され
る。
At time t1, the input signal falls, diode D2 cuts off, transistor Q2 becomes conductive, and capacitor C
The charges charged in the transistor Q2 are transferred to the transistor Q2 through the emitter and collector current path of the transistor Q2 and the resistor R4.
It is discharged so that the voltage level of the emitter of 2 becomes 2.

このときコンテ゛ンサC2,抵抗R4は微分回路を形成
するので時刻t1で微分波形53を発生する。
At this time, since the capacitor C2 and the resistor R4 form a differentiating circuit, a differentiated waveform 53 is generated at time t1.

この微分波形53は立ち下がりパルス計数回路30に供
給され立ち下がりパルス数が計数される。
This differential waveform 53 is supplied to a falling pulse counting circuit 30, and the number of falling pulses is counted.

次に立ち上がり部51の検出動作について第3図を参照
して述べると、時刻t1ではダイオードD1は遮断して
おり、このときトランジスタQ1は導通してコンデンサ
C1は略レベルが■1の電圧に充電される。
Next, the detection operation of the rising portion 51 will be described with reference to FIG. 3. At time t1, the diode D1 is cut off, and at this time, the transistor Q1 is conductive, and the capacitor C1 is charged to a voltage whose level is approximately 1. be done.

次に時刻t1〜t2ではダイオードD1が導通し■1の
電圧で充電された電荷は抵抗R1を介して放電して前記
コンデンサC1の両端電圧はレベルv2の電圧となる。
Next, from time t1 to t2, the diode D1 becomes conductive, and the charge charged at the voltage 1 is discharged through the resistor R1, so that the voltage across the capacitor C1 becomes the voltage level v2.

そして、時刻t2で電圧レベルが■2から■3まで立ち
上がると、これと同時にトランジスタQ1が導通して抵
抗R3,コンテ゛ンサC1による微分波形54を発生し
て入力信号の立ち上がり部に応じたパルスがコンデンサ
C3を介して立ち上がりパルス計数回路40に供給され
る。
Then, when the voltage level rises from ■2 to ■3 at time t2, the transistor Q1 becomes conductive at the same time, generating a differential waveform 54 by the resistor R3 and the capacitor C1, and a pulse corresponding to the rising edge of the input signal is applied to the capacitor. It is supplied to the rising pulse counting circuit 40 via C3.

このようにして、入力信号の立ち上がり部51゜立ち下
がり部52を検出するが、検出すべき立ち上がりパルス
、立ち下がりパルスはトランジスタQ1.Q2を用いて
行なわれるので、パルスの閾値変動がなく、計数回路3
0.40の誤動作を抑止し得る。
In this way, the rising edge 51 and the falling edge 52 of the input signal are detected, but the rising pulse and falling pulse to be detected are the transistor Q1. Q2 is used, so there is no pulse threshold fluctuation and the counting circuit 3
0.40 malfunction can be suppressed.

又、従来のように、充放電に供するコンデンサの容量を
決めるに際して立ち上がり、立ち下がりパルス計数回路
の入力インピーダンスに拘束されることはない。
Furthermore, unlike the conventional art, when determining the capacitance of a capacitor for charging and discharging, it is not restricted by the input impedance of the rising and falling pulse counting circuit.

以上の記載から明らかなように、本考案によれば入力信
号の電位変動に応じたパルスを確実に発生する電位変動
検出回路を提供し得るものである。
As is clear from the above description, according to the present invention, it is possible to provide a potential fluctuation detection circuit that reliably generates a pulse in accordance with potential fluctuations of an input signal.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図は従来の電位変動検出回路を示す回路図、第2図
は本考案に係る電位変動検出回路の一実施例を示す回路
図、第3図は第2図に示す回路の動作を説明する波形図
である。 20・・・・・・入力端子、DI、D2・・・・・・ス
イッチング手段、C1,C2・・・・・・コンデンサ、
R1,R2・・・・・・第1の抵抗、R3,R4・・・
・・・第2の抵抗。
FIG. 1 is a circuit diagram showing a conventional potential fluctuation detection circuit, FIG. 2 is a circuit diagram showing an embodiment of the potential fluctuation detection circuit according to the present invention, and FIG. 3 explains the operation of the circuit shown in FIG. 2. FIG. 20... Input terminal, DI, D2... Switching means, C1, C2... Capacitor,
R1, R2...First resistor, R3, R4...
...Second resistance.

Claims (1)

【実用新案登録請求の範囲】 第1の電圧レベルから第2の電圧レベルに電位が変動す
る入力信号が印加される入力端子と、この入力端子に一
方端が接続された第1の抵抗と、 この第1の抵抗の他方端に一方端が接続され、他方端が
コンデンサに接続され前記入力信号の電圧レベル変動に
応じてスイッチングすることにより前記コンテ゛ンサを
充放電するスイッチング手段と、 このスイッチング手段の一方端にベース側が接続されス
イッチング手段の他端と挙準電位間にコレクタ、エミッ
タ電流路を接続したトランジスタと、 このトランジスタのコレクタ、エミッタ側の電流路に介
在接続した第2の抵抗とを具備し、前記入力信号の電圧
レベルの変動を検出することを特徴とする電位変動検出
回路。
[Claims for Utility Model Registration] An input terminal to which an input signal whose potential changes from a first voltage level to a second voltage level is applied; a first resistor having one end connected to the input terminal; a switching means having one end connected to the other end of the first resistor and the other end connected to a capacitor for charging and discharging the capacitor by switching according to voltage level fluctuations of the input signal; It includes a transistor whose base side is connected to one end and whose collector and emitter current paths are connected between the other end of the switching means and a ground potential, and a second resistor which is connected to the collector and emitter current paths of this transistor. and detecting a change in the voltage level of the input signal.
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