JPS5819341U - グラフイツク・デイスプレイ装置 - Google Patents

グラフイツク・デイスプレイ装置

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JPS5819341U
JPS5819341U JP11175481U JP11175481U JPS5819341U JP S5819341 U JPS5819341 U JP S5819341U JP 11175481 U JP11175481 U JP 11175481U JP 11175481 U JP11175481 U JP 11175481U JP S5819341 U JPS5819341 U JP S5819341U
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JP
Japan
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display device
refresh memory
signal
decoder
output
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Pending
Application number
JP11175481U
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English (en)
Inventor
金子　由雄
久保　典夫
Original Assignee
株式会社横河電機製作所
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Publication date
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は、本考案実施例の概念構成図、第２図　　。 は、第１図の一部の詳細図、第３図は、第１図の装置の
動作説明図である。 １・・・プロセッサ、２・・・メモリバス、３・・・デ
ータバッファ、４・・・アドレスバッファ、５・・・デ
コーダ、６・・・タイミング変換回路、７・・・リフレ
ッシュメモリ制御回路、８・・・リフレッシュメモリ、
９・・・表示器。

Claims (1)

    【実用新案登録請求の範囲】
  1. プロセッサのメモリバスにデータおよびアドレス用のバ
    ッファを介して接続されプロセラ−１％と（１独立のク
    ロックに基づいて動作するリフレッシュメモリ、プロセ
    ッサのメモリバス上の信号を解読してリフレッシュメモ
    リ書込み指令報知信号を生じるデコーダ、このデコーダ
    の出力信号とリフレッシュメモリの書込みタイミング信
    号とを入力とし、デコーダ出力発生後の最初の書込みタ
    イミング信号に基づいて応答信号を出力するタイミング
    変換回路、および、このタイミング変換回路の出力に従
    ってリフレッシュメモリにバッファのデータを書込ませ
    るリフレッシュメモリ制御回路を具備するグラフィック
    ・ディスプレイ装置。
JP11175481U 1981-07-28 1981-07-28 グラフイツク・デイスプレイ装置 Pending JPS5819341U (ja)

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JP11175481U JPS5819341U (ja) 1981-07-28 1981-07-28 グラフイツク・デイスプレイ装置

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JPS5819341U true JPS5819341U (ja) 1983-02-05

Family

ID=29906098

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JP11175481U Pending JPS5819341U (ja) 1981-07-28 1981-07-28 グラフイツク・デイスプレイ装置

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