JPS5816029B2 - Thyristor Seiri Yuki - Google Patents

Thyristor Seiri Yuki

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Publication number
JPS5816029B2
JPS5816029B2 JP8669973A JP8669973A JPS5816029B2 JP S5816029 B2 JPS5816029 B2 JP S5816029B2 JP 8669973 A JP8669973 A JP 8669973A JP 8669973 A JP8669973 A JP 8669973A JP S5816029 B2 JPS5816029 B2 JP S5816029B2
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JP
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selector
rectifier
counter
pulse
control device
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JP8669973A
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ゲオルグ・リンドブロム
ベルント・オストルンド
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ABB Norden Holding AB
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ASEA AB
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Publication date
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Publication of JPS4959252A publication Critical patent/JPS4959252A/ja
Publication of JPS5816029B2 publication Critical patent/JPS5816029B2/en
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    • HELECTRICITY
    • H02GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
    • H02HEMERGENCY PROTECTIVE CIRCUIT ARRANGEMENTS
    • H02H7/00Emergency protective circuit arrangements specially adapted for specific types of electric machines or apparatus or for sectionalised protection of cable or line systems, and effecting automatic switching in the event of an undesired change from normal working conditions
    • H02H7/10Emergency protective circuit arrangements specially adapted for specific types of electric machines or apparatus or for sectionalised protection of cable or line systems, and effecting automatic switching in the event of an undesired change from normal working conditions for converters; for rectifiers
    • H02H7/12Emergency protective circuit arrangements specially adapted for specific types of electric machines or apparatus or for sectionalised protection of cable or line systems, and effecting automatic switching in the event of an undesired change from normal working conditions for converters; for rectifiers for static converters or rectifiers
    • H02H7/1203Circuits independent of the type of conversion
    • H02H7/1206Circuits independent of the type of conversion specially adapted to conversion cells composed of a plurality of parallel or serial connected elements
    • HELECTRICITY
    • H02GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
    • H02MAPPARATUS FOR CONVERSION BETWEEN AC AND AC, BETWEEN AC AND DC, OR BETWEEN DC AND DC, AND FOR USE WITH MAINS OR SIMILAR POWER SUPPLY SYSTEMS; CONVERSION OF DC OR AC INPUT POWER INTO SURGE OUTPUT POWER; CONTROL OR REGULATION THEREOF
    • H02M1/00Details of apparatus for conversion
    • H02M1/08Circuits specially adapted for the generation of control voltages for semiconductor devices incorporated in static converters
    • H02M1/088Circuits specially adapted for the generation of control voltages for semiconductor devices incorporated in static converters for the simultaneous control of series or parallel connected semiconductor devices
    • H02M1/092Circuits specially adapted for the generation of control voltages for semiconductor devices incorporated in static converters for the simultaneous control of series or parallel connected semiconductor devices the control signals being transmitted optically
    • HELECTRICITY
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    • H02M7/04Conversion of ac power input into dc power output without possibility of reversal by static converters
    • H02M7/12Conversion of ac power input into dc power output without possibility of reversal by static converters using discharge tubes with control electrode or semiconductor devices with control electrode
    • H02M7/145Conversion of ac power input into dc power output without possibility of reversal by static converters using discharge tubes with control electrode or semiconductor devices with control electrode using devices of a thyratron or thyristor type requiring extinguishing means
    • H02M7/155Conversion of ac power input into dc power output without possibility of reversal by static converters using discharge tubes with control electrode or semiconductor devices with control electrode using devices of a thyratron or thyristor type requiring extinguishing means using semiconductor devices only
    • H02M7/19Conversion of ac power input into dc power output without possibility of reversal by static converters using discharge tubes with control electrode or semiconductor devices with control electrode using devices of a thyratron or thyristor type requiring extinguishing means using semiconductor devices only arranged for operation in series, e.g. for voltage multiplication

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Description

【発明の詳細な説明】 本発明は高圧用静止変換器のサイリスク整流器に関する
DETAILED DESCRIPTION OF THE INVENTION The present invention relates to a sirisk rectifier for high voltage static converters.

前記サイリスク整流器は直列接続された複数のサイリス
クを有し、各サイリスクには整流器全体の制御回路で制
御される制御装置が設けられており、前記制御回路は静
止変換器全体を制御しその整流動作を制御する制御シス
テムの影響を受ける。
The thyrisk rectifier has a plurality of thyrisks connected in series, and each thyrisk is provided with a control device controlled by a control circuit of the entire rectifier, and the control circuit controls the entire static converter and controls its rectification operation. affected by the control system that controls it.

前記制御装置には適宜のサイリスクに加わる導通方向の
電圧が一定値に達するとサイリスクおよびその制御装置
に欠陥あるいは不良がない限り指示パルスを発生する信
号発生器が設けられている。
The control device is provided with a signal generator which generates an indication pulse when the voltage in the conduction direction applied to the appropriate sirisk reaches a certain value, unless the sirisk and its control device are defective or defective.

このようなサイリスク整流器は、例えば、米国特許第3
794908号により知られており、本発明の目的は、
前記指示パルスの助けをもって、どのサイリスクおよび
その制御装置が何個良好であるのかあるいは不良である
のかを記録し、整流器の状態の不断の監視を確実にする
ことである。
Such a silis rectifier is described, for example, in U.S. Pat.
No. 794908, the object of the present invention is to
With the aid of said indication pulses, it is to record which sirisks and how many of their control devices are good or bad, ensuring constant monitoring of the condition of the rectifier.

この目的のための手段は既知のものであり、そして一般
にそれらはサイリスク両端に接続されているグロー・ラ
ンプやあるいは異なる電圧レベルの間の伝送又は長距離
の伝送に工匠なかなり原始的回路に基づいているもので
ある。
Means for this purpose are known, and generally they are based on glow lamps connected across the cyrisk, or on fairly primitive circuits ingenious for transmission between different voltage levels or for long distance transmission. It is something that

それに反して、本発明は前記指示パルスを記憶素子で感
知し、そしてそれを伝送装置によりカウンタに送る選択
器を使用するものであり、そのカウンタ及び選択器は共
に接続された制御システムにより互いに同期されている
ものである。
On the contrary, the present invention uses a selector that senses the instruction pulse with a storage element and sends it to a counter by a transmission device, the counter and selector being synchronized with each other by a control system connected together. This is what has been done.

本発明による装置は特許請求の範囲に述べるように構成
されている。
The device according to the invention is constructed as described in the claims.

既知の装置と比較すると、本発明はサイリスク及びそれ
らの制御装置の状態について、無人変換局での操作に好
適な明確な方法で詳細な情報を得ている。
Compared to known devices, the present invention obtains detailed information about the status of the cyrisks and their control devices in a clear manner suitable for operation in unmanned conversion stations.

それと同時に、本装置の構成は簡単である。At the same time, the configuration of this device is simple.

とりわけ、整流器については高電位からアース電位へ2
つの伝送チャネルが必要なだけである。
In particular, for rectifiers, from high potential to ground potential 2
only one transmission channel is required.

さらにその上、本発明による装置rlサイリスク回路に
既に現存するいくつかの構成部品を利用できる。
Furthermore, some components already existing in the device rl sirisk circuit according to the invention can be utilized.

その外の点については、付図を参照して本発明をさらに
詳細に記載することとする。
In other respects, the present invention will be described in further detail with reference to the accompanying drawings.

本サイリスク整流器は直列に接続された複数個のサイリ
スク13〜1nから成り、そしてその整流器は高圧用静
止変換器に包含され、変換器内において数個の同様の整
流器と共に整流器ブリッジを形成している。
The present thyrisk rectifier consists of several thyrisks 13 to 1n connected in series, and the rectifier is included in a high-voltage stationary converter, forming a rectifier bridge with several similar rectifiers within the converter. .

各整流器の一端は整流器ブリッジの直流側に接続され、
そして他端はブリッジの交流側に接続されている。
One end of each rectifier is connected to the DC side of the rectifier bridge,
The other end is connected to the AC side of the bridge.

各サイリスクの制御電極は、例えば前述の米国特許第3
794908号におけるように、整流器全体のための制
御回路22からの光パルスによって影響を受けるフォト
・ダイオード11の形式の検出器を有する制御装置1に
接続されている。
The control electrodes of each Cyrisk may be used, for example, in the aforementioned U.S. Pat.
As in No. 794,908, it is connected to a control device 1 with a detector in the form of a photodiode 11, which is influenced by a light pulse from a control circuit 22 for the entire rectifier.

この制御回路22は図示されていない静止変換器の制御
システムの影響を受け、光ダイオード23及び光導体2
4を介して制御装置1に信号を送りサイリスクを点弧す
る。
This control circuit 22 is influenced by a control system of a stationary converter (not shown), which controls the photodiode 23 and the light guide 2.
4 to the control device 1 to ignite the cyrisk.

各制御装置1は関連するサイリスクに加わる導通方向の
電圧が一定値に達すると指示パルスを発生する光ダイオ
ード12の形の信号発生器を備えている。
Each control device 1 is equipped with a signal generator in the form of a photodiode 12 which generates an indication pulse when the conduction voltage applied to the associated sirisk reaches a certain value.

制御装置1はそれ自身に欠陥がない限りサイリスクのア
ノード−カソード間電圧から得た供給電圧を受けて指示
パルスを発生する。
The control device 1 receives a supply voltage derived from the anode-cathode voltage of the SIRISK and generates an indication pulse unless it is defective.

欠陥サイリスクは短絡回路として働き、その両端間の1
圧はほとんどゼロであるので、欠陥サイリスクの制御装
置は電圧の供給を受けず、従って指示パルスを発生しな
い。
A defective cyrisk acts as a short circuit, with the 1
Since the voltage is almost zero, the control device of the defective cyrisk receives no voltage and therefore does not generate an indication pulse.

これらの指示パルスは光導体2を介して検出器2に送ら
れる。
These indicator pulses are sent to a detector 2 via a light guide 2.

この検出器はフォト・ダイオードで構成され、記憶回路
3の入力回路を形成する。
This detector consists of a photodiode and forms the input circuit of the storage circuit 3.

記憶回路において指示パルスは不装置の各動作期間の間
蓄積される。
In the memory circuit the instruction pulses are stored during each period of operation of the non-device.

各動作期間の間に指示パルスは全く無作為に言[憶回路
3に到達する。
During each operating period the instruction pulses arrive at the memory circuit 3 quite randomly.

記憶回路3は例えば各検出器ごとに設けられかつ検出器
2からの信号によ1てセットされる双安定フリップ・フ
ロップで構必される。
The memory circuit 3 comprises, for example, a bistable flip-flop provided for each detector and set to 1 by a signal from the detector 2.

記憶回路3に蓄積された信号は選択器4によって感知さ
れる。
The signal stored in the storage circuit 3 is sensed by the selector 4.

選択器4は制御装置5から受ける一連の信号に従って所
定の順序でその入力を1つの記憶素子(フリップ・フロ
ップ)から次の記憶素子にステップ状に一定の速度で進
め記憶回路を検索する。
The selector 4 searches the memory circuit by stepping its input from one memory element (flip-flop) to the next at a constant speed in a predetermined order according to a series of signals received from the controller 5.

上記一連の信号が選択器4に与えられると制御装置5は
リセット信号を発生して選択器4への信号の送出を停止
し、新しい一連の指示パルスが蓄積され記録されるよう
に記憶回路3をクリアする。
When the above series of signals is applied to the selector 4, the control device 5 generates a reset signal to stop sending signals to the selector 4, and sends the signal to the memory circuit 3 so that a new series of instruction pulses can be accumulated and recorded. Clear.

制御装置5で制御されたパルス列は選択器4から送り出
されるが、そのパルス列における異なるパルスの各々お
よび欠けたパルスにより生じるすべてのパルス間隔はサ
イリスク13〜1nの各々の状態に対応する。
A pulse train controlled by the control device 5 is sent out from the selector 4, in which each different pulse and all pulse intervals caused by missing pulses correspond to the state of each of the sirisks 13 to 1n.

これらのパルスは伝送装置6aによりカウンタ7に送ら
れる。
These pulses are sent to the counter 7 by the transmission device 6a.

カウンタ7の同期をとるために別の伝送装置6bによっ
て選択器4の制御装置5に接続された制御装置9が設け
られている。
A control device 9 is provided which is connected to the control device 5 of the selector 4 by a further transmission device 6b for synchronizing the counter 7.

このようにして、カウンタ7は選択器4から出るパルス
又は欠けたパルスにより生じるパルス間隔を記録する。
In this way, the counter 7 records the pulse interval caused by a pulse or a missing pulse coming from the selector 4.

カウンタ7は、選択器4がパルスを感知する前に、サイ
リスクの全数に相当する信号を含んでいてダウン・カウ
ンタとしての特性も有している。
The counter 7 contains a signal corresponding to the total number of sirisks before the selector 4 senses the pulse and also has the characteristic of a down counter.

前記のサイリスクの全数に相当する信号はその後選択器
4から来るパルスにより減数される。
The signal corresponding to the total number of said risks is then subtracted by the pulses coming from the selector 4.

走査後、カウンタは欠陥サイリスクの数を有している。After scanning, the counter contains the number of defective cyrisks.

カウンタ7の結果は、例えは、欠陥サイリスクの数を表
示するいわゆる数字表示管の形の特別指示部材20によ
って記録するために使用できる。
The result of the counter 7 can be used to record by means of a special indicator 20, for example in the form of a so-called numeric display tube, which displays the number of defective cyrisks.

欠陥サイリスクが一定の数になると警告信号を発生し、
もしその数が問題のサイリスクの強度に関して危険な数
に近付くと警報信号又は解放信号が発せられるように、
好適には多段装置の警報装置又は解放装置を得ることが
可能である。
Generates a warning signal when the number of defective Cyrisks reaches a certain number,
so that if the number approaches a dangerous number with respect to the strength of the psi-risk in question, an alarm or release signal will be emitted.
It is advantageously possible to obtain a multi-stage alarm or release device.

欠陥サイリスクの位置を記録する記憶装置8はカウンタ
7と並列に配列され、そして同様に制御装置9で制御さ
れる。
A storage device 8 for recording the position of the defective cyrisk is arranged in parallel with the counter 7 and is likewise controlled by a control device 9.

記憶回路3の特定の記憶素子の内容が指示パルスを受け
ていないことを示すものであれば記憶装置8はこの事実
を記録し対応ノするサイリスクを識別する。
If the contents of a particular memory element of the memory circuit 3 indicate that no instruction pulse has been received, the memory device 8 records this fact and identifies the corresponding risk.

前記記憶装置の出力回路21は電灯又は信号旗を有する
図表形式のものでもよい。
The output circuit 21 of the storage device may be in the form of a diagram with electric lights or signal flags.

出力回路21も又、例えば、定期的に整流器内の欠陥の
ないサイリスクや破損したサイリスクを記録する記録器
として構成されている。
The output circuit 21 is also designed, for example, as a recorder that periodically records the defective and damaged cycles in the rectifier.

上述の欠陥サイリスクの数をカウントする動作を要約す
ると次のとおりである。
The operation of counting the number of defective risks described above is summarized as follows.

制御装置5は例えば、サイリスク整流器の各導通期間の
終りを検知することのできるもので、この時期に従属制
御装置9に同期信号を送り、また記憶回路3及び選択器
4をリセットし、このため選択器4は記憶回路3の記憶
内容の走査を開始する。
The control device 5 is, for example, capable of detecting the end of each conduction period of the Sirisk rectifier and at this time sends a synchronization signal to the slave control device 9 and also resets the storage circuit 3 and the selector 4, thus The selector 4 starts scanning the contents of the memory circuit 3.

即ち、選択器4は記憶回路3内の各サイリスクに対応し
たそれぞれの記憶素子を次々に速やかに続出して、その
続出し結果をパルス列として出力する。
That is, the selector 4 rapidly outputs the memory elements corresponding to the respective si-risks in the memory circuit 3 one after another, and outputs the successive output results as a pulse train.

整流器が5個のサイリスクからなり、そして第3番目の
サイリスクが故障しているとすれば、パルス列は[11
0111となる。
If the rectifier consists of 5 sirisks and the third sirisk is faulty, then the pulse train is [11
It becomes 0111.

このパルス列は伝送装置6aを経てカウンタ7及び記憶
装置8に送られるが、これらカウンタ7及び記憶装置8
は制御装置9が記憶装置5から同期信号を受けたときリ
セットされている。
This pulse train is sent to a counter 7 and a storage device 8 via a transmission device 6a;
is reset when the control device 9 receives a synchronization signal from the storage device 5.

カウンタ7は受けたパルス列から「01の数をカウント
する。
Counter 7 counts the number of 01s from the received pulse train.

パルス列の全部を受信し、「0」の数をカウントし終っ
たときのカウンタ7の内容は欠陥サイリスクの□数を示
している。
When the entire pulse train has been received and the number of "0"s has been counted, the contents of the counter 7 indicate the number of defective SI risks.

記憶装置8は記憶装置3と同様に各サイリスクに対応し
た記憶素子があり、この場合5個の素子があり、パルス
列の各桁を記憶する。
The memory device 8, like the memory device 3, has a memory element corresponding to each signal, and in this case, there are five elements, and each digit of the pulse train is stored.

パルス列全部を受信し終ると記憶装置8のそれぞれの素
子の内容は、ml、1,0,1.jJであり、第1,2
゜4.5サイリスクは作動しているか、第3サイリスク
が故障であることを示している。
When the entire pulse train has been received, the contents of each element of the storage device 8 will be ml, 1, 0, 1 . jJ, and the first and second
゜4.5 This indicates that the cyrisk is operating or the third cyrisk is malfunctioning.

カウンタ7と記憶回路8とは並列に配列されているため
、それらはそれぞれの速度で動作することが可能であり
、したがって回路20は常に最新の数字表示を提供し、
一方回路21はある遅延をもって、適当な時、例えば、
破損したサイリスクの数が増加した時、に全サイリスク
と破損したサイリスクの配分を表示する。
Since the counter 7 and the memory circuit 8 are arranged in parallel, they can operate at their respective speeds, so that the circuit 20 always provides an up-to-date numerical display;
On the other hand, the circuit 21 is activated at an appropriate time, with a certain delay, e.g.
When the number of corrupted Sairisks increases, displays the distribution of total Sairisks and corrupted Sairisks.

図に示した構成品中、2から5までは整流器電位、すな
わちサイリスク13〜10及び制御装置1と同じ電位に
適宜に保持されてよい。
Among the components shown in the figure, 2 to 5 may be suitably kept at the rectifier potential, ie the same potential as the cyrisks 13 to 10 and the control device 1.

従って構成部品2から5までは整流器のシャーシ上に取
付けられている。
Components 2 to 5 are therefore mounted on the rectifier chassis.

さらに容易に手で触れることができる他の構成部品はア
ース電圧に保持され、伝送装置6a及び6bは光学的信
号伝達のための光導体として適当に構成されている。
Furthermore, the other easily accessible components are kept at ground voltage, and the transmission devices 6a and 6b are suitably constructed as light guides for optical signal transmission.

原則として、出力回路20及び21はどこにでも配置で
きるが、無人変換局の場合それらはその変換局から遠隔
の主制御局内に装置され、そして7及び8からの信号は
電気通信によって送られることが示唆される。
In principle, the output circuits 20 and 21 can be placed anywhere, but in the case of an unmanned converter station they are installed in a main control station remote from the converter station, and the signals from 7 and 8 can be sent by telecommunications. It is suggested.

2から先のすべての構成部品はできる限りアース電圧に
配列され、構成部品間の接続を簡素化している。
All components from 2 onwards are arranged as close to ground voltage as possible to simplify the connections between the components.

構成部品2から5までは米国特許第3842337号に
よる。
Components 2 through 5 are according to US Pat. No. 3,842,337.

前述のように、検出器2から出るパルスは、導通期間後
整流器両端に電圧が増加する時にそれぞれのサイリスク
13〜1nに加わる電圧に従って任意に記憶回路3に達
する。
As mentioned above, the pulses emerging from the detector 2 reach the storage circuit 3 arbitrarily according to the voltage applied to the respective sirisk 13-1n as the voltage increases across the rectifier after the conduction period.

パルスが記録されそしてサイリスクの状態が制御される
のを可能にするために、記憶回路3が導入され、したが
って選択器4は適当な速度で働くことができる。
To enable the pulses to be recorded and the state of the sirisk to be controlled, a memory circuit 3 is introduced so that the selector 4 can work at an appropriate speed.

パルスはサイリスク整流器の各導通期間後に記録される
が、一般に選択器4が幾分遅い速度、例えは静止変換器
の各動作期間の記録又はもつと遅い周波数で作動してい
ても十分な確実性が得られる。
Pulses are recorded after each conduction period of the Sirisk rectifier, but generally with sufficient certainty even if the selector 4 is operating at a somewhat slower speed, for example recording each period of operation of a stationary transducer or at a slower frequency. is obtained.

この場合、例えば記録回路8及び21は静正変換器内の
すべての整流器に共通とすることができる。
In this case, for example, the recording circuits 8 and 21 can be common to all rectifiers in the static positive converter.

記憶装置3を完全に除外して選択器4が検出器2を直接
綾取ることも可能である。
It is also possible to completely exclude the storage device 3 and allow the selector 4 to directly select the detector 2.

これは、選択器4かサイリスク整流器の各導通期間後に
検出器2を読み、その後次の検出器に進ませるような方
法で実施できる。
This can be done in such a way that the detector 2 is read after each conduction period of the selector 4 or the Sirisk rectifier, and then proceeding to the next detector.

この場合、整流器内のサイリスクの数と同数の動作期間
に相当する読取り回数を必要とするであろう。
In this case, a number of readings corresponding to the same number of operating periods as the number of cyrisks in the rectifier would be required.

この数が数百に達しても、読取り速度は完全に満足し得
るものである。
Even if this number reaches several hundred, the reading speed is completely satisfactory.

さらにその上、この回数は、もし検出器2が抑止出力信
号で制御され従って選択器4に読取りに必要な時間を与
えるならば数回減少し得る。
Moreover, this number can be reduced by several times if the detector 2 is controlled with an inhibit output signal, thus giving the selector 4 the necessary time to read.

これは検出器2に3からの記憶機能を引継がせることに
なろう。
This would cause detector 2 to take over the memory function from 3.

【図面の簡単な説明】[Brief explanation of the drawing]

付図は本発明による監視装置を有するサイリスク整流器
を示す。 1・・・制御装置、2・・・検出器、3・・・記憶回路
、4・・・選択器、5・・・制御装置、6・・・伝送装
置、7・・・カウンタ、8・・・記録記憶装置、12・
・・信号発生器、13・・・サイリスク、22・・・制
御回路。
The attached figure shows a sirisk rectifier with a monitoring device according to the invention. DESCRIPTION OF SYMBOLS 1... Control device, 2... Detector, 3... Memory circuit, 4... Selector, 5... Control device, 6... Transmission device, 7... Counter, 8...・Recording storage device, 12・
...Signal generator, 13...Sirisk, 22...Control circuit.

Claims (1)

【特許請求の範囲】 1 複数個の直列に接続されたサイリスタ13−1nを
含む高圧静止変換器用サイリスク整流器であって、各サ
イリスクはそのアノード、カソード及びゲート電極間に
接続された制御装置1をもち前記制御装置1は整流器全
体のための制御回路22からの点弧パルスを受けてサイ
リスクにゲート電流を供給すると共にサイリスクの導通
方向の電圧を検知してその検知電圧が所定の値に達する
と検出器2へ指示パルスを発生する信号発生器12を備
えたものにおいて、 前記整流器の各動作期間中に前記検出器2から不規則に
送られてくる各サイリスクからの指示パルスを受け、各
サイリスクの作動状態に対応して異なった内容のパルス
列を伝送路6を経て送り出す選択器4と、 前記選択器4からのパルス列を受け、このパルス列から
欠陥サイリスタの数をカウントするカウンタ7と、 前記選択器4及びカウンタ7に接続され前記選択器4及
びカウンタ7の動作を同期させる制御装置5,9を備え
たことを特徴とするサイリスク整流器。
[Scope of Claims] 1. A thyristor rectifier for a high-voltage static converter including a plurality of thyristors 13-1n connected in series, each thyristor having a control device 1 connected between its anode, cathode and gate electrode. The control device 1 receives the ignition pulse from the control circuit 22 for the entire rectifier, supplies a gate current to the cyrisk, detects the voltage in the conduction direction of the cyrisk, and when the detected voltage reaches a predetermined value. In a device equipped with a signal generator 12 that generates an instruction pulse to the detector 2, the signal generator 12 receives the instruction pulses from each of the cyrisks irregularly sent from the detector 2 during each operation period of the rectifier, and a selector 4 that sends out pulse trains with different contents via the transmission line 6 in accordance with the operating state of the selector; a counter 7 that receives the pulse train from the selector 4 and counts the number of defective thyristors from this pulse train; A silice rectifier, characterized in that it comprises control devices 5 and 9 connected to a selector 4 and a counter 7 to synchronize the operations of the selector 4 and the counter 7.
JP8669973A 1972-08-04 1973-08-01 Thyristor Seiri Yuki Expired JPS5816029B2 (en)

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
SE1017572A SE365915B (en) 1972-08-04 1972-08-04

Publications (2)

Publication Number Publication Date
JPS4959252A JPS4959252A (en) 1974-06-08
JPS5816029B2 true JPS5816029B2 (en) 1983-03-29

Family

ID=20291832

Family Applications (1)

Application Number Title Priority Date Filing Date
JP8669973A Expired JPS5816029B2 (en) 1972-08-04 1973-08-01 Thyristor Seiri Yuki

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