JPH104335A - デューティ制御されたスイッチ可変キャパシタ - Google Patents
デューティ制御されたスイッチ可変キャパシタInfo
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- JPH104335A JPH104335A JP9019263A JP1926397A JPH104335A JP H104335 A JPH104335 A JP H104335A JP 9019263 A JP9019263 A JP 9019263A JP 1926397 A JP1926397 A JP 1926397A JP H104335 A JPH104335 A JP H104335A
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- Japan
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- current
- period
- capacitor
- switch
- variable capacitor
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- G—PHYSICS
- G05—CONTROLLING; REGULATING
- G05F—SYSTEMS FOR REGULATING ELECTRIC OR MAGNETIC VARIABLES
- G05F1/00—Automatic systems in which deviations of an electric quantity from one or more predetermined values are detected at the output of the system and fed back to a device within the system to restore the detected quantity to its predetermined value or values, i.e. retroactive systems
- G05F1/10—Regulating voltage or current
- G05F1/12—Regulating voltage or current wherein the variable actually regulated by the final control device is ac
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- Engineering & Computer Science (AREA)
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- Physics & Mathematics (AREA)
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- Radar, Positioning & Navigation (AREA)
- Automation & Control Theory (AREA)
- Dc-Dc Converters (AREA)
- Filters That Use Time-Delay Elements (AREA)
- Electronic Switches (AREA)
Abstract
(57)【要約】
【課題】 本発明は、可変位相駆動を必要としないスイ
ッチ可変キャパシタ回路を提供することを目的とする。 【解決手段】 第１の端子11および第２の端子12を有す
るキャパシタ13と、それら第１、第２の端子11, 12間に
並列に接続されるスイッチング手段17と、正弦波曲線で
変化する電流の正方向でゼロと交差する点で閉じ、正方
向でゼロと交差する点の後Ｄ秒（Ｄは０．２５Ｔ乃至
０．５Ｔ）で開くようにスイッチング手段17を制御して
スイッチング手段17が閉じている期間中正弦波電流を導
通するように制御するパルス幅変調手段19と、正弦波電
流が第２の方向で流れるとき正弦波電流を導通するため
キャパシタ13と並列に接続されているダイオード15とを
備え、Ｄ秒の値を変化することによって回路のキャパシ
タンスが制御されることを特徴とする。
ッチ可変キャパシタ回路を提供することを目的とする。 【解決手段】 第１の端子11および第２の端子12を有す
るキャパシタ13と、それら第１、第２の端子11, 12間に
並列に接続されるスイッチング手段17と、正弦波曲線で
変化する電流の正方向でゼロと交差する点で閉じ、正方
向でゼロと交差する点の後Ｄ秒（Ｄは０．２５Ｔ乃至
０．５Ｔ）で開くようにスイッチング手段17を制御して
スイッチング手段17が閉じている期間中正弦波電流を導
通するように制御するパルス幅変調手段19と、正弦波電
流が第２の方向で流れるとき正弦波電流を導通するため
キャパシタ13と並列に接続されているダイオード15とを
備え、Ｄ秒の値を変化することによって回路のキャパシ
タンスが制御されることを特徴とする。
Description
【０００１】
【発明の属する技術分野】本発明は可変キャパシタンス
構造、特にパルス幅変調されたスイッチ可変キャパシタ
ンス構造に関する。
構造、特にパルス幅変調されたスイッチ可変キャパシタ
ンス構造に関する。
【０００２】
【従来の技術】スイッチ可変キャパシタ回路は出力電圧
の調節用に共振パワー供給で利用される。既知のスイッ
チ可変キャパシタ回路は文献（“Controlled Resonant
Converters with Switching Frequency Fixed ”、Hara
da氏、IEEE Power ElectronicsSpecialists Conference
(PESC)、1987年、 431〜438 頁、IEEE Catalog No. 87
CH2459-6 ）に記載されている。Harada氏等のスイッチ
可変キャパシタ回路は実効的なキャパシタンスに比例的
変化を起こすため可変位相駆動信号を使用し、同期装
置、エラー増幅器、駆動装置、位相シフタ回路を含んで
いる。このような回路について検討した結果では１ＭＨ
ｚを越えるスイッチング周波数で、位相シフタ回路が大
型で高価格となり、単一の現存の集積回路で便宜的に構
成されることができないことが認められる。
の調節用に共振パワー供給で利用される。既知のスイッ
チ可変キャパシタ回路は文献（“Controlled Resonant
Converters with Switching Frequency Fixed ”、Hara
da氏、IEEE Power ElectronicsSpecialists Conference
(PESC)、1987年、 431〜438 頁、IEEE Catalog No. 87
CH2459-6 ）に記載されている。Harada氏等のスイッチ
可変キャパシタ回路は実効的なキャパシタンスに比例的
変化を起こすため可変位相駆動信号を使用し、同期装
置、エラー増幅器、駆動装置、位相シフタ回路を含んで
いる。このような回路について検討した結果では１ＭＨ
ｚを越えるスイッチング周波数で、位相シフタ回路が大
型で高価格となり、単一の現存の集積回路で便宜的に構
成されることができないことが認められる。
【０００３】
【発明が解決しようとする課題】それ故、可変位相駆動
を必要としないスイッチ可変キャパシタ回路を提供する
ことが有効である。
を必要としないスイッチ可変キャパシタ回路を提供する
ことが有効である。
【０００４】別の利点は位相シフタを必要としないスイ
ッチ可変キャパシタ回路を提供することである。
ッチ可変キャパシタ回路を提供することである。
【０００５】
【課題を解決するための手段】前述および他の利点は、
本発明によって達成される。本発明のスイッチ可変キャ
パシタは、第１の端子および第２の端子を有するキャパ
シタと、キャパシタの第１および第２の端子間に接続さ
れるスイッチと、第１および第２の端子に供給される正
弦波曲線で変化する電流の正方向でゼロと交差する点で
閉じ、正方向にゼロと交差する点の後Ｄ秒で開くように
スイッチを制御し、Ｄは正弦波曲線で変化する電流の周
期Ｔの０．２５乃至０．５の範囲であるパルス幅変調器
と、正弦波曲線的に変化する電流の各周期の半分の負の
部分で正弦波曲線で変化する電流を導電するキャパシタ
の第１および第２の端子間に接続されているダイオード
とを含んでいる。
本発明によって達成される。本発明のスイッチ可変キャ
パシタは、第１の端子および第２の端子を有するキャパ
シタと、キャパシタの第１および第２の端子間に接続さ
れるスイッチと、第１および第２の端子に供給される正
弦波曲線で変化する電流の正方向でゼロと交差する点で
閉じ、正方向にゼロと交差する点の後Ｄ秒で開くように
スイッチを制御し、Ｄは正弦波曲線で変化する電流の周
期Ｔの０．２５乃至０．５の範囲であるパルス幅変調器
と、正弦波曲線的に変化する電流の各周期の半分の負の
部分で正弦波曲線で変化する電流を導電するキャパシタ
の第１および第２の端子間に接続されているダイオード
とを含んでいる。
【０００６】
【発明の実施の形態】本発明で開示された利点および特
徴は添付図面を伴った後述の詳細な説明から当業者によ
り容易に認識されるであろう。後述の詳細な説明および
図面の幾つかの形状で、同一素子は同一の参照符号で示
されている。
徴は添付図面を伴った後述の詳細な説明から当業者によ
り容易に認識されるであろう。後述の詳細な説明および
図面の幾つかの形状で、同一素子は同一の参照符号で示
されている。
【０００７】図１を参照すると、本発明にしたがったス
イッチ可変キャパシタンス回路の概略図が示されてお
り、第１のノード11に接続されている第１の端子と第２
のノード12に接続されている第２の端子を有するキャパ
シタンス13を含んでいる。ダイオ−ド15は第２のノード
12に接続されている陽極と第１のノード11に接続されて
いる陰極を有する。能動スイッチ17は第１のノード11と
第２のノード12との間に接続されている。能動スイッチ
17がオンのとき、閉じられ第１のノード11と第２のノー
ド12との間に導電通路が形成される。能動スイッチ17が
オフのときに開放されて第１のノード11と第２のノード
12との間の開回路を形成する。能動スイッチ17は、動作
を基準周波数に同期するためのＳＹＮＣＨ制御信号とデ
ューティ係数を制御するためのＤＵＴＹ信号とを受信す
るパルス幅変調器19により与えられる周期パルス列ＶP
により制御される。キャパシタ13、ダイオード15、能動
スイッチ17はしたがって並列に接続される。
イッチ可変キャパシタンス回路の概略図が示されてお
り、第１のノード11に接続されている第１の端子と第２
のノード12に接続されている第２の端子を有するキャパ
シタンス13を含んでいる。ダイオ−ド15は第２のノード
12に接続されている陽極と第１のノード11に接続されて
いる陰極を有する。能動スイッチ17は第１のノード11と
第２のノード12との間に接続されている。能動スイッチ
17がオンのとき、閉じられ第１のノード11と第２のノー
ド12との間に導電通路が形成される。能動スイッチ17が
オフのときに開放されて第１のノード11と第２のノード
12との間の開回路を形成する。能動スイッチ17は、動作
を基準周波数に同期するためのＳＹＮＣＨ制御信号とデ
ューティ係数を制御するためのＤＵＴＹ信号とを受信す
るパルス幅変調器19により与えられる周期パルス列ＶP
により制御される。キャパシタ13、ダイオード15、能動
スイッチ17はしたがって並列に接続される。
【０００８】動作において、正弦波入力電流ＩINは第１
のノード11と第２のノード12に供給され、本発明にした
がってパルス幅変調器19は、パルス列ＶP により能動ス
イッチ17を制御し、このパルス列ＶP は正弦波入力電流
ＩINの周波数と同期され、第１のノードおよび第２のノ
ードを横切る所望なキャパシタンスを達成するように制
御されるデューティ係数を有する。パルス幅変調器19の
制御下で能動スイッチ17のスイッチングにしたがって、
入力電流ＩINは能動スイッチ17とキャパシタ13とダイオ
ード15の間で整流される。
のノード11と第２のノード12に供給され、本発明にした
がってパルス幅変調器19は、パルス列ＶP により能動ス
イッチ17を制御し、このパルス列ＶP は正弦波入力電流
ＩINの周波数と同期され、第１のノードおよび第２のノ
ードを横切る所望なキャパシタンスを達成するように制
御されるデューティ係数を有する。パルス幅変調器19の
制御下で能動スイッチ17のスイッチングにしたがって、
入力電流ＩINは能動スイッチ17とキャパシタ13とダイオ
ード15の間で整流される。
【０００９】図３を参照すると、図１の回路の適切な信
号の波形が示されている。入力電流ＩINは周期Ｔ秒を有
する正弦波電流である。能動スイッチ17に与えられるパ
ルス幅変調器からの駆動信号ＶP は正弦波入力電流ＩIN
に同期され、周期Ｔを有する電圧パルス波形を有する。
ＶP パルスの上昇するエッジは正弦波入力電流ＩINの負
から正への方向でゼロと交差する点と同期され、Ｖパル
スはパルス幅Ｄを有し、Ｄは０．２５Ｔと０．５Ｔの間
である。したがって各ＶP パルスの下降エッジは正弦波
入力電流ＩINの正のピークと後続する正から負へのゼロ
交差点との間で生じる。パルスの幅Ｄは所望の平均キャ
パシタンスを達成するように制御される。
号の波形が示されている。入力電流ＩINは周期Ｔ秒を有
する正弦波電流である。能動スイッチ17に与えられるパ
ルス幅変調器からの駆動信号ＶP は正弦波入力電流ＩIN
に同期され、周期Ｔを有する電圧パルス波形を有する。
ＶP パルスの上昇するエッジは正弦波入力電流ＩINの負
から正への方向でゼロと交差する点と同期され、Ｖパル
スはパルス幅Ｄを有し、Ｄは０．２５Ｔと０．５Ｔの間
である。したがって各ＶP パルスの下降エッジは正弦波
入力電流ＩINの正のピークと後続する正から負へのゼロ
交差点との間で生じる。パルスの幅Ｄは所望の平均キャ
パシタンスを達成するように制御される。
【００１０】能動スイッチはしたがって駆動信号ＶP の
各パルス期間中に入力電流を導通し、能動スイッチを通
過する電流ＩS は各周期Ｔで０秒とＤ秒との間で流れる
入力電流を有する。駆動信号ＰＷＭの各パルス期間中に
はキャパシタ13を介する電流は存在しない。駆動信号Ｖ
P のパルスの終了後、キャパシタ13は正弦波入力電流に
より充電され放電される。キャパシタから放電されなけ
ればならない充電量がＶP のパルスの終了と周期Ｔの中
心の間に流れる充電量と同一であり、正弦波の後半であ
る第２の部分が正弦波の前半の第１の部分に関して逆対
称であるので、キャパシタの両端の電圧ＶC はほぼＴ／
２を中心とする正弦波の正の半サイクルの上部部分から
なる。キャパシタ電圧ＶC は周期Ｔの開始後Ｄ秒でほぼ
ゼロから増加を開始し、周期Ｔの開始後Ｔ／２秒でピー
クに達し、周期Ｔの開始後（Ｔ−Ｄ）秒でゼロより下の
１ダイオード降下まで減少する。
各パルス期間中に入力電流を導通し、能動スイッチを通
過する電流ＩS は各周期Ｔで０秒とＤ秒との間で流れる
入力電流を有する。駆動信号ＰＷＭの各パルス期間中に
はキャパシタ13を介する電流は存在しない。駆動信号Ｖ
P のパルスの終了後、キャパシタ13は正弦波入力電流に
より充電され放電される。キャパシタから放電されなけ
ればならない充電量がＶP のパルスの終了と周期Ｔの中
心の間に流れる充電量と同一であり、正弦波の後半であ
る第２の部分が正弦波の前半の第１の部分に関して逆対
称であるので、キャパシタの両端の電圧ＶC はほぼＴ／
２を中心とする正弦波の正の半サイクルの上部部分から
なる。キャパシタ電圧ＶC は周期Ｔの開始後Ｄ秒でほぼ
ゼロから増加を開始し、周期Ｔの開始後Ｔ／２秒でピー
クに達し、周期Ｔの開始後（Ｔ−Ｄ）秒でゼロより下の
１ダイオード降下まで減少する。
【００１１】キャパシタ電圧ＶC が正であり、正弦波入
力電流はキャパシタ13を通って流れ、キャパシタ13を通
る電流ＩC は各周期ＴのＤ秒と（Ｔ−Ｄ）秒との間で流
れる正弦波入力電流を有する。キャパシタ電圧はゼロよ
りも低い１ダイオード降下であり入力電流は負である
が、ダイオード15を通って流れ、ダイオード15を通る電
流Ｉd は各周期Ｔの（Ｔ−Ｄ）秒とＴ秒との間で流れる
正弦波入力電流からなる。
力電流はキャパシタ13を通って流れ、キャパシタ13を通
る電流ＩC は各周期ＴのＤ秒と（Ｔ−Ｄ）秒との間で流
れる正弦波入力電流を有する。キャパシタ電圧はゼロよ
りも低い１ダイオード降下であり入力電流は負である
が、ダイオード15を通って流れ、ダイオード15を通る電
流Ｉd は各周期Ｔの（Ｔ−Ｄ）秒とＴ秒との間で流れる
正弦波入力電流からなる。
【００１２】したがって正弦波入力電流ＩINはＴ秒の各
周期に以下のように整流される。０秒とＤ秒の間では、
電流は能動スイッチ17を介して流れる。Ｄ秒と（Ｔ−
Ｄ）秒との間では、電流はキャパシタ13を通って流れ
る。（Ｔ−Ｄ）秒とＴ秒との間では電流はダイオード15
を介して流れる。
周期に以下のように整流される。０秒とＤ秒の間では、
電流は能動スイッチ17を介して流れる。Ｄ秒と（Ｔ−
Ｄ）秒との間では、電流はキャパシタ13を通って流れ
る。（Ｔ−Ｄ）秒とＴ秒との間では電流はダイオード15
を介して流れる。
【００１３】パルス継続期間Ｄと周期Ｔとの間の比率で
ある駆動信号ＶP のデューティ係数は図１のキャパシタ
回路により第１のノード11と第２のノード12との間で与
えられる実効キャパシタンスを制御するように制御され
る。特に、第１のノード11と第２のノード12との間の実
効キャパシタンスはＶP パルスのパルス幅Ｄに関して以
下のように計算される。電流ＩINは正弦波であり、した
がって次のように示されることができる。
ある駆動信号ＶP のデューティ係数は図１のキャパシタ
回路により第１のノード11と第２のノード12との間で与
えられる実効キャパシタンスを制御するように制御され
る。特に、第１のノード11と第２のノード12との間の実
効キャパシタンスはＶP パルスのパルス幅Ｄに関して以
下のように計算される。電流ＩINは正弦波であり、した
がって次のように示されることができる。
【００１４】ＩIN＝ＩPKｓｉｎωｔ それ故、正弦波入力電流ＩINの平均値Ｉavは次式で与え
られる。
られる。
【数１】 キャパシタを横切る電圧は次式で与えられる。
【数２】 キャパシタを横切る平均電圧Ｖavは次式で与えられる。
【数３】 平均キャパシタンスＣavは、平均電圧と、正弦波入力電
流ＩINのラジアンの周波数との積により除算された平均
電流に等しい。
流ＩINのラジアンの周波数との積により除算された平均
電流に等しい。
【数４】
【００１５】したがって、図１の可変キャパシタのキャ
パシタンスはＶP パルスのパルス幅Ｄを制御することに
より制御される。
パシタンスはＶP パルスのパルス幅Ｄを制御することに
より制御される。
【００１６】図２を参照すると、本発明にしたがったス
イッチ可変キャパシタを有効に使用するＤＣ・ＤＣ変換
器の概略図が示されている。ＤＣ・ＤＣ変換器はＤＣ入
力に応答し、インダクタ53の一方の端子に接続された出
力上にＡＣ出力を与える共振インバータ51を含んでい
る。インダクタ53の他方の端子はノード56でダイオード
55の陽極に接続されている。フィルタキャパシタ57の一
方の端子は接地に接続され、キャパシタ57の他方の端子
はノード58でダイオード55の陰極に接続されている。図
２のＤＣ・ＤＣ変換器のＤＣ出力ＶOUT はキャパシタ57
とダイオード55の陰極との接続により形成されるノード
58で与えられる。キャパシタ59は本発明にしたがってノ
ード56とスイッチ可変キャパシタ60との間に接続され
る。
イッチ可変キャパシタを有効に使用するＤＣ・ＤＣ変換
器の概略図が示されている。ＤＣ・ＤＣ変換器はＤＣ入
力に応答し、インダクタ53の一方の端子に接続された出
力上にＡＣ出力を与える共振インバータ51を含んでい
る。インダクタ53の他方の端子はノード56でダイオード
55の陽極に接続されている。フィルタキャパシタ57の一
方の端子は接地に接続され、キャパシタ57の他方の端子
はノード58でダイオード55の陰極に接続されている。図
２のＤＣ・ＤＣ変換器のＤＣ出力ＶOUT はキャパシタ57
とダイオード55の陰極との接続により形成されるノード
58で与えられる。キャパシタ59は本発明にしたがってノ
ード56とスイッチ可変キャパシタ60との間に接続され
る。
【００１７】スイッチ可変キャパシタ60は図１のスイッ
チ可変キャパシタの特別構成を有し、ここで能動スイッ
チはｎ型チャンネルトランジスタ117 により構成されて
いる。パルス幅変調制御装置19の同期信号ＳＹＮＣＨは
ノード54で電圧Ｖ1 により与えられ、パルス幅変調器19
を制御するためのＤＵＴＹ信号はダイオード55とキャパ
シタ57との接続により形成されるノード58に接続した反
転入力を有するエラー増幅器61の出力により与えられ
る。エラー増幅器61の非反転入力は基準電圧ＶRE F に接
続されている。
チ可変キャパシタの特別構成を有し、ここで能動スイッ
チはｎ型チャンネルトランジスタ117 により構成されて
いる。パルス幅変調制御装置19の同期信号ＳＹＮＣＨは
ノード54で電圧Ｖ1 により与えられ、パルス幅変調器19
を制御するためのＤＵＴＹ信号はダイオード55とキャパ
シタ57との接続により形成されるノード58に接続した反
転入力を有するエラー増幅器61の出力により与えられ
る。エラー増幅器61の非反転入力は基準電圧ＶRE F に接
続されている。
【００１８】図２の共振インバータでは、パルス幅変調
器19に対する同期信号ＳＹＮＣＨは、スイッチ可変キャ
パシタ60を介して流れる電流ＩINに関する固定位相を備
えた正弦波曲線的に変化する電圧Ｖ1 から得られる。そ
れ故、パルス幅変調器19は図２に関して前述したように
駆動信号ＶP が電流ＩINに同期されるように位相され
る。
器19に対する同期信号ＳＹＮＣＨは、スイッチ可変キャ
パシタ60を介して流れる電流ＩINに関する固定位相を備
えた正弦波曲線的に変化する電圧Ｖ1 から得られる。そ
れ故、パルス幅変調器19は図２に関して前述したように
駆動信号ＶP が電流ＩINに同期されるように位相され
る。
【００１９】以上、可変位相駆動を使用せず、また位相
シフタを必要とせずに容易に入手可能であり、低パワー
部品で、構成が容易である可変キャパシタ回路に付いて
説明した。結果として可変キャパシタ回路は、本発明に
したがって優秀な価格、重量、容積、性能、実効的な能
力を与える。
シフタを必要とせずに容易に入手可能であり、低パワー
部品で、構成が容易である可変キャパシタ回路に付いて
説明した。結果として可変キャパシタ回路は、本発明に
したがって優秀な価格、重量、容積、性能、実効的な能
力を与える。
【００２０】前述の説明は本発明の特別な実施形態の説
明および図示であるが、種々の変形および変更が特許請
求の範囲により定められた本発明の技術的範囲から逸脱
せず、当業者により行われることができる。
明および図示であるが、種々の変形および変更が特許請
求の範囲により定められた本発明の技術的範囲から逸脱
せず、当業者により行われることができる。
【図１】本発明にしたがったスイッチ可変キャパシタ回
路の概略図。
路の概略図。
【図２】図１のスイッチ可変キャパシタを使用したＤＣ
・ＤＣ変換器の概略図。
・ＤＣ変換器の概略図。
【図３】図１のスイッチ可変キャパシタの信号波形の概
略図。
略図。
───────────────────────────────────────────────────── フロントページの続き (72)発明者 シー・ラス・グーリック アメリカ合衆国、カリフォルニア州 90245、エル・セグンド、アパートメン ト・エー、イースト・インペリアル 1116
Claims (2)
- 【請求項１】 周波数および周期Ｔを有する正弦波曲線
で変化する電流源に接続され、電流は各周期の前半の１
／２周期の第１の期間に第１の方向で流れ、各周期の後
半のの１／２周期の第２の期間に第２の方向で流れ、前
記正弦波曲線で変化する電流は各周期の開始時における
正方向でゼロと交差する点と、各周期の中間点における
負方向でゼロと交差する点を有するスイッチ制御された
可変キャパシタ回路において、 第１の端子および第２の端子を有するキャパシタと、 前記第１および第２の端子間に接続されるスイッチング
手段と、 正弦波曲線で変化する電流の正方向でゼロと交差する点
で閉じ、正方向でゼロと交差する点の後Ｄ秒で開くよう
に前記スイッチング手段を制御し、それにおいてＤは
０．２５Ｔ乃至０．５Ｔの範囲であり、それによって前
記スイッチング手段は閉じている期間中正弦波曲線で変
化する電流を導通するように制御されるパルス幅変調手
段と、 前記正弦波曲線で変化する電流が第２の方向で流れると
き前記正弦波曲線で変化する電流を導通するため前記キ
ャパシタの前記第１の端子と第２の端子との間に接続さ
れているダイオードとを具備し、 スイッチ可変キャパシタ回路は前記Ｄ秒の値を変化する
ことにより制御されるキャパシタンスを有することを特
徴とするスイッチ制御された可変キャパシタ回路。 - 【請求項２】 前記パルス幅変調手段は方形波信号を前
記スイッチング手段に与え、前記方形波信号は前記正弦
波曲線で変化する電流の周期と同一の周期とパルス幅Ｄ
を有し、スイッチ可変キャパシタ回路のキャパシタンス
を制御するデューティ係数を有する請求項１記載のスイ
ッチ制御された可変キャパシタ。
Applications Claiming Priority (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| US08/594,738 US5640082A (en) | 1996-01-31 | 1996-01-31 | Duty cycle controlled switch variable capacitor circuit |
| US594738 | 1996-01-31 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH104335A true JPH104335A (ja) | 1998-01-06 |
Family
ID=24380180
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP9019263A Pending JPH104335A (ja) | 1996-01-31 | 1997-01-31 | デューティ制御されたスイッチ可変キャパシタ |
Country Status (4)
| Country | Link |
|---|---|
| US (1) | US5640082A (ja) |
| EP (1) | EP0786863B1 (ja) |
| JP (1) | JPH104335A (ja) |
| DE (1) | DE69717513T2 (ja) |
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