JPH10321487A - Iii−v族化合物半導体ウェハ - Google Patents
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Abstract
−V族化合物半導体ウェハを提供する。 【解決手段】 III−V族化合物半導体からなるウェ
ハ21は、断面がほぼ半径Rの円弧形状を有するように
外周端部が面取りされた、III−V族化合物からなる
基板22と、基板22上に形成されたIII−V族化合
物層からなるエピタキシャル層26とを備える。ウェハ
22の外周端縁から距離Lだけ離れた位置までの部分が
除去されており、距離Lが式R≦L≦3Rの関係を満足
する。
Description
合物半導体ウェハに関し、特に、気相エピタキシャル成
長法により成長したエピタキシャル層を有するIII−
V族化合物半導体ウェハに関するものである。
ードなどの生産量が増加している。フォトダイオードと
して、たとえば、インジウム−リン(以下、InPと称
する)基板の上にクロライド気相成長法によりエピタキ
シャル層を成長した、InPフォトダイオード(以下、
pin−PDと称する)が実用化されている。
インゴットを輪切りにしてチャンファー加工、研磨加工
を施しInP基板を形成する。次に、この基板上にII
I−V族化合物層をエピタキシャル成長させたInPウ
ェハ上にZn拡散層や保護膜などを形成する。このよう
な製造工程においては、通常は直径2インチで成長させ
たInPウェハを矩形に切出し、その後Zn拡散層など
を形成するデバイスプロセスに投入しているが、最近で
は、コストダウンを図るために直径2インチの円形のウ
ェハのままデバイスプロセスを行なう場合が多い。
ピンセットでつかまれたり、機械で挟まれて搬送される
ことが多いため、ウェハの端部が欠けたり割れたりする
ことがある。これを防止するため、従来より、基板の端
部に面取り部を形成することが行なわれる。たとえば実
開昭58−103144号公報には、GaAs基板の端
部に所定の面取り部を形成して鏡面研磨時のひっかき傷
や、工程移動の際の欠けを防止する技術が記載されてい
る。
シリコン基板の端部に所定の面取り部を形成してエッジ
クラウンの発生を防止する技術が開示されている。
部を形成したInP基板上にエピタキシャル層を成長さ
せたウェハをデバイスプロセスに投入した場合には、不
純物導入のための拡散工程、保護膜形成のための熱CV
D工程、異物除去のための超音波洗浄工程などでウェハ
に割れが発生するという問題が生じている。
決するためになされたものであり、デバイスプロセスで
割れが生じにくいIII−V族化合物半導体ウェハを提
供することである。
従ったIII−V族化合物半導体ウェハは、断面がほぼ
半径Rの円弧形状を有するように外周縁部が面取りされ
た、III−V族化合物からなる半導体基板と、この基
板上に形成されたIII−V族化合物層とを備える。I
II−V族化合物半導体ウェハの外周端縁から距離Lだ
け離れた位置までの部分が除去されており、距離Lが式
R≦L≦3Rを満足する。
表面にほぼ平行な面として(100)面を有するように
形成されていることが好ましい。
族化合物半導体ウェハの外周端縁の表面粗さRmaxが
2μm以下であることが好ましい。
化合物半導体ウェハは、III−V族化合物からなる半
導体基板と、この半導体基板上に形成されたIII−V
族化合物層とを備える。III−V族化合物半導体ウェ
ハの外周縁部でエピタキシャル異常成長部が除去されて
いる。ここで、エピタキシャル異常成長部とは、III
−V族化合物層において、相対的に厚さが厚くなってい
る部分をいう。
外周端縁からの距離が0.1mmまでの部分では半導体
基板が露出していることが好ましい。
るようにIII−V族化合物半導体ウェハの外周縁部が
面取りされており、半径rは0.1mm以上であること
が好ましい。
ロセス中でのウェハの割れの発生を防止するために、ま
ず割れの原因の究明を行なった。その結果、InP基板
上にInGaAsエピタキシャル層を成長させたウェハ
においては、ウェハの周辺部の特定面方位部分でエピタ
キシャル層が異常に高速成長し、この部分で特にウェハ
の割れが多発することを見出した。
Asエピタキシャル層を示す断面図である。図1を参照
して、InP基板1の表面にIII−V族化合物層とし
てのInGaAsエピタキシャル層2が形成されてい
る。矢印(100)、矢印(111)、矢印(011)
は、それぞれ、InP基板1の(100)面、(11
1)面、(011)面を示す。InP基板1の外周縁部
は半径Rの円弧形状である。InGaAsエピタキシャ
ル層2のうち部分2Xでは異常な高速成長のため層が厚
くなっている。また、部分2Yでは、逆に、InGaA
sエピタキシャル層の厚みが薄くなっている。このよう
に、エピタキシャル層2の厚さが部分的に異なるウェハ
をデバイスプロセスに投入すると、InP基板1とIn
GaAsエピタキシャル層2の熱膨張係数が大きく異な
るため、デバイスプロセス中の熱サイクルにより大きな
応力が発生し、厚さが厚い部分2Xにクラックが生じ、
ウェハの割れの原因となることがわかった。
1)面付近で異常成長を起こしたウェハの端部をエピタ
キシャル成長後に点線3で示す位置まで除去することに
より異常成長部をなくしているため、デバイスプロセス
中で割れが生じにくいIII−V族化合物半導体ウェハ
10を得ることができる。
ぼ半径Rの円弧形状を有するように外周縁部が面取りさ
れたウェハ10では、外周端縁からの距離が0〜Rの部
分において、特に、異常成長部が発生しやすいことを発
見した。したがって、ウェハの端縁から少なくとも距離
Rの部分を取除けば、異常成長部は除去される。一方、
ウェハを除去する量が小さいほどInP基板を有効に活
用できるため、除去量は小さいほどよい。しかしなが
ら、現在の設備での位置決め精度は、現在よく使用して
いる基板の半径R(=0.25mm)にほぼ等しいた
め、除去量には±Rのばらつきがある。したがって、除
去量の上限値を3Rとすれば、最悪の場合でもウェハの
端縁から距離Rの部分を除去することができる。
GaAsエピタキシャル層2は、InP基板1の主表面
にほぼ平行な面として(100)面を有するように形成
されていれば、異常成長する部分2Xが(111)面と
なり、上述の条件を満たす可能性が高くなるので好まし
い。
化合物半導体ウェハの外周端縁3の表面粗さRmaxが
2μm以下であれば、ウェハの割れにつながる起点が存
在しないためさらに好ましい。
体ウェハにおいては、図1に示すように、ウェハの外周
端縁部でエピタキシャル異常成長部2Xが除去されてい
るため、デバイスプロセス中で割れが生じにくくなる。
0.1mmまでの部分でInP基板1が露出していれば
デバイスプロセス中で割れが生じにくいことがわかっ
た。
るようにウェハ10の外周縁部が面取りされており、r
は0.1mm以上であることが好ましい。ここで、rを
0.1mm以上としたのは、現在半径が0.1mm未満
の面取り用の砥石がないためであり、もしそのような砥
石ができたとしても、砥石を構成するダイヤの粒径が約
0.05μmであるため、十分な加工精度が得られず加
工面の平坦性に問題があるからである。さらに、半径が
0.1mm未満の面取り加工をしたとしても、このよう
な面取りではウェハの端部が尖ったものとなるため、ウ
ェハ研磨中やデバイスプロセス中で、ウェハの端部が欠
けやすくなるという問題があるからである。
照して説明する。図2は、気相エピタキシャル成長装置
を示す模式図である。図3はこの発明に従って製造した
ウェハの断面を示す図である。図4は、図3中のIVで
囲んだ部分の拡大断面図である。図2を参照して、気相
エピタキシャル成長装置11は、反応器12と、駆動手
段13と、ヒータ14a、14bと、ソースボード1
5、16、17と、ソース容器18、19、20とを備
える。反応器12内にインジウム(In)が入ったソー
スボード15、17と、ガリウム(Ga)が入ったソー
スボード16とが設けられる。駆動装置13は基板22
を矢印で示す方向に回転させるために設けられる。As
Cl3 が入ったソース容器18、19と、PCl3 が入
ったソース容器20には、それぞれ、配管101〜10
3を介して水素が送り込まれる。ソース容器18はソー
スボード15と、ソース容器19はソースボード16
と、ソース容器20はソースボード17と配管104〜
106を介してそれぞれ接続される。ヒータ14a、1
4bが反応器12を加熱する。
4a、14bの出力を調整して反応器12内に図2の
(B)で示すような温度分布を形成した。次に、イオウ
がドープされたInPからなる基板22を駆動手段13
にセットした。基板22の直径は51mmであり、厚さ
は450μmとした。図3で示すように、基板22の端
部断面の半径Rを0.25mmとした。駆動手段13に
より基板22を図2中の下側へ回転させて移動させた。
この状態でソース容器20に配管103を介して水素ガ
スを送り込むことにより、ソース容器20では以下の
(1)で示す化学反応を起こした。
とHClがソースボード17へ送り込まれ、以下の
(2)で示す化学反応が起きた。
上述の(2)で示す反応により生じたInClとH2 が
基板22上で以下の(3)で示す化学反応を起こした。
板22上に厚さ約2μmのInPバッファ層23を成長
させた。
中の上側へ回転させて移動させ、ソース容器18へ配管
101、102を介して水素ガスを送り込むことによ
り、ソース容器18、19では以下の(4)で示す反応
を起こさせた。
s4 とHClが配管104を介してソースボード15へ
送り込まれ、以下の(5)で示す化学反応が起きた。
じたAs4 とHClが配管105を介してソースボード
16へ送り込まれることにより、以下の(6)で示す化
学反応が起きた。
と、ソースボード15で生じたInClと、ソースボー
ド16で生じたGaClと、ソースボード15、16で
生じたH2 以下の(7)で示す化学反応を起こした。
板22上に厚さ3μmのInGaAs受光層24を形成
した。
下側へ移動させてバッファタンク20に水素ガスを送り
込むことにより、図4で示すように基板22上に厚さ約
1.5μmのInP窓層25を形成した。これにより、
図3で示すように、基板22上にIII−V族化合物層
としてのエピタキシャル層26が形成されたウェハ21
をクロライドVPE法により製造した。
し、ウェハ21の面のうちエピタキシャル層26が成長
していない面27を真空吸引して保持した。粒度♯80
0で円弧半径0.25mmの図5で示すダイヤモンド砥
石を図3の矢印28で示す方向からウェハ21に接触さ
せ、ウェハ21の端縁からの距離が0.4mmの部分、
すなわち図3中のAで示す部分までを除去した。また、
仕上げ加工時の負荷低減と異常成長部を完全に除去する
ためにウェハ21のエッジからの距離が0.1mm以上
0.2mm以下の部分に面取りを施し、ウェハ21のエ
ッジをBで示す形状とした。
mmのダイヤモンド砥石を用いてウェハ21のエッジか
らの距離が0.1mmの部分を除去し、ウェハ21のエ
ッジをCで示す形状とした。また、ウェハ21のエッジ
からの距離が0.2〜0.25mmの部分の面取りを行
ないウェハ21のエッジをDで示す形状とした。ウェハ
21の端面の表面粗さRmaxが2.0μm以下とな
り、ウェハ21の直径が50mmとなり、本発明による
ウェハが完成した。以上のようにして製造したウェハを
デバイスプロセスに投入したところ、従来発生していた
割れの発生率が約1/5となった。
の平面図である。図7は図6中のVII−VII線に沿
ってみたへき開断面図である。図8は、異常成長部を除
去していないウェハの図6で示す部分に相当するへき開
断面図である。図7で示すこの発明のウェハ101は、
基板103とエピタキシャル層104により構成され、
ウェハの外周部102での異常成長部が除去できている
ことがわかる。また、図7で示す本発明のウェハ101
では、外周部102に歪がないため、多数の線状の傷が
発生していないことがわかる。一方、異常成長部を除去
していない図8で示すウェハ201は、基板203とエ
ピタキシャル層204により構成され、外周部202の
歪により生ずる多数の線状の傷205が発生しているこ
とがわかる。また、ウェハ201では、異常成長部で
は、平坦部に比べてエピタキシャル膜が約3倍の厚さと
なっている。このことからも、本発明では、異常成長部
を除去することによりウェハの周辺部の歪が有効に除去
されていることがわかる。
が、この実施例についてはさまざまに変形が可能であ
る。まず、最初に準備する基板の直径は51mmとした
が、これは、基板の直径が50mmよりも小さくなると
50mm用にセットされたデバイスプロセス工程で装置
がウェハをつかみ損ねるなどの問題を回避するためであ
る。そのため、ハンドリングでウェハを搬送する場合に
は、基板の径を51mmとする必要はない。
用いたクロライドVPE法は、エピタキシャル層を高速
成長できるという点でpin−PDのような比較的厚い
エピタキシャル層を必要とする製品には有利であるが、
厚いエピタキシャル層を必要としない場合には有機金属
気相成長法によりエピタキシャル層を製造してもよい。
また、この発明は、エピタキシャル層の成長速度の面方
位依存性を持ったエピタキシャル成長法、すなわち、ハ
イドライド法、有機金属法などのすべての成長法に適用
することができる。
工精度を向上させるため2種類の粒度を有し、一体化し
た砥石を使うことが望ましい。また、ウェハの端部を除
去する際にはエピタキシャル層と砥石が接触するが、砥
石と接触したエピタキシャル層は砥石と接触した後洗浄
することが好ましい。また、エピタキシャル層の端部以
外をレジストまたはテープなどで保護し、端部を除去し
た後このレジストやテープなどを除去してもよい。 ま
た、基板として、InPのみならず、結晶構造が同一で
ある他のIII−V族化合物を用いてもよい。今回開示
された実施例および実施の形態はすべての点で例示であ
って制限的なものではないと考えられるべきである。本
発明の範囲は上記した説明ではなくて特許請求の範囲に
よって示され、特許請求の範囲と均等の意味および範囲
内でのすべての変更が含まれることが意図される。
異常成長部がなくなり、プロセス中における割れが少な
いIII−V族化合物半導体ウェハが得られる。その結
果、このウェハを使用することにより、素子を製造する
際のプロセスでの歩留りが向上するという効果が得られ
る。
ある。
(A)は装置の構成を示す模式図であり、(B)は反応
器内の温度分布を示す図である。
図である。
る。
断面図である。
Claims (6)
- 【請求項1】 断面がほぼ半径Rの円弧形状を有するよ
うに外周縁部が面取りされた、III−V族化合物から
なる半導体基板と、この基板上に形成されたIII−V
族化合物層とを備えたIII−V族化合物半導体ウェハ
において、 前記III−V族化合物半導体ウェハ上の外周端縁から
距離Lだけ離れた位置までの部分が除去されており、 距離Lが式R≦L≦3Rを満足することを特徴とする、
III−V族化合物半導体ウェハ。 - 【請求項2】 前記III−V族化合物層は、前記基板
の主表面にほぼ平行な面として(100)面を有するよ
うに形成されていることを特徴とする、請求項1に記載
のIII−V族化合物半導体ウェハ。 - 【請求項3】 除去されて形成された前記III−V族
化合物半導体ウェハの外周端縁の表面粗さRmaxが2
μm以下であることを特徴とする、請求項1または2に
記載のIII−V族化合物半導体ウェハ。 - 【請求項4】 III−V族化合物からなる半導体基板
と、この半導体基板上に形成されたIII−V族化合物
層とを備えたIII−V族化合物半導体ウェハにおい
て、 前記III−V族化合物半導体ウェハの外周縁部でエピ
タキシャル異常成長部が除去されていることを特徴とす
る、III−V族化合物半導体ウェハ。 - 【請求項5】 前記III−V族化合物半導体ウェハの
外周端縁からの距離が0.1mmまでの部分では前記半
導体基板が露出していることを特徴とする、請求項4に
記載のIII−V族化合物半導体ウェハ。 - 【請求項6】 断面がほぼ半径rの円弧形状を有するよ
うに前記III−V族化合物半導体ウェハの外周縁部が
面取りされており、前記半径rは0.1mm以上である
ことを特徴とする、請求項4に記載のIII−V族化合
物半導体ウェハ。
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Cited By (6)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2006203071A (ja) * | 2005-01-21 | 2006-08-03 | Sumitomo Electric Ind Ltd | Iii−v族化合物半導体単結晶基板 |
US7217640B2 (en) | 2003-05-16 | 2007-05-15 | Kabushiki Kaisha Toshiba | Semiconductor device and manufacturing method thereof |
JP2016028009A (ja) * | 2015-09-02 | 2016-02-25 | 住友電気工業株式会社 | 炭化珪素基板および炭化珪素半導体装置ならびに炭化珪素基板および炭化珪素半導体装置の製造方法 |
US9691608B2 (en) | 2013-05-29 | 2017-06-27 | Sumitomo Electric Industries, Ltd. | Silicon carbide substrate, silicon carbide semiconductor device, and methods for manufacturing silicon carbide substrate and silicon carbide semiconductor device |
JP2022098256A (ja) * | 2020-12-21 | 2022-07-01 | Jx金属株式会社 | リン化インジウム基板、リン化インジウム基板の製造方法及び半導体エピタキシャルウエハ |
WO2023171536A1 (ja) * | 2022-03-10 | 2023-09-14 | 信越半導体株式会社 | Iii族窒化物半導体ウエーハ及びその製造方法 |
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---|---|---|---|---|
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US7258931B2 (en) * | 2002-08-29 | 2007-08-21 | Samsung Electronics Co., Ltd. | Semiconductor wafers having asymmetric edge profiles that facilitate high yield processing by inhibiting particulate contamination |
DE10302611B4 (de) * | 2003-01-23 | 2011-07-07 | Siltronic AG, 81737 | Polierte Halbleiterscheibe und Verfahren zu deren Herstellung und Anordnung bestehend aus einer Halbleiterscheibe und einem Schild |
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JP2005026413A (ja) * | 2003-07-01 | 2005-01-27 | Renesas Technology Corp | 半導体ウエハ、半導体素子およびその製造方法 |
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WO2009060913A1 (ja) * | 2007-11-08 | 2009-05-14 | Sumco Corporation | エピタキシャルウェーハの製造方法 |
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Family Cites Families (17)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US4054010A (en) * | 1976-01-20 | 1977-10-18 | Headway Research, Inc. | Apparatus for grinding edges of planar workpieces |
JPS5425185A (en) | 1977-07-27 | 1979-02-24 | Matsushita Electric Ind Co Ltd | Semiconductor laser device and its manufacture |
FR2493604A1 (fr) * | 1980-10-31 | 1982-05-07 | Thomson Csf | Transistors a effet de champ a grille ultra courte |
JPS58103144A (ja) | 1981-12-15 | 1983-06-20 | Matsushita Electronics Corp | 半導体装置 |
US5225235A (en) * | 1987-05-18 | 1993-07-06 | Osaka Titanium Co., Ltd. | Semiconductor wafer and manufacturing method therefor |
US4925809A (en) * | 1987-05-23 | 1990-05-15 | Osaka Titanium Co., Ltd. | Semiconductor wafer and epitaxial growth on the semiconductor wafer with autodoping control and manufacturing method therefor |
JP2645478B2 (ja) | 1988-10-07 | 1997-08-25 | 富士通株式会社 | 半導体装置の製造方法 |
EP0416128B1 (en) * | 1989-03-17 | 1995-05-24 | Sumitomo Electric Industries Limited | Wafer of compound semiconductor |
DE4033683A1 (de) | 1989-11-30 | 1991-06-06 | Motorola Inc | Verfahren zur herstellung von wafern mit einer epitaxialen schicht |
DE4033283A1 (de) * | 1990-10-19 | 1992-04-23 | Swf Auto Electric Gmbh | Scheibenwischeranlage, insbesondere fuer kraftfahrzeuge |
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JPH05259016A (ja) * | 1992-03-12 | 1993-10-08 | Mitsubishi Electric Corp | ウエハ作製用基板及び半導体ウエハの製造方法 |
JP2825048B2 (ja) | 1992-08-10 | 1998-11-18 | 信越半導体株式会社 | 半導体シリコン基板 |
JP2759594B2 (ja) * | 1993-01-30 | 1998-05-28 | 信越半導体株式会社 | エピタキシャル基板の製造方法 |
JP2827885B2 (ja) * | 1994-02-12 | 1998-11-25 | 信越半導体株式会社 | 半導体単結晶基板およびその製造方法 |
US5532173A (en) | 1994-07-14 | 1996-07-02 | The United States Of America As Represented By The Secretary Of The Air Force | FET optical receiver using backside illumination, indium materials species |
JPH08162420A (ja) | 1994-12-08 | 1996-06-21 | Sharp Corp | エピタキシャルウエハの製造方法 |
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Cited By (8)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US7217640B2 (en) | 2003-05-16 | 2007-05-15 | Kabushiki Kaisha Toshiba | Semiconductor device and manufacturing method thereof |
US7638858B2 (en) | 2003-05-16 | 2009-12-29 | Kabushiki Kaisha Toshiba | Semiconductor device and manufacturing method thereof |
JP2006203071A (ja) * | 2005-01-21 | 2006-08-03 | Sumitomo Electric Ind Ltd | Iii−v族化合物半導体単結晶基板 |
US9691608B2 (en) | 2013-05-29 | 2017-06-27 | Sumitomo Electric Industries, Ltd. | Silicon carbide substrate, silicon carbide semiconductor device, and methods for manufacturing silicon carbide substrate and silicon carbide semiconductor device |
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JP2022098256A (ja) * | 2020-12-21 | 2022-07-01 | Jx金属株式会社 | リン化インジウム基板、リン化インジウム基板の製造方法及び半導体エピタキシャルウエハ |
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