JPH1031200A - 液晶駆動用分割電圧発生器 - Google Patents
液晶駆動用分割電圧発生器Info
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- JPH1031200A JPH1031200A JP18773796A JP18773796A JPH1031200A JP H1031200 A JPH1031200 A JP H1031200A JP 18773796 A JP18773796 A JP 18773796A JP 18773796 A JP18773796 A JP 18773796A JP H1031200 A JPH1031200 A JP H1031200A
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Abstract
(57)【要約】
【解決手段】直列接続された分圧抵抗Ｒ１〜Ｒ５により
電圧供給源１の電圧が分圧され、これにより得られた電
圧がボルテージフォロア接続された演算増幅器ＯＰ１〜
ＯＰ４を介して液晶ドライバに供給される。コンデンサ
Ｃ１が電圧供給源の正側電位と負側電位との中点近傍の
電位を保持し、トランジスタＴｎとＴｐはＣ１が保持す
る中間電位Ｖｘを所定の範囲内に収める働きをする。高
電圧側の演算増幅器ＯＰ１・ＯＰ２の電源端子には電圧
供給源の正側電位とＶｘを接続し、低電圧側の演算増幅
器ＯＰ３・ＯＰ４の電源端子にはＶｘと電圧供給源の負
側電位を接続する。 【効果】低消費電力化の効果を維持したまま液晶駆動用
分割電圧発生ＩＣを低コスト化できる。
電圧供給源１の電圧が分圧され、これにより得られた電
圧がボルテージフォロア接続された演算増幅器ＯＰ１〜
ＯＰ４を介して液晶ドライバに供給される。コンデンサ
Ｃ１が電圧供給源の正側電位と負側電位との中点近傍の
電位を保持し、トランジスタＴｎとＴｐはＣ１が保持す
る中間電位Ｖｘを所定の範囲内に収める働きをする。高
電圧側の演算増幅器ＯＰ１・ＯＰ２の電源端子には電圧
供給源の正側電位とＶｘを接続し、低電圧側の演算増幅
器ＯＰ３・ＯＰ４の電源端子にはＶｘと電圧供給源の負
側電位を接続する。 【効果】低消費電力化の効果を維持したまま液晶駆動用
分割電圧発生ＩＣを低コスト化できる。
Description
【０００１】
【発明の属する技術分野】本発明は、単純マトリックス
液晶表示パネルの駆動に必要な多レベルの電圧を発生さ
せる液晶駆動用分割電圧発生器に関する。
液晶表示パネルの駆動に必要な多レベルの電圧を発生さ
せる液晶駆動用分割電圧発生器に関する。
【０００２】
【従来の技術】通常、単純マトリックス液晶表示パネル
を駆動する場合は液晶駆動用分割電圧発生器により６レ
ベルの電圧を発生させ、この６レベルの電圧を液晶ドラ
イバを介して液晶表示パネルに供給して駆動する。この
ような液晶駆動用分割電圧発生器の中で特に低消費電力
化を狙ったものとして、特開平８−５４５９９号公報の
実施例２及び図６に記載されたものが知られている。
を駆動する場合は液晶駆動用分割電圧発生器により６レ
ベルの電圧を発生させ、この６レベルの電圧を液晶ドラ
イバを介して液晶表示パネルに供給して駆動する。この
ような液晶駆動用分割電圧発生器の中で特に低消費電力
化を狙ったものとして、特開平８−５４５９９号公報の
実施例２及び図６に記載されたものが知られている。
【０００３】以下にこの方式の液晶駆動用分割電圧発生
器の回路図の例である図５について説明する。図５の分
割電圧発生回路は直流電源１と分割電圧発生ＩＣ１２お
よび外付けコンデンサとで構成されている。直流電源１
から得られた電圧が直列接続された抵抗Ｒ１〜Ｒ５にて
分割され、この分割された電圧がボルテージフォロア接
続された演算増幅器ＯＰ１〜ＯＰ４に入力される。ＯＰ
１〜ＯＰ４の出力であるＶ１〜Ｖ４および直流電源１自
体の電圧であるＶ０とＶ５の合計６レベルの電圧が液晶
表示パネルを駆動する電圧となる。Ｖ０〜Ｖ５にはほぼ
Ｖ０−Ｖ１＝Ｖ１−Ｖ２＝Ｖ３−Ｖ４＝Ｖ４−Ｖ５とい
う関係があり、液晶のスレッショールド電圧や駆動デュ
ーティによるが、Ｖ０−Ｖ１は１Ｖ〜２Ｖ程度、Ｖ０−
Ｖ５は１０Ｖ強〜４０Ｖ程度である。定電圧ダイオード
Ｄ１はＶ０−Ｖ５を２等分した電位近傍の中間電位Ｖｃ
を発生する手段であり、数μＦのコンデンサＣ１と直列
接続されてＶ０−Ｖ５間に挿入されている。高電圧側で
動作する演算増幅器ＯＰ１とＯＰ２の電源端子は正側が
Ｖ０に接続され、負側が中間電位Ｖｃに接続されてい
る。低電圧側で動作する演算増幅器ＯＰ３とＯＰ４の電
源端子は正側が中間電位Ｖｃに接続され、負側がＶ５に
接続されている。ＯＰ１〜ＯＰ４すべてをＶ０−Ｖ５の
電圧で動作させる場合と比べて、このような回路構成に
すれば各演算増幅器の動作電圧が直流電源１の電圧の約
半分となるので演算増幅器自体の消費電力が低減できる
と同時に、液晶を高電圧側の演算増幅器で駆動する期間
の消費電流による電荷が一旦コンデンサＣ１に蓄えら
れ、次に液晶を逆極性で駆動する期間すなわち低電圧側
の演算増幅器で駆動する期間はこのコンデンサＣ１に蓄
えられていた電荷で低電圧側の演算増幅器を動作させる
ことができるため、液晶表示パネルの充放電による消費
電力を半分近くまで低減することができる。
器の回路図の例である図５について説明する。図５の分
割電圧発生回路は直流電源１と分割電圧発生ＩＣ１２お
よび外付けコンデンサとで構成されている。直流電源１
から得られた電圧が直列接続された抵抗Ｒ１〜Ｒ５にて
分割され、この分割された電圧がボルテージフォロア接
続された演算増幅器ＯＰ１〜ＯＰ４に入力される。ＯＰ
１〜ＯＰ４の出力であるＶ１〜Ｖ４および直流電源１自
体の電圧であるＶ０とＶ５の合計６レベルの電圧が液晶
表示パネルを駆動する電圧となる。Ｖ０〜Ｖ５にはほぼ
Ｖ０−Ｖ１＝Ｖ１−Ｖ２＝Ｖ３−Ｖ４＝Ｖ４−Ｖ５とい
う関係があり、液晶のスレッショールド電圧や駆動デュ
ーティによるが、Ｖ０−Ｖ１は１Ｖ〜２Ｖ程度、Ｖ０−
Ｖ５は１０Ｖ強〜４０Ｖ程度である。定電圧ダイオード
Ｄ１はＶ０−Ｖ５を２等分した電位近傍の中間電位Ｖｃ
を発生する手段であり、数μＦのコンデンサＣ１と直列
接続されてＶ０−Ｖ５間に挿入されている。高電圧側で
動作する演算増幅器ＯＰ１とＯＰ２の電源端子は正側が
Ｖ０に接続され、負側が中間電位Ｖｃに接続されてい
る。低電圧側で動作する演算増幅器ＯＰ３とＯＰ４の電
源端子は正側が中間電位Ｖｃに接続され、負側がＶ５に
接続されている。ＯＰ１〜ＯＰ４すべてをＶ０−Ｖ５の
電圧で動作させる場合と比べて、このような回路構成に
すれば各演算増幅器の動作電圧が直流電源１の電圧の約
半分となるので演算増幅器自体の消費電力が低減できる
と同時に、液晶を高電圧側の演算増幅器で駆動する期間
の消費電流による電荷が一旦コンデンサＣ１に蓄えら
れ、次に液晶を逆極性で駆動する期間すなわち低電圧側
の演算増幅器で駆動する期間はこのコンデンサＣ１に蓄
えられていた電荷で低電圧側の演算増幅器を動作させる
ことができるため、液晶表示パネルの充放電による消費
電力を半分近くまで低減することができる。
【０００４】ここで、中間電位Ｖｃの挙動について説明
する。なお、定電圧ダイオードＤ１の降伏電圧をＶｂと
表すこととする。電源投入時にＶｃの電位はコンデンサ
Ｃ１に引きずられて瞬間的にＶ５の電位に近づくが、す
ぐに定電圧ダイオードＤ１が働いてＶ０−Ｖｃ＝Ｖｂを
満足する電位まで上昇し、この電位がＶｃの下限電位と
なる。以後は、液晶の交流駆動に対応して、液晶を高電
圧側の演算増幅器で駆動する期間はＯＰ１とＯＰ２の負
側電源端子から流出する電流でＣ１が充電されてＶｃの
電位は緩やかに上昇し、液晶を低電圧側の演算増幅器で
駆動する期間はＣ１からＯＰ３とＯＰ４の正側電源端子
へ流出する電流でＣ１が放電されてＶｃの電位は緩やか
に下降するという挙動を繰り返す。定常表示状態でのＶ
ｃの変動幅はＣ１の容量値や表示パネルのサイズおよび
表示パターン等によって異なる。ＯＰ１とＯＰ２が正常
動作するためにはＶｃはＶ２より２Ｖ以上低いことが必
要であり、ＯＰ３とＯＰ４が正常動作するためにはＶｃ
はＶ３より２Ｖ以上高いことが必要である。ＯＰ１とＯ
Ｐ２の負側電源端子から流出する電流の平均とＯＰ３と
ＯＰ４の正側電源端子へ流入する電流の平均とは基本的
には同じはずであるが、実際には少しアンバランスがあ
るのでＤ１とＣ１だけではＶｃの電位がＯＰ１〜ＯＰ４
が正常動作できる範囲から徐々に飛び出してしまうとい
う不都合の起こることがある。トランジスタＴｎとＴｐ
はこの不都合を防止するためのもので、中間電位Ｖｃを
所定の電圧範囲内に収めるように制御する働きをする。
ＶｃがＶ０−Ｖ５の中点電位近傍にある場合はＴｎとＴ
ｐは共にオフしている。Ｖｃの電位がＲ３ＭとＲ３Ｌの
交点の電位よりも約０．６Ｖ以上低くなるとＴｎがオン
してＶｃ電位のそれ以上の低下を食い止めようとし、ま
た、Ｖｃの電位がＲ３ＵとＲ３Ｍの交点の電位よりも約
０．６Ｖ以上高くなるとＴｐがオンしてＶｃ電位のそれ
以上の上昇を食い止めようとするのでＶｃは所定の電圧
範囲内に収まる。Ｖｃの実際の下限電位はＲ３ＭとＲ３
Ｌの交点の電位−約０．６ＶとＶ０−Ｖｂとの高い方に
なる。
する。なお、定電圧ダイオードＤ１の降伏電圧をＶｂと
表すこととする。電源投入時にＶｃの電位はコンデンサ
Ｃ１に引きずられて瞬間的にＶ５の電位に近づくが、す
ぐに定電圧ダイオードＤ１が働いてＶ０−Ｖｃ＝Ｖｂを
満足する電位まで上昇し、この電位がＶｃの下限電位と
なる。以後は、液晶の交流駆動に対応して、液晶を高電
圧側の演算増幅器で駆動する期間はＯＰ１とＯＰ２の負
側電源端子から流出する電流でＣ１が充電されてＶｃの
電位は緩やかに上昇し、液晶を低電圧側の演算増幅器で
駆動する期間はＣ１からＯＰ３とＯＰ４の正側電源端子
へ流出する電流でＣ１が放電されてＶｃの電位は緩やか
に下降するという挙動を繰り返す。定常表示状態でのＶ
ｃの変動幅はＣ１の容量値や表示パネルのサイズおよび
表示パターン等によって異なる。ＯＰ１とＯＰ２が正常
動作するためにはＶｃはＶ２より２Ｖ以上低いことが必
要であり、ＯＰ３とＯＰ４が正常動作するためにはＶｃ
はＶ３より２Ｖ以上高いことが必要である。ＯＰ１とＯ
Ｐ２の負側電源端子から流出する電流の平均とＯＰ３と
ＯＰ４の正側電源端子へ流入する電流の平均とは基本的
には同じはずであるが、実際には少しアンバランスがあ
るのでＤ１とＣ１だけではＶｃの電位がＯＰ１〜ＯＰ４
が正常動作できる範囲から徐々に飛び出してしまうとい
う不都合の起こることがある。トランジスタＴｎとＴｐ
はこの不都合を防止するためのもので、中間電位Ｖｃを
所定の電圧範囲内に収めるように制御する働きをする。
ＶｃがＶ０−Ｖ５の中点電位近傍にある場合はＴｎとＴ
ｐは共にオフしている。Ｖｃの電位がＲ３ＭとＲ３Ｌの
交点の電位よりも約０．６Ｖ以上低くなるとＴｎがオン
してＶｃ電位のそれ以上の低下を食い止めようとし、ま
た、Ｖｃの電位がＲ３ＵとＲ３Ｍの交点の電位よりも約
０．６Ｖ以上高くなるとＴｐがオンしてＶｃ電位のそれ
以上の上昇を食い止めようとするのでＶｃは所定の電圧
範囲内に収まる。Ｖｃの実際の下限電位はＲ３ＭとＲ３
Ｌの交点の電位−約０．６ＶとＶ０−Ｖｂとの高い方に
なる。
【０００５】分圧抵抗Ｒ１〜Ｒ５の抵抗値は、Ｒ１＝Ｒ
２＝Ｒ４＝Ｒ５＝１５ＫΩ前後であり、Ｒ３Ｕ，Ｒ３
Ｌ，Ｒ３Ｍを含めたＲ１〜Ｒ５の直列抵抗値は最大で４
００ＫΩ前後である。これらの抵抗はＴｎとＴｐにベー
ス電流を供給する必要があるため、余り大きくはできな
い。
２＝Ｒ４＝Ｒ５＝１５ＫΩ前後であり、Ｒ３Ｕ，Ｒ３
Ｌ，Ｒ３Ｍを含めたＲ１〜Ｒ５の直列抵抗値は最大で４
００ＫΩ前後である。これらの抵抗はＴｎとＴｐにベー
ス電流を供給する必要があるため、余り大きくはできな
い。
【０００６】なお、Ｒ１１〜Ｒ１４は各々２５Ω前後の
抵抗であり、演算増幅器ＯＰ１〜ＯＰ４の動作を安定化
して演算増幅器の動作電流を低減する働きをしている。
また、Ｃ１１〜Ｃ１４は各々数μＦのコンデンサであ
り、Ｖ１〜Ｖ４のレベルを安定化する働きをしている。
抵抗であり、演算増幅器ＯＰ１〜ＯＰ４の動作を安定化
して演算増幅器の動作電流を低減する働きをしている。
また、Ｃ１１〜Ｃ１４は各々数μＦのコンデンサであ
り、Ｖ１〜Ｖ４のレベルを安定化する働きをしている。
【０００７】
【発明が解決しようとする課題】ところが、上述した従
来の液晶駆動用分割電圧発生器においては、中間電位発
生手段として定電圧ダイオードを具備しているため、液
晶駆動用分割電圧発生ＩＣの製造工程が複雑となり高コ
ストになるという問題がある。中間電位発生手段は入力
電源電圧をほぼ２等分した電位を発生させることが目的
であるが、前述したように液晶駆動用分割電圧発生ＩＣ
は汎用化のために１０Ｖ強〜４０Ｖの動作電圧範囲を確
保する必要があり、それに対応して降伏電圧が異なる数
種類の定電圧ダイオードをＩＣに内蔵して切換え使用で
きるようにしておかなければならないため、ＩＣはかな
り高コストになる。
来の液晶駆動用分割電圧発生器においては、中間電位発
生手段として定電圧ダイオードを具備しているため、液
晶駆動用分割電圧発生ＩＣの製造工程が複雑となり高コ
ストになるという問題がある。中間電位発生手段は入力
電源電圧をほぼ２等分した電位を発生させることが目的
であるが、前述したように液晶駆動用分割電圧発生ＩＣ
は汎用化のために１０Ｖ強〜４０Ｖの動作電圧範囲を確
保する必要があり、それに対応して降伏電圧が異なる数
種類の定電圧ダイオードをＩＣに内蔵して切換え使用で
きるようにしておかなければならないため、ＩＣはかな
り高コストになる。
【０００８】なお、中間電位発生手段として定電圧ダイ
オードではなく、Ｖ０−Ｖｃ間およびＶｃ−Ｖ５間に抵
抗を設けるという分圧回路を用いることも可能である。
この場合はＩＣへの内蔵はかなり容易であるが、この分
圧抵抗により消費電力が増大してしまうという問題があ
る。
オードではなく、Ｖ０−Ｖｃ間およびＶｃ−Ｖ５間に抵
抗を設けるという分圧回路を用いることも可能である。
この場合はＩＣへの内蔵はかなり容易であるが、この分
圧抵抗により消費電力が増大してしまうという問題があ
る。
【０００９】
【課題を解決するための手段】上記の課題を解決するた
めに、本発明の液晶駆動用分割電圧発生器は、直列接続
された複数個の分圧抵抗により電圧供給源の電圧が分圧
され、これにより得られた電圧がボルテージフォロア接
続された各演算増幅器を介して液晶ドライバに供給され
る液晶駆動用分割電圧発生器において、前記電圧供給源
は単一の電圧供給源からなり、前記電圧供給源の正側電
位と負側電位との中点近傍の電位を保持するコンデンサ
と、そのコンデンサで保持される中間電位を所定の範囲
内に収める電圧制御手段とを備え、前記演算増幅器の内
で高電圧側の演算増幅器の電源端子には前記電圧供給源
の正側電位と前記中間電位とが接続され、低電圧側の演
算増幅器の電源端子には前記中間電位と前記電圧供給源
の負側電位とが接続されていることを特徴としている。
めに、本発明の液晶駆動用分割電圧発生器は、直列接続
された複数個の分圧抵抗により電圧供給源の電圧が分圧
され、これにより得られた電圧がボルテージフォロア接
続された各演算増幅器を介して液晶ドライバに供給され
る液晶駆動用分割電圧発生器において、前記電圧供給源
は単一の電圧供給源からなり、前記電圧供給源の正側電
位と負側電位との中点近傍の電位を保持するコンデンサ
と、そのコンデンサで保持される中間電位を所定の範囲
内に収める電圧制御手段とを備え、前記演算増幅器の内
で高電圧側の演算増幅器の電源端子には前記電圧供給源
の正側電位と前記中間電位とが接続され、低電圧側の演
算増幅器の電源端子には前記中間電位と前記電圧供給源
の負側電位とが接続されていることを特徴としている。
【００１０】
【発明の実施の形態】以下、本発明の実施形態を図面に
基づいて説明する。
基づいて説明する。
【００１１】（実施例１）図１は本発明による液晶駆動
用分割電圧発生器の第１の実施例を示す回路図である。
その構成は従来技術の項で説明した図５から単に中間電
位発生手段である定電圧ダイオードＤ１を削除したもの
である。従って、図５と同じ部分についての説明は省略
する。高電圧側演算増幅器の負側電源端子と低電圧側演
算増幅器の正側電源端子との接続点である中間電位は従
来は通常の直流電源端子のように極力一定の電位を保つ
ようにすることが良いと考えられていた。そのために定
電圧ダイオードや分圧回路等の中間電位発生手段が必要
とされていた。
用分割電圧発生器の第１の実施例を示す回路図である。
その構成は従来技術の項で説明した図５から単に中間電
位発生手段である定電圧ダイオードＤ１を削除したもの
である。従って、図５と同じ部分についての説明は省略
する。高電圧側演算増幅器の負側電源端子と低電圧側演
算増幅器の正側電源端子との接続点である中間電位は従
来は通常の直流電源端子のように極力一定の電位を保つ
ようにすることが良いと考えられていた。そのために定
電圧ダイオードや分圧回路等の中間電位発生手段が必要
とされていた。
【００１２】ところが、こうした中間電位発生手段を削
除しても液晶駆動用分割電圧発生ＩＣの機能や特性に悪
影響は全く無い。本発明の実施例の回路図においては中
間電位をＶｘと表してあるが、これは、中間電位を一定
の電位に保とうとする手段を備えていないため、Ｔｎと
Ｔｐによる電圧制御手段の範囲内ではあるが、中間電位
が基本的に不定であることを示している。中間電位Ｖｘ
は電源投入時には従来と同様にコンデンサＣ１に引きず
られて瞬間的にＶ５の電位に近づくが、すぐにＴｎがオ
ンしてＶｘの電位をＲ３ＭとＲ３Ｌの交点の電位−約
０．６Ｖまで引き上げ、この電位よりもＶｘが下がらな
いように働く。
除しても液晶駆動用分割電圧発生ＩＣの機能や特性に悪
影響は全く無い。本発明の実施例の回路図においては中
間電位をＶｘと表してあるが、これは、中間電位を一定
の電位に保とうとする手段を備えていないため、Ｔｎと
Ｔｐによる電圧制御手段の範囲内ではあるが、中間電位
が基本的に不定であることを示している。中間電位Ｖｘ
は電源投入時には従来と同様にコンデンサＣ１に引きず
られて瞬間的にＶ５の電位に近づくが、すぐにＴｎがオ
ンしてＶｘの電位をＲ３ＭとＲ３Ｌの交点の電位−約
０．６Ｖまで引き上げ、この電位よりもＶｘが下がらな
いように働く。
【００１３】また、Ｖｘの電位がＲ３ＵとＲ３Ｍの交点
の電位＋約０．６Ｖよりも高くなるとＴｐがオンしてＶ
ｘ電位のそれ以上の上昇を食い止めようとするのでＶｘ
は所定の電圧範囲内に収まる。つまり、従来のような中
間電位発生手段が無くてもＶｘ電位はＯＰ１〜ＯＰ４が
正常動作できる範囲内に収まる。このように、定電圧ダ
イオードや分圧回路等の中間電位発生手段を備えなくて
よいため、２の液晶駆動用分割電圧発生ＩＣは低消費電
力化の効果を全く損なうことなく低コスト化できる。
の電位＋約０．６Ｖよりも高くなるとＴｐがオンしてＶ
ｘ電位のそれ以上の上昇を食い止めようとするのでＶｘ
は所定の電圧範囲内に収まる。つまり、従来のような中
間電位発生手段が無くてもＶｘ電位はＯＰ１〜ＯＰ４が
正常動作できる範囲内に収まる。このように、定電圧ダ
イオードや分圧回路等の中間電位発生手段を備えなくて
よいため、２の液晶駆動用分割電圧発生ＩＣは低消費電
力化の効果を全く損なうことなく低コスト化できる。
【００１４】なお、本発明の実施例の回路図においては
コンデンサＣ１の接続先はＶ０となっているが、Ｖ５で
あってもかまわない。また、コンデンサを２つ用いてＶ
０とＶ５の両方に接続してもかまわない。
コンデンサＣ１の接続先はＶ０となっているが、Ｖ５で
あってもかまわない。また、コンデンサを２つ用いてＶ
０とＶ５の両方に接続してもかまわない。
【００１５】（実施例２）図２は本発明による液晶駆動
用分割電圧発生器の第２の実施例を示す回路図である。
ＴｎとＴｐのベース端子を短絡してあるため、図１の回
路に比べて中間電位Ｖｘの変動幅を狭い範囲に収めるこ
とが出来る。変動許容幅の中心電位はＶ０−Ｖ５を抵抗
Ｒ６とＲ７とで分圧した電位である。実際に液晶表示装
置を駆動した場合、中間電位Ｖｘの変動幅は最大でも２
Ｖ程度であるので、こうした回路でも良好に表示でき
る。なお、Ｒ６とＲ７の抵抗値は低消費電力化の観点か
らは大きくすべきだが、ＴｎとＴｐにベース電流を供給
する必要性から余り大きくはできず、各々２００ＫΩ程
度が好ましい。
用分割電圧発生器の第２の実施例を示す回路図である。
ＴｎとＴｐのベース端子を短絡してあるため、図１の回
路に比べて中間電位Ｖｘの変動幅を狭い範囲に収めるこ
とが出来る。変動許容幅の中心電位はＶ０−Ｖ５を抵抗
Ｒ６とＲ７とで分圧した電位である。実際に液晶表示装
置を駆動した場合、中間電位Ｖｘの変動幅は最大でも２
Ｖ程度であるので、こうした回路でも良好に表示でき
る。なお、Ｒ６とＲ７の抵抗値は低消費電力化の観点か
らは大きくすべきだが、ＴｎとＴｐにベース電流を供給
する必要性から余り大きくはできず、各々２００ＫΩ程
度が好ましい。
【００１６】（実施例３）図３は本発明による液晶駆動
用分割電圧発生器の第３の実施例を示す回路図である。
中間電位Ｖｘの変動幅を制御するトランジスタＴｎ１と
Ｔｎ２及びＴｐ１とＴｐ２を公知のダーリントン接続に
することで、 Ｔｎ１とＴｐ１のベース電流を小さくす
ることができ、従って、分圧抵抗の抵抗値を図１や図２
の回路に比べて３倍以上高く設定することができる。
用分割電圧発生器の第３の実施例を示す回路図である。
中間電位Ｖｘの変動幅を制御するトランジスタＴｎ１と
Ｔｎ２及びＴｐ１とＴｐ２を公知のダーリントン接続に
することで、 Ｔｎ１とＴｐ１のベース電流を小さくす
ることができ、従って、分圧抵抗の抵抗値を図１や図２
の回路に比べて３倍以上高く設定することができる。
【００１７】以下に本発明に基づいて作製した液晶駆動
用分割電圧発生ＩＣと、このＩＣを用いて液晶表示モジ
ュールを駆動した時の消費電力の測定結果について簡単
に述べる。実際にＩＣ化した回路は図３の回路ではな
く、図２の回路においてＴｎとＴｐをダーリントン接続
にしたもので、分圧抵抗の抵抗値はＲ１＝Ｒ２＝Ｒ４＝
Ｒ５＝４０ＫΩで、Ｒ３は駆動デューティにより適する
バイアス比が選択できるように２００ＫΩ〜８００ＫΩ
の範囲内で４０ＫΩ間隔で端子設定できるようにしてあ
り、Ｒ６とＲ７は各々４００ＫΩである。駆動した液晶
表示モジュールは表示ドット数が６４０×４８０のもの
と３２０×２４０のものの２種類であり、以下、前者を
ＶＧＡ、後者をＱＶＧＡと記す。いずれもモノクロ反射
型液晶表示モジュールで、ドットピッチはＶＧＡが０．
３ｍｍ、ＱＶＧＡが０．２４ｍｍであり、フレーム周波
数７５Ｈｚ，１／２４０デューティ，１／１３バイアス
で駆動した。液晶ドライバ部のロジック電圧は３．３Ｖ
で、データ転送はＶＧＡが４ビット×２画面、ＱＶＧＡ
が８ビットである。全画面に文字を最適コントラストで
表示した時の消費電力はＶＧＡが２９ｍＷ、ＱＶＧＡが
８．３ｍＷと従来に対して各々３０％以上低減した。こ
の時のＶ０−Ｖ５の値はＶＧＡが２２．３Ｖ、ＱＶＧＡ
が２１．１Ｖであった。なお、表示品位は両モジュール
とも良好であった。
用分割電圧発生ＩＣと、このＩＣを用いて液晶表示モジ
ュールを駆動した時の消費電力の測定結果について簡単
に述べる。実際にＩＣ化した回路は図３の回路ではな
く、図２の回路においてＴｎとＴｐをダーリントン接続
にしたもので、分圧抵抗の抵抗値はＲ１＝Ｒ２＝Ｒ４＝
Ｒ５＝４０ＫΩで、Ｒ３は駆動デューティにより適する
バイアス比が選択できるように２００ＫΩ〜８００ＫΩ
の範囲内で４０ＫΩ間隔で端子設定できるようにしてあ
り、Ｒ６とＲ７は各々４００ＫΩである。駆動した液晶
表示モジュールは表示ドット数が６４０×４８０のもの
と３２０×２４０のものの２種類であり、以下、前者を
ＶＧＡ、後者をＱＶＧＡと記す。いずれもモノクロ反射
型液晶表示モジュールで、ドットピッチはＶＧＡが０．
３ｍｍ、ＱＶＧＡが０．２４ｍｍであり、フレーム周波
数７５Ｈｚ，１／２４０デューティ，１／１３バイアス
で駆動した。液晶ドライバ部のロジック電圧は３．３Ｖ
で、データ転送はＶＧＡが４ビット×２画面、ＱＶＧＡ
が８ビットである。全画面に文字を最適コントラストで
表示した時の消費電力はＶＧＡが２９ｍＷ、ＱＶＧＡが
８．３ｍＷと従来に対して各々３０％以上低減した。こ
の時のＶ０−Ｖ５の値はＶＧＡが２２．３Ｖ、ＱＶＧＡ
が２１．１Ｖであった。なお、表示品位は両モジュール
とも良好であった。
【００１８】（実施例４）図４は本発明による液晶駆動
用分割電圧発生器の第４の実施例を示す回路図であり、
液晶駆動用分割電圧発生ＩＣをＣＭＯＳで構成する場合
の例である。ＭＯＳトランジスタの入力インピーダンス
は極めて高いため、Ｒ１〜Ｒ７を高抵抗にしてＲ１〜Ｒ
７による消費電力が無視し得る大きさになるようにする
ことができる。図４のようにＴｎとＴｐの基板電位をＶ
ｘに接続したＩＣは、製造工程がやや複雑にはなるが製
造可能である。Ｔｎの基板電位をＶ５とし、Ｔｐの基板
電位をＶ０とすれば、ＴｎとＴｐのスレッショールド電
圧がバックゲート効果でかなり高くなるので、Ｖｘの変
動幅を小さい範囲に収めることは困難となるが、それで
も動作上は問題は無く、ＩＣ製造工程も複雑化しない。
用分割電圧発生器の第４の実施例を示す回路図であり、
液晶駆動用分割電圧発生ＩＣをＣＭＯＳで構成する場合
の例である。ＭＯＳトランジスタの入力インピーダンス
は極めて高いため、Ｒ１〜Ｒ７を高抵抗にしてＲ１〜Ｒ
７による消費電力が無視し得る大きさになるようにする
ことができる。図４のようにＴｎとＴｐの基板電位をＶ
ｘに接続したＩＣは、製造工程がやや複雑にはなるが製
造可能である。Ｔｎの基板電位をＶ５とし、Ｔｐの基板
電位をＶ０とすれば、ＴｎとＴｐのスレッショールド電
圧がバックゲート効果でかなり高くなるので、Ｖｘの変
動幅を小さい範囲に収めることは困難となるが、それで
も動作上は問題は無く、ＩＣ製造工程も複雑化しない。
【００１９】
【発明の効果】本発明によれば、定電圧ダイオードや分
圧回路等の中間電位発生手段を備えなくてよいため、低
消費電力化の効果を維持したまま液晶駆動用分割電圧発
生ＩＣを低コスト化できる。
圧回路等の中間電位発生手段を備えなくてよいため、低
消費電力化の効果を維持したまま液晶駆動用分割電圧発
生ＩＣを低コスト化できる。
【図１】本発明の一実施例を示す液晶駆動用分割電圧発
生器の回路図。
生器の回路図。
【図２】本発明の他の実施例を示す液晶駆動用分割電圧
発生器の回路図。
発生器の回路図。
【図３】本発明のさらに他の実施例を示す液晶駆動用分
割電圧発生器の回路図。
割電圧発生器の回路図。
【図４】本発明のさらに他の実施例を示す液晶駆動用分
割電圧発生器の回路図。
割電圧発生器の回路図。
【図５】従来の液晶駆動用分割電圧発生器の回路図。
１…電圧供給源 ２，１２…液晶駆動用分割電圧発生ＩＣ Ｒ１〜Ｒ７，Ｒ３Ｕ，Ｒ３Ｍ、Ｒ３Ｌ，Ｒ１１〜Ｒ１４
…抵抗 ＯＰ１〜ＯＰ４…演算増幅器 Ｃ１，Ｃ１１〜Ｃ１４…コンデンサ Ｔｎ，Ｔｎ１，Ｔｎ２，Ｔｐ，Ｔｐ１，Ｔｐ２…トラン
ジスタ Ｄ１…定電圧ダイオード
…抵抗 ＯＰ１〜ＯＰ４…演算増幅器 Ｃ１，Ｃ１１〜Ｃ１４…コンデンサ Ｔｎ，Ｔｎ１，Ｔｎ２，Ｔｐ，Ｔｐ１，Ｔｐ２…トラン
ジスタ Ｄ１…定電圧ダイオード
Claims (1)
- 【請求項１】直列接続された複数個の分圧抵抗により電
圧供給源の電圧が分圧され、これにより得られた電圧が
ボルテージフォロア接続された各演算増幅器を介して液
晶ドライバに供給される液晶駆動用分割電圧発生器にお
いて、前記電圧供給源は単一の電圧供給源からなる一
方、前記電圧供給源の正側電位と負側電位との中点近傍
の電位を保持するコンデンサと、そのコンデンサで保持
される中間電位を所定の範囲内に収める電圧制御手段と
を備え、前記演算増幅器の内で高電圧側の演算増幅器の
電源端子には前記電圧供給源の正側電位と前記中間電位
とが接続され、低電圧側の演算増幅器の電源端子には前
記中間電位と前記電圧供給源の負側電位とが接続されて
いることを特徴とする液晶駆動用分割電圧発生器。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP18773796A JPH1031200A (ja) | 1996-07-17 | 1996-07-17 | 液晶駆動用分割電圧発生器 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP18773796A JPH1031200A (ja) | 1996-07-17 | 1996-07-17 | 液晶駆動用分割電圧発生器 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH1031200A true JPH1031200A (ja) | 1998-02-03 |
Family
ID=16211318
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP18773796A Withdrawn JPH1031200A (ja) | 1996-07-17 | 1996-07-17 | 液晶駆動用分割電圧発生器 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH1031200A (ja) |
Cited By (11)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2000235727A (ja) * | 1998-12-15 | 2000-08-29 | Matsushita Electric Ind Co Ltd | 光学素子ならびにこれを用いた光ヘッドおよび光記録再生装置 |
| US6344984B1 (en) | 1999-09-03 | 2002-02-05 | Nec Corporation | Voltage multiplier having an intermediate tap |
| JP2002182617A (ja) * | 2000-12-18 | 2002-06-26 | Kyocera Corp | 液晶駆動用電圧発生回路および液晶表示装置 |
| US6501467B2 (en) | 1998-06-08 | 2002-12-31 | Nec Corporation | Liquid-crystal display panel drive power supply circuit |
| JP2003518702A (ja) * | 1999-12-24 | 2003-06-10 | コーニンクレッカ フィリップス エレクトロニクス エヌ ヴィ | 光走査ヘッド |
| US7138971B2 (en) | 2001-03-09 | 2006-11-21 | Nec Electronics Corp. | Power supply circuit for driving liquid crystal display |
| US7397680B2 (en) | 2001-11-27 | 2008-07-08 | Power Integrations, Inc. | Method and apparatus for balancing active capacitor leakage current |
| JP2009194485A (ja) * | 2008-02-12 | 2009-08-27 | Nec Electronics Corp | 演算増幅器回路、及び表示装置 |
| WO2012123996A1 (ja) * | 2011-03-15 | 2012-09-20 | パナソニック株式会社 | 階調電圧発生回路及び表示装置 |
| WO2012123995A1 (ja) * | 2011-03-15 | 2012-09-20 | パナソニック株式会社 | 階調電圧発生回路及び表示装置 |
| WO2019172168A1 (ja) * | 2018-03-08 | 2019-09-12 | 日本電信電話株式会社 | 増幅回路 |
-
1996
- 1996-07-17 JP JP18773796A patent/JPH1031200A/ja not_active Withdrawn
Cited By (13)
| Publication number | Priority date | Publication date | Assignee | Title |
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| US8310422B2 (en) | 2008-02-12 | 2012-11-13 | Renesas Electronics Corporation | Operational amplifier circuit and display apparatus using the same |
| WO2012123996A1 (ja) * | 2011-03-15 | 2012-09-20 | パナソニック株式会社 | 階調電圧発生回路及び表示装置 |
| WO2012123995A1 (ja) * | 2011-03-15 | 2012-09-20 | パナソニック株式会社 | 階調電圧発生回路及び表示装置 |
| WO2019172168A1 (ja) * | 2018-03-08 | 2019-09-12 | 日本電信電話株式会社 | 増幅回路 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A300 | Withdrawal of application because of no request for examination |
Free format text: JAPANESE INTERMEDIATE CODE: A300 Effective date: 20031007 |