JPH10256478A - 半導体集積回路装置 - Google Patents
半導体集積回路装置Info
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- JPH10256478A JPH10256478A JP5620697A JP5620697A JPH10256478A JP H10256478 A JPH10256478 A JP H10256478A JP 5620697 A JP5620697 A JP 5620697A JP 5620697 A JP5620697 A JP 5620697A JP H10256478 A JPH10256478 A JP H10256478A
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- Japan
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- block
- data
- antenna
- integrated circuit
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Abstract
(57)【要約】
【課題】 チップサイズが増大することおよび信頼性が
低下することを可及的に防止するとともに全ての機能ブ
ロックが効率良く動作することを可能にする。 【解決手段】 各々が、データおよび制御信号に基づい
て所定の処理を行う複数の機能ブロック４1 ，…４
n と、データの入力先、データの出力先、およびデータ
の処理内容を指示する制御信号を出力する制御ブロック
１４と、を備え、機能ブロック４i （ｉ＝１，…ｎ）は
各々、アンテナ３i ，９i と、データおよび制御信号を
アンテナを介して受信し復調する受信回路と、処理され
たデータを変調して無線信号としてアンテナを介して送
信する送信回路と、を有し、制御ブロックは、アンテナ
１１と、制御信号を無線信号に変調してアンテナを介し
て送信する送信回路と、を有していることを特徴とす
る。
低下することを可及的に防止するとともに全ての機能ブ
ロックが効率良く動作することを可能にする。 【解決手段】 各々が、データおよび制御信号に基づい
て所定の処理を行う複数の機能ブロック４1 ，…４
n と、データの入力先、データの出力先、およびデータ
の処理内容を指示する制御信号を出力する制御ブロック
１４と、を備え、機能ブロック４i （ｉ＝１，…ｎ）は
各々、アンテナ３i ，９i と、データおよび制御信号を
アンテナを介して受信し復調する受信回路と、処理され
たデータを変調して無線信号としてアンテナを介して送
信する送信回路と、を有し、制御ブロックは、アンテナ
１１と、制御信号を無線信号に変調してアンテナを介し
て送信する送信回路と、を有していることを特徴とす
る。
Description
【０００１】
【発明の属する技術分野】本発明は、各々がデータ処理
ユニット、記憶ユニット、および制御ユニットを有する
複数の機能ブロックを備えている半導体集積回路装置に
関する。
ユニット、記憶ユニット、および制御ユニットを有する
複数の機能ブロックを備えている半導体集積回路装置に
関する。
【０００２】
【従来の技術】近年コンピュータや通信機器のキーコン
ポーネントとして複数の機能ブロックからなる大規模集
積回路（ＬＳＩ）のような半導体装置が多用されてい
る。情報量の増大に伴い、ＬＳＩをはじめとする半導体
装置は、益々高集積化および高速化が図られている。な
かでも素子を微細化することにより、高速化・高集積化
を実現しているＶＬＳＩは、超高速・高機能デバイスと
して必須のものとなってきている。ここで、複数個の機
能ブロックから構成されるデータ処理用の従来のＶＬＳ
Ｉについて図２を参照して説明を行う。
ポーネントとして複数の機能ブロックからなる大規模集
積回路（ＬＳＩ）のような半導体装置が多用されてい
る。情報量の増大に伴い、ＬＳＩをはじめとする半導体
装置は、益々高集積化および高速化が図られている。な
かでも素子を微細化することにより、高速化・高集積化
を実現しているＶＬＳＩは、超高速・高機能デバイスと
して必須のものとなってきている。ここで、複数個の機
能ブロックから構成されるデータ処理用の従来のＶＬＳ
Ｉについて図２を参照して説明を行う。
【０００３】図２は従来の数値処理用の半導体集積回路
装置（以下、集積回路装置ともいう）の構成を示すブロ
ック図である。この従来の集積回路装置２０は、データ
バス２１と、ｎ個の数値処理ブロック２２1 ，…２２n
と、制御バス２６と、制御ブロック２８と、共通の記憶
装置（図示せず）とを備えている。各数値処理ブロック
２２i （ｉ＝１，…ｎ）は、数値計算を行う数値演算ブ
ロック２５i と、数値記憶部ブロック２４i とを有して
いる。この数値記憶部ブロック２４i （ｉ＝１，…ｎ）
は、上記共通の記憶装置または他の数値記憶部ブロック
２４j （ｊ≠ｉ）からデータバス２１を介して送られて
くるデータを数値処理ブロック２５i に受け渡すために
上記データを一時的に記憶する。
装置（以下、集積回路装置ともいう）の構成を示すブロ
ック図である。この従来の集積回路装置２０は、データ
バス２１と、ｎ個の数値処理ブロック２２1 ，…２２n
と、制御バス２６と、制御ブロック２８と、共通の記憶
装置（図示せず）とを備えている。各数値処理ブロック
２２i （ｉ＝１，…ｎ）は、数値計算を行う数値演算ブ
ロック２５i と、数値記憶部ブロック２４i とを有して
いる。この数値記憶部ブロック２４i （ｉ＝１，…ｎ）
は、上記共通の記憶装置または他の数値記憶部ブロック
２４j （ｊ≠ｉ）からデータバス２１を介して送られて
くるデータを数値処理ブロック２５i に受け渡すために
上記データを一時的に記憶する。
【０００４】制御ブロック２８は制御バス２６を介して
制御信号を送り数値処理ブロック２２1 ，…２２n およ
び上記共通の記憶装置を制御する。この従来の集積回路
装置２０においては、データは各数値処理ブロック２２
i （ｉ＝１，…ｎ）を経由することにより演算され、演
算されたデータは最終的に共通の記憶装置に格納され
る。
制御信号を送り数値処理ブロック２２1 ，…２２n およ
び上記共通の記憶装置を制御する。この従来の集積回路
装置２０においては、データは各数値処理ブロック２２
i （ｉ＝１，…ｎ）を経由することにより演算され、演
算されたデータは最終的に共通の記憶装置に格納され
る。
【０００５】
【発明が解決しようとする課題】上述のように構成され
た従来の集積回路装置２０においては次の問題点があ
る。まず第１に、データの転送能力を高くするためにバ
ス幅を大きくとるため（例えば３２、６４、１２８ビッ
ト等）、これらのバス領域をチップ内にレイアウトする
半導体集積回路装置においては、そのチップの大きさが
著しく大きくなってしまう。
た従来の集積回路装置２０においては次の問題点があ
る。まず第１に、データの転送能力を高くするためにバ
ス幅を大きくとるため（例えば３２、６４、１２８ビッ
ト等）、これらのバス領域をチップ内にレイアウトする
半導体集積回路装置においては、そのチップの大きさが
著しく大きくなってしまう。
【０００６】第２にバス配線間の容量性カップリングに
より、データ信号に重畳する雑音成分が大きくなり、そ
の結果バス内のデータ転送のエラー確率が増大し、最終
的にチップとしての信頼性が低くなる。一般に、バスの
信号線は論理回路ブロック内の信号線に比べて数倍長い
ため、論理回路ブロック間の信号を駆動するために駆動
能力の高いバッファセルを用いる。バッファセルは、通
常のセルに比べて負荷駆動能力が数倍から数十倍高い。
このため、図３に示すようにバッファセル３２からバス
の信号線３５にバス信号３４が出力されているときに
は、バスの信号線３５とこの信号線３５に隣接する、論
理回路ブロック内の信号線３７との間の配線間容量３６
を介して漏話信号３８が生じやすい。これにより半導体
集積回路装置の動作の信頼性は低くなる。逆にこの問題
を防止するためにバッファセル３２の駆動能力を低下さ
せると、データの伝達遅延時間のばらつきが大きくな
り、結果的に半導体集積回路装置の信頼性は低下するこ
とになる。
より、データ信号に重畳する雑音成分が大きくなり、そ
の結果バス内のデータ転送のエラー確率が増大し、最終
的にチップとしての信頼性が低くなる。一般に、バスの
信号線は論理回路ブロック内の信号線に比べて数倍長い
ため、論理回路ブロック間の信号を駆動するために駆動
能力の高いバッファセルを用いる。バッファセルは、通
常のセルに比べて負荷駆動能力が数倍から数十倍高い。
このため、図３に示すようにバッファセル３２からバス
の信号線３５にバス信号３４が出力されているときに
は、バスの信号線３５とこの信号線３５に隣接する、論
理回路ブロック内の信号線３７との間の配線間容量３６
を介して漏話信号３８が生じやすい。これにより半導体
集積回路装置の動作の信頼性は低くなる。逆にこの問題
を防止するためにバッファセル３２の駆動能力を低下さ
せると、データの伝達遅延時間のばらつきが大きくな
り、結果的に半導体集積回路装置の信頼性は低下するこ
とになる。
【０００７】第３に上記集積回路装置においては、ブロ
ック間結線が自由に行える長所があるが、システムとし
ては全ての機能ブロックが効率良く動作しているとは云
えない。例えば、各数値処理ブロック２２i （ｉ＝１，
…ｎ）間の信号の授受は１本のバス２１を通して行って
いるので、ある数値処理ブロック（例えば数値処理ブロ
ック２２1 ）がバス２１を占有しているときには他の全
てのブロック間でのデータ転送は行われず、システムの
全ての機能ブロックが効率良く動作していることになら
ない。
ック間結線が自由に行える長所があるが、システムとし
ては全ての機能ブロックが効率良く動作しているとは云
えない。例えば、各数値処理ブロック２２i （ｉ＝１，
…ｎ）間の信号の授受は１本のバス２１を通して行って
いるので、ある数値処理ブロック（例えば数値処理ブロ
ック２２1 ）がバス２１を占有しているときには他の全
てのブロック間でのデータ転送は行われず、システムの
全ての機能ブロックが効率良く動作していることになら
ない。
【０００８】これを解消して全てのブロック間転送を、
同時に行うためには、特別な制御を必要とするマトリク
ススイッチと言ったバス構成が必要となる。このため並
列度の高いシステムではバス構成部のシステム全体に占
める割合が著しく大きくなってしまい、システムそのも
のが冗長になってしまう、という問題点が生じる。従っ
て、ブロック間の信号結線方式によりシステムの性能が
決まってしまう、あるいはそのシステムの効率を重視す
る結果、冗長なシステムになってしまう問題点を有して
いた。
同時に行うためには、特別な制御を必要とするマトリク
ススイッチと言ったバス構成が必要となる。このため並
列度の高いシステムではバス構成部のシステム全体に占
める割合が著しく大きくなってしまい、システムそのも
のが冗長になってしまう、という問題点が生じる。従っ
て、ブロック間の信号結線方式によりシステムの性能が
決まってしまう、あるいはそのシステムの効率を重視す
る結果、冗長なシステムになってしまう問題点を有して
いた。
【０００９】本発明は上記事情を考慮してなされたもの
であって、チップサイズが増大することおよび信頼性が
低下することを可及的に防止するとともに全ての機能ブ
ロックが効率良く動作することが可能な半導体集積回路
装置を提供することを目的とする。
であって、チップサイズが増大することおよび信頼性が
低下することを可及的に防止するとともに全ての機能ブ
ロックが効率良く動作することが可能な半導体集積回路
装置を提供することを目的とする。
【００１０】
【課題を解決するための手段】本発明による半導体集積
回路装置は、各々が、データおよび制御信号に基づいて
所定の処理を行う複数の機能ブロックと、前記データの
入力先、前記データの出力先、および前記データの処理
内容を指示する制御信号を出力する制御ブロックと、を
備え、前記機能ブロックは各々、アンテナと、前記デー
タおよび前記制御信号を前記アンテナを介して受信し復
調する受信回路と、前記処理されたデータを変調して無
線信号として前記アンテナを介して送信する送信回路
と、を有し、前記制御ブロックは、アンテナと、前記制
御信号を無線信号に変調して前記アンテナを介して送信
する送信回路と、を有していることを特徴とする。
回路装置は、各々が、データおよび制御信号に基づいて
所定の処理を行う複数の機能ブロックと、前記データの
入力先、前記データの出力先、および前記データの処理
内容を指示する制御信号を出力する制御ブロックと、を
備え、前記機能ブロックは各々、アンテナと、前記デー
タおよび前記制御信号を前記アンテナを介して受信し復
調する受信回路と、前記処理されたデータを変調して無
線信号として前記アンテナを介して送信する送信回路
と、を有し、前記制御ブロックは、アンテナと、前記制
御信号を無線信号に変調して前記アンテナを介して送信
する送信回路と、を有していることを特徴とする。
【００１１】なお、前記複数の機能ブロックのうちの１
つの機能ブロックは、データを記憶する記憶装置であ
り、他の機能ブロックは数値処理を行う数値処理ブロッ
クであるように構成しても良い。
つの機能ブロックは、データを記憶する記憶装置であ
り、他の機能ブロックは数値処理を行う数値処理ブロッ
クであるように構成しても良い。
【００１２】また、前記数値処理ブロックは各々、数値
演算を行う数値演算ブロックと、受信し、復調されたデ
ータを一時的に記憶保持する数値記憶ブロックとを有し
ているように構成しても良い。
演算を行う数値演算ブロックと、受信し、復調されたデ
ータを一時的に記憶保持する数値記憶ブロックとを有し
ているように構成しても良い。
【００１３】なお、無線信号に複数のキャリア周波数を
用いることも可能である。
用いることも可能である。
【００１４】また、無線信号に単一のキャリア周波数を
用いることも可能である。
用いることも可能である。
【００１５】
【発明の実施の形態】本発明による半導体集積回路装置
（以下、単に集積回路装置という）の一実施の形態の構
成を図１に示す。この実施の形態の集積回路装置１は、
ｎ個の数値処理ブロック４1 ，…４n と、制御ブロック
１４と、図示しない共有の記憶装置とを備えている。
（以下、単に集積回路装置という）の一実施の形態の構
成を図１に示す。この実施の形態の集積回路装置１は、
ｎ個の数値処理ブロック４1 ，…４n と、制御ブロック
１４と、図示しない共有の記憶装置とを備えている。
【００１６】各数値処理ブロック４i （ｉ＝１，…ｎ）
は、アンテナ３i と送信／受信回路５i と、数値記憶部
ブロック６i と、数値演算ブロック７i と、送信／受信
回路８i と、アンテナ９i を有している。
は、アンテナ３i と送信／受信回路５i と、数値記憶部
ブロック６i と、数値演算ブロック７i と、送信／受信
回路８i と、アンテナ９i を有している。
【００１７】送信／受信回路５i （ｉ＝１，…ｎ）は、
ディジタル信号を変調し、アンテナ３i を介してＲＦ信
号（無線信号）として送信する送信部と、アンテナ３i
を介して受信したＲＦ信号をディジタル信号に復調する
ための受信部と、ＲＦ信号のキャリア周波数を決定する
発振部とを有している。
ディジタル信号を変調し、アンテナ３i を介してＲＦ信
号（無線信号）として送信する送信部と、アンテナ３i
を介して受信したＲＦ信号をディジタル信号に復調する
ための受信部と、ＲＦ信号のキャリア周波数を決定する
発振部とを有している。
【００１８】各数値記憶部ブロック６i （ｉ＝１，…
ｎ）は、共有の記憶装置、あるいは他の数値処理ブロッ
ク４j （ｊ＝ｉ）からアンテナ３i および送信／受信回
路５iを介して送られてきたデータを記憶する。
ｎ）は、共有の記憶装置、あるいは他の数値処理ブロッ
ク４j （ｊ＝ｉ）からアンテナ３i および送信／受信回
路５iを介して送られてきたデータを記憶する。
【００１９】各数値演算ブロック７i （ｉ＝１，…ｎ）
は数値記憶部ブロック６i に記憶されたデータに基づい
て数値演算を行い、演算終了時には終了を示す信号を出
力する。
は数値記憶部ブロック６i に記憶されたデータに基づい
て数値演算を行い、演算終了時には終了を示す信号を出
力する。
【００２０】送信／受信回路８i （ｉ＝１，…ｎ）は、
数値演算ブロック７i の出力（ディジタル信号）を変調
し、アンテナ９i を介してＲＦ信号として送信する送信
部と、アンテナ９i を介して受信したＲＦ信号（主に、
制御ブロック１４からの制御信号）をディジタル信号に
復調するための受信部と、ＲＦ信号のキャリア周波数を
決定する発振部とを有している。
数値演算ブロック７i の出力（ディジタル信号）を変調
し、アンテナ９i を介してＲＦ信号として送信する送信
部と、アンテナ９i を介して受信したＲＦ信号（主に、
制御ブロック１４からの制御信号）をディジタル信号に
復調するための受信部と、ＲＦ信号のキャリア周波数を
決定する発振部とを有している。
【００２１】制御ブロック１４は、アンテナ１１と、送
信／受信回路１２とを有し、各数値処理ブロック４
i （ｉ＝１，…ｎ）のデータの入力先、出力先および処
理内容を決定し、送信／受信回路１２およびアンテナ１
１を介して各数値処理ブロック４i にＲＦ信号に変調し
た制御信号を送る。また数値処理ブロックからの演算の
終了を示す信号をアンテナ１１および送信／受信回路１
２を介して受信、復調し、この演算終了を示す信号に基
づいてデータの出力先等を決定する。なお送信／受信回
路１２も送信／受信回路８i （ｉ＝１，…ｎ）と同様に
送信部、受信部、および発振部を有している。なお各ア
ンテナは金属配線および誘電体から構成される。
信／受信回路１２とを有し、各数値処理ブロック４
i （ｉ＝１，…ｎ）のデータの入力先、出力先および処
理内容を決定し、送信／受信回路１２およびアンテナ１
１を介して各数値処理ブロック４i にＲＦ信号に変調し
た制御信号を送る。また数値処理ブロックからの演算の
終了を示す信号をアンテナ１１および送信／受信回路１
２を介して受信、復調し、この演算終了を示す信号に基
づいてデータの出力先等を決定する。なお送信／受信回
路１２も送信／受信回路８i （ｉ＝１，…ｎ）と同様に
送信部、受信部、および発振部を有している。なお各ア
ンテナは金属配線および誘電体から構成される。
【００２２】このような本実施の形態の集積回路装置に
おいては、各ブロック間のデータのやり取りを無線で行
うことにより、従来の技術で問題であったブロック間結
線領域である制御バスおよびデータバスの信号結線領域
が不要になり、送受信回路によるチップ面積の若干の増
大があるものの、バス領域が不要となるため大幅な面積
の縮小を計ることが可能となり結果的にチップサイズの
小形化を計ることができる。
おいては、各ブロック間のデータのやり取りを無線で行
うことにより、従来の技術で問題であったブロック間結
線領域である制御バスおよびデータバスの信号結線領域
が不要になり、送受信回路によるチップ面積の若干の増
大があるものの、バス領域が不要となるため大幅な面積
の縮小を計ることが可能となり結果的にチップサイズの
小形化を計ることができる。
【００２３】また、無線信号に関しても周波数多重によ
る信号間の干渉を防ぐあるいは変調方式を干渉の少ない
スペクトラム拡散方式を採用する等により各データ間の
干渉の少ない高品質なデータ伝送が可能となり、従来の
技術で問題となっている信号間の容量性結合による信号
間カップリングあるいは信号間路漏話を避けることがで
きる。
る信号間の干渉を防ぐあるいは変調方式を干渉の少ない
スペクトラム拡散方式を採用する等により各データ間の
干渉の少ない高品質なデータ伝送が可能となり、従来の
技術で問題となっている信号間の容量性結合による信号
間カップリングあるいは信号間路漏話を避けることがで
きる。
【００２４】さらに、各ブロック間のデータ伝送に無線
を用いているために、制御ブロックなどを介して各送受
信回路に周波数多重の場合は周波数情報を伝送すること
により、またスペクトラム拡散の場合は符号化のパター
ン情報を伝送することにより、従来の技術にあるような
数値記憶ブロック間のデータバスと数値演算ブロック間
のデータバスのように一度配線として固定してしまった
ら変更ができないということなく、直接送受信回路を介
して記憶装置のデータを制御ブロック１４に送ること、
制御情報を直接記憶部装置に送ること、制御情報を送受
信バッファ回路を介して外部記憶装置に転送すること等
の配線情報の変更が容易に行えることとなり、目的に応
じたシステムの構築がチップ内での情報の変更により容
易にできる特徴がある。
を用いているために、制御ブロックなどを介して各送受
信回路に周波数多重の場合は周波数情報を伝送すること
により、またスペクトラム拡散の場合は符号化のパター
ン情報を伝送することにより、従来の技術にあるような
数値記憶ブロック間のデータバスと数値演算ブロック間
のデータバスのように一度配線として固定してしまった
ら変更ができないということなく、直接送受信回路を介
して記憶装置のデータを制御ブロック１４に送ること、
制御情報を直接記憶部装置に送ること、制御情報を送受
信バッファ回路を介して外部記憶装置に転送すること等
の配線情報の変更が容易に行えることとなり、目的に応
じたシステムの構築がチップ内での情報の変更により容
易にできる特徴がある。
【００２５】以上示したように本発明を用いることによ
り、高集積密度、高信頼度で且つブロック間の信号結線
をフレキシブルに変更可能である柔軟な配線をもつＬＳ
Ｉが可能となる。
り、高集積密度、高信頼度で且つブロック間の信号結線
をフレキシブルに変更可能である柔軟な配線をもつＬＳ
Ｉが可能となる。
【００２６】なお、本発明に於いては、無線周波数は１
０ＧＨｚ以上の領域であれば構成可能であるが、アンテ
ナを含めた送受信回路が小型化されるためには無線とし
て用いる周波数はミリ波である３０ＧＨｚ以上であるこ
とが望ましい。
０ＧＨｚ以上の領域であれば構成可能であるが、アンテ
ナを含めた送受信回路が小型化されるためには無線とし
て用いる周波数はミリ波である３０ＧＨｚ以上であるこ
とが望ましい。
【００２７】また、既に述べたように無線としてチップ
内で用いる周波数は、周波数多重で信号間干渉を防ぐ場
合に於いては、複数のキャリア周波数を用いることが望
ましく、この周波数情報に関しては制御ブロックから各
ブロックへある固定の周波数を用いた同報で情報が送ら
れる。
内で用いる周波数は、周波数多重で信号間干渉を防ぐ場
合に於いては、複数のキャリア周波数を用いることが望
ましく、この周波数情報に関しては制御ブロックから各
ブロックへある固定の周波数を用いた同報で情報が送ら
れる。
【００２８】またスペクトラム拡散のように符号間の干
渉の低さを利用する方式であれば、単一のキャリア周波
数を用い、符号化情報を同報により制御ブロックから各
ブロックに送付し、各機能ブロックがそれぞれが必要と
する情報をその中から入手することができる。
渉の低さを利用する方式であれば、単一のキャリア周波
数を用い、符号化情報を同報により制御ブロックから各
ブロックに送付し、各機能ブロックがそれぞれが必要と
する情報をその中から入手することができる。
【００２９】
【発明の効果】以上述べたように、本発明によれば、チ
ップサイズが増大することおよび信頼性が低下するのを
可及的に防止することができるとももに、全ての機能ブ
ロックを効率良く動作させることが可能となる。
ップサイズが増大することおよび信頼性が低下するのを
可及的に防止することができるとももに、全ての機能ブ
ロックを効率良く動作させることが可能となる。
【図１】本発明による半導体集積回路装置の一実施の形
態の構成を示すブロック図。
態の構成を示すブロック図。
【図２】従来の半導体集積回路装置の構成を示すブロッ
ク図。
ク図。
【図３】従来の半導体集積回路装置の問題点を説明する
説明図。
説明図。
１，２０ 半導体集積回路装置 ３i （ｉ＝１，…ｎ），９i （ｉ＝１，…ｎ），１１
アンテナ ４i （ｉ＝１，…ｎ），２２i （ｉ＝１，…ｎ） 数値
処理ブロック ５i （ｉ＝１，…ｎ），８i （ｉ＝１，…ｎ），１２
送信／受信回路 ６i （ｉ＝１，…ｎ），２４i （ｉ＝１，…ｎ） 数値
記憶部ブロック ７i （ｉ＝１，…ｎ），２５i （ｉ＝１，…ｎ） 数値
演算ブロック １４，２８ 制御ブロック ２１ データバス ２６ 制御バス ３２ バッファ ３４ バス信号 ３５ バス ３６ 配線間容量 ３７ 信号線 ３８ 漏話信号
アンテナ ４i （ｉ＝１，…ｎ），２２i （ｉ＝１，…ｎ） 数値
処理ブロック ５i （ｉ＝１，…ｎ），８i （ｉ＝１，…ｎ），１２
送信／受信回路 ６i （ｉ＝１，…ｎ），２４i （ｉ＝１，…ｎ） 数値
記憶部ブロック ７i （ｉ＝１，…ｎ），２５i （ｉ＝１，…ｎ） 数値
演算ブロック １４，２８ 制御ブロック ２１ データバス ２６ 制御バス ３２ バッファ ３４ バス信号 ３５ バス ３６ 配線間容量 ３７ 信号線 ３８ 漏話信号
Claims (5)
- 【請求項１】各々が、データおよび制御信号に基づいて
所定の処理を行う複数の機能ブロックと、 前記データの入力先、前記データの出力先、および前記
データの処理内容を指示する制御信号を出力する制御ブ
ロックと、 を備え、 前記機能ブロックは各々、アンテナと、前記データおよ
び前記制御信号を前記アンテナを介して受信し復調する
受信回路と、前記処理されたデータを変調して無線信号
として前記アンテナを介して送信する送信回路と、を有
し、 前記制御ブロックは、アンテナと、前記制御信号を無線
信号に変調して前記アンテナを介して送信する送信回路
と、 を有していることを特徴とする半導体集積回路装置。 - 【請求項２】前記複数の機能ブロックのうちの１つの機
能ブロックは、データを記憶する記憶装置であり、他の
機能ブロックは数値処理を行う数値処理ブロックである
ことを特徴とする請求項１記載の半導体集積回路装置。 - 【請求項３】前記数値処理ブロックは各々、数値演算を
行う数値演算ブロックと、受信し、復調されたデータを
一時的に記憶保持する数値記憶ブロックとを有している
ことを特徴とする請求項２記載の半導体集積回路装置。 - 【請求項４】無線信号に複数のキャリア周波数を用いる
ことを特徴とする請求項１乃至３のいずれかに記載の半
導体集積回路装置。 - 【請求項５】無線信号に単一のキャリア周波数を用いる
ことを特徴とする請求項１乃至３のいずれかに記載の半
導体集積回路装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5620697A JPH10256478A (ja) | 1997-03-11 | 1997-03-11 | 半導体集積回路装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5620697A JPH10256478A (ja) | 1997-03-11 | 1997-03-11 | 半導体集積回路装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH10256478A true JPH10256478A (ja) | 1998-09-25 |
Family
ID=13020650
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP5620697A Pending JPH10256478A (ja) | 1997-03-11 | 1997-03-11 | 半導体集積回路装置 |
Country Status (1)
| Country | Link |
|---|---|
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