JPH10242480A - Semiconductor pressure sensor - Google Patents

Semiconductor pressure sensor

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Publication number
JPH10242480A
JPH10242480A JP4514097A JP4514097A JPH10242480A JP H10242480 A JPH10242480 A JP H10242480A JP 4514097 A JP4514097 A JP 4514097A JP 4514097 A JP4514097 A JP 4514097A JP H10242480 A JPH10242480 A JP H10242480A
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JP
Japan
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diaphragm
pressure sensor
semiconductor pressure
present
groove
Prior art date
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Application number
JP4514097A
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Japanese (ja)
Inventor
Kazuo Eda
和夫 江田
Shuichiro Yamaguchi
周一郎 山口
Takashi Saijo
隆司 西條
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Panasonic Electric Works Co Ltd
Original Assignee
Matsushita Electric Works Ltd
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Publication date
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Abstract

PROBLEM TO BE SOLVED: To provide a semiconductor pressure sensor whose sensitivity can be enhanced without making a chip size large. SOLUTION: Piezoresistive elements 2 are formed on one main face of a silicon wafer 1, two main surfaces are etched anisotropically while a nitride film 4 in which an opening part 5 is formed is used as a mask, and a diaphragm 1a is formed. Then, the two main surfaces of the silicon wafer 1 are etched anisotropically while the nitride film 4 in which opening parts 4a are formed is used as a mask, and slit-shaped groove parts 1b are formed.

Description

【発明の詳細な説明】DETAILED DESCRIPTION OF THE INVENTION

【0001】[0001]

【発明の属する技術分野】本発明は、半導体圧力センサ
に関するものである。
BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a semiconductor pressure sensor.

【0002】[0002]

【従来の技術】図8は、従来例に係る半導体圧力センサ
の製造工程を示す略断面図である。従来の半導体圧力セ
ンサは、先ず、厚さが約300μmの面方位が(11
0)のシリコンウェハ1の一主表面に不純物のイオン注
入及びアニール処理を行うことにより後述するダイヤフ
ラム1a形成箇所にピエゾ抵抗素子2を形成し、シリコ
ンウェハ1の両面にCVD法等により酸化膜3及び窒化
膜4を形成する。このとき、ピエゾ抵抗素子2は、ダイ
ヤフラムの略中央に2つと、外周部に2つ形成され、4
つのピエゾ抵抗素子2及び後述するアルミニウム(A
l)配線6によりホイートストンブリッジ構造を構成し
ている。
2. Description of the Related Art FIG. 8 is a schematic sectional view showing a manufacturing process of a conventional semiconductor pressure sensor. In the conventional semiconductor pressure sensor, first, a plane orientation having a thickness of about 300 μm (11
0), a piezoresistive element 2 is formed at a portion where a diaphragm 1a to be described later is formed by performing ion implantation of impurities and annealing on one main surface of the silicon wafer 1; And a nitride film 4 are formed. At this time, two piezoresistive elements 2 are formed substantially at the center of the diaphragm and two at the outer periphery thereof.
Piezoresistive elements 2 and aluminum (A
l) The wiring 6 constitutes a Wheatstone bridge structure.

【0003】次に、所定形状にパターニングされたフォ
トレジスト(図示せず)をマスクとしてシリコンウェハ
1の二主表面に形成された酸化膜3及び窒化膜4のエッ
チングを行うことにより開口部5を形成して、プラズマ
アッシング等によりフォトレジストを除去し(図8
(a))、開口部5が形成された酸化膜3及び窒化膜4
をマスクとして水酸化カリウム(KOH)水溶液等のア
ルカリ系のエッチャントを用いてシリコンウェハ1の異
方性エッチングを行うことにより、薄肉状のダイヤフラ
ム1aを形成する(図8(b))。
Next, the opening 5 is formed by etching the oxide film 3 and the nitride film 4 formed on the two main surfaces of the silicon wafer 1 using a photoresist (not shown) patterned into a predetermined shape as a mask. Then, the photoresist is removed by plasma ashing or the like (FIG. 8).
(A)) Oxide film 3 and nitride film 4 in which opening 5 is formed
Is used as a mask, anisotropic etching of the silicon wafer 1 is performed using an alkaline etchant such as an aqueous solution of potassium hydroxide (KOH) to form a thin diaphragm 1a (FIG. 8B).

【0004】次に、ピエゾ抵抗素子2上の酸化膜3及び
窒化膜4と、シリコンウェハ1の二主表面に形成された
酸化膜3及び窒化膜4をエッチングにより除去し、シリ
コンウェハ1のピエゾ抵抗素子2が形成された面側全面
にアルミニウム(Al)層を形成し、所定形状にパター
ニングされたフォトレジスト(図示せず)をマスクとし
てエッチングを行うことにより、アルミニウム(Al)
層のパターニングを行ってアルミニウム(Al)配線6
を形成し、フォトレジストを除去する(図8(c))。
最後に、シリコンウェハ1の二主表面に、ダイヤフラム
1aに対応する箇所に、パッケージへの実装に必要な所
望の厚み(約1mm)を有し、圧力導入孔7aを有して
成るガラス台座7を接合する(図8(d))。
[0004] Next, the oxide film 3 and the nitride film 4 on the piezoresistive element 2 and the oxide film 3 and the nitride film 4 formed on the two main surfaces of the silicon wafer 1 are removed by etching. An aluminum (Al) layer is formed on the entire surface side on which the resistance element 2 is formed, and etching is performed using a photoresist (not shown) patterned in a predetermined shape as a mask, thereby forming an aluminum (Al) layer.
Patterning the layer to form aluminum (Al) wiring 6
Is formed, and the photoresist is removed (FIG. 8C).
Finally, a glass pedestal 7 having a desired thickness (about 1 mm) required for mounting on a package and having a pressure introducing hole 7a is provided on the two main surfaces of the silicon wafer 1 at locations corresponding to the diaphragm 1a. (FIG. 8D).

【0005】[0005]

【発明が解決しようとする課題】ところが、上述のよう
な構成の半導体圧力センサにおいて、必要な出力を得る
ためには、ダイヤフラム1aの厚み(D),ダイヤフラ
ム1aのサイズ(L)を調整する必要があり、低圧を測
定(感度を向上)しようとすればするほど、ダイヤフラ
ム1aの厚み(D)を薄くし、ダイヤフラム1aのサイ
ズ(L)を大きくする必要がある。
However, in the semiconductor pressure sensor having the above structure, in order to obtain a required output, it is necessary to adjust the thickness (D) of the diaphragm 1a and the size (L) of the diaphragm 1a. Therefore, as the lower pressure is measured (improved in sensitivity), the thickness (D) of the diaphragm 1a must be reduced and the size (L) of the diaphragm 1a must be increased.

【0006】また、必要なダイヤフラム1aのサイズ
(L)を得るためには、シリコンウェハ1の厚みに応じ
たサイドエッチ量(l)を考慮し、更に、ガラス台座7
との接合のための貼りしろ(A)も確保する必要があ
る。
In order to obtain the required size (L) of the diaphragm 1a, a side etching amount (l) corresponding to the thickness of the silicon wafer 1 is taken into consideration.
It is also necessary to secure a bonding margin (A) for bonding with the substrate.

【0007】更に、パッケージ(図示せず)からガラス
台座7へ、ガラス台座7からピエゾ抵抗素子2へと影響
を及ぼす熱膨張率の違いによるストレスを緩和するため
には、シリコンウェハ1の厚みができるだけ厚い方が望
ましく、結果的に感度を向上させるためにはどうしても
チップサイズが大きくなってしまうという問題があっ
た。
Further, in order to reduce stress caused by a difference in the coefficient of thermal expansion from a package (not shown) to the glass pedestal 7 and from the glass pedestal 7 to the piezoresistive element 2, the thickness of the silicon wafer 1 must be reduced. It is desirable that the thickness be as thick as possible. As a result, there is a problem that the chip size is inevitably increased in order to improve the sensitivity.

【0008】本発明は、上記の点に鑑みて成されたもの
であり、その目的とするところは、チップサイズを大き
くすることなく、感度を向上させることのできる半導体
圧力センサを提供することにある。
The present invention has been made in view of the above points, and an object of the present invention is to provide a semiconductor pressure sensor capable of improving the sensitivity without increasing the chip size. is there.

【0009】[0009]

【課題を解決するための手段】請求項1記載の発明は、
ダイヤフラムを有する半導体基板と、該ダイヤフラム上
に形成されたピエゾ抵抗素子とを有して成る半導体圧力
センサにおいて、前記ダイヤフラム上にスリット状の溝
部を複数形成したことを特徴とするものである。
According to the first aspect of the present invention,
In a semiconductor pressure sensor having a semiconductor substrate having a diaphragm and a piezoresistive element formed on the diaphragm, a plurality of slit-shaped grooves are formed on the diaphragm.

【0010】請求項2記載の発明は、請求項1記載の半
導体圧力センサにおいて、隣接する前記スリット状の溝
部の間隔を、前記ダイヤフラムの略中央から周辺に行く
に従って、狭くするようにしたことを特徴とするもので
ある。
According to a second aspect of the present invention, in the semiconductor pressure sensor according to the first aspect, an interval between the adjacent slit-shaped grooves is made narrower from a substantially center to a periphery of the diaphragm. It is a feature.

【0011】請求項3記載の発明は、請求項1または請
求項2記載の半導体圧力センサにおいて、前記スリット
状の溝部の深さを、前記ダイヤフラムの略中央から周辺
に行くに従って、深くするようにしたことを特徴とする
ものである。
According to a third aspect of the present invention, in the semiconductor pressure sensor according to the first or second aspect, the depth of the slit-shaped groove portion is increased from a substantially center to a periphery of the diaphragm. It is characterized by having done.

【0012】請求項4記載の発明は、請求項1乃至請求
項3記載の半導体圧力センサにおいて、前記溝部を前記
ダイヤフラムの前記ピエゾ抵抗素子を形成した面側に形
成したことを特徴とするものである。
According to a fourth aspect of the present invention, in the semiconductor pressure sensor according to the first to third aspects, the groove is formed on a surface of the diaphragm on which the piezoresistive element is formed. is there.

【0013】請求項5記載の発明は、請求項1乃至請求
項4記載の半導体圧力センサにおいて、前記溝部を前記
ダイヤフラムの前記ピエゾ抵抗素子を形成した面と異な
る面側に形成したことを特徴とするものである。
According to a fifth aspect of the present invention, in the semiconductor pressure sensor according to the first to fourth aspects, the groove is formed on a surface of the diaphragm different from the surface on which the piezoresistive element is formed. Is what you do.

【0014】請求項6記載の発明は、請求項1乃至請求
項5記載の半導体圧力センサにおいて、前記溝部を、ア
ルカリ系のエッチャントを用いて異方性エッチングする
ことにより形成したことを特徴とするものである。
According to a sixth aspect of the present invention, in the semiconductor pressure sensor according to the first to fifth aspects, the groove is formed by anisotropic etching using an alkali-based etchant. Things.

【0015】請求項7記載の発明は、請求項1乃至請求
項5記載の半導体圧力センサにおいて、前記溝部を、R
IEにより形成するようにしたことを特徴とするもので
ある。
According to a seventh aspect of the present invention, in the semiconductor pressure sensor according to any one of the first to fifth aspects, the groove is formed by R
It is characterized by being formed by IE.

【0016】[0016]

【発明の実施の形態】以下、本発明の実施形態について
図面に基づき説明する。
Embodiments of the present invention will be described below with reference to the drawings.

【0017】=実施形態1= 図1は、本発明の一実施形態に係る半導体圧力センサの
製造工程を示す略断面図であり、図2は、本実施形態に
係る半導体圧力センサの裏面から見た状態を示す略平面
図である。なお、本実施形態係る半導体圧力センサの図
1(b)までの製造工程は、従来例として図8に示す
(b)までの製造工程と同様であるので、ここでは説明
を省略し、図1(c)の製造工程から説明する。シリコ
ンウェハ1の二主表面に形成された窒化膜4及び酸化膜
3をCF4プラズマエッチング等により除去し(図1
(c))、再びシリコンウェハ1の二主表面にCVD法
等により窒化膜4を形成する。
Embodiment 1 = FIG. 1 is a schematic sectional view showing a manufacturing process of a semiconductor pressure sensor according to an embodiment of the present invention, and FIG. 2 is a view seen from the back surface of the semiconductor pressure sensor according to the embodiment. FIG. 4 is a schematic plan view showing a state in which it is folded. The manufacturing process of the semiconductor pressure sensor according to the present embodiment up to FIG. 1B is the same as the manufacturing process up to FIG. 8B as a conventional example, and the description is omitted here. Description will be made from the manufacturing process (c). The nitride film 4 and the oxide film 3 formed on the two main surfaces of the silicon wafer 1 are removed by CF 4 plasma etching or the like (FIG. 1).
(C)) A nitride film 4 is formed again on the two main surfaces of the silicon wafer 1 by the CVD method or the like.

【0018】そして、所定形状にパターニングされたフ
ォトレジスト(図示せず)をマスクとしてシリコンウェ
ハ1の二主表面に形成された窒化膜4のエッチングを行
うことにより開口部4aを形成し、フォトレジストを除
去する。このとき、エッチング用の開口部4aは、図2
に示すピエゾ抵抗素子2の外側の位置のダイヤフラム1
aの形成箇所に形成されており、この開口部4aの大き
さを調整することによりエッチングの深さを決定するこ
とができる。
An opening 4a is formed by etching the nitride film 4 formed on the two main surfaces of the silicon wafer 1 using a photoresist (not shown) patterned in a predetermined shape as a mask. Is removed. At this time, the opening 4a for etching is
Diaphragm 1 at a position outside piezoresistive element 2 shown in FIG.
The depth of the etching can be determined by adjusting the size of the opening 4a.

【0019】次に、開口部4aが形成された窒化膜4を
マスクとして、水酸化カリウム(KOH)水溶液等のア
ルカリ系のエッチャントを用いて異方性エッチング行う
ことにより、スリット状で、かつ、V字形状の溝部1b
を形成し(図1(d))、シリコンウェハ1の二主表面
に形成された窒化膜4をエッチングにより除去する。こ
のとき、エッチングは、シリコンウェハ1のエッチング
面が全て(111)面で形成されるようになった時点で
ストップする。また、溝部1bは、ダイヤフラム1aの
中央線に対して線対照となるように配置することにより
応力による歪みが最も大きくなる。
Next, using the nitride film 4 in which the opening 4a is formed as a mask, anisotropic etching is performed using an alkaline etchant such as an aqueous solution of potassium hydroxide (KOH) to obtain a slit-like shape. V-shaped groove 1b
Is formed (FIG. 1D), and the nitride film 4 formed on the two main surfaces of the silicon wafer 1 is removed by etching. At this time, the etching is stopped when the entire etched surface of the silicon wafer 1 is formed on the (111) plane. Further, the groove 1b is arranged so as to be in line contrast with the center line of the diaphragm 1a, so that the distortion due to the stress is maximized.

【0020】なお、以下の工程は、従来例として図8に
示した(c)からの製造工程と同様であるので、ここで
は説明を省略する。また、図1においては、開口部4a
は2つしか形成されていないが、実際には図2に示すよ
うに、形成する溝部1bの数に対応した数の開口部4a
が形成される。
The following steps are the same as the manufacturing steps from (c) shown in FIG. 8 as a conventional example, and the description is omitted here. In FIG. 1, the opening 4a
Although only two are formed, as shown in FIG. 2, actually, as many openings 4a as the number of grooves 1b to be formed are formed.
Is formed.

【0021】従って、本実施形態においては、シリコン
ウェハ1のダイヤフラム1aに、スリット状の溝部1b
を形成することによりダイヤフラム1aに膜厚の薄い箇
所を形成するようにしたので、従来に比べて応力による
歪みが大きくなり、出力感度を向上させることができ
る。
Accordingly, in this embodiment, the diaphragm 1a of the silicon wafer 1 is provided with a slit-shaped groove 1b.
Is formed so that a portion having a small film thickness is formed on the diaphragm 1a. Therefore, distortion due to stress is increased as compared with the related art, and output sensitivity can be improved.

【0022】なお、本実施形態においては、溝部1bの
形成をKOH水溶液を用いて異方性エッチングにより形
成するようにしたが、これに限定される必要はなく、例
えばRIE(Reactive Ion Etching)を用いて溝部1
bを形成するようにしても良い。この場合、開口部4a
の大きさに関係なく、所望の深さの溝部1bを形成する
ことができる。
In this embodiment, the groove 1b is formed by anisotropic etching using a KOH aqueous solution. However, the present invention is not limited to this. For example, RIE (Reactive Ion Etching) may be used. Groove 1 using
b may be formed. In this case, the opening 4a
Regardless of the size, the groove 1b having a desired depth can be formed.

【0023】また、本実施形態においては、シリコンウ
ェハ1として面方位が(110)面のものを用いた場合
について説明したが、これに限定される必要はなく、面
方位が(100)面のシリコンウェハを用いた場合にも
適用できる。
Further, in the present embodiment, the case where the silicon wafer 1 having the (110) plane orientation is used as the silicon wafer 1, but the present invention is not limited to this. The silicon wafer 1 has the (100) plane orientation. The present invention can be applied to a case where a silicon wafer is used.

【0024】=実施形態2= 図3は、本発明の他の実施形態に係る半導体圧力センサ
の製造工程を示す略断面図であり、図4は、本実施形態
に係る半導体圧力センサの表面から見た状態を示す略平
面図である。本実施形態に係る半導体圧力センサは、先
ず、厚さが約300μmの面方位が(110)のシリコ
ンウェハ1の一主表面に不純物のイオン注入及びアニー
ル処理を行うことにより後述するダイヤフラム1a形成
箇所にピエゾ抵抗素子2を形成し、シリコンウェハ1の
両面にCVD法等により酸化膜3及び窒化膜4を形成す
る。このとき、ピエゾ抵抗素子2は、ダイヤフラムの略
中央に2つと、外周部に2つ形成され、4つのピエゾ抵
抗素子2及び後述する配線7によりホイートストンブリ
ッジ構造を構成している。
Embodiment 2 = FIG. 3 is a schematic sectional view showing a manufacturing process of a semiconductor pressure sensor according to another embodiment of the present invention, and FIG. It is an approximate top view showing the state where it was seen. In the semiconductor pressure sensor according to the present embodiment, first, an ion implantation of impurities and an annealing process are performed on one main surface of a silicon wafer 1 having a thickness of about 300 μm and a plane orientation of (110), thereby forming a diaphragm 1a to be described later. A piezoresistive element 2 is formed, and an oxide film 3 and a nitride film 4 are formed on both surfaces of the silicon wafer 1 by a CVD method or the like. At this time, two piezoresistive elements 2 are formed at substantially the center of the diaphragm and two at the outer periphery, and a four-piezoresistive element 2 and a wiring 7 described later constitute a Wheatstone bridge structure.

【0025】次に、所定形状にパターニングされたフォ
トレジスト(図示せず)をマスクとしてシリコンウェハ
1の両面に形成された酸化膜3及び窒化膜4のエッチン
グを行うことにより開口部5a,5bを形成して、プラ
ズマアッシング等によりフォトレジストを除去する(図
3(a))。
Next, the openings 5a and 5b are formed by etching the oxide film 3 and the nitride film 4 formed on both sides of the silicon wafer 1 using a photoresist (not shown) patterned in a predetermined shape as a mask. Then, the photoresist is removed by plasma ashing or the like (FIG. 3A).

【0026】このとき、開口部5aは後述する溝部1b
形成箇所上に形成され、開口部5bは後述するダイヤフ
ラム1aが所望の大きさになるようにサイズを調整す
る。
At this time, the opening 5a is formed in a groove 1b to be described later.
The opening 5b is formed on the formation location, and the size of the opening 5b is adjusted so that a later-described diaphragm 1a has a desired size.

【0027】そして、開口部5a,5bが形成された酸
化膜3及び窒化膜4をマスクとして水酸化カリウム(K
OH)水溶液等のアルカリ系のエッチャントを用いてシ
リコンウェハ1の異方性エッチングを行うことにより、
薄肉状のダイヤフラム1aを形成するとともに、シリコ
ンウェハ1のピエゾ抵抗素子2が形成された面側にスリ
ット状の溝部1bを形成する(図3(b))。このと
き、溝部1bのエッチングは、シリコンウェハ1のエッ
チング面が全て(111)面で形成されるようになった
時点でストップする。また、溝部1bは、ダイヤフラム
1aの中央線に対して線対照となるように配置すること
により応力による歪みが最も大きくなる。
Using the oxide film 3 and the nitride film 4 in which the openings 5a and 5b are formed as a mask, potassium hydroxide (K
OH) By performing anisotropic etching of the silicon wafer 1 using an alkaline etchant such as an aqueous solution,
A thin diaphragm 1a is formed, and a slit-like groove 1b is formed on the surface of the silicon wafer 1 on which the piezoresistive elements 2 are formed (FIG. 3B). At this time, the etching of the groove 1b is stopped when the entire etched surface of the silicon wafer 1 is formed with the (111) plane. Further, the groove 1b is arranged so as to be in line contrast with the center line of the diaphragm 1a, so that the distortion due to the stress is maximized.

【0028】なお、以下の工程は、従来例として図8に
示した(c)からの工程と同様であるので、ここでは説
明を省略する。また、図3においては、開口部5aは2
つしか形成されていないが、実際には図4に示すよう
に、形成する溝部1bの数に対応した数の開口部5aが
形成される。
The following steps are the same as the steps from (c) shown in FIG. 8 as a conventional example, and the description is omitted here. In FIG. 3, the opening 5a is 2
Although only one is formed, actually, as shown in FIG. 4, the number of openings 5a corresponding to the number of grooves 1b to be formed is formed.

【0029】従って、本実施形態においては、シリコン
ウェハ1のダイヤフラム1aに、スリット状の溝部1b
を形成することによりダイヤフラム1aに膜厚の薄い箇
所を形成するようにしたので、従来に比べて応力による
歪みが大きくなり、出力感度を向上させることができ
る。
Therefore, in this embodiment, the diaphragm 1a of the silicon wafer 1 is provided with the slit-shaped groove 1b.
Is formed so that a portion having a small film thickness is formed on the diaphragm 1a. Therefore, distortion due to stress is increased as compared with the related art, and output sensitivity can be improved.

【0030】また、本実施形態においては、ダイヤフラ
ム1a形成の際の異方性エッチングと同時に、溝部1b
を形成するようにしたので、実施形態1よりも少ない工
程数で、応力による歪みを大きくして、出力感度を向上
させることができる。
In the present embodiment, the groove 1b is formed simultaneously with the anisotropic etching when the diaphragm 1a is formed.
Is formed, the strain due to stress can be increased and the output sensitivity can be improved with fewer steps than in the first embodiment.

【0031】なお、本実施形態においては、シリコンウ
ェハ1として面方位が(110)面のものを用いた場合
について説明したが、これに限定される必要はなく、面
方位が(100)面のシリコンウェハを用いた場合にも
適用できる。
In this embodiment, the case where the silicon wafer 1 has a plane orientation of (110) plane is used, but the present invention is not limited to this. The present invention can be applied to a case where a silicon wafer is used.

【0032】=実施形態3= 図5は、本発明の他の実施形態に係る半導体圧力センサ
の製造工程を示す略断面図である。なお、本実施形態に
係る半導体圧力センサの表面から見た状態を示す略平面
図は、図4と同様である。また、本実施形態に係る図5
(b)までの製造工程は、従来例として図8に示す
(b)までの製造工程と同様であるので、ここでは説明
を省略し、図5(c)の製造工程から説明する。所定形
状にパターニングされたフォトレジスト(図示せず)を
マスクとして、シリコンウェハ1のピエゾ抵抗素子2が
形成された面側の窒化膜4及び酸化膜3のエッチングを
行うことにより開口部5aを形成し、フォトレジストを
除去する。このとき、開口部5aは、溝部1b形成箇所
上に形成される。
Embodiment 3 = FIG. 5 is a schematic sectional view showing a manufacturing process of a semiconductor pressure sensor according to another embodiment of the present invention. A schematic plan view showing a state of the semiconductor pressure sensor according to the present embodiment viewed from the surface is the same as FIG. FIG. 5 according to the present embodiment.
Since the manufacturing process up to (b) is the same as the manufacturing process up to (b) shown in FIG. 8 as a conventional example, the description is omitted here, and the manufacturing process from FIG. The opening 5a is formed by etching the nitride film 4 and the oxide film 3 on the surface of the silicon wafer 1 on which the piezoresistive elements 2 are formed, using a photoresist (not shown) patterned in a predetermined shape as a mask. Then, the photoresist is removed. At this time, the opening 5a is formed on the location where the groove 1b is formed.

【0033】そして、開口部5aが形成された酸化膜3
及び窒化膜4をマスクとしてRIEにより、溝部1bが
所望の深さになるまでエッチングを行う(図5
(c))。このとき、溝部1bは、ダイヤフラム1aの
中央線に対して線対照となるように配置することにより
応力による歪みが最も大きくなる。
The oxide film 3 having the opening 5a formed therein
Then, etching is performed by RIE using the nitride film 4 as a mask until the trench 1b reaches a desired depth (FIG. 5).
(C)). At this time, by disposing the groove portion 1b so as to be in line contrast with the center line of the diaphragm 1a, distortion due to stress is maximized.

【0034】なお、以下の工程は、従来例として図8に
示した(c)からの工程と同様であるので、ここでは説
明を省略する。また、図5においては、開口部5aは2
つしか形成されていないが、実際には図4に示すよう
に、形成する溝部1bの数に対応した数の開口部5aが
形成される。
The following steps are the same as the steps from (c) shown in FIG. 8 as a conventional example, and the description is omitted here. In FIG. 5, the opening 5a is 2
Although only one is formed, actually, as shown in FIG. 4, the number of openings 5a corresponding to the number of grooves 1b to be formed is formed.

【0035】従って、本実施形態においては、シリコン
ウェハ1のダイヤフラム1aに、スリット状の溝部1b
を形成することによりダイヤフラム1aに膜厚の薄い箇
所を形成するようにしたので、従来に比べて応力による
歪みが大きくなり、出力感度を向上させることができ
る。
Therefore, in this embodiment, the diaphragm 1a of the silicon wafer 1 is provided with the slit-shaped groove 1b.
Is formed so that a portion having a small film thickness is formed on the diaphragm 1a. Therefore, distortion due to stress is increased as compared with the related art, and output sensitivity can be improved.

【0036】また、本実施形態においては、RIEによ
り溝部1bを形成するようにしたので、開口部4aの大
きさに関係なく、所望の深さの溝部1bを形成すること
ができる。
In the present embodiment, since the groove 1b is formed by RIE, the groove 1b having a desired depth can be formed regardless of the size of the opening 4a.

【0037】なお、本実施形態においては、シリコンウ
ェハ1として面方位が(110)面のものを用いた場合
について説明したが、これに限定される必要はなく、面
方位が(100)面のシリコンウェハを用いた場合にも
適用できる。
In the present embodiment, the case where the silicon wafer 1 has a (110) plane orientation is used as the silicon wafer 1. However, the present invention is not limited to this. The silicon wafer 1 has a (100) plane orientation. The present invention can be applied to a case where a silicon wafer is used.

【0038】=実施形態4= 図6は、本発明の他の実施形態に係る半導体圧力センサ
を示す模式図であり、(a)は上面から見た状態を示す
略平面図であり、(b)は(a)のX−X’での略断面
図である。本実施形態に係る半導体圧力センサの製造工
程は、実施形態2として図3に示す半導体圧力センサの
製造工程と同様であるので、異なる点についてのみ説明
する。本実施形態の半導体圧力センサは、図6に示すよ
うに、ダイヤフラム1aの略中央から周辺にいくに従っ
て、隣接するスリット状の溝部1bの間隔を狭くした構
成である。
Embodiment 4 = FIGS. 6A and 6B are schematic views showing a semiconductor pressure sensor according to another embodiment of the present invention. FIG. 6A is a schematic plan view showing a state viewed from above, and FIG. () Is a schematic sectional view taken along line XX 'of (a). Since the manufacturing process of the semiconductor pressure sensor according to the present embodiment is the same as the manufacturing process of the semiconductor pressure sensor shown in FIG. 3 as the second embodiment, only different points will be described. As shown in FIG. 6, the semiconductor pressure sensor according to the present embodiment has a configuration in which the interval between adjacent slit-shaped grooves 1b is reduced from substantially the center to the periphery of the diaphragm 1a.

【0039】本実施形態においては、図3(a)におけ
る開口部5aを、図6(a)の溝部1bの形成箇所上に
形成するようにする。
In the present embodiment, the opening 5a in FIG. 3A is formed on the location where the groove 1b is formed in FIG. 6A.

【0040】従って、本実施形態においては、シリコン
ウェハ1のダイヤフラム1aに、スリット状の溝部1b
を形成することによりダイヤフラム1aに膜厚の薄い箇
所を形成するようにしたので、従来に比べて応力による
歪みが大きくなり、出力感度を向上させることができ
る。
Therefore, in this embodiment, the diaphragm 1a of the silicon wafer 1 is provided with the slit-shaped groove 1b.
Is formed so that a portion having a small film thickness is formed on the diaphragm 1a. Therefore, distortion due to stress is increased as compared with the related art, and output sensitivity can be improved.

【0041】また、ダイヤフラム1aの周辺にいくに従
って、隣接するスリット状の溝部1bの間隔を狭くする
ようにしたので、ダイヤフラム1aの周辺部では応力に
よる歪みがさらに大きくなり、逆にダイヤフラム1aの
中央部では応力による歪みが小さくなるため、さらに感
度を向上させることができる。
Further, the distance between the adjacent slit-shaped grooves 1b is made narrower toward the periphery of the diaphragm 1a, so that the stress due to the stress at the periphery of the diaphragm 1a further increases, and conversely, the center of the diaphragm 1a is increased. Since the strain due to the stress is reduced in the portion, the sensitivity can be further improved.

【0042】また、本実施形態においては、シリコンウ
ェハ1として面方位が(110)面のものを用いた場合
について説明したが、これに限定される必要はなく、面
方位が(100)面のシリコンウェハを用いた場合にも
適用できる。
Further, in the present embodiment, the case where the silicon wafer 1 having the (110) plane orientation is used has been described. However, the present invention is not limited to this. The silicon wafer 1 has the (100) plane orientation. The present invention can be applied to a case where a silicon wafer is used.

【0043】また、本実施形態においては、溝部1bを
ダイヤフラム1aのピエゾ抵抗素子2が形成された面側
に形成されたが、これに限定される必要はなく、ダイヤ
フラム1aのピエゾ抵抗素子2が形成された面と異なる
面側に形成するようにしても同様の効果が得られる。
In this embodiment, the groove 1b is formed on the surface of the diaphragm 1a on which the piezoresistive element 2 is formed. However, the present invention is not limited to this, and the piezoresistive element 2 of the diaphragm 1a may be used. The same effect can be obtained even if it is formed on a surface side different from the formed surface.

【0044】なお、本実施形態においては、ダイヤフラ
ム1aの略中央から周辺にいくに従って、隣接する溝部
1bの間隔を狭くするようにしたが、これに限定される
必要はなく、ダイヤラム1aの周辺部での応力による歪
みが大きくなり、ダイヤフラム1aの中央部での応力に
よる歪みが小さくなるように溝部1bを配置すればよ
い。
In this embodiment, the distance between the adjacent grooves 1b is reduced from substantially the center to the periphery of the diaphragm 1a. However, the present invention is not limited to this. The groove 1b may be arranged so that the distortion caused by the stress in the diaphragm 1a increases and the distortion caused by the stress in the central portion of the diaphragm 1a decreases.

【0045】=実施形態5= 図7は、本発明の他の実施形態に係る半導体圧力センサ
を示す模式図であり、(a)は上面から見た状態を示す
略平面図であり、(b)は(a)のY−Y’での略断面
図である。本実施形態に係る半導体圧力センサの製造工
程は、実施形態2として図3に示す半導体圧力センサの
製造工程と同様であるので、異なる点についてのみ説明
する。本実施形態の半導体圧力センサは、図7に示すよ
うに、ダイヤフラム1aの略中央から周辺にいくに従っ
て、スリット状の溝部1bの深さを深くした構成であ
る。
Embodiment 5 = FIGS. 7A and 7B are schematic views showing a semiconductor pressure sensor according to another embodiment of the present invention. FIG. 7A is a schematic plan view showing a state viewed from above, and FIG. () Is a schematic sectional view taken along line YY 'of (a). Since the manufacturing process of the semiconductor pressure sensor according to the present embodiment is the same as the manufacturing process of the semiconductor pressure sensor shown in FIG. 3 as the second embodiment, only different points will be described. As shown in FIG. 7, the semiconductor pressure sensor according to the present embodiment has a configuration in which the depth of the slit-like groove 1b is increased from substantially the center to the periphery of the diaphragm 1a.

【0046】本実施形態においては、図3(a)におけ
る開口部5aの開口の幅を、ダイヤフラム1aの周辺部
にいくに従って広くすることにより、ダイヤフラム1a
の略中央から周辺にいくに従って、スリット状の溝部1
bの深さを深くすることができる。
In the present embodiment, the width of the opening 5a in FIG. 3A is increased toward the periphery of the diaphragm 1a to thereby increase the width of the diaphragm 1a.
From the substantially center to the periphery, the slit-shaped groove 1
b can be made deeper.

【0047】従って、本実施形態においては、シリコン
ウェハ1のダイヤフラム1aに、スリット状の溝部1b
を形成することによりダイヤフラム1aに膜厚の薄い箇
所を形成するようにしたので、従来に比べて応力による
歪みが大きくなり、出力感度を向上させることができ
る。
Therefore, in this embodiment, the diaphragm 1a of the silicon wafer 1 is provided with the slit-shaped groove 1b.
Is formed so that a portion having a small film thickness is formed on the diaphragm 1a. Therefore, distortion due to stress is increased as compared with the related art, and output sensitivity can be improved.

【0048】また、ダイヤフラム1aの周辺にいくに従
って、溝部1bの深さを深くするようにしたので、ダイ
ヤフラム1aの周辺部では応力による歪みがさらに大き
くなり、逆にダイヤフラム1aの中央部では応力による
歪みが小さくなるため、さらに感度を向上させることが
できる。
Further, the depth of the groove 1b is made deeper toward the periphery of the diaphragm 1a, so that the distortion due to the stress becomes larger at the periphery of the diaphragm 1a, and conversely, the stress at the center of the diaphragm 1a becomes larger. Since the distortion is reduced, the sensitivity can be further improved.

【0049】また、本実施形態においては、シリコンウ
ェハ1として面方位が(110)面のものを用いた場合
について説明したが、これに限定される必要はなく、面
方位が(100)面のシリコンウェハを用いた場合にも
適用できる。
Further, in the present embodiment, the case where the silicon wafer 1 having the (110) plane is used as the silicon wafer 1 has been described. However, the present invention is not limited to this. The present invention can be applied to a case where a silicon wafer is used.

【0050】また、本実施形態においては、溝部1bを
ダイヤフラム1aのピエゾ抵抗素子2が形成された面側
に形成されたが、これに限定される必要はなく、ダイヤ
フラム1aのピエゾ抵抗素子2が形成された面と異なる
面側に形成するようにしても同様の効果が得られる。
In the present embodiment, the groove 1b is formed on the surface of the diaphragm 1a on which the piezoresistive element 2 is formed. However, the present invention is not limited to this, and the piezoresistive element 2 of the diaphragm 1a may be used. The same effect can be obtained even if it is formed on a surface side different from the formed surface.

【0051】なお、本実施形態においては、ダイヤフラ
ム1aの略中央から周辺にいくに従って、溝部1b深さ
を深くするようにしたが、これに限定される必要はな
く、ダイヤラム1aの周辺部での応力による歪みが大き
くなり、ダイヤフラム1aの中央部での応力による歪み
が小さくなるように溝部1bを形成すればよい。
In this embodiment, the depth of the groove 1b is increased from the substantially center to the periphery of the diaphragm 1a. However, the present invention is not limited to this. The groove 1b may be formed so that the strain due to the stress increases and the strain at the center of the diaphragm 1a decreases.

【0052】[0052]

【発明の効果】請求項1記載の発明は、ダイヤフラムを
有する半導体基板と、ダイヤフラム上に形成されたピエ
ゾ抵抗素子とを有して成る半導体圧力センサにおいて、
ダイヤフラム上にスリット状の溝部を複数形成したの
で、ダイヤフラムに膜厚の薄い箇所を形成することにな
り、応力による歪みが大きくなって出力感度が向上し、
チップサイズを大きくすることなく、感度を向上させる
ことのできる半導体圧力センサを提供することができ
た。
According to a first aspect of the present invention, there is provided a semiconductor pressure sensor having a semiconductor substrate having a diaphragm and a piezoresistive element formed on the diaphragm.
Since a plurality of slit-shaped grooves are formed on the diaphragm, a thin portion is formed on the diaphragm, which increases the distortion due to stress and improves the output sensitivity.
A semiconductor pressure sensor capable of improving sensitivity without increasing the chip size was provided.

【0053】請求項2記載の発明は、請求項1記載の半
導体圧力センサにおいて、隣接するスリット状の溝部の
間隔を、ダイヤフラムの略中央から周辺に行くに従っ
て、狭くするようにしたので、ダイヤフラムの周辺部で
は応力による歪みがさらに大きくなり、逆にダイヤフラ
ムの中央部では応力による歪みが小さくなるため、さら
に感度を向上させることができる。
According to a second aspect of the present invention, in the semiconductor pressure sensor according to the first aspect, an interval between adjacent slit-shaped grooves is made narrower from substantially the center to the periphery of the diaphragm. The distortion due to the stress is further increased in the peripheral portion, and the distortion due to the stress is decreased in the central portion of the diaphragm, so that the sensitivity can be further improved.

【0054】請求項3記載の発明は、請求項1または請
求項2記載の半導体圧力センサにおいて、スリット状の
溝部の深さを、ダイヤフラムの略中央から周辺に行くに
従って、深くするようにしたので、ダイヤフラムの周辺
部では応力による歪みがさらに大きくなり、逆にダイヤ
フラムの中央部では応力による歪みが小さくなるため、
さらに感度を向上させることができる。
According to a third aspect of the present invention, in the semiconductor pressure sensor according to the first or second aspect, the depth of the slit-shaped groove is made deeper as it goes from substantially the center to the periphery of the diaphragm. However, since the distortion due to the stress becomes larger at the periphery of the diaphragm, and the distortion due to the stress becomes smaller at the center of the diaphragm,
Further, the sensitivity can be improved.

【0055】請求項4記載の発明は、請求項1乃至請求
項3記載の半導体圧力センサにおいて、溝部をダイヤフ
ラムのピエゾ抵抗素子を形成した面側に形成したので、
ダイヤフラム形成と同時に、溝部1bを形成することが
でき、工程数を増やすことなく、応力による歪みを大き
くして出力感度を向上させることができる。
According to a fourth aspect of the present invention, in the semiconductor pressure sensor according to the first to third aspects, the groove is formed on the surface of the diaphragm on which the piezoresistive element is formed.
The groove 1b can be formed at the same time as the diaphragm is formed, and the distortion due to stress can be increased to increase the output sensitivity without increasing the number of steps.

【0056】請求項5記載の発明は、請求項1乃至請求
項4記載の半導体圧力センサにおいて、溝部をダイヤフ
ラムのピエゾ抵抗素子を形成した面と異なる面側に形成
したので、ダイヤフラムに膜厚の薄い箇所を形成するこ
とになり、応力による歪みが大きくなって出力感度が向
上する。
According to a fifth aspect of the present invention, in the semiconductor pressure sensor according to the first to fourth aspects, the groove is formed on a surface of the diaphragm different from the surface on which the piezoresistive element is formed. Since a thin portion is formed, distortion due to stress is increased and output sensitivity is improved.

【0057】請求項6記載の発明は、請求項1乃至請求
項5記載の半導体圧力センサにおいて、溝部をアルカリ
系のエッチャントを用いて異方性エッチングすることに
より形成したものである。
According to a sixth aspect of the present invention, in the semiconductor pressure sensor according to the first to fifth aspects, the groove is formed by performing anisotropic etching using an alkaline etchant.

【0058】請求項7記載の発明は、請求項1乃至請求
項5記載の半導体圧力センサにおいて、溝部をRIEに
より形成するようにしたので、エッチングのためのマス
クの開口部の大きさに関係なく所望の深さの溝部を形成
することができる。
According to a seventh aspect of the present invention, in the semiconductor pressure sensor according to the first to fifth aspects, the groove is formed by RIE, so that the groove is formed irrespective of the size of the opening of the mask for etching. A groove having a desired depth can be formed.

【図面の簡単な説明】[Brief description of the drawings]

【図1】本発明の一実施形態に係る半導体圧力センサの
製造工程を示す略断面図である。
FIG. 1 is a schematic sectional view showing a manufacturing process of a semiconductor pressure sensor according to one embodiment of the present invention.

【図2】本実施形態に係る半導体圧力センサの裏面から
見た状態を示す略平面図である。
FIG. 2 is a schematic plan view showing a state of the semiconductor pressure sensor according to the embodiment as viewed from the back surface.

【図3】本発明の他の実施形態に係る半導体圧力センサ
の製造工程を示す略断面図である。
FIG. 3 is a schematic sectional view showing a manufacturing process of a semiconductor pressure sensor according to another embodiment of the present invention.

【図4】本実施形態に係る半導体圧力センサの表面から
見た状態を示す略平面図である。
FIG. 4 is a schematic plan view showing a state of the semiconductor pressure sensor according to the embodiment as viewed from the surface.

【図5】本発明の他の実施形態に係る半導体圧力センサ
の製造工程を示す略断面図である。
FIG. 5 is a schematic sectional view showing a manufacturing process of a semiconductor pressure sensor according to another embodiment of the present invention.

【図6】本発明の他の実施形態に係る半導体圧力センサ
を示す模式図であり、(a)は上面から見た状態を示す
略平面図であり、(b)は(a)のX−X’での略断面
図である。
FIGS. 6A and 6B are schematic views showing a semiconductor pressure sensor according to another embodiment of the present invention, wherein FIG. 6A is a schematic plan view showing a state viewed from above, and FIG. It is a schematic sectional drawing in X '.

【図7】本発明の他の実施形態に係る半導体圧力センサ
を示す模式図であり、(a)は上面から見た状態を示す
略平面図であり、(b)は(a)のY−Y’での略断面
図である。
FIGS. 7A and 7B are schematic views showing a semiconductor pressure sensor according to another embodiment of the present invention, wherein FIG. 7A is a schematic plan view showing a state viewed from above, and FIG. It is a schematic sectional drawing in Y '.

【図8】従来例に係る半導体圧力センサの製造工程を示
す略断面図である。
FIG. 8 is a schematic sectional view showing a manufacturing process of a semiconductor pressure sensor according to a conventional example.

【符号の説明】[Explanation of symbols]

1 シリコンウェハ 1a ダイヤフラム 1b 溝部 2 ピエゾ抵抗素子 3 酸化膜 4 窒化膜 4a 開口部 5,5a,5b 開口部 6 アルミニウム(Al)配線 7 ガラス台座 7a 圧力導入孔 DESCRIPTION OF SYMBOLS 1 Silicon wafer 1a Diaphragm 1b Groove part 2 Piezoresistive element 3 Oxide film 4 Nitride film 4a Opening 5,5a, 5b Opening 6 Aluminum (Al) wiring 7 Glass pedestal 7a Pressure introducing hole

Claims (7)

【特許請求の範囲】[Claims] 【請求項1】 ダイヤフラムを有する半導体基板と、該
ダイヤフラム上に形成されたピエゾ抵抗素子とを有して
成る半導体圧力センサにおいて、前記ダイヤフラム上に
スリット状の溝部を複数形成したことを特徴とする半導
体圧力センサ。
1. A semiconductor pressure sensor comprising a semiconductor substrate having a diaphragm and a piezoresistive element formed on the diaphragm, wherein a plurality of slit-shaped grooves are formed on the diaphragm. Semiconductor pressure sensor.
【請求項2】 隣接する前記スリット状の溝部の間隔
を、前記ダイヤフラムの略中央から周辺に行くに従っ
て、狭くするようにしたことを特徴とする請求項1記載
の半導体圧力センサ。
2. The semiconductor pressure sensor according to claim 1, wherein an interval between the adjacent slit-shaped grooves is narrowed from a substantially center to a periphery of the diaphragm.
【請求項3】 前記スリット状の溝部の深さを、前記ダ
イヤフラムの略中央から周辺に行くに従って、深くする
ようにしたことを特徴とする請求項1または請求項2記
載の半導体圧力センサ。
3. The semiconductor pressure sensor according to claim 1, wherein the depth of the slit-shaped groove portion is made deeper as it goes from substantially the center to the periphery of the diaphragm.
【請求項4】 前記溝部を前記ダイヤフラムの前記ピエ
ゾ抵抗素子を形成した面側に形成したことを特徴とする
請求項1乃至請求項3記載の半導体圧力センサ。
4. The semiconductor pressure sensor according to claim 1, wherein said groove is formed on a surface of said diaphragm on which said piezoresistive element is formed.
【請求項5】 前記溝部を前記ダイヤフラムの前記ピエ
ゾ抵抗素子を形成した面と異なる面側に形成したことを
特徴とする請求項1乃至請求項4記載の半導体圧力セン
サ。
5. The semiconductor pressure sensor according to claim 1, wherein said groove is formed on a surface of said diaphragm that is different from a surface on which said piezoresistive element is formed.
【請求項6】 前記溝部を、アルカリ系のエッチャント
を用いて異方性エッチングすることにより形成したこと
を特徴とする請求項1乃至請求項5記載の半導体圧力セ
ンサ。
6. The semiconductor pressure sensor according to claim 1, wherein the groove is formed by performing anisotropic etching using an alkaline etchant.
【請求項7】 前記溝部を、RIEにより形成するよう
にしたことを特徴とする請求項1乃至請求項5記載の半
導体圧力センサ。
7. The semiconductor pressure sensor according to claim 1, wherein said groove is formed by RIE.
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Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN1322591C (en) * 2003-04-25 2007-06-20 北京大学 Method for processing and manufacturing components and parts applied in micro-electronics and mechanical system
US7916591B2 (en) 2001-04-27 2011-03-29 Panasonic Corporation Recordable optical disc, optical disc recording apparatus, optical disc reproduction apparatus, and method for recording data onto recordable optical disc
JP2019198936A (en) * 2018-05-18 2019-11-21 新日本無線株式会社 MEMS element

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