JPH09232256A - チップサイズパッケージの製造方法 - Google Patents
チップサイズパッケージの製造方法Info
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- JPH09232256A JPH09232256A JP8035902A JP3590296A JPH09232256A JP H09232256 A JPH09232256 A JP H09232256A JP 8035902 A JP8035902 A JP 8035902A JP 3590296 A JP3590296 A JP 3590296A JP H09232256 A JPH09232256 A JP H09232256A
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Abstract
パッケージの完成までの製造工程を減らすと同時に、ダ
イボンド工程での位置合わせ等を容易に行えるようにし
たチップサイズパッケージの製造方法を提供する。 【解決手段】 半導体ウエハ8上にバンプ2を形成する
工程と、このバンプ2によって半導体ウエハ8を回路基
板3上にダイボンドする工程と、ダイボンドした半導体
ウエハ8と回路基板3との間を樹脂6で封止する工程
と、樹脂封止した回路基板3と半導体ウエハ8とを半導
体チップ1毎にダイシングする工程とを備えるチップサ
イズパッケージの製造方法。
Description
の製造方法に係り、特に超小型のチップサイズパッケー
ジの製造方法に関する。
導体パッケージの超小型化が益々進み、最近ではバンプ
接続技術を用いた所謂チップサイズパッケージ(CS
P)が開発されている(エレクトロニクス実装技術 199
5(Vol.11 No.3)、及び特開平6−349893号参
照)。これは、例えば図10に示したように、半導体チ
ップ1の下面に多数のバンプ2を形成しておき、半導体
チップ1をマザーボードに直接マウントしてバンプ2を
回路接続するか、もしくは図に示したように、半導体チ
ップ1と同一形状の回路基板3にバンプ2を接続して層
状の半導体パッケージ4としておき、回路基板3の下面
に設けた電極5をマザーボードに接続するものである。
なお、バンプ2によって形成される半導体チップ1と回
路基板3との隙間は樹脂6によって封止されている。
ケージ4(CSP)の一製造工程図を示したものであ
る。この製造工程では先ずシリコン等のウエハ上に集積
回路を形成して半導体ウエハ8としたのち、その表面に
パッシベーション膜を施して集積回路を保護した上で、
半導体ウエハ8上に整列した多数のバンプ2を形成す
る。次の工程では半導体ウエハ8を半導体チップ1毎に
ダイシングし、更に半導体チップ1を一個ずつ吸着し易
いように、エキスパンド工程によって隣接する半導体チ
ップ1同士の間隔を空ける。次の工程ではガラスエポキ
シ又はフィルム等によって形成された回路基板3の所定
位置に上記エキスパンドした半導体チップ1を吸着ノズ
ルを用いて一個ずつ配置する。図12に示したように、
半導体チップ1はバンプ2を下側に向けて回路基板3に
配列され、バンプ2を所定の電子回路上にダイボンディ
ングする。リフロー工程でバンプ2を溶融し、回路基板
3上に接合する。次の樹脂コーティング工程は半導体チ
ップ1と回路基板3との隙間を封止するためのものであ
り、両者間に樹脂6が充填される。樹脂6はキュア炉を
通すことで硬化する。最後のダイシング工程ではダイシ
ングマシーンによって枡目状に切断し、一個ずつの半導
体チップ1とする。この時は回路基板3も半導体チップ
1と一緒にダイシングされて、直方体形状の半導体パッ
ケージ4(CSP)が完成する。
来の製造方法にあっては、バンプ2の形成から半導体パ
ッケージ4の完成までに6工程を必要とする上、半導体
チップ1を一個ずつ回路基板3上に移送し、各々につい
て位置合わせしてからダイボンドしなければならないな
ど、作業工程が面倒である他、作業時間が掛かってしま
うといった問題があった。
体パッケージの完成までの製造工程を減らすと同時に、
ダイボンド工程での位置合わせ等を容易に行えるように
したチップサイズパッケージの製造方法を提供するもの
である。
決するために、本発明に係るチップサイズパッケージの
製造方法は、第1に、半導体ウエハ上にバンプを形成す
る工程と、このバンプによって半導体ウエハを回路基板
上にダイボンドする工程と、ダイボンドした半導体ウエ
ハと回路基板との間を樹脂封止する工程と、樹脂封止し
た回路基板と半導体ウエハとを半導体チップ毎にダイシ
ングする工程とを備えることを特徴とし、第2に、半導
体ウエハ上にバンプを形成する工程と、このバンプによ
って半導体ウエハを回路基板上にダイボンドする工程
と、回路基板は残してダイボンドした半導体ウエハのみ
を半導体チップ毎にダイシングする工程と、回路基板上
でダイシングした半導体ウエハと回路基板との間を樹脂
封止する工程と、樹脂封止した回路基板と半導体ウエハ
とを半導体チップ毎にダイシングする工程とを備えるこ
とを特徴とする。
に係るチップサイズパッケージの製造方法を詳細に説明
する。図1は本発明の第一実施例の製造工程を示したも
のである。先の実施例と同様、先ずシリコン等のウエハ
上に集積回路を形成して半導体ウエハ8としたのち、そ
の表面にパッシベーション膜を施して集積回路を保護し
た上で、半導体ウエハ8上に整列した多数のバンプ2を
形成する。次に上記半導体ウエハ8を裏返してバンプ2
を下側に向け、そのまま回路基板3の上に載置して上下
左右の4箇所のポイント9a,9b,9c,9dで位置
決めを行なったのちダイボンドする(図2参照)。次に
これをリフローに通してバンプ2を溶融し、回路基板3
上に接合する。次の樹脂コーティング工程は半導体ウエ
ハ8と回路基板3との隙間を封止するためのものであ
る。図3に示したように、両者間の隙間に樹脂6を充填
してバンプ2を封止する。樹脂6はキュア炉に通すこと
で硬化する。次のダイシング工程ではダイシングマシー
ンによって半導体ウエハ8を枡目状に切断して半導体チ
ップ1毎に分割する。この時、図4に示したように、回
路基板3も半導体チップ1と一緒にダイシングされ、直
方体形状の半導体パッケージ4(CSP)として完成す
る。
て半導体ウエハ8の状態で回路基板3上にダイボンドす
るので、従来のような回路基板3にダイボンドする前に
半導体ウエハ8をダイシングする工程及びダイシングし
た半導体チップ1をエキスパンドする工程を省略するこ
とができる。また、ダイボンド工程も従来のような半導
体チップ1一個ずつ何回も繰り返して行うのに比べて一
回だけで済むので、従来より2工程少ない4工程で製造
することができる他、ダイボンド工程における半導体ウ
エハ8の位置合わせ作業も極めて容易となる。
程を示したものである。この実施例では、半導体ウエハ
8上にバンプ2を形成する工程、及び半導体ウエハ8を
回路基板3上にダイボンドする工程は、前記第一実施例
と同様なので、各工程の詳細な説明は省略する。この実
施例では回路基板3上にダイボンドされた半導体ウエハ
8に対して、図6に示したように、回路基板3をそのま
まにして半導体ウエハ8のみをチップ毎にダイシングし
て枡目状の半導体チップ1とする工程が先の実施例とは
異なる。次の樹脂コーティング工程は、前述と同様、半
導体ウエハ8と回路基板3との隙間を樹脂封止するため
のものであるが、この実施例では図7に示したように、
半導体ウエハ8と回路基板3との隙間だけでなく、ダイ
シングした半導体チップ1同士の隙間にも樹脂6が充填
される。キュア炉で樹脂6を硬化させたのち、再度半導
体チップ1のダイシングラインに沿って今度は回路基板
3も一緒にダイシングし(図8参照)、直方体形状の半
導体パッケージ4(CSP)を完成させる。
例とは異なって半導体ウエハ8の状態で回路基板3上に
ダイボンドするので、従来のような半導体ウエハ8のダ
イシング工程及びエキスパンド工程を省略することがで
き、従来より1工程少ない5工程で製造することができ
る他、この実施例では半導体ウエハ8を回路基板3上で
ダイシングして半導体チップ1にしてから樹脂を充填し
ているので、樹脂封止がより一層確実になるといった効
果がある。また、回路基板3と一緒に切断する二回目の
ダイシング幅を、半導体ウエハ8だけを切断する一回目
のダイシング幅より狭くした場合には、図9に示したよ
うに、半導体チップ1の側面周囲に樹脂6を残すことが
でき、これによって半導体チップ1をより確実に保護で
きるといった効果がある。
プサイズパッケージの製造方法によれば、半導体ウエハ
の状態で回路基板上にダイボンドするので、ダイボンド
する際の回路基板上への位置合わせ作業が、従来のよう
に半導体チップ毎にするのに比べて極めて容易となる
他、従来の製造工程より少ない工程数で製造することが
できるといった効果を奏する。
ンドしたのち、半導体ウエハだけを枡目状にダイシング
して半導体チップとした場合には、樹脂封止がより一層
確実なものになるといった効果が得られる。
ージの製造工程図である。
ージの製造工程図である。
図8と同様の断面図である。
である。
である。
Claims (2)
- 【請求項1】 半導体ウエハ上にバンプを形成する工程
と、 このバンプによって半導体ウエハを回路基板上にダイボ
ンドする工程と、 ダイボンドした半導体ウエハと回路基板との間を樹脂封
止する工程と、 樹脂封止した回路基板と半導体ウエハとを半導体チップ
毎にダイシングする工程とを備えるチップサイズパッケ
ージの製造方法。 - 【請求項2】 半導体ウエハ上にバンプを形成する工程
と、 このバンプによって半導体ウエハを回路基板上にダイボ
ンドする工程と、 回路基板は残してダイボンドした半導体ウエハのみを半
導体チップ毎にダイシングする工程と、 回路基板上でダイシングした半導体ウエハと回路基板と
の間を樹脂封止する工程と、 樹脂封止した回路基板と半導体ウエハとを半導体チップ
毎にダイシングする工程とを備えるチップサイズパッケ
ージの製造方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP3590296A JP3621182B2 (ja) | 1996-02-23 | 1996-02-23 | チップサイズパッケージの製造方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP3590296A JP3621182B2 (ja) | 1996-02-23 | 1996-02-23 | チップサイズパッケージの製造方法 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH09232256A true JPH09232256A (ja) | 1997-09-05 |
JP3621182B2 JP3621182B2 (ja) | 2005-02-16 |
Family
ID=12454968
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP3590296A Expired - Lifetime JP3621182B2 (ja) | 1996-02-23 | 1996-02-23 | チップサイズパッケージの製造方法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP3621182B2 (ja) |
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- 1996-02-23 JP JP3590296A patent/JP3621182B2/ja not_active Expired - Lifetime
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