JPH0918490A - 制御回線多重化装置 - Google Patents
制御回線多重化装置Info
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- JPH0918490A JPH0918490A JP16590695A JP16590695A JPH0918490A JP H0918490 A JPH0918490 A JP H0918490A JP 16590695 A JP16590695 A JP 16590695A JP 16590695 A JP16590695 A JP 16590695A JP H0918490 A JPH0918490 A JP H0918490A
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Abstract
(57)【要約】
【目的】 共通のＡＴＭ伝送路で主信号系のＡＴＭセル
と制御用パケットを伝送する。 【構成】 ＡＴＭセル組立部７はインタフェース部４で
受信された制御用パケットから制御用ＡＴＭセルを生成
する。ＡＴＭセル多重部８はインタフェース部５で受信
されたＡＴＭセルと制御用ＡＴＭセルを多重化する。こ
れにより、インタフェース部６からＡＴＭ伝送路３へ制
御用ＡＴＭセルが送出される。ＡＴＭセル分離部９は、
インタフェース部６で受信されたＡＴＭセルを主信号系
のＡＴＭセルと制御用ＡＴＭセルに分離する。制御用パ
ケット再生部１０は制御用ＡＴＭセルから制御用パケッ
トを再生する。こうして、インタフェース部４から非Ａ
ＴＭ伝送路１へ制御用パケットが送出される。
と制御用パケットを伝送する。 【構成】 ＡＴＭセル組立部７はインタフェース部４で
受信された制御用パケットから制御用ＡＴＭセルを生成
する。ＡＴＭセル多重部８はインタフェース部５で受信
されたＡＴＭセルと制御用ＡＴＭセルを多重化する。こ
れにより、インタフェース部６からＡＴＭ伝送路３へ制
御用ＡＴＭセルが送出される。ＡＴＭセル分離部９は、
インタフェース部６で受信されたＡＴＭセルを主信号系
のＡＴＭセルと制御用ＡＴＭセルに分離する。制御用パ
ケット再生部１０は制御用ＡＴＭセルから制御用パケッ
トを再生する。こうして、インタフェース部４から非Ａ
ＴＭ伝送路１へ制御用パケットが送出される。
Description
【０００１】
【産業上の利用分野】本発明は、ＡＴＭ伝送網上の制御
対象の装置に送信する制御用パケットをＡＴＭ伝送路で
伝送できるように、ＡＴＭセルと制御用パケットの多重
・分離を行う制御回線多重化装置に関するものである。
対象の装置に送信する制御用パケットをＡＴＭ伝送路で
伝送できるように、ＡＴＭセルと制御用パケットの多重
・分離を行う制御回線多重化装置に関するものである。
【０００２】
【従来の技術】従来より広帯域ＩＳＤＮを実現する転送
方式としてＡＴＭ（Asynchronous Transfer Mode、非同
期転送モード）の研究が進められている。このようなＡ
ＴＭを用いたＡＴＭ伝送網では、ネットワーク管理装置
と各伝送装置との間に主信号系のＡＴＭ伝送路とは物理
的に独立な制御用回線を設けて、ネットワーク管理装置
から各伝送装置を制御していた。
方式としてＡＴＭ（Asynchronous Transfer Mode、非同
期転送モード）の研究が進められている。このようなＡ
ＴＭを用いたＡＴＭ伝送網では、ネットワーク管理装置
と各伝送装置との間に主信号系のＡＴＭ伝送路とは物理
的に独立な制御用回線を設けて、ネットワーク管理装置
から各伝送装置を制御していた。
【０００３】図４はこのような従来のＡＴＭ伝送網の１
構成例を示す図であり、１１はＡＴＭ伝送路、１２は制
御用回線、１３はネットワーク管理装置、１４ａ、１４
ｂは端末（TE）、１５ａ〜１５ｅは加入者宅等に設置さ
れる網終端装置（NT）、１６ａは網終端装置１５ａ、１
５ｂの出力を多重化してＡＴＭ伝送路に送出する多重化
装置（MUX ）、１６ｂは同様に網終端装置１５ｃ、１５
ｄの出力を多重化する多重化装置、１７は加入者線端局
装置（SLT ）、１８ａ〜１８ｃはＡＴＭ伝送路の仮想パ
スレベルにおける相互接続を行うクロスコネクト（XC）
である。太線で示す主信号系のＡＴＭ伝送路１１に対し
て、制御用回線１２に用いられる通信方式は、イーサネ
ット（Ethernet）などの非ＡＴＭパケット通信であり、
ほとんどが１Ｍｂｐｓ以下の小さな帯域で使用されてい
る。
構成例を示す図であり、１１はＡＴＭ伝送路、１２は制
御用回線、１３はネットワーク管理装置、１４ａ、１４
ｂは端末（TE）、１５ａ〜１５ｅは加入者宅等に設置さ
れる網終端装置（NT）、１６ａは網終端装置１５ａ、１
５ｂの出力を多重化してＡＴＭ伝送路に送出する多重化
装置（MUX ）、１６ｂは同様に網終端装置１５ｃ、１５
ｄの出力を多重化する多重化装置、１７は加入者線端局
装置（SLT ）、１８ａ〜１８ｃはＡＴＭ伝送路の仮想パ
スレベルにおける相互接続を行うクロスコネクト（XC）
である。太線で示す主信号系のＡＴＭ伝送路１１に対し
て、制御用回線１２に用いられる通信方式は、イーサネ
ット（Ethernet）などの非ＡＴＭパケット通信であり、
ほとんどが１Ｍｂｐｓ以下の小さな帯域で使用されてい
る。
【０００４】
【発明が解決しようとする課題】以上のように従来のＡ
ＴＭ伝送網では、ＡＴＭ伝送路とは別の制御用回線を多
重化装置、加入者線端局装置、クロスコネクト等の各伝
送装置ごとに設ける必要があるので、制御対象の伝送装
置が増すに従ってシステム全体の物理的な伝送回線数、
規模が増大してしまうという問題点があった。本発明
は、上記課題を解決するためになされたもので、共通の
ＡＴＭ伝送路で主信号系のＡＴＭセルと制御用パケット
を伝送することができる制御回線多重化装置を提供する
ことを目的とする。
ＴＭ伝送網では、ＡＴＭ伝送路とは別の制御用回線を多
重化装置、加入者線端局装置、クロスコネクト等の各伝
送装置ごとに設ける必要があるので、制御対象の伝送装
置が増すに従ってシステム全体の物理的な伝送回線数、
規模が増大してしまうという問題点があった。本発明
は、上記課題を解決するためになされたもので、共通の
ＡＴＭ伝送路で主信号系のＡＴＭセルと制御用パケット
を伝送することができる制御回線多重化装置を提供する
ことを目的とする。
【０００５】
【課題を解決するための手段】本発明の制御回線多重化
装置は、受信した制御用パケットからヘッダ内の仮想パ
ス識別子が特定の値を有する制御用ＡＴＭセルを生成
し、多重化処理を行ってＡＴＭ伝送路に送出すると共
に、受信したＡＴＭセル中から仮想パス識別子に基づい
て制御用ＡＴＭセルを分離し、このセルから制御用パケ
ットを再生して非ＡＴＭ伝送路に送出するものである。
装置は、受信した制御用パケットからヘッダ内の仮想パ
ス識別子が特定の値を有する制御用ＡＴＭセルを生成
し、多重化処理を行ってＡＴＭ伝送路に送出すると共
に、受信したＡＴＭセル中から仮想パス識別子に基づい
て制御用ＡＴＭセルを分離し、このセルから制御用パケ
ットを再生して非ＡＴＭ伝送路に送出するものである。
【０００６】また、制御回線多重化装置は、非ＡＴＭ伝
送路との間で制御用パケットの送受信を行う制御用パケ
ットインタフェース部と、第１、第２のＡＴＭ伝送路と
の間でＡＴＭセルの送受信をそれぞれ行う第１、第２の
ＡＴＭセルインタフェース部と、仮想パス識別子の値が
第１のＡＴＭセルインタフェース部で受信されたＡＴＭ
セルとは異なる特定値を有する制御用ＡＴＭセルを、制
御用パケットインタフェース部で受信された制御用パケ
ットから生成するＡＴＭセル組立部と、第１のＡＴＭセ
ルインタフェース部で受信されたＡＴＭセルとＡＴＭセ
ル組立部からの制御用ＡＴＭセルとを多重化して、第２
のＡＴＭセルインタフェース部に出力するＡＴＭセル多
重部と、第２のＡＴＭセルインタフェース部で受信され
たＡＴＭセルを識別子によりＡＴＭ伝送路に送出すべき
ＡＴＭセルと制御用ＡＴＭセルに分離し、ＡＴＭ伝送路
に送出すべきセルを第１のＡＴＭセルインタフェース部
に出力するＡＴＭセル分離部と、このＡＴＭセル分離部
で得られた制御用ＡＴＭセルから非ＡＴＭ伝送路に送出
すべき制御用パケットを再生して、制御用パケットイン
タフェース部に出力する制御用パケット再生部とを有す
るものである。
送路との間で制御用パケットの送受信を行う制御用パケ
ットインタフェース部と、第１、第２のＡＴＭ伝送路と
の間でＡＴＭセルの送受信をそれぞれ行う第１、第２の
ＡＴＭセルインタフェース部と、仮想パス識別子の値が
第１のＡＴＭセルインタフェース部で受信されたＡＴＭ
セルとは異なる特定値を有する制御用ＡＴＭセルを、制
御用パケットインタフェース部で受信された制御用パケ
ットから生成するＡＴＭセル組立部と、第１のＡＴＭセ
ルインタフェース部で受信されたＡＴＭセルとＡＴＭセ
ル組立部からの制御用ＡＴＭセルとを多重化して、第２
のＡＴＭセルインタフェース部に出力するＡＴＭセル多
重部と、第２のＡＴＭセルインタフェース部で受信され
たＡＴＭセルを識別子によりＡＴＭ伝送路に送出すべき
ＡＴＭセルと制御用ＡＴＭセルに分離し、ＡＴＭ伝送路
に送出すべきセルを第１のＡＴＭセルインタフェース部
に出力するＡＴＭセル分離部と、このＡＴＭセル分離部
で得られた制御用ＡＴＭセルから非ＡＴＭ伝送路に送出
すべき制御用パケットを再生して、制御用パケットイン
タフェース部に出力する制御用パケット再生部とを有す
るものである。
【０００７】また、ＡＴＭセル多重部は、第１のＡＴＭ
セルインタフェース部で受信されたＡＴＭセル中の空き
セルを検出する優先順位判定部と、ＡＴＭセル組立部か
らの制御用ＡＴＭセルを保持するバッファ部と、優先順
位判定部によって空きセルが検出されると、バッファ部
に保持された制御用ＡＴＭセルを出力させるバッファ制
御部と、通常は第１のＡＴＭセルインタフェース部から
のＡＴＭセルを出力し、優先順位判定部によって空きセ
ルが検出されたときは、バッファ部からの制御用ＡＴＭ
セルを出力するセレクタ部とからなるものである。
セルインタフェース部で受信されたＡＴＭセル中の空き
セルを検出する優先順位判定部と、ＡＴＭセル組立部か
らの制御用ＡＴＭセルを保持するバッファ部と、優先順
位判定部によって空きセルが検出されると、バッファ部
に保持された制御用ＡＴＭセルを出力させるバッファ制
御部と、通常は第１のＡＴＭセルインタフェース部から
のＡＴＭセルを出力し、優先順位判定部によって空きセ
ルが検出されたときは、バッファ部からの制御用ＡＴＭ
セルを出力するセレクタ部とからなるものである。
【０００８】
【作用】本発明によれば、制御用パケットから仮想パス
識別子が特定の値を有する制御用ＡＴＭセルを生成して
多重化処理を行うと共に、受信したＡＴＭセル中から仮
想パス識別子に基づいて制御用ＡＴＭセルを分離して制
御用パケットを再生することにより、ＡＴＭセルと制御
用パケットの多重・分離が行われる。また、ＡＴＭセル
組立部が、制御用パケットインタフェース部で受信され
た制御用パケットから制御用ＡＴＭセルを生成し、ＡＴ
Ｍセル多重部が、第１のＡＴＭセルインタフェース部で
受信されたＡＴＭセルと制御用ＡＴＭセルとを多重化す
ることにより、第２のＡＴＭセルインタフェース部から
第２のＡＴＭ伝送路へ制御用ＡＴＭセルが送出される。
そして、ＡＴＭセル分離部が、第２のＡＴＭセルインタ
フェース部で受信されたＡＴＭセルをＡＴＭ伝送路に送
出すべきＡＴＭセルと制御用ＡＴＭセルに分離し、制御
用パケット再生部が、この制御用ＡＴＭセルから制御用
パケットを再生することにより、制御用パケットインタ
フェース部から非ＡＴＭ伝送路へ制御用パケットが送出
される。
識別子が特定の値を有する制御用ＡＴＭセルを生成して
多重化処理を行うと共に、受信したＡＴＭセル中から仮
想パス識別子に基づいて制御用ＡＴＭセルを分離して制
御用パケットを再生することにより、ＡＴＭセルと制御
用パケットの多重・分離が行われる。また、ＡＴＭセル
組立部が、制御用パケットインタフェース部で受信され
た制御用パケットから制御用ＡＴＭセルを生成し、ＡＴ
Ｍセル多重部が、第１のＡＴＭセルインタフェース部で
受信されたＡＴＭセルと制御用ＡＴＭセルとを多重化す
ることにより、第２のＡＴＭセルインタフェース部から
第２のＡＴＭ伝送路へ制御用ＡＴＭセルが送出される。
そして、ＡＴＭセル分離部が、第２のＡＴＭセルインタ
フェース部で受信されたＡＴＭセルをＡＴＭ伝送路に送
出すべきＡＴＭセルと制御用ＡＴＭセルに分離し、制御
用パケット再生部が、この制御用ＡＴＭセルから制御用
パケットを再生することにより、制御用パケットインタ
フェース部から非ＡＴＭ伝送路へ制御用パケットが送出
される。
【０００９】また、セレクタ部が、通常は第１のＡＴＭ
セルインタフェース部からのＡＴＭセルを出力し、優先
順位判定部によって空きセルが検出されたときはバッフ
ァ部からの制御用ＡＴＭセルを出力することにより、第
１のＡＴＭセルインタフェース部からのＡＴＭセル中の
空きセルの位置に制御用ＡＴＭセルが多重化される。
セルインタフェース部からのＡＴＭセルを出力し、優先
順位判定部によって空きセルが検出されたときはバッフ
ァ部からの制御用ＡＴＭセルを出力することにより、第
１のＡＴＭセルインタフェース部からのＡＴＭセル中の
空きセルの位置に制御用ＡＴＭセルが多重化される。
【００１０】
【実施例】図１は本発明の１実施例を示す制御回線多重
化装置のブロック図であり、１はイーサネットやＲＳ−
２３２Ｃ等の非ＡＴＭ伝送路、２、３は第１、第２のＡ
ＴＭ伝送路、４は非ＡＴＭ伝送路１との間で制御用パケ
ットの送受信を行う制御用パケットインタフェース部、
５、６はＡＴＭ伝送路２、３との間でＡＴＭセルの送受
信をそれぞれ行う第１、第２のＡＴＭセルインタフェー
ス部である。７はＡＴＭセル組立部であり、ヘッダ内の
仮想パス識別子（Virtual Path Identifier、以下、Ｖ
ＰＩとする）の値がＡＴＭセルインタフェース部５で受
信されたＡＴＭセルとは異なる値を有する制御用ＡＴＭ
セルを、制御用パケットインタフェース部４で受信され
た制御用パケットから生成する。
化装置のブロック図であり、１はイーサネットやＲＳ−
２３２Ｃ等の非ＡＴＭ伝送路、２、３は第１、第２のＡ
ＴＭ伝送路、４は非ＡＴＭ伝送路１との間で制御用パケ
ットの送受信を行う制御用パケットインタフェース部、
５、６はＡＴＭ伝送路２、３との間でＡＴＭセルの送受
信をそれぞれ行う第１、第２のＡＴＭセルインタフェー
ス部である。７はＡＴＭセル組立部であり、ヘッダ内の
仮想パス識別子（Virtual Path Identifier、以下、Ｖ
ＰＩとする）の値がＡＴＭセルインタフェース部５で受
信されたＡＴＭセルとは異なる値を有する制御用ＡＴＭ
セルを、制御用パケットインタフェース部４で受信され
た制御用パケットから生成する。
【００１１】また、８はＡＴＭセルインタフェース部５
で受信されたＡＴＭセルとＡＴＭセル組立部７からの制
御用ＡＴＭセルとを多重化して、ＡＴＭセルインタフェ
ース部６に出力するＡＴＭセル多重部、９はＡＴＭセル
インタフェース部６で受信されたＡＴＭセルをＶＰＩの
値によりＡＴＭ伝送路２に送出すべきＡＴＭセルと制御
用ＡＴＭセルに分離するＡＴＭセル分離部、１０はＡＴ
Ｍセル分離部９で得られた制御用ＡＴＭセルから非ＡＴ
Ｍ伝送路１に送出すべき制御用パケットを再生して、制
御用パケットインタフェース部４に出力する制御用パケ
ット再生部である。
で受信されたＡＴＭセルとＡＴＭセル組立部７からの制
御用ＡＴＭセルとを多重化して、ＡＴＭセルインタフェ
ース部６に出力するＡＴＭセル多重部、９はＡＴＭセル
インタフェース部６で受信されたＡＴＭセルをＶＰＩの
値によりＡＴＭ伝送路２に送出すべきＡＴＭセルと制御
用ＡＴＭセルに分離するＡＴＭセル分離部、１０はＡＴ
Ｍセル分離部９で得られた制御用ＡＴＭセルから非ＡＴ
Ｍ伝送路１に送出すべき制御用パケットを再生して、制
御用パケットインタフェース部４に出力する制御用パケ
ット再生部である。
【００１２】本実施例の非ＡＴＭ伝送路１には、図４の
例と同様の図示しないネットワーク管理装置が接続さ
れ、ＡＴＭ伝送路２、３には多重化装置、加入者線端局
装置、クロスコネクト等の図示しない伝送装置が接続さ
れている。次に、このような制御回線多重化装置の動作
を説明する。制御用パケットインタフェース部４は、非
ＡＴＭ伝送路１からの制御用パケットを受信して、これ
をＡＴＭセル組立部７に出力する。
例と同様の図示しないネットワーク管理装置が接続さ
れ、ＡＴＭ伝送路２、３には多重化装置、加入者線端局
装置、クロスコネクト等の図示しない伝送装置が接続さ
れている。次に、このような制御回線多重化装置の動作
を説明する。制御用パケットインタフェース部４は、非
ＡＴＭ伝送路１からの制御用パケットを受信して、これ
をＡＴＭセル組立部７に出力する。
【００１３】一方、第１のＡＴＭセルインタフェース部
５は、ＡＴＭ伝送路２からのＡＴＭセルを受信して、こ
れをＡＴＭセル多重部８に出力する。次いで、ＡＴＭセ
ル組立部７は、制御用パケットインタフェース部４から
入力された制御用パケットのＡＴＭセルへの組み立てを
行い、制御用ＡＴＭセルを生成する。このとき、制御用
ＡＴＭセルのヘッダに含まれるＶＰＩの値は、ＡＴＭ伝
送路２からのＡＴＭセルのヘッダに含まれるＶＰＩの値
とは異なるように特定の値が与えられる。
５は、ＡＴＭ伝送路２からのＡＴＭセルを受信して、こ
れをＡＴＭセル多重部８に出力する。次いで、ＡＴＭセ
ル組立部７は、制御用パケットインタフェース部４から
入力された制御用パケットのＡＴＭセルへの組み立てを
行い、制御用ＡＴＭセルを生成する。このとき、制御用
ＡＴＭセルのヘッダに含まれるＶＰＩの値は、ＡＴＭ伝
送路２からのＡＴＭセルのヘッダに含まれるＶＰＩの値
とは異なるように特定の値が与えられる。
【００１４】そして、ＡＴＭセル多重部８は、ＡＴＭセ
ルインタフェース部５からのＡＴＭセルとＡＴＭセル組
立部７からの制御用ＡＴＭセルとを多重化し、ＡＴＭセ
ルインタフェース部６に出力する。図２はこのＡＴＭセ
ル多重部８の１構成例を示す図、図３はＡＴＭセル多重
部８による多重化の様子を示す図である。
ルインタフェース部５からのＡＴＭセルとＡＴＭセル組
立部７からの制御用ＡＴＭセルとを多重化し、ＡＴＭセ
ルインタフェース部６に出力する。図２はこのＡＴＭセ
ル多重部８の１構成例を示す図、図３はＡＴＭセル多重
部８による多重化の様子を示す図である。
【００１５】図２において、８ａはＡＴＭセルインタフ
ェース部５で受信されたＡＴＭセル中の空きセルを検出
する優先順位判定部、８ｂはＡＴＭセル組立部７からの
制御用ＡＴＭセルを保持するバッファ部、８ｃは優先順
位判定部８ａによって空きセルが検出されると、バッフ
ァ部８ｂに保持された制御用ＡＴＭセルを出力させるバ
ッファ制御部、８ｄは通常はＡＴＭセルインタフェース
部５からのＡＴＭセルを出力し、優先順位判定部８ａに
よって空きセルが検出されたときは、バッファ部８ｂか
らの制御用ＡＴＭセルを出力するセレクタ部である。
ェース部５で受信されたＡＴＭセル中の空きセルを検出
する優先順位判定部、８ｂはＡＴＭセル組立部７からの
制御用ＡＴＭセルを保持するバッファ部、８ｃは優先順
位判定部８ａによって空きセルが検出されると、バッフ
ァ部８ｂに保持された制御用ＡＴＭセルを出力させるバ
ッファ制御部、８ｄは通常はＡＴＭセルインタフェース
部５からのＡＴＭセルを出力し、優先順位判定部８ａに
よって空きセルが検出されたときは、バッファ部８ｂか
らの制御用ＡＴＭセルを出力するセレクタ部である。
【００１６】図３において、２０はＡＴＭセルインタフ
ェース部５から出力されたＡＴＭセル、２１は空きセ
ル、２２はＡＴＭセル組立部７から出力された制御用Ａ
ＴＭセルである。
ェース部５から出力されたＡＴＭセル、２１は空きセ
ル、２２はＡＴＭセル組立部７から出力された制御用Ａ
ＴＭセルである。
【００１７】ＡＴＭでは運ぶべき情報がない場合は空き
セル２１を送ることになっており、優先順位判定部８ａ
は、この空きセル２１の検出を行う。一方、バッファ部
８ｂは、ＡＴＭセル組立部７より入力された制御用ＡＴ
Ｍセルを記憶する。
セル２１を送ることになっており、優先順位判定部８ａ
は、この空きセル２１の検出を行う。一方、バッファ部
８ｂは、ＡＴＭセル組立部７より入力された制御用ＡＴ
Ｍセルを記憶する。
【００１８】バッファ制御部８ｃは、優先順位判定部８
ａによって空きセル２１が検出されたときに、バッファ
部８ｂを制御して制御用ＡＴＭセル２２を出力させる。
そして、ＡＴＭセル多重部８の出力部となるセレクタ部
８ｄは、通常ＡＴＭセルインタフェース部５からのＡＴ
Ｍセル２０を選択して出力し、優先順位判定部８ａによ
って空きセル２１が検出されたときには、バッファ部８
ｂからの制御用ＡＴＭセル２２を選択して出力する。
ａによって空きセル２１が検出されたときに、バッファ
部８ｂを制御して制御用ＡＴＭセル２２を出力させる。
そして、ＡＴＭセル多重部８の出力部となるセレクタ部
８ｄは、通常ＡＴＭセルインタフェース部５からのＡＴ
Ｍセル２０を選択して出力し、優先順位判定部８ａによ
って空きセル２１が検出されたときには、バッファ部８
ｂからの制御用ＡＴＭセル２２を選択して出力する。
【００１９】こうして、図３に示すように空きセル２１
の位置に制御用ＡＴＭセル２２が多重化され、このよう
なＡＴＭセル２０、２２がＡＴＭセルインタフェース部
６を介してＡＴＭ伝送路３に送出される。これで、ＡＴ
Ｍ伝送路３に接続された図示しない伝送装置にネットワ
ーク管理装置からの制御用パケット（制御用ＡＴＭセ
ル）を伝送することができる。
の位置に制御用ＡＴＭセル２２が多重化され、このよう
なＡＴＭセル２０、２２がＡＴＭセルインタフェース部
６を介してＡＴＭ伝送路３に送出される。これで、ＡＴ
Ｍ伝送路３に接続された図示しない伝送装置にネットワ
ーク管理装置からの制御用パケット（制御用ＡＴＭセ
ル）を伝送することができる。
【００２０】次に、ＡＴＭセルインタフェース部６は、
ＡＴＭ伝送路３からのＡＴＭセルを受信して、これをＡ
ＴＭセル分離部９に出力する。ＡＴＭセル分離部９は、
入力されたＡＴＭセルのヘッダに含まれるＶＰＩの値に
より、このＡＴＭセルを制御パケット用のＶＰＩ値を有
する制御用ＡＴＭセルとそれ以外のＶＰＩ値を有するＡ
ＴＭセルに分離する。
ＡＴＭ伝送路３からのＡＴＭセルを受信して、これをＡ
ＴＭセル分離部９に出力する。ＡＴＭセル分離部９は、
入力されたＡＴＭセルのヘッダに含まれるＶＰＩの値に
より、このＡＴＭセルを制御パケット用のＶＰＩ値を有
する制御用ＡＴＭセルとそれ以外のＶＰＩ値を有するＡ
ＴＭセルに分離する。
【００２１】そして、ＡＴＭ伝送路２に送出すべきＡＴ
Ｍセルは、ＡＴＭセルインタフェース部５に出力され、
インタフェース部５を介してＡＴＭ伝送路２に送出され
る。また、制御用パケット再生部１０は、ＡＴＭセル分
離部９で分離された制御用ＡＴＭセルを分解して制御用
パケットを再生する。この制御用パケットは、制御用パ
ケットインタフェース部４を介して非ＡＴＭ伝送路１に
送出される。こうして、ＡＴＭ伝送路３に接続された伝
送装置からの制御用ＡＴＭセルを制御用パケットに変換
して、非ＡＴＭ伝送路１に接続されたネットワーク管理
装置に伝送することができる。
Ｍセルは、ＡＴＭセルインタフェース部５に出力され、
インタフェース部５を介してＡＴＭ伝送路２に送出され
る。また、制御用パケット再生部１０は、ＡＴＭセル分
離部９で分離された制御用ＡＴＭセルを分解して制御用
パケットを再生する。この制御用パケットは、制御用パ
ケットインタフェース部４を介して非ＡＴＭ伝送路１に
送出される。こうして、ＡＴＭ伝送路３に接続された伝
送装置からの制御用ＡＴＭセルを制御用パケットに変換
して、非ＡＴＭ伝送路１に接続されたネットワーク管理
装置に伝送することができる。
【００２２】なお、本実施例では、ＡＴＭ伝送路２、３
に接続された伝送装置の構成について示していないが、
制御回線多重化装置と同様の手段により、制御用ＡＴＭ
セルの分離又はモニタリングと多重化とを実現すること
ができるので、これによりネットワーク管理装置と伝送
装置との間で制御用ＡＴＭセル（制御用パケット）のや
り取りを行うことができる。
に接続された伝送装置の構成について示していないが、
制御回線多重化装置と同様の手段により、制御用ＡＴＭ
セルの分離又はモニタリングと多重化とを実現すること
ができるので、これによりネットワーク管理装置と伝送
装置との間で制御用ＡＴＭセル（制御用パケット）のや
り取りを行うことができる。
【００２３】また、本実施例では、制御用ＡＴＭセルに
主信号系のＡＴＭセルと異なる特定値のＶＰＩを与えて
いるが、これにより以下のような効果が得られる。すな
わち、ＡＴＭ伝送路上の仮想パスで障害が発生した場
合、ＯＡＭ（Operation and Maintenance ）機能により
ＯＡＭセルが生成されるが、このＯＡＭセルのＶＰＩの
値を見ることにより、主信号系の仮想パス又は制御用の
仮想パスのいずれで障害が発生したかを識別することが
できる。例えば、ＡＴＭ伝送路３上の制御用の仮想パス
で障害が発生したときに、制御回線多重化装置は、ＯＡ
ＭセルのＶＰＩの値が制御用ＡＴＭセルに与えられるＶ
ＰＩの値に等しいことから、制御用の仮想パスで障害が
発生したと認識することができる。
主信号系のＡＴＭセルと異なる特定値のＶＰＩを与えて
いるが、これにより以下のような効果が得られる。すな
わち、ＡＴＭ伝送路上の仮想パスで障害が発生した場
合、ＯＡＭ（Operation and Maintenance ）機能により
ＯＡＭセルが生成されるが、このＯＡＭセルのＶＰＩの
値を見ることにより、主信号系の仮想パス又は制御用の
仮想パスのいずれで障害が発生したかを識別することが
できる。例えば、ＡＴＭ伝送路３上の制御用の仮想パス
で障害が発生したときに、制御回線多重化装置は、ＯＡ
ＭセルのＶＰＩの値が制御用ＡＴＭセルに与えられるＶ
ＰＩの値に等しいことから、制御用の仮想パスで障害が
発生したと認識することができる。
【００２４】
【発明の効果】本発明によれば、制御用パケットから仮
想パス識別子が特定の値を有する制御用ＡＴＭセルを生
成して多重化処理を行うと共に、受信したＡＴＭセル中
から仮想パス識別子に基づいて制御用ＡＴＭセルを分離
して制御用パケットを再生することにより、ＡＴＭ伝送
網上の制御対象の装置との間で送受信される制御用パケ
ットと、主信号系のＡＴＭセルとの多重・分離が行われ
るので、ＡＴＭ伝送路によって制御用パケットを伝送す
ることができ、制御用回線を独立に設ける必要のないシ
ステム構成をとることできる。
想パス識別子が特定の値を有する制御用ＡＴＭセルを生
成して多重化処理を行うと共に、受信したＡＴＭセル中
から仮想パス識別子に基づいて制御用ＡＴＭセルを分離
して制御用パケットを再生することにより、ＡＴＭ伝送
網上の制御対象の装置との間で送受信される制御用パケ
ットと、主信号系のＡＴＭセルとの多重・分離が行われ
るので、ＡＴＭ伝送路によって制御用パケットを伝送す
ることができ、制御用回線を独立に設ける必要のないシ
ステム構成をとることできる。
【００２５】また、制御回線多重化装置を、制御用パケ
ットインタフェース部、第１、第２のＡＴＭセルインタ
フェース部、ＡＴＭセル組立部、ＡＴＭセル多重部、Ａ
ＴＭセル分離部及び制御用パケット再生部から構成する
ことにより、ＡＴＭ伝送路によって制御用パケットを伝
送することができる制御回線多重化装置を簡単な構成で
実現することができる。
ットインタフェース部、第１、第２のＡＴＭセルインタ
フェース部、ＡＴＭセル組立部、ＡＴＭセル多重部、Ａ
ＴＭセル分離部及び制御用パケット再生部から構成する
ことにより、ＡＴＭ伝送路によって制御用パケットを伝
送することができる制御回線多重化装置を簡単な構成で
実現することができる。
【００２６】また、セレクタ部が、通常は第１のＡＴＭ
セルインタフェース部からのＡＴＭセルを出力し、優先
順位判定部によって空きセルが検出されたときは制御用
ＡＴＭセルを出力することにより、主信号系のＡＴＭセ
ル中の空きセルの位置に制御用ＡＴＭセルが多重化され
るので、主信号系が混雑しているとき、すなわち空きセ
ルがないときには、制御用ＡＴＭセルを多重化しないよ
うに多重化処理の優先順位をＡＴＭセル多重部に持たせ
ることができ、主信号系の伝送回線に影響を与えること
なく制御回線の多重化を実現することができる。
セルインタフェース部からのＡＴＭセルを出力し、優先
順位判定部によって空きセルが検出されたときは制御用
ＡＴＭセルを出力することにより、主信号系のＡＴＭセ
ル中の空きセルの位置に制御用ＡＴＭセルが多重化され
るので、主信号系が混雑しているとき、すなわち空きセ
ルがないときには、制御用ＡＴＭセルを多重化しないよ
うに多重化処理の優先順位をＡＴＭセル多重部に持たせ
ることができ、主信号系の伝送回線に影響を与えること
なく制御回線の多重化を実現することができる。
【図１】 本発明の１実施例を示す制御回線多重化装置
のブロック図である。
のブロック図である。
【図２】 図１のＡＴＭセル多重部の１構成例を示す図
である。
である。
【図３】 ＡＴＭセル多重部による多重化の様子を示す
図である。
図である。
【図４】 従来のＡＴＭ伝送網の１構成例を示す図であ
る。
る。
１…非ＡＴＭ伝送路、２、３…ＡＴＭ伝送路、４…制御
用パケットインタフェース部、５、６…ＡＴＭセルイン
タフェース部、７…ＡＴＭセル組立部、８…ＡＴＭセル
多重部、８ａ…優先順位判定部、８ｂ…バッファ部、８
ｃ…バッファ制御部、８ｄ…セレクタ部、９…ＡＴＭセ
ル分離部、１０…制御用パケット再生部。
用パケットインタフェース部、５、６…ＡＴＭセルイン
タフェース部、７…ＡＴＭセル組立部、８…ＡＴＭセル
多重部、８ａ…優先順位判定部、８ｂ…バッファ部、８
ｃ…バッファ制御部、８ｄ…セレクタ部、９…ＡＴＭセ
ル分離部、１０…制御用パケット再生部。
Claims (3)
- 【請求項１】 ＡＴＭ伝送路によって伝送されるＡＴＭ
セルと制御用の非ＡＴＭ伝送路によって伝送される制御
用パケットとの多重・分離を行う制御回線多重化装置で
あって、 この制御回線多重化装置は、受信した制御用パケットか
らヘッダ内の仮想パス識別子が特定の値を有する制御用
ＡＴＭセルを生成し、多重化処理を行ってＡＴＭ伝送路
に送出すると共に、受信したＡＴＭセル中から仮想パス
識別子に基づいて制御用ＡＴＭセルを分離し、このセル
から制御用パケットを再生して非ＡＴＭ伝送路に送出す
るものであることを特徴とする制御回線多重化装置。 - 【請求項２】 請求項１記載の制御回線多重化装置にお
いて、 前記制御回線多重化装置は、非ＡＴＭ伝送路との間で制
御用パケットの送受信を行う制御用パケットインタフェ
ース部と、 第１、第２のＡＴＭ伝送路との間でＡＴＭセルの送受信
をそれぞれ行う第１、第２のＡＴＭセルインタフェース
部と、 仮想パス識別子の値が第１のＡＴＭセルインタフェース
部で受信されたＡＴＭセルとは異なる特定値を有する制
御用ＡＴＭセルを、制御用パケットインタフェース部で
受信された制御用パケットから生成するＡＴＭセル組立
部と、 第１のＡＴＭセルインタフェース部で受信されたＡＴＭ
セルとＡＴＭセル組立部からの制御用ＡＴＭセルとを多
重化して、第２のＡＴＭセルインタフェース部に出力す
るＡＴＭセル多重部と、 第２のＡＴＭセルインタフェース部で受信されたＡＴＭ
セルを前記識別子によりＡＴＭ伝送路に送出すべきＡＴ
Ｍセルと制御用ＡＴＭセルに分離し、ＡＴＭ伝送路に送
出すべきセルを第１のＡＴＭセルインタフェース部に出
力するＡＴＭセル分離部と、 このＡＴＭセル分離部で得られた制御用ＡＴＭセルから
非ＡＴＭ伝送路に送出すべき制御用パケットを再生し
て、制御用パケットインタフェース部に出力する制御用
パケット再生部とを有するものであることを特徴とする
制御回線多重化装置。 - 【請求項３】 請求項２記載の制御回線多重化装置にお
いて、 前記ＡＴＭセル多重部は、第１のＡＴＭセルインタフェ
ース部で受信されたＡＴＭセル中の空きセルを検出する
優先順位判定部と、 ＡＴＭセル組立部からの制御用ＡＴＭセルを保持するバ
ッファ部と、 優先順位判定部によって空きセルが検出されると、バッ
ファ部に保持された制御用ＡＴＭセルを出力させるバッ
ファ制御部と、 通常は第１のＡＴＭセルインタフェース部からのＡＴＭ
セルを出力し、優先順位判定部によって空きセルが検出
されたときは、バッファ部からの制御用ＡＴＭセルを出
力するセレクタ部とからなるものであることを特徴とす
る制御回線多重化装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16590695A JPH0918490A (ja) | 1995-06-30 | 1995-06-30 | 制御回線多重化装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16590695A JPH0918490A (ja) | 1995-06-30 | 1995-06-30 | 制御回線多重化装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0918490A true JPH0918490A (ja) | 1997-01-17 |
Family
ID=15821255
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP16590695A Pending JPH0918490A (ja) | 1995-06-30 | 1995-06-30 | 制御回線多重化装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0918490A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5875224A (en) * | 1997-09-02 | 1999-02-23 | General Electric Company | Swirler attachment for a spacer of a nuclear fuel bundle |
| JP2001251299A (ja) * | 2000-03-06 | 2001-09-14 | Ntt Communications Kk | 遠隔監視制御チャネル構成方法及びａｔｍ装置 |
-
1995
- 1995-06-30 JP JP16590695A patent/JPH0918490A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5875224A (en) * | 1997-09-02 | 1999-02-23 | General Electric Company | Swirler attachment for a spacer of a nuclear fuel bundle |
| JP2001251299A (ja) * | 2000-03-06 | 2001-09-14 | Ntt Communications Kk | 遠隔監視制御チャネル構成方法及びａｔｍ装置 |
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