JPH08317017A - 二重化構成方式 - Google Patents
二重化構成方式Info
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- JPH08317017A JPH08317017A JP7117011A JP11701195A JPH08317017A JP H08317017 A JPH08317017 A JP H08317017A JP 7117011 A JP7117011 A JP 7117011A JP 11701195 A JP11701195 A JP 11701195A JP H08317017 A JPH08317017 A JP H08317017A
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- Detection And Prevention Of Errors In Transmission (AREA)
Abstract
(57)【要約】
【目的】伝送機器におけるインタフェース回路の二重化
構成方式に関し、二重化する部分と一重化する部分とが
混在する場合や、同一基板内に複数のポートを収容する
場合等に好適な、二重化構成方式を提供することを目的
とする。 【構成】２つのポートを有する０系と１系の伝送装置側
の基板１0 ，１1 に対して、この２つのポートに対応す
るインタフェース部を有する２枚のインタフェース基板
２1,２2 を接続する。そして両インタフェース基板にお
いて切り替えを行なうことによって、両インタフェース
基板を、２つのポートまたはいずれか１つのポートにつ
いて、０系または１系の片系のインタフェースと、０系
と１系との両系のインタフェースとに運用可能にする。
構成方式に関し、二重化する部分と一重化する部分とが
混在する場合や、同一基板内に複数のポートを収容する
場合等に好適な、二重化構成方式を提供することを目的
とする。 【構成】２つのポートを有する０系と１系の伝送装置側
の基板１0 ，１1 に対して、この２つのポートに対応す
るインタフェース部を有する２枚のインタフェース基板
２1,２2 を接続する。そして両インタフェース基板にお
いて切り替えを行なうことによって、両インタフェース
基板を、２つのポートまたはいずれか１つのポートにつ
いて、０系または１系の片系のインタフェースと、０系
と１系との両系のインタフェースとに運用可能にする。
Description
【０００１】
【産業上の利用分野】本発明は、伝送機器におけるイン
タフェース回路の二重化構成方式に関し、特に二重化す
る部分と一重化する部分とが混在する場合や、同一基板
内に複数のポートを収容する場合等に好適な二重化構成
方式に関するものである。
タフェース回路の二重化構成方式に関し、特に二重化す
る部分と一重化する部分とが混在する場合や、同一基板
内に複数のポートを収容する場合等に好適な二重化構成
方式に関するものである。
【０００２】伝送機器においては、二重化されたスイッ
チ部等の装置に対して、複数の二重化されたインタフェ
ース部を設ける場合、それぞれのインタフェース盤を、
シェルフ（架）に設けられたそれぞれのスロットに挿入
して収容する。
チ部等の装置に対して、複数の二重化されたインタフェ
ース部を設ける場合、それぞれのインタフェース盤を、
シェルフ（架）に設けられたそれぞれのスロットに挿入
して収容する。
【０００３】このような二重化構成方式において、二重
化の部分と一重化の部分とが混在する場合や、同一基板
内に複数のポートを収容する場合でも、効率よくインタ
フェース盤を収容できるようにすることが必要である。
化の部分と一重化の部分とが混在する場合や、同一基板
内に複数のポートを収容する場合でも、効率よくインタ
フェース盤を収容できるようにすることが必要である。
【０００４】
【従来の技術】図８は、複数のインタフェース部を有す
る伝送機器を示したものである。１はスイッチ部等の装
置であって、０系と１系の部分１0 ，１1 によって二重
化されている。これに対して、１００1 〜１００4 は、
それぞれポート１の０系（＃０），ポート１の１系（＃
１），ポート２の０系（＃０），ポート２の１系（＃
１）の入力インタフェース部を示し、２００1 〜２００
4 は、それぞれポート１の０系（＃０），ポート１の１
系（＃１），ポート２の０系（＃０），ポート２の１系
（＃１）の出力インタフェース部を示している。
る伝送機器を示したものである。１はスイッチ部等の装
置であって、０系と１系の部分１0 ，１1 によって二重
化されている。これに対して、１００1 〜１００4 は、
それぞれポート１の０系（＃０），ポート１の１系（＃
１），ポート２の０系（＃０），ポート２の１系（＃
１）の入力インタフェース部を示し、２００1 〜２００
4 は、それぞれポート１の０系（＃０），ポート１の１
系（＃１），ポート２の０系（＃０），ポート２の１系
（＃１）の出力インタフェース部を示している。
【０００５】装置１においては、例えばスイッチング等
の処理を行ない、インタフェース部は伝送路と装置との
間に介在して、例えば光インタフェースであれば、光信
号と電気信号の相互の変換，同期等の処理を行なう。こ
の際、装置とインタフェースとの間では、０系，１系の
交絡をとって、現用系が障害のときは予備系に切り替え
るようにして、信頼度を向上させている。
の処理を行ない、インタフェース部は伝送路と装置との
間に介在して、例えば光インタフェースであれば、光信
号と電気信号の相互の変換，同期等の処理を行なう。こ
の際、装置とインタフェースとの間では、０系，１系の
交絡をとって、現用系が障害のときは予備系に切り替え
るようにして、信頼度を向上させている。
【０００６】図９は、従来のスロット構成を示したもの
であって、図中ポート（Ｐｏｒｔ）１＃０，ポート（Ｐ
ｏｒｔ）１＃１，ポート（Ｐｏｒｔ）２＃０，ポート
（Ｐｏｒｔ）２＃１，…は、図８に示された同一ポー
ト，同系の入力インタフェース部と出力インタフェース
部とを、１枚の基板に収容したインタフェース盤であっ
て、それぞれ対応するスロットＳ10, Ｓ11, Ｓ20, Ｓ
21, …に収容されるようになっている。
であって、図中ポート（Ｐｏｒｔ）１＃０，ポート（Ｐ
ｏｒｔ）１＃１，ポート（Ｐｏｒｔ）２＃０，ポート
（Ｐｏｒｔ）２＃１，…は、図８に示された同一ポー
ト，同系の入力インタフェース部と出力インタフェース
部とを、１枚の基板に収容したインタフェース盤であっ
て、それぞれ対応するスロットＳ10, Ｓ11, Ｓ20, Ｓ
21, …に収容されるようになっている。
【０００７】従来のインタフェース部の収容構成におい
ては、図９に示されたように、それぞれのインタフェー
ス盤を挿入するスロットは、二重化構成に対応して予め
定められていて、二重化構成に対して、一重化構成が混
在する場合には、使用しない部分のスロットは空きにさ
れていた。図９においては、ポート３が一重化構成であ
って、０系のインタフェース盤のみを収容したため、１
系のインタフェース盤に対応するスロットＳ31は、空き
になったことが示されている。
ては、図９に示されたように、それぞれのインタフェー
ス盤を挿入するスロットは、二重化構成に対応して予め
定められていて、二重化構成に対して、一重化構成が混
在する場合には、使用しない部分のスロットは空きにさ
れていた。図９においては、ポート３が一重化構成であ
って、０系のインタフェース盤のみを収容したため、１
系のインタフェース盤に対応するスロットＳ31は、空き
になったことが示されている。
【０００８】
【発明が解決しようとする課題】このようにインタフェ
ース回路を二重化する場合、従来のスロット構成では、
インタフェース盤を収容するスロットは二重化構成に対
応して予め定められていて、二重化構成のインタフェー
ス部と、一重化構成のインタフェース部とが混在する場
合、スロットに空きを生じて、シェルフ（架）における
インタフェース盤の収容効率が低下するという問題があ
った。
ース回路を二重化する場合、従来のスロット構成では、
インタフェース盤を収容するスロットは二重化構成に対
応して予め定められていて、二重化構成のインタフェー
ス部と、一重化構成のインタフェース部とが混在する場
合、スロットに空きを生じて、シェルフ（架）における
インタフェース盤の収容効率が低下するという問題があ
った。
【０００９】また１個のインタフェース盤に複数のポー
トを収容したい場合があるが、従来のインタフェース盤
の構成方法では、このような構成をとることができず、
スロットにおけるインタフェース盤の収容効率を向上さ
せることができなかった。
トを収容したい場合があるが、従来のインタフェース盤
の構成方法では、このような構成をとることができず、
スロットにおけるインタフェース盤の収容効率を向上さ
せることができなかった。
【００１０】本発明は、このような従来技術の課題を解
決しようとするものであって、インタフェース回路を二
重化する場合、インタフェース盤の収容効率を向上させ
ることが可能な、二重化構成方式を提供することを目的
としている。
決しようとするものであって、インタフェース回路を二
重化する場合、インタフェース盤の収容効率を向上させ
ることが可能な、二重化構成方式を提供することを目的
としている。
【００１１】
(1) ２つのポートを有する０系と１系の伝送装置側の基
板１0,１1 に対して、この２つのポートに対応するイン
タフェース部を有する２枚のインタフェース基板２1,２
2 を接続し、両インタフェース基板において切り替えを
行なうことによって、両インタフェース基板を、２つの
ポートまたはいずれか１つのポートについて、０系また
は１系の片系のインタフェースと、０系と１系との両系
のインタフェースとに運用可能にする。
板１0,１1 に対して、この２つのポートに対応するイン
タフェース部を有する２枚のインタフェース基板２1,２
2 を接続し、両インタフェース基板において切り替えを
行なうことによって、両インタフェース基板を、２つの
ポートまたはいずれか１つのポートについて、０系また
は１系の片系のインタフェースと、０系と１系との両系
のインタフェースとに運用可能にする。
【００１２】(2) ２つのポートを有する０系と１系の伝
送装置側の基板１0,１1 に対して、この２つのポートに
対応するインタフェース部を有する２枚のインタフェー
ス基板２1,２2 を接続し、伝送装置側の基板において切
り替えを行なうことによって、両インタフェース基板
を、２つのポートまたはいずれか１つのポートについ
て、０系または１系の片系のインタフェースと、０系と
１系との両系のインタフェースとに運用可能にする。
送装置側の基板１0,１1 に対して、この２つのポートに
対応するインタフェース部を有する２枚のインタフェー
ス基板２1,２2 を接続し、伝送装置側の基板において切
り替えを行なうことによって、両インタフェース基板
を、２つのポートまたはいずれか１つのポートについ
て、０系または１系の片系のインタフェースと、０系と
１系との両系のインタフェースとに運用可能にする。
【００１３】
【作用】図１は、本発明で実現するスロット構成例を示
したものであって、（ａ）は片系インタフェースの場合
を示し、（ｂ）は複数ポート収容の場合を示している。
したものであって、（ａ）は片系インタフェースの場合
を示し、（ｂ）は複数ポート収容の場合を示している。
【００１４】図１（ａ）の場合は、例えばポート１を二
重化構成として使用する場合は、スロットＳ1 にポート
１の０系（＃０）を挿入し、スロットＳ2 にポート１の
１系（＃１）を挿入するが、ポート１を０系のみの片系
インタフェースとした場合は、スロットＳ2 が空きにな
るので、この部分をポート２の０系（＃０）のインタフ
ェース盤として、ポート２の０系のみの片系インタフェ
ースとして使用することが示されている。
重化構成として使用する場合は、スロットＳ1 にポート
１の０系（＃０）を挿入し、スロットＳ2 にポート１の
１系（＃１）を挿入するが、ポート１を０系のみの片系
インタフェースとした場合は、スロットＳ2 が空きにな
るので、この部分をポート２の０系（＃０）のインタフ
ェース盤として、ポート２の０系のみの片系インタフェ
ースとして使用することが示されている。
【００１５】図１（ｂ）の場合は、各スロットにおい
て、２つのポートを収容したインタフェース盤を挿入し
て使用する場合を示し、例えばスロットＳ1 に、ポート
１の０系（＃０）とポート２の０系（＃０）を収容した
インタフェース盤を挿入し、スロットＳ2 に、ポート１
の１系（＃１）とポート２の１系（＃１）を収容したイ
ンタフェース盤を挿入したことが示されている。
て、２つのポートを収容したインタフェース盤を挿入し
て使用する場合を示し、例えばスロットＳ1 に、ポート
１の０系（＃０）とポート２の０系（＃０）を収容した
インタフェース盤を挿入し、スロットＳ2 に、ポート１
の１系（＃１）とポート２の１系（＃１）を収容したイ
ンタフェース盤を挿入したことが示されている。
【００１６】このように本発明によれば、インタフェー
ス回路を二重化する場合、二重化構成に対して、一重化
構成を混在させてもスロットの空きができないように
し、また１個のインタフェース盤を複数のポートに対し
て使用することができるので、スロット部における収容
効率を向上させることが可能な、二重化構成方式を提供
することができる。
ス回路を二重化する場合、二重化構成に対して、一重化
構成を混在させてもスロットの空きができないように
し、また１個のインタフェース盤を複数のポートに対し
て使用することができるので、スロット部における収容
効率を向上させることが可能な、二重化構成方式を提供
することができる。
【００１７】
【実施例】図２は、本発明の実施例(1) を示したもので
あって、インタフェース部において切り替えを行なうこ
とによって、片系インタフェースとした例を示してい
る。
あって、インタフェース部において切り替えを行なうこ
とによって、片系インタフェースとした例を示してい
る。
【００１８】図２において、１はスイッチ部等の装置で
あって、１0,１1 は装置側の０系の基板と１系の基板で
ある。２はインタフェース部であって、２1,２2 は０系
インタフェースのポート１の基板とポート２の基板であ
る。
あって、１0,１1 は装置側の０系の基板と１系の基板で
ある。２はインタフェース部であって、２1,２2 は０系
インタフェースのポート１の基板とポート２の基板であ
る。
【００１９】図２において、１１，１２，１３，１４は
信号を分配するディストリビュータ（ＤＩＳ）である。
１５，１７，１８は、現用／予備（０系／１系）の切り
替え用のセレクタ（ＳＥＬ）である。１９，２０はポー
ト１／ポート２の切り替え用のセレクタである。
信号を分配するディストリビュータ（ＤＩＳ）である。
１５，１７，１８は、現用／予備（０系／１系）の切り
替え用のセレクタ（ＳＥＬ）である。１９，２０はポー
ト１／ポート２の切り替え用のセレクタである。
【００２０】セレクタ１５，１７，１８を０系側に切り
替え、セレクタ１９をポート１側に切り替え、セレクタ
２０をポート２側に切り替えて、図２において太線で示
す信号経路の選択を行なうことによって、装置側からイ
ンタフェース部に対して、ポート１とポート２につい
て、０系のインタフェースがとられる。
替え、セレクタ１９をポート１側に切り替え、セレクタ
２０をポート２側に切り替えて、図２において太線で示
す信号経路の選択を行なうことによって、装置側からイ
ンタフェース部に対して、ポート１とポート２につい
て、０系のインタフェースがとられる。
【００２１】また、図２において、２１，２３，２４は
ポート１／ポート２の信号接断用のゲート（ＧＡＴＥ）
である。２５，２６，２７，２８はセレクタ、２９，３
０はそれぞれセレクタ２５，２６および２７，２８の切
り替えを制御する制御部である。
ポート１／ポート２の信号接断用のゲート（ＧＡＴＥ）
である。２５，２６，２７，２８はセレクタ、２９，３
０はそれぞれセレクタ２５，２６および２７，２８の切
り替えを制御する制御部である。
【００２２】ゲート２１をポート１側でオンにし、ゲー
ト２４をポート２側でオンにする。またセレクタ２５，
２６を０系側に切り替え、セレクタ２７，２８を１系側
に切り替えて、図２において太線で示す信号経路の選択
を行なうことによって、インタフェース部のポート１の
０系と、装置側のポート１の０系と１系とでインタフェ
ースがとられ、インタフェース部のポート２の０系と、
装置側のポート２の０系と１系とでインタフェースがと
られる。
ト２４をポート２側でオンにする。またセレクタ２５，
２６を０系側に切り替え、セレクタ２７，２８を１系側
に切り替えて、図２において太線で示す信号経路の選択
を行なうことによって、インタフェース部のポート１の
０系と、装置側のポート１の０系と１系とでインタフェ
ースがとられ、インタフェース部のポート２の０系と、
装置側のポート２の０系と１系とでインタフェースがと
られる。
【００２３】このように、図２に示された実施例によれ
ば、インタフェース部において切り替えを行なうことに
よって、装置１とインタフェース部２との間で、ポート
１とポート２について、片系インタフェースを実現でき
る。なお、図２において点線で示す部分は、使用しない
ので接続を行なわないことを示している。
ば、インタフェース部において切り替えを行なうことに
よって、装置１とインタフェース部２との間で、ポート
１とポート２について、片系インタフェースを実現でき
る。なお、図２において点線で示す部分は、使用しない
ので接続を行なわないことを示している。
【００２４】図３は、本発明の実施例(2) を示したもの
であって、実施例(1) の変形例を示している。図２の回
路と比較して、セレクタ１５，１６，１７，１８がポー
ト１／ポート２の切り替えを行ない，セレクタ１９，２
０が現用／予備（０系／１系）の切り替えを行なうよう
に構成されている点が相違している。
であって、実施例(1) の変形例を示している。図２の回
路と比較して、セレクタ１５，１６，１７，１８がポー
ト１／ポート２の切り替えを行ない，セレクタ１９，２
０が現用／予備（０系／１系）の切り替えを行なうよう
に構成されている点が相違している。
【００２５】セレクタ１５，１６をポート１側に切り替
え、セレクタ１７，１８をポート２側に切り替え、セレ
クタ１９，２０を０系側に切り替えて、図３において太
線で示す信号経路の選択を行なうことによって、装置側
からインタフェース部に対して、ポート１とポート２に
ついて、０系のインタフェースがとられる。
え、セレクタ１７，１８をポート２側に切り替え、セレ
クタ１９，２０を０系側に切り替えて、図３において太
線で示す信号経路の選択を行なうことによって、装置側
からインタフェース部に対して、ポート１とポート２に
ついて、０系のインタフェースがとられる。
【００２６】また ゲート２１をポート１側でオンに
し、ゲート２４をポート２側でオンにする。またセレク
タ２５，２６を０系側に切り替え、セレクタ２７，２８
を１系側に切り替えて、図３において太線で示す信号経
路の選択を行なうことによって、インタフェース部のポ
ート１の０系と、装置側のポート１の０系と１系との間
でインタフェースがとられ、インタフェース部のポート
２の０系と、装置側のポート２の０系と１系との間でイ
ンタフェースがとられる。
し、ゲート２４をポート２側でオンにする。またセレク
タ２５，２６を０系側に切り替え、セレクタ２７，２８
を１系側に切り替えて、図３において太線で示す信号経
路の選択を行なうことによって、インタフェース部のポ
ート１の０系と、装置側のポート１の０系と１系との間
でインタフェースがとられ、インタフェース部のポート
２の０系と、装置側のポート２の０系と１系との間でイ
ンタフェースがとられる。
【００２７】このように、図３に示された実施例によれ
ば、インタフェース部において切り替えを行なうことに
よって、装置１とインタフェース部２との間で、ポート
１とポート２について、片系インタフェースを実現でき
る。なお、図３において点線で示す部分は、使用しない
ので接続を行なわないことを示している。
ば、インタフェース部において切り替えを行なうことに
よって、装置１とインタフェース部２との間で、ポート
１とポート２について、片系インタフェースを実現でき
る。なお、図３において点線で示す部分は、使用しない
ので接続を行なわないことを示している。
【００２８】図４は、本発明の実施例(3) を示したもの
であって、インタフェース部において切り替えを行なう
ことによって、０系／１系のインタフェースとしたもの
であり、容量が小さい場合に適した例を示している。図
４の場合、インタフェース部２において、２1,２2 はポ
ート１の０系と１系のインタフェース基板である。
であって、インタフェース部において切り替えを行なう
ことによって、０系／１系のインタフェースとしたもの
であり、容量が小さい場合に適した例を示している。図
４の場合、インタフェース部２において、２1,２2 はポ
ート１の０系と１系のインタフェース基板である。
【００２９】図４において、１１，１３，１４は信号を
分配するディストリビュータ、１５，１７は現用／予備
（０系／１系）の切り替え用のセレクタである。
分配するディストリビュータ、１５，１７は現用／予備
（０系／１系）の切り替え用のセレクタである。
【００３０】セレクタ１５を０系側に切り替え、セレク
タ１７を１系側に切り替えて、図４において太線で示す
信号経路の選択を行なうことによって、装置側からイン
タフェース部に対して、ポート１について、０系と１系
のインタフェースがとられる。
タ１７を１系側に切り替えて、図４において太線で示す
信号経路の選択を行なうことによって、装置側からイン
タフェース部に対して、ポート１について、０系と１系
のインタフェースがとられる。
【００３１】また、図４において、２１，２３はポート
１／ポート２の信号接断用のゲート、２５，２７はセレ
クタ、２９，３０はそれぞれセレクタ２５および２７の
切り替えを制御する制御部である。
１／ポート２の信号接断用のゲート、２５，２７はセレ
クタ、２９，３０はそれぞれセレクタ２５および２７の
切り替えを制御する制御部である。
【００３２】ゲート２１，２３をポート１側でオンに
し、セレクタ２５，２７を０系側と１系側とに切り替え
るようにして、図４において太線で示す信号経路の選択
を行なうことによって、インタフェース部から装置側に
対して、ポート１の０系と１系とのインタフェースがと
られる。
し、セレクタ２５，２７を０系側と１系側とに切り替え
るようにして、図４において太線で示す信号経路の選択
を行なうことによって、インタフェース部から装置側に
対して、ポート１の０系と１系とのインタフェースがと
られる。
【００３３】このように、図４に示された実施例によれ
ば、インタフェース部において切り替えを行なうことに
よって、装置１とインタフェース部２との間で、０系／
１系のインタフェースを実現することができる。なお、
図４において点線で示す部分は、使用しないので接続を
行なわないことを示している。
ば、インタフェース部において切り替えを行なうことに
よって、装置１とインタフェース部２との間で、０系／
１系のインタフェースを実現することができる。なお、
図４において点線で示す部分は、使用しないので接続を
行なわないことを示している。
【００３４】図５は、本発明の実施例(4) を示したもの
であって、インタフェース部において切り替えを行なう
ことによって、０系／１系のインタフェースとしたもの
であり、容量が大きくポート１とポート２とを使用する
場合に適した例を示している。図４の場合と同様に、イ
ンタフェース部２において、２1,２2 は、ポート１の０
系と１系のインタフェース基板である。
であって、インタフェース部において切り替えを行なう
ことによって、０系／１系のインタフェースとしたもの
であり、容量が大きくポート１とポート２とを使用する
場合に適した例を示している。図４の場合と同様に、イ
ンタフェース部２において、２1,２2 は、ポート１の０
系と１系のインタフェース基板である。
【００３５】図５において、１１，１２，１３，１４は
信号を分配するディストリビュータ、１５，１６，１
７，１８は現用／予備（０系／１系）の切り替え用のセ
レクタである。
信号を分配するディストリビュータ、１５，１６，１
７，１８は現用／予備（０系／１系）の切り替え用のセ
レクタである。
【００３６】セレクタ１５，１６を０系側に切り替え、
セレクタ１７，１８を１系側に切り替えて、図５におい
て太線で示す信号経路の選択を行なうことによって、装
置側からインタフェース部に対して、ポート１とポート
２について、０系と１系のインタフェースをとることが
できる。
セレクタ１７，１８を１系側に切り替えて、図５におい
て太線で示す信号経路の選択を行なうことによって、装
置側からインタフェース部に対して、ポート１とポート
２について、０系と１系のインタフェースをとることが
できる。
【００３７】また図５において、３１，３２，３３，３
４は信号を分配するディストリビュータ、３５，３６，
３７，３８は現用／予備（０系／１系）の切り替え用の
セレクタである。
４は信号を分配するディストリビュータ、３５，３６，
３７，３８は現用／予備（０系／１系）の切り替え用の
セレクタである。
【００３８】セレクタ３５，３６を０系側に切り替え、
セレクタ３７，３８を１系側に切り替えて、図５におい
て太線で示す信号経路の選択を行なうことによって、イ
ンタフェース部から装置側に対して、ポート１とポート
２について、０系と１系のインタフェースをとることが
できる。
セレクタ３７，３８を１系側に切り替えて、図５におい
て太線で示す信号経路の選択を行なうことによって、イ
ンタフェース部から装置側に対して、ポート１とポート
２について、０系と１系のインタフェースをとることが
できる。
【００３９】このように、図５に示された実施例によれ
ば、インタフェース部において切り替えを行なうことに
よって、装置１とインタフェース部２との間で、ポート
１とポート２とについて、０系／１系のインタフェース
を実現することができる。
ば、インタフェース部において切り替えを行なうことに
よって、装置１とインタフェース部２との間で、ポート
１とポート２とについて、０系／１系のインタフェース
を実現することができる。
【００４０】図６は、本発明の実施例(5) を示したもの
であって、装置側において切り替えを行なうことによっ
て、片系インタフェースとした例を示している。図６の
場合、インタフェース部２において、２1,２2 は０系イ
ンタフェースのポート１の基板とポート２の基板であ
る。
であって、装置側において切り替えを行なうことによっ
て、片系インタフェースとした例を示している。図６の
場合、インタフェース部２において、２1,２2 は０系イ
ンタフェースのポート１の基板とポート２の基板であ
る。
【００４１】図６において、４１，４２は、信号経路を
選択するセレクタまたはスイッチからなる切り替え部、
４３，４４は、現用／予備（０系／１系）の切り替え用
のセレクタである。
選択するセレクタまたはスイッチからなる切り替え部、
４３，４４は、現用／予備（０系／１系）の切り替え用
のセレクタである。
【００４２】切り替え部４１において、セレクタ４１1
をポート２側に切り替え、切り替え部４２において、セ
レクタ４２1 をポート２側に切り替え、セレクタ４３，
４４を０系側に切り替えて、図６において太線で示す信
号経路の選択を行なうことによって、装置側からインタ
フェース部に対して、ポート１とポート２について０系
のインタフェースをとることができる。
をポート２側に切り替え、切り替え部４２において、セ
レクタ４２1 をポート２側に切り替え、セレクタ４３，
４４を０系側に切り替えて、図６において太線で示す信
号経路の選択を行なうことによって、装置側からインタ
フェース部に対して、ポート１とポート２について０系
のインタフェースをとることができる。
【００４３】また図６において、４５，４６は信号を分
配するディストリビュータ、４７，４８は信号経路を選
択するセレクタまたはスイッチからなる切り替え部であ
る。
配するディストリビュータ、４７，４８は信号経路を選
択するセレクタまたはスイッチからなる切り替え部であ
る。
【００４４】切り替え部４７において、セレクタ４７1
を０系側に切り替え、セレクタ４７ 2 をポート２側に切
り替え、切り替え部４８において、セレクタ４８1 を１
系側に切り替え、セレクタ４８2 をポート２側に切り替
えて、図６において太線で示す信号経路の選択を行なう
ことによって、インタフェース部のポート１の０系と、
装置側のポート１の０系と１系とでインタフェースがと
られ、インタフェース部のポート２の０系と、装置側の
ポート２の０系と１系とでインタフェースがとられる。
を０系側に切り替え、セレクタ４７ 2 をポート２側に切
り替え、切り替え部４８において、セレクタ４８1 を１
系側に切り替え、セレクタ４８2 をポート２側に切り替
えて、図６において太線で示す信号経路の選択を行なう
ことによって、インタフェース部のポート１の０系と、
装置側のポート１の０系と１系とでインタフェースがと
られ、インタフェース部のポート２の０系と、装置側の
ポート２の０系と１系とでインタフェースがとられる。
【００４５】このように、図６に示された実施例によれ
ば、装置側において切り替えを行なうことによって、装
置１とインタフェース部２との間で、ポート１とポート
２について、片系インタフェースを実現できる。
ば、装置側において切り替えを行なうことによって、装
置１とインタフェース部２との間で、ポート１とポート
２について、片系インタフェースを実現できる。
【００４６】図７は、本発明の実施例(6) を示したもの
であって、装置側において切り替えを行なうことによっ
て、０系／１系のインタフェースとした例を示してい
る。図７の場合、インタフェース部２において、２1,２
2 は、ポート１の０系と１系のインタフェース基板であ
る。
であって、装置側において切り替えを行なうことによっ
て、０系／１系のインタフェースとした例を示してい
る。図７の場合、インタフェース部２において、２1,２
2 は、ポート１の０系と１系のインタフェース基板であ
る。
【００４７】図７において、４１，４２は、信号経路を
選択するセレクタまたはスイッチからなる切り替え部、
４３，４４は、現用／予備（０系／１系）の切り替え用
のセレクタである。
選択するセレクタまたはスイッチからなる切り替え部、
４３，４４は、現用／予備（０系／１系）の切り替え用
のセレクタである。
【００４８】切り替え部４１において、セレクタ４１1
をポート１側に切り替え、切り替え部４２において、セ
レクタ４２1 をポート１側に切り替え、セレクタ４３を
０系側に切り替え、セレクタ４４を１系側に切り替え
て、図７において太線で示す信号経路の選択を行なうこ
とによって、装置側からインタフェース部に対して、ポ
ート１について、０系と１系のインタフェースがとられ
る。
をポート１側に切り替え、切り替え部４２において、セ
レクタ４２1 をポート１側に切り替え、セレクタ４３を
０系側に切り替え、セレクタ４４を１系側に切り替え
て、図７において太線で示す信号経路の選択を行なうこ
とによって、装置側からインタフェース部に対して、ポ
ート１について、０系と１系のインタフェースがとられ
る。
【００４９】また図７において、４５，４６は信号を分
配するディストリビュータ、４７，４８は信号経路を選
択するセレクタまたはスイッチからなる切り替え部であ
る。
配するディストリビュータ、４７，４８は信号経路を選
択するセレクタまたはスイッチからなる切り替え部であ
る。
【００５０】切り替え部４７において、セレクタ４７1
で０系側と１系側の選択を行ない、セレクタ４７2 をポ
ート１側に切り替える。また、切り替え部４８におい
て、セレクタ４８1 で０系側と１系側の選択を行ない、
セレクタ４８2 をポート１側に切り替える。これによっ
て、図７において太線で示す信号経路の選択を行なうこ
とによって、インタフェース部から装置側に対して、ポ
ート１の０系と１系とのインタフェースがとられる。
で０系側と１系側の選択を行ない、セレクタ４７2 をポ
ート１側に切り替える。また、切り替え部４８におい
て、セレクタ４８1 で０系側と１系側の選択を行ない、
セレクタ４８2 をポート１側に切り替える。これによっ
て、図７において太線で示す信号経路の選択を行なうこ
とによって、インタフェース部から装置側に対して、ポ
ート１の０系と１系とのインタフェースがとられる。
【００５１】このように、図７に示された実施例によれ
ば、装置側において切り替えを行なうことによって、装
置１とインタフェース部２との間で、ポート１につい
て、０系と１系のインタフェースを実現できる。
ば、装置側において切り替えを行なうことによって、装
置１とインタフェース部２との間で、ポート１につい
て、０系と１系のインタフェースを実現できる。
【００５２】
【発明の効果】以上説明したように本発明によれば、イ
ンタフェースの二重化構成において、一重化構成を混在
させてもスロットの空きができないようにすることがで
きる。また、１個のインタフェース盤を複数のポートに
対して使用することができる。従って本発明によれば、
インタフェース盤を挿入するスロット部における収容効
率を向上させることが可能となる。
ンタフェースの二重化構成において、一重化構成を混在
させてもスロットの空きができないようにすることがで
きる。また、１個のインタフェース盤を複数のポートに
対して使用することができる。従って本発明によれば、
インタフェース盤を挿入するスロット部における収容効
率を向上させることが可能となる。
【図１】本発明で実現するスロット構成例を示す図であ
って、（ａ）は片系インタフェースの場合を示し、
（ｂ）は複数ポート収容の場合を示す。
って、（ａ）は片系インタフェースの場合を示し、
（ｂ）は複数ポート収容の場合を示す。
【図２】本発明の実施例(1) を示す図である。
【図３】本発明の実施例(2) を示す図である。
【図４】本発明の実施例(3) を示す図である。
【図５】本発明の実施例(4) を示す図である。
【図６】本発明の実施例(5) を示す図である。
【図７】本発明の実施例(6) を示す図である。
【図８】複数のインタフェース部を有する伝送機器を示
す図である。
す図である。
【図９】従来のスロット構成を示す図である。
１0 伝送装置側の基板 １1 伝送装置側の基板 ２1 インタフェース基板 ２2 インタフェース基板
───────────────────────────────────────────────────── フロントページの続き (72)発明者 阿比留 節雄 神奈川県川崎市中原区上小田中1015番地 富士通株式会社内 (72)発明者 河合 正昭 神奈川県川崎市中原区上小田中1015番地 富士通株式会社内 (72)発明者 奥村 康行 東京都千代田区内幸町一丁目１番６号 日 本電信電話株式会社内
Claims (2)
- 【請求項１】 ２つのポートを有する０系と１系の伝送
装置側の基板に対して、該２つのポートに対応するイン
タフェース部を有する２枚のインタフェース基板を接続
し、 該両インタフェース基板において切り替えを行なうこと
によって、両インタフェース基板を、前記２つのポート
またはいずれか１つのポートについて、０系または１系
の片系のインタフェースと、０系と１系との両系のイン
タフェースとに運用可能にしたことを特徴とする二重化
構成方式。 - 【請求項２】 ２つのポートを有する０系と１系の伝送
装置側の基板に対して、該２つのポートに対応するイン
タフェース部を有する２枚のインタフェース基板を接続
し、 前記伝送装置側の基板において切り替えを行なうことに
よって、両インタフェース基板を、前記２つのポートま
たはいずれか１つのポートについて、０系または１系の
片系のインタフェースと、０系と１系との両系のインタ
フェースとに運用可能にしたことを特徴とする二重化構
成方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7117011A JPH08317017A (ja) | 1995-05-16 | 1995-05-16 | 二重化構成方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7117011A JPH08317017A (ja) | 1995-05-16 | 1995-05-16 | 二重化構成方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH08317017A true JPH08317017A (ja) | 1996-11-29 |
Family
ID=14701251
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP7117011A Withdrawn JPH08317017A (ja) | 1995-05-16 | 1995-05-16 | 二重化構成方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH08317017A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6466551B2 (en) | 1998-03-16 | 2002-10-15 | Fujitsu Limited | Simplex/duplex switching system |
-
1995
- 1995-05-16 JP JP7117011A patent/JPH08317017A/ja not_active Withdrawn
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6466551B2 (en) | 1998-03-16 | 2002-10-15 | Fujitsu Limited | Simplex/duplex switching system |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A300 | Application deemed to be withdrawn because no request for examination was validly filed |
Free format text: JAPANESE INTERMEDIATE CODE: A300 Effective date: 20020806 |