JPH08305812A - スマートカード及び該カードの実施方法 - Google Patents
スマートカード及び該カードの実施方法Info
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- JPH08305812A JPH08305812A JP10820596A JP10820596A JPH08305812A JP H08305812 A JPH08305812 A JP H08305812A JP 10820596 A JP10820596 A JP 10820596A JP 10820596 A JP10820596 A JP 10820596A JP H08305812 A JPH08305812 A JP H08305812A
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- card
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- G07F—COIN-FREED OR LIKE APPARATUS
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- G07F7/08—Mechanisms actuated by objects other than coins to free or to actuate vending, hiring, coin or paper currency dispensing or refunding apparatus by coded identity card or credit card or other personal identification means
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- G07F7/1008—Active credit-cards provided with means to personalise their use, e.g. with PIN-introduction/comparison system
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- G06Q20/00—Payment architectures, schemes or protocols
- G06Q20/30—Payment architectures, schemes or protocols characterised by the use of specific devices or networks
- G06Q20/34—Payment architectures, schemes or protocols characterised by the use of specific devices or networks using cards, e.g. integrated circuit [IC] cards or magnetic cards
- G06Q20/341—Active cards, i.e. cards including their own processing means, e.g. including an IC or chip
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- G07F7/08—Mechanisms actuated by objects other than coins to free or to actuate vending, hiring, coin or paper currency dispensing or refunding apparatus by coded identity card or credit card or other personal identification means
- G07F7/0866—Mechanisms actuated by objects other than coins to free or to actuate vending, hiring, coin or paper currency dispensing or refunding apparatus by coded identity card or credit card or other personal identification means by active credit-cards adapted therefor
Abstract
(57)【要約】
【課題】 スマートカード除去防止機構を提供する。
【解決手段】 少なくとも２ビットを各々が有する少な
くとも２つのレベルのカウンタで形成され、計算器原理
に従って使用されうるカウンタゾーンと、少なくとも２
ビットを各々が有する少なくとも２つの参照レジスタで
形成され、前記カウンタの全消去を示すために使用され
る第１の参照ゾーンと、書き込み及び読み出しの際にア
クセス可能であり、前記カウンタゾーンの内容が増分さ
れた場合には単独で消去可能である差引残高ゾーンと、
前記差引残高ゾーンに関連する２つのフィールドに構築
される第２の参照ゾーンとを具備し、前記差引残高のビ
ットの書き込みが、前記差引残高ゾーン及び前記第２の
参照ゾーンに同時に行われ、前記差引残高ゾーン及び前
記第２の参照ゾーン各々は、存在する前記差引残高が完
全に書き込まれているかどうかを知り得る１つの妥当性
検査ビットを備える。
くとも２つのレベルのカウンタで形成され、計算器原理
に従って使用されうるカウンタゾーンと、少なくとも２
ビットを各々が有する少なくとも２つの参照レジスタで
形成され、前記カウンタの全消去を示すために使用され
る第１の参照ゾーンと、書き込み及び読み出しの際にア
クセス可能であり、前記カウンタゾーンの内容が増分さ
れた場合には単独で消去可能である差引残高ゾーンと、
前記差引残高ゾーンに関連する２つのフィールドに構築
される第２の参照ゾーンとを具備し、前記差引残高のビ
ットの書き込みが、前記差引残高ゾーン及び前記第２の
参照ゾーンに同時に行われ、前記差引残高ゾーン及び前
記第２の参照ゾーン各々は、存在する前記差引残高が完
全に書き込まれているかどうかを知り得る１つの妥当性
検査ビットを備える。
Description
【０００１】
【発明の属する技術分野】本発明は、スマートカード及
び該カードの実施方法に関する。
び該カードの実施方法に関する。
【０００２】
【従来の技術】１９８３年以来、フランステレコムは、
フランス領でそのカード電話ボックスの設置を増加し続
けてきた。カードを装備した電話ボックスの数は目下１
２０，０００を超えており、内部にカードを装備した国
内電話は４０００を超えている。１９９３年以来、電話
カードの売上高は、年間１００，０００，０００枚に達
した。フランステレコムは、パブリファクス及び家庭電
話ボックスのような新しい端末を提供するためにその開
発を続けている。
フランス領でそのカード電話ボックスの設置を増加し続
けてきた。カードを装備した電話ボックスの数は目下１
２０，０００を超えており、内部にカードを装備した国
内電話は４０００を超えている。１９９３年以来、電話
カードの売上高は、年間１００，０００，０００枚に達
した。フランステレコムは、パブリファクス及び家庭電
話ボックスのような新しい端末を提供するためにその開
発を続けている。
【０００３】フランステレコムは、特に極端に低い通話
料金及び極端に高い国際通話料金に従事しているオペレ
ーターに関して、高度の計算能力を輸出する必要に直面
してきた。これらの要求を満たすために、ＳＥＰＴは、
増加された容量ばかりでなく、より融通性のある個人化
及び有効な機密保護をも含む新しいカードを作成するこ
とを提案している。
料金及び極端に高い国際通話料金に従事しているオペレ
ーターに関して、高度の計算能力を輸出する必要に直面
してきた。これらの要求を満たすために、ＳＥＰＴは、
増加された容量ばかりでなく、より融通性のある個人化
及び有効な機密保護をも含む新しいカードを作成するこ
とを提案している。
【０００４】新しい電話カード、即ち、第２世代の《Ｔ
２Ｇ》カードは、はるかに高度の計算能力を計算器機構
によって認証し、その電流消費ははるかに低い。機密保
護に関しては、《チャレンジ／レスポンス》機構に従っ
て機能する。即ち、カードは、単独で含み、秘密を含む
ための唯一の素子である秘密によってシグネチャをいか
に計算するかを知る。最近のCMOS（《相補金属酸化物半
導体》）技術によって、外部プログラミング電圧はもは
や必要ない。この電圧は、５ボルトから、ユニットが消
費される時にメモリからのビットを傾かせるのに必要と
される電圧を発生する《チャージポンプ》によって内部
的に生成される。
２Ｇ》カードは、はるかに高度の計算能力を計算器機構
によって認証し、その電流消費ははるかに低い。機密保
護に関しては、《チャレンジ／レスポンス》機構に従っ
て機能する。即ち、カードは、単独で含み、秘密を含む
ための唯一の素子である秘密によってシグネチャをいか
に計算するかを知る。最近のCMOS（《相補金属酸化物半
導体》）技術によって、外部プログラミング電圧はもは
や必要ない。この電圧は、５ボルトから、ユニットが消
費される時にメモリからのビットを傾かせるのに必要と
される電圧を発生する《チャージポンプ》によって内部
的に生成される。
【０００５】コンポーネント（ＳＴ １３３３）は、Ｓ
ＧＳトムソン会社によって、この第２世代カードのため
に開発されてきた。図１に示されるように、このコンポ
ーネントは、２７２ビットのＥＥＰＲＯＭメモリ（《電
気的に消去プログラム可能な読み出し専用メモリ》）を
含み、標準のマイクロプロセッサアーキテクチャが採用
されておらず、そのコストを最適化するための特定のア
ーキテクチャが採用されている。
ＧＳトムソン会社によって、この第２世代カードのため
に開発されてきた。図１に示されるように、このコンポ
ーネントは、２７２ビットのＥＥＰＲＯＭメモリ（《電
気的に消去プログラム可能な読み出し専用メモリ》）を
含み、標準のマイクロプロセッサアーキテクチャが採用
されておらず、そのコストを最適化するための特定のア
ーキテクチャが採用されている。
【０００６】ＥＥＰＲＯＭタイプのスマートカードを使
用する利点の一つは、このメモリが計算器構成され得る
ことである。現在、このカードのチップのプログラミン
グブロックは、次の３つの基本コマンド、即ち、メモリ
をクリアするコマンド、インクリメント及び読み出しを
するコマンド、書き込み又は消去するコマンドのいずれ
も受け入れるように単独で提供される。従って、これら
基本コマンドのいくつかは、計算器の２つの連続レベル
が関連するとき、計算器を更新するために互いに続く必
要がある。
用する利点の一つは、このメモリが計算器構成され得る
ことである。現在、このカードのチップのプログラミン
グブロックは、次の３つの基本コマンド、即ち、メモリ
をクリアするコマンド、インクリメント及び読み出しを
するコマンド、書き込み又は消去するコマンドのいずれ
も受け入れるように単独で提供される。従って、これら
基本コマンドのいくつかは、計算器の２つの連続レベル
が関連するとき、計算器を更新するために互いに続く必
要がある。
【０００７】実際、コンポーネントＳＴ １３３３は、
各クロックストライク（clock strike）に対して１だけ
インクリメントされ、《リセット》信号によってクリア
されるアドレスカウンタによって制御される２７２ビッ
トの直列メモリ（直列に読み出し及び書き込みされる）
である。このコンポーネントの制御ロジックは次のいく
つかの役割を有する。
各クロックストライク（clock strike）に対して１だけ
インクリメントされ、《リセット》信号によってクリア
されるアドレスカウンタによって制御される２７２ビッ
トの直列メモリ（直列に読み出し及び書き込みされる）
である。このコンポーネントの制御ロジックは次のいく
つかの役割を有する。
【０００８】−アドレスが割り振られたゾーン及び回路
がおかれているフェーズによりメモリへのアクセス（読
み出し、書き込み、消去）を制御する。即ち、テスト、
初期設定、使用である。 −認証計算ユニットによって、秘密キーを有するメモリ
の内部データに基づいて４ビットのシグネチャを計算
し、外部源から供給される３２ビットで危険を計算する
ことを可能にする。この過程は、機密保護のレベルを要
求されるレベルに調整するために数回繰り返され得る。
従って、秘密キー及び認証計算アルゴリズムの知識を必
要とするので、カードは、《クローン化》されない。 −高容量非可逆カウンタの制御が考慮に入れられる。こ
のカウンタは、８ビットの６レベルで形成され、計算器
内で機能する。レベルｉが一杯であるとき、１ビットが
レベルｉ＋１に加算される必要があり、それからレベル
ｉは消去され得る。従って、これは、基数８を６桁計算
することを含み、８6≒２５６，０００の容量を与え
る。
がおかれているフェーズによりメモリへのアクセス（読
み出し、書き込み、消去）を制御する。即ち、テスト、
初期設定、使用である。 −認証計算ユニットによって、秘密キーを有するメモリ
の内部データに基づいて４ビットのシグネチャを計算
し、外部源から供給される３２ビットで危険を計算する
ことを可能にする。この過程は、機密保護のレベルを要
求されるレベルに調整するために数回繰り返され得る。
従って、秘密キー及び認証計算アルゴリズムの知識を必
要とするので、カードは、《クローン化》されない。 −高容量非可逆カウンタの制御が考慮に入れられる。こ
のカウンタは、８ビットの６レベルで形成され、計算器
内で機能する。レベルｉが一杯であるとき、１ビットが
レベルｉ＋１に加算される必要があり、それからレベル
ｉは消去され得る。従って、これは、基数８を６桁計算
することを含み、８6≒２５６，０００の容量を与え
る。
【０００９】この構成の結果、回路に関して極めて簡単
なロジックを有することになる。万一カードがすぐに引
き取られるならば、カウンタが非有意状態にあることを
確実にするために、参照レジスタ機構が用意されてい
た。例えば、参照レジスタは、ステージｉ＋１が書き込
まれるが、レベルｉは消去されないことを示す。従っ
て、電話カードの次の使用で、端末はカウンタを有意状
態に置き換えることができる。
なロジックを有することになる。万一カードがすぐに引
き取られるならば、カウンタが非有意状態にあることを
確実にするために、参照レジスタ機構が用意されてい
た。例えば、参照レジスタは、ステージｉ＋１が書き込
まれるが、レベルｉは消去されないことを示す。従っ
て、電話カードの次の使用で、端末はカウンタを有意状
態に置き換えることができる。
【００１０】本発明は、いかなる内部マイクロプロセッ
サも含まないで、一定数の制御信号に応じて、このメモ
リの連続ブロックを順次アクセスし、そこに読み出し操
作、書き込み操作、又は消去操作を実行するようなメモ
リ及び復号化手段を単に含んでいる受動的な携帯支持体
に対するこの種の集積回路に関する。いかなる理由に関
しても、カードの処理が計算器の更新終了前に突然中断
されるかどうかの問題が生じる。フランスの逓信省の特
許第ＦＲ−２ ６７８ ０９４号は計算器の更新終了前
にカードを突然引き抜くことに続いて、その後カードを
使用することにより上記更新を終了する基本参照機構を
規定する。
サも含まないで、一定数の制御信号に応じて、このメモ
リの連続ブロックを順次アクセスし、そこに読み出し操
作、書き込み操作、又は消去操作を実行するようなメモ
リ及び復号化手段を単に含んでいる受動的な携帯支持体
に対するこの種の集積回路に関する。いかなる理由に関
しても、カードの処理が計算器の更新終了前に突然中断
されるかどうかの問題が生じる。フランスの逓信省の特
許第ＦＲ−２ ６７８ ０９４号は計算器の更新終了前
にカードを突然引き抜くことに続いて、その後カードを
使用することにより上記更新を終了する基本参照機構を
規定する。
【００１１】この特許では、それぞれのブロックｎ
１...ｎｐの数を含むｐ個のデータ計数メモリレベルを
含む携帯ユニット計数支持体のための集積回路が記載さ
れ、書き込みは、下部レベルの全ブロックが妥当性検査
される毎に上部レベルのブロックで実行され、次に下部
レベルのブロックが無効にされる。さらに、この回路
は、ｐ計数レベルのｐ−１上位行レベルに等しい参照レ
ベルを含み、参照レベルのアドレス指定ロジックは、こ
れらの参照レベルのブロックが対応する計数ブロックの
ブロックと同時に書き込みアドレス指定され、書き込み
後に丁度妥当性検査されたレベルよりも低いレベルのブ
ロックと同時に消去アドレス指定されるようなものであ
る。
１...ｎｐの数を含むｐ個のデータ計数メモリレベルを
含む携帯ユニット計数支持体のための集積回路が記載さ
れ、書き込みは、下部レベルの全ブロックが妥当性検査
される毎に上部レベルのブロックで実行され、次に下部
レベルのブロックが無効にされる。さらに、この回路
は、ｐ計数レベルのｐ−１上位行レベルに等しい参照レ
ベルを含み、参照レベルのアドレス指定ロジックは、こ
れらの参照レベルのブロックが対応する計数ブロックの
ブロックと同時に書き込みアドレス指定され、書き込み
後に丁度妥当性検査されたレベルよりも低いレベルのブ
ロックと同時に消去アドレス指定されるようなものであ
る。
【００１２】スマートカードの関連ゾーン この回路では、スマートカードの２つのゾーンは計数機
構と関連する。 −各々がｘビット、例えば８ビットを有する少なくとも
２つのレベルのカウンタ（Ｃ１及びＣｙ）で形成される
カウンタの１つのゾーン。このカウンタ部は計算器原理
に従って使用されうる。計数機構に関しては、ビットは
カウンタＣｎ（第１の《フリー》カウンタ）に規則的に
書き込まれる。カウンタＣｎに、いかなる記録もされて
いないビットがないとき、カウンタＣｎの消去を認証す
る《上部カウンタＣｎ＋１》に１ビットが書き込まれ、
この消去は同一のアドレスにおいて第２の書き込みコマ
ンドによって実行される。
構と関連する。 −各々がｘビット、例えば８ビットを有する少なくとも
２つのレベルのカウンタ（Ｃ１及びＣｙ）で形成される
カウンタの１つのゾーン。このカウンタ部は計算器原理
に従って使用されうる。計数機構に関しては、ビットは
カウンタＣｎ（第１の《フリー》カウンタ）に規則的に
書き込まれる。カウンタＣｎに、いかなる記録もされて
いないビットがないとき、カウンタＣｎの消去を認証す
る《上部カウンタＣｎ＋１》に１ビットが書き込まれ、
この消去は同一のアドレスにおいて第２の書き込みコマ
ンドによって実行される。
【００１３】−各々がｘビットのｙ−１個の参照レジス
タ（Ｒｔｙ−１〜ＲＴ１）で形成された参照カウンタの
ゾーン。参照カウンタはカウンタの適正な消去を表すた
めに使用される。カウンタＣｎの一つが正確に消去され
ないならば、レジスタＲｔｎの中のビットの位置は、消
去シーケンスがカウンタＣＮ＋１のどのビットで中断さ
れたのかを指示する。参照レジスタは、 −１ビットがゾーンＣｎに書き込まれたとき、コンポー
ネントの内部機構が、カウンタＣｎに書き込まれたビッ
トの位置と同じ位置に参照レジスタＲＴＮ−１にビット
を同時に書き込み、 −参照レジスタＲＴＮ−１は、第２の書き込みコマンド
の時点で関連ゾーンＣｎ−１と同時に消去されるよう
に、カウンタと関連している。
タ（Ｒｔｙ−１〜ＲＴ１）で形成された参照カウンタの
ゾーン。参照カウンタはカウンタの適正な消去を表すた
めに使用される。カウンタＣｎの一つが正確に消去され
ないならば、レジスタＲｔｎの中のビットの位置は、消
去シーケンスがカウンタＣＮ＋１のどのビットで中断さ
れたのかを指示する。参照レジスタは、 −１ビットがゾーンＣｎに書き込まれたとき、コンポー
ネントの内部機構が、カウンタＣｎに書き込まれたビッ
トの位置と同じ位置に参照レジスタＲＴＮ−１にビット
を同時に書き込み、 −参照レジスタＲＴＮ−１は、第２の書き込みコマンド
の時点で関連ゾーンＣｎ−１と同時に消去されるよう
に、カウンタと関連している。
【００１４】カウンタを増分するための方法手段 値１５を有するカウンタとともに２つのレベルカウンタ
の最も簡単な場合を取り上げるならば、
の最も簡単な場合を取り上げるならば、
【表１】 次に、カードのカウンタを１単位だけ増分することが望
まれるならば、最終値は１６である。この操作を実行す
るために、公衆電話は、最低カウンタで検知される最初
の《０》ビットを探し出し、そこに《１》を書き込む。
カウンタの状態に注目すると、Ｃ２のビット３は配置さ
れる必要がある。この操作を実行するために、二重書き
込みは下表に示されるように実行される必要がある。
まれるならば、最終値は１６である。この操作を実行す
るために、公衆電話は、最低カウンタで検知される最初
の《０》ビットを探し出し、そこに《１》を書き込む。
カウンタの状態に注目すると、Ｃ２のビット３は配置さ
れる必要がある。この操作を実行するために、二重書き
込みは下表に示されるように実行される必要がある。
【００１５】Ｃ２のビット３に書き込むための第１命令
【表２】 第１の書き込み配列後に、レベルＣ２は増分されるが、
レベルＣ１はなおその最初の値にある。従って、カウン
タの値は１５＋８＝２３である。 Ｃ２のビット３に書き込むための第２命令
レベルＣ１はなおその最初の値にある。従って、カウン
タの値は１５＋８＝２３である。 Ｃ２のビット３に書き込むための第２命令
【表３】 カウンタの最終値は書き込まれる総額に一致する２３−
７＝１６である。
７＝１６である。
【００１６】除去防止表示子 除去防止機構の実施は、同一例（その値が１５であるカ
ウンタからの１単位だけの増分）に基づいて（参照ゾー
ンの表示とともに）下記の表によって示される。 Ｃ２のビット３に書き込むための第１命令
ウンタからの１単位だけの増分）に基づいて（参照ゾー
ンの表示とともに）下記の表によって示される。 Ｃ２のビット３に書き込むための第１命令
【表４】 Ｃ２のビット３に書き込むための第２命令
【表５】
【００１７】再開手順 カードが２つの書き込みの間で読み取り機から取り除か
れた場合、他の電話ボックスでカードが次に使用される
ときに、特別の手順が実施される。実際、配置されたＲ
Ｔ１のビット３は、Ｃ２のビット３の二重書き込みの
間、カウンタを更新するための機構の中断を示す。従っ
て、単にＣ２のビット２に書き込みシーケンスを実行す
るには十分である。これは二重書き込みを必要とし、こ
の操作の詳細は通常の手順の詳細と同様である（上記参
照）。この手順はカウンタを期待最終構成に配置する。
次に、合法的な構成にカウンタ１を再固定するためにＣ
１のビット１を書き込むだけにとどまる。
れた場合、他の電話ボックスでカードが次に使用される
ときに、特別の手順が実施される。実際、配置されたＲ
Ｔ１のビット３は、Ｃ２のビット３の二重書き込みの
間、カウンタを更新するための機構の中断を示す。従っ
て、単にＣ２のビット２に書き込みシーケンスを実行す
るには十分である。これは二重書き込みを必要とし、こ
の操作の詳細は通常の手順の詳細と同様である（上記参
照）。この手順はカウンタを期待最終構成に配置する。
次に、合法的な構成にカウンタ１を再固定するためにＣ
１のビット１を書き込むだけにとどまる。
【００１８】第２に、スマートカードは、ケーブル接続
された認証回路及びゾーンによるアクセス条件のための
回路を備えていてもよい。フランスの逓信省のフランス
特許出願第ＦＲ−２ ７０４ ０８１号には、低価の
《金銭カード》を製造するためにこれらの特定の機能の
特定の実施が記載されている。低価の金銭機能を実施す
るために、カードは３つのゾーン、即ち差引残額ゾー
ン、カウンタゾーン及び認証ゾーンを含む必要がある。
認証ゾーンは、認証を生成し、それゆえに金銭の借方総
額を換金する機密保護のＩＤを含む。カードは、カウン
タ（書き込み及び書き込みにアクセス可能であるが消去
可能である）が認証ゾーン及び差引残高ゾーンの更新前
に増分されるような手段を含む。カウンタの内容が増分
されているならば、差引残高ゾーン及び認証ゾーンは、
書き込み及び読み出しの際にアクセス可能であるが消去
のみ可能である。
された認証回路及びゾーンによるアクセス条件のための
回路を備えていてもよい。フランスの逓信省のフランス
特許出願第ＦＲ−２ ７０４ ０８１号には、低価の
《金銭カード》を製造するためにこれらの特定の機能の
特定の実施が記載されている。低価の金銭機能を実施す
るために、カードは３つのゾーン、即ち差引残額ゾー
ン、カウンタゾーン及び認証ゾーンを含む必要がある。
認証ゾーンは、認証を生成し、それゆえに金銭の借方総
額を換金する機密保護のＩＤを含む。カードは、カウン
タ（書き込み及び書き込みにアクセス可能であるが消去
可能である）が認証ゾーン及び差引残高ゾーンの更新前
に増分されるような手段を含む。カウンタの内容が増分
されているならば、差引残高ゾーン及び認証ゾーンは、
書き込み及び読み出しの際にアクセス可能であるが消去
のみ可能である。
【００１９】電子金銭機能は、二重認証手順、即ちカー
ドの認証及びその最初の内容を確証するために取引の開
始時の一方の認証手順と、借方が計算され、メモリ内容
が更新された後の取引終了時の他方の認証手順との実行
に基づいている。金銭の更新は、１単位だけカウンタを
増分すること、前の差引残高及び以前の認証を消去する
こと、及び新しい差引残高及び新しい認証を代わりに書
き込むことからなる。
ドの認証及びその最初の内容を確証するために取引の開
始時の一方の認証手順と、借方が計算され、メモリ内容
が更新された後の取引終了時の他方の認証手順との実行
に基づいている。金銭の更新は、１単位だけカウンタを
増分すること、前の差引残高及び以前の認証を消去する
こと、及び新しい差引残高及び新しい認証を代わりに書
き込むことからなる。
【００２０】
【発明が解決しようとする課題】現行の技術の欠点は、
万一カードが差引残高及び認証を更新するためのシーケ
ンスの間、端末から除去されるならば、差引残高＋認証
ゾーンに関する再開機構を管理することはできないとい
うことである。除去防止機構は、カウンタのゾーンだけ
に関し、差引残高＋認証ゾーンには関していない。実際
に、差引残高及び認証が消去される時と、差引残高の新
しい値及び認証が書き込まれる時との間でカードが引き
抜かれた場合、差引残高及び認証はゼロにおかれる。同
様に、カードが新しい差引残高及び新しい認証を書き込
むためのフェーズの間に引き抜かれるならば、差引残高
及び認証は不確定値となってしまうという問題があっ
た。
万一カードが差引残高及び認証を更新するためのシーケ
ンスの間、端末から除去されるならば、差引残高＋認証
ゾーンに関する再開機構を管理することはできないとい
うことである。除去防止機構は、カウンタのゾーンだけ
に関し、差引残高＋認証ゾーンには関していない。実際
に、差引残高及び認証が消去される時と、差引残高の新
しい値及び認証が書き込まれる時との間でカードが引き
抜かれた場合、差引残高及び認証はゼロにおかれる。同
様に、カードが新しい差引残高及び新しい認証を書き込
むためのフェーズの間に引き抜かれるならば、差引残高
及び認証は不確定値となってしまうという問題があっ
た。
【００２１】本発明は上記事情に鑑みてなされたもので
あり、カウンタゾーンに関して同一の有効性を有する差
引残高＋認証に関する再開機構を管理することができる
ためのスマートカード除去防止機構を改善することを目
的とする。
あり、カウンタゾーンに関して同一の有効性を有する差
引残高＋認証に関する再開機構を管理することができる
ためのスマートカード除去防止機構を改善することを目
的とする。
【００２２】
【課題を解決するための手段】上記課題を解決するため
に、本発明は、少なくとも２ビットを各々が有する少な
くとも２つのレベルのカウンタで形成され、計算器原理
に従って使用されうるカウンタゾーンと、少なくとも２
ビットを各々が有する少なくとも２つの参照レジスタで
形成され、前記カウンタの全消去を示すために使用され
る第１の参照ゾーンとを有するスマートカードであっ
て、書き込み及び読み出しの際にアクセス可能であり、
前記カウンタゾーンの内容が増分された場合には単独で
消去可能である差引残高ゾーンと、前記差引残高ゾーン
に関連する２つのフィールドに構築される第２の参照ゾ
ーンとを具備し、前記差引残高のビットの書き込みが、
前記差引残高ゾーン及び前記第２の参照ゾーンに同時に
行われ、前記差引残高ゾーン及び前記第２の参照ゾーン
各々は、存在する前記差引残高が完全に書き込まれてい
るかどうかを知り得る１つの妥当性検査ビットを備える
ことを特徴とするスマートカードに関する。
に、本発明は、少なくとも２ビットを各々が有する少な
くとも２つのレベルのカウンタで形成され、計算器原理
に従って使用されうるカウンタゾーンと、少なくとも２
ビットを各々が有する少なくとも２つの参照レジスタで
形成され、前記カウンタの全消去を示すために使用され
る第１の参照ゾーンとを有するスマートカードであっ
て、書き込み及び読み出しの際にアクセス可能であり、
前記カウンタゾーンの内容が増分された場合には単独で
消去可能である差引残高ゾーンと、前記差引残高ゾーン
に関連する２つのフィールドに構築される第２の参照ゾ
ーンとを具備し、前記差引残高のビットの書き込みが、
前記差引残高ゾーン及び前記第２の参照ゾーンに同時に
行われ、前記差引残高ゾーン及び前記第２の参照ゾーン
各々は、存在する前記差引残高が完全に書き込まれてい
るかどうかを知り得る１つの妥当性検査ビットを備える
ことを特徴とするスマートカードに関する。
【００２３】スマートカードは、書き込み及び読み出し
の際にアクセス可能であり、前記カウンタゾーンの内容
が増分された場合には単独で消去可能である認証ゾーン
と、前記認証ゾーンに関連する２つのフィールドに構築
される第３の参照ゾーンと、前記認証のビットの書き込
みが、前記認証ゾーン及び前記第３の参照ゾーンに同時
に行われ、前記認証ゾーン及び前記第３の参照ゾーン各
々は、存在する前記認証が完全に書き込まれているかど
うかを知り得る１つの妥当性検査ビットとをさらに備え
ることを特徴とする。
の際にアクセス可能であり、前記カウンタゾーンの内容
が増分された場合には単独で消去可能である認証ゾーン
と、前記認証ゾーンに関連する２つのフィールドに構築
される第３の参照ゾーンと、前記認証のビットの書き込
みが、前記認証ゾーン及び前記第３の参照ゾーンに同時
に行われ、前記認証ゾーン及び前記第３の参照ゾーン各
々は、存在する前記認証が完全に書き込まれているかど
うかを知り得る１つの妥当性検査ビットとをさらに備え
ることを特徴とする。
【００２４】本発明は、特に、プログラム可能で電気的
に消去可能なデッドメモリであるＥＥＰＲＯＭタイプの
メモリのようなメモリが電気的に消去可能であるカード
に関する。スマートカードの一つの現行の適用はプリペ
イドカードに関する。これらのカードでは、メモリのブ
ロックは、最初に、カードが挿入された読み取り機によ
って提供されるいかなるサービスのコスト単位に対応す
る外部パルスに応じて変更される特定の状態にある。本
発明はまた、勘定単位がカードに記録され、カードが使
用されるとき減少又は増分される他の使用に適用され得
る。これらの単位は貨幣価値を有してもよい。このスマ
ートカードはまた、電話カード式カードであってもよ
い。
に消去可能なデッドメモリであるＥＥＰＲＯＭタイプの
メモリのようなメモリが電気的に消去可能であるカード
に関する。スマートカードの一つの現行の適用はプリペ
イドカードに関する。これらのカードでは、メモリのブ
ロックは、最初に、カードが挿入された読み取り機によ
って提供されるいかなるサービスのコスト単位に対応す
る外部パルスに応じて変更される特定の状態にある。本
発明はまた、勘定単位がカードに記録され、カードが使
用されるとき減少又は増分される他の使用に適用され得
る。これらの単位は貨幣価値を有してもよい。このスマ
ートカードはまた、電話カード式カードであってもよ
い。
【００２５】本発明はまた、金銭モードで使用されるス
マートカードの除去防止方法に関し、妥当性検査ビット
が、存在する差引残高が完全に書き込まれているかどう
かを明確に知ることを可能にし、二重書き込み機構を実
行している場合にこの妥当性検査ビットが配置され、こ
のビットが配置されない場合、前記差引残高が書き込ま
れていないとみなされ、前の差引残高に基づく取引の再
開のための機構であって、この機構が、２つのフィール
ドに構築されるデータフィールド（例えば、差引残高）
の参照レジスタゾーンに基づいている。
マートカードの除去防止方法に関し、妥当性検査ビット
が、存在する差引残高が完全に書き込まれているかどう
かを明確に知ることを可能にし、二重書き込み機構を実
行している場合にこの妥当性検査ビットが配置され、こ
のビットが配置されない場合、前記差引残高が書き込ま
れていないとみなされ、前の差引残高に基づく取引の再
開のための機構であって、この機構が、２つのフィール
ドに構築されるデータフィールド（例えば、差引残高）
の参照レジスタゾーンに基づいている。
【００２６】同様に、妥当性検査ビットが、存在する認
証が完全に書き込まれているかどうかを明確に知ること
を可能にし、このビットが、二重書き込み機構を実施し
ているときに配置され、このビットが配置されていない
場合には前記認証が書き込まれていないとみなされ、前
の認証に基づいて、２つのフィールドに構築されるデー
タフィールドの参照レジスタゾーンに基づいている取引
の再開のための機構。
証が完全に書き込まれているかどうかを明確に知ること
を可能にし、このビットが、二重書き込み機構を実施し
ているときに配置され、このビットが配置されていない
場合には前記認証が書き込まれていないとみなされ、前
の認証に基づいて、２つのフィールドに構築されるデー
タフィールドの参照レジスタゾーンに基づいている取引
の再開のための機構。
【００２７】書き込みは、好ましくは差引残高ゾーン及
び参照ゾーンに同時に書き込みまれる。参照ゾーンは、
カードの回路によって制御されている。各参照ゾーンが
２つのゾーンに切断される。参照ゾーン間のチルトは、
これらの妥当性検査ビットが等しい場合には、区域参照
ゾーンの妥当性検査ビットの値によって、又は、差引残
高及び参照差引残高のそれぞれの値によって制御され
る。各参照ゾーンは、対応する妥当性検査ビットが配置
されていない場合には、リセットのときに消去される。
妥当性検査ビットの二重書き込みは、前の差引残高に対
応する参照ゾーンの消去を引き起こす。
び参照ゾーンに同時に書き込みまれる。参照ゾーンは、
カードの回路によって制御されている。各参照ゾーンが
２つのゾーンに切断される。参照ゾーン間のチルトは、
これらの妥当性検査ビットが等しい場合には、区域参照
ゾーンの妥当性検査ビットの値によって、又は、差引残
高及び参照差引残高のそれぞれの値によって制御され
る。各参照ゾーンは、対応する妥当性検査ビットが配置
されていない場合には、リセットのときに消去される。
妥当性検査ビットの二重書き込みは、前の差引残高に対
応する参照ゾーンの消去を引き起こす。
【００２８】本発明によって、オープンな前払いシステ
ムをセットアップできる。これは、電子貨幣を発行する
機構を含むシステムに関し、ユーザは発行団体によって
予め代金を求められたカードを所有し、端末は、あるサ
ービスを提供でき、従ってカードに借方を記入でき、い
くつかのカードから得られる金額を収集する。これらの
端末を所有する機構には、機構により集められた単位の
金額に従って発行者によって支払われる。発行機構から
得られたこの方式のオープンな性質は、端末を所有する
サービスサプライヤーと必ずしも統合されない。
ムをセットアップできる。これは、電子貨幣を発行する
機構を含むシステムに関し、ユーザは発行団体によって
予め代金を求められたカードを所有し、端末は、あるサ
ービスを提供でき、従ってカードに借方を記入でき、い
くつかのカードから得られる金額を収集する。これらの
端末を所有する機構には、機構により集められた単位の
金額に従って発行者によって支払われる。発行機構から
得られたこの方式のオープンな性質は、端末を所有する
サービスサプライヤーと必ずしも統合されない。
【００２９】本発明が《オープン》特性に結合されたあ
る問題を解決しうるため、本発明が特にこれらのシステ
ムに適用できる場合には、やはり単にこれらのシステム
に限定されず、発行する団体が端末を所有するクローズ
ドシステムにもまた適用できる。
る問題を解決しうるため、本発明が特にこれらのシステ
ムに適用できる場合には、やはり単にこれらのシステム
に限定されず、発行する団体が端末を所有するクローズ
ドシステムにもまた適用できる。
【００３０】
【発明の実施の形態】簡単のため、スマートカードだけ
を、より一般に使用される支持体に関するものと呼ぶ。
しかしながら、いかなる他の携帯媒体も使用されてもよ
いことは明らかである。説明の残りは、金銭の差引残高
に関する除去防止機構に関する。同一の機構は認証（認
証の証明）に適用されてもよいことは明らかである。２
つの付加機構は前述の目的を達成できる。
を、より一般に使用される支持体に関するものと呼ぶ。
しかしながら、いかなる他の携帯媒体も使用されてもよ
いことは明らかである。説明の残りは、金銭の差引残高
に関する除去防止機構に関する。同一の機構は認証（認
証の証明）に適用されてもよいことは明らかである。２
つの付加機構は前述の目的を達成できる。
【００３１】第１の機構では、妥当性検査ビットは、存
在する差引残高が完全に書き込まれるかどうかを疑いも
なく知ることを可能にする。この妥当性検査ビットは、
二重書き込み機構を実施することによって配置される。
この妥当性検査ビットは、対応する差引残高が、実際の
差引残高又は差引残高参照に関する時に完全に書き込ま
れていることを保証する。対応する差引残高もまた書き
込まれているとき（使用によって）書き込まれる。この
ビットが配置されていないならば、差引残高は書き込ま
れていないものとみなされる。以前の差引残高に基づく
取引を再開するための第２の機構は、２つのフィールド
に構築されるデータフィールド（例えば、差引残高）の
参照レジスタゾーンに依存する。
在する差引残高が完全に書き込まれるかどうかを疑いも
なく知ることを可能にする。この妥当性検査ビットは、
二重書き込み機構を実施することによって配置される。
この妥当性検査ビットは、対応する差引残高が、実際の
差引残高又は差引残高参照に関する時に完全に書き込ま
れていることを保証する。対応する差引残高もまた書き
込まれているとき（使用によって）書き込まれる。この
ビットが配置されていないならば、差引残高は書き込ま
れていないものとみなされる。以前の差引残高に基づく
取引を再開するための第２の機構は、２つのフィールド
に構築されるデータフィールド（例えば、差引残高）の
参照レジスタゾーンに依存する。
【００３２】本発明の機能を果たすことは下記の通りで
ある。
ある。
【表６】
【００３３】妥当性検査ビット（第１行のビット）は、
それが実際の差引残高又は差引残高参照であるかどうか
にかかわらず、対応する差引残高が完全に書き込まれて
いることを保証する。対応する差引残高もまた書き込ま
れているとき、（使用によって）書き込まれる。このビ
ットが配置されていないならば、差引残高は書き込まれ
ていないものとみなされる。この妥当性検査ビットは、
二重書き込み機構を実行することによって配置される。
それが実際の差引残高又は差引残高参照であるかどうか
にかかわらず、対応する差引残高が完全に書き込まれて
いることを保証する。対応する差引残高もまた書き込ま
れているとき、（使用によって）書き込まれる。このビ
ットが配置されていないならば、差引残高は書き込まれ
ていないものとみなされる。この妥当性検査ビットは、
二重書き込み機構を実行することによって配置される。
【００３４】差引残高のビットは、カウンタゾーンの全
参照ビットと丁度同じように差引残高ゾーンの中及び参
照ゾーン（例えば、参照ゾーン１）の中に同時に単に書
き込むことによって書き込まれる。一旦差引残高が完全
に書き込まれると、差引残高ゾーン及び関連参照ゾーン
における妥当性検査ビットは、二重書き込みによって他
の参照ゾーン（前述の例におけるゾーン２）の消去を認
証する。
参照ビットと丁度同じように差引残高ゾーンの中及び参
照ゾーン（例えば、参照ゾーン１）の中に同時に単に書
き込むことによって書き込まれる。一旦差引残高が完全
に書き込まれると、差引残高ゾーン及び関連参照ゾーン
における妥当性検査ビットは、二重書き込みによって他
の参照ゾーン（前述の例におけるゾーン２）の消去を認
証する。
【００３５】次に、ＴＧ２カードによって使用される内
部機構は図２に示される。カードは３つの基本コマンド
のみを知っている。 −リセット −増分・読み出し −書き込み カードのメモリイメージは３つのゾーンを有する。 −ゾーンIは現在のＴ２Ｇカード（わずかに再配置され
ている）に対応する。 −ゾーンIIはＴ２Ｇ《金銭》カードに対応する。 −ゾーンIIIは本発明に対応する。 《ｖ》は妥当性検査ビットを表す。これらの機構は下記
に細分割され得る。
部機構は図２に示される。カードは３つの基本コマンド
のみを知っている。 −リセット −増分・読み出し −書き込み カードのメモリイメージは３つのゾーンを有する。 −ゾーンIは現在のＴ２Ｇカード（わずかに再配置され
ている）に対応する。 −ゾーンIIはＴ２Ｇ《金銭》カードに対応する。 −ゾーンIIIは本発明に対応する。 《ｖ》は妥当性検査ビットを表す。これらの機構は下記
に細分割され得る。
【００３６】《単一》Ｔ２Ｇによって実施された内部機
構 Ｃｎ＋１のビットの書き込みは、 − ・カウンタＣｎの全ビットの消去を認証し、 ・Ｃｎ＋１のビットと同じ位置のＲｔｎに１ビットの同
時書き込みを引き起こす第１の書き込みと、 − ・カウンタＣnの全ビットを消去し、 ・参照ビットを同時に消去する第２の書き込みとを有す
る。
構 Ｃｎ＋１のビットの書き込みは、 − ・カウンタＣｎの全ビットの消去を認証し、 ・Ｃｎ＋１のビットと同じ位置のＲｔｎに１ビットの同
時書き込みを引き起こす第１の書き込みと、 − ・カウンタＣnの全ビットを消去し、 ・参照ビットを同時に消去する第２の書き込みとを有す
る。
【００３７】《金銭》Ｔ２Ｇによって使用される付加機
構 金額は、《差引残高》ゾーンで計数され、《カウンタ》
ゾーンで計数されない。ゾーンIVは、カウンタを増分
後、消去可能のみで、シグネチャの計算の一部を形成す
る。
構 金額は、《差引残高》ゾーンで計数され、《カウンタ》
ゾーンで計数されない。ゾーンIVは、カウンタを増分
後、消去可能のみで、シグネチャの計算の一部を形成す
る。
【００３８】本発明の背景内で使用される付加機構 妥当性検査ビットの書き込みは下記のように細分割され
うる。 −《フリー》差引残高参照１の妥当性検査ビットの同時
書き込みを引き起こし、差引残高参照２の消去を認証す
る妥当性検査ビットの第１の書き込み。差引残高ビット
は差引残高ゾーンおよびフリー参照ゾーンに同時に書き
込まれる。 −差引残高ゾーン２の全ビットの消去を引き起こす妥当
性検査ビットの第２の書き込み。
うる。 −《フリー》差引残高参照１の妥当性検査ビットの同時
書き込みを引き起こし、差引残高参照２の消去を認証す
る妥当性検査ビットの第１の書き込み。差引残高ビット
は差引残高ゾーンおよびフリー参照ゾーンに同時に書き
込まれる。 −差引残高ゾーン２の全ビットの消去を引き起こす妥当
性検査ビットの第２の書き込み。
【００３９】同じことは認証ゾーン（ＩＤモジュール）
に適用する。カウンタの増分は、《差引残高》ゾーン及
び《認証》ゾーンの消去と《差引残高》ゾーン及びその
妥当性検査ビットが０にある《認証》ゾーンの消去とを
引き起こす。差引残高それ自体が書き込まれたとき、参
照ビットは使用によってのみ書き込まれうる。
に適用する。カウンタの増分は、《差引残高》ゾーン及
び《認証》ゾーンの消去と《差引残高》ゾーン及びその
妥当性検査ビットが０にある《認証》ゾーンの消去とを
引き起こす。差引残高それ自体が書き込まれたとき、参
照ビットは使用によってのみ書き込まれうる。
【００４０】次に、特定の実施例に関して説明を続け
る。最初の状況は次の通りであると仮定する。すなわ
ち、いかなる金額の差引残高も書き込まれ、差引残高ゾ
ーンで妥当性検査がされる（妥当性検査ビットは１）。
参照差引残高が書き込まれ、参照ゾーン２で妥当性検査
される。この例では、差引残高及びその参照は、各々が
８ビット（実際の差引残高に対する７ビット及び１つの
妥当性検査ビット）のままであると仮定される。
る。最初の状況は次の通りであると仮定する。すなわ
ち、いかなる金額の差引残高も書き込まれ、差引残高ゾ
ーンで妥当性検査がされる（妥当性検査ビットは１）。
参照差引残高が書き込まれ、参照ゾーン２で妥当性検査
される。この例では、差引残高及びその参照は、各々が
８ビット（実際の差引残高に対する７ビット及び１つの
妥当性検査ビット）のままであると仮定される。
【００４１】
【表７】
【００４２】新しい差引残高がカードに書き込まれる必
要が生じた瞬間から、現在の差引残高と関連妥当性検査
ビットの消去を引き起こす取引カウンタが増分される
（適当であるならば、そのシステムビットが《０》であ
る参照の消去と同様）。
要が生じた瞬間から、現在の差引残高と関連妥当性検査
ビットの消去を引き起こす取引カウンタが増分される
（適当であるならば、そのシステムビットが《０》であ
る参照の消去と同様）。
【００４３】
【表８】
【００４４】この状況では、現在の差引残高は消去され
るが、その記録は検査参照ゾーンに存在する。従って、
再開機構は、有効参照（この例では参照２）に書き込ま
れた金額の読み出しに基づいて開始する。書き込まれる
新しい差引残高が３２＋１６＋２＝５０単位であると仮
定する。新しい差引残高の書き込みが、差引残高ゾーン
の中に及び《フリー》参照ゾーン（その参照ビットが
《１》であるゾーン）の中に行われる。
るが、その記録は検査参照ゾーンに存在する。従って、
再開機構は、有効参照（この例では参照２）に書き込ま
れた金額の読み出しに基づいて開始する。書き込まれる
新しい差引残高が３２＋１６＋２＝５０単位であると仮
定する。新しい差引残高の書き込みが、差引残高ゾーン
の中に及び《フリー》参照ゾーン（その参照ビットが
《１》であるゾーン）の中に行われる。
【００４５】
【表９】
【００４６】妥当性検査ビットが配置されない限り、差
引残高は書き込みと見なされなく、低い重みビットが書
き込まれるべきか否かは分からない。唯一の明確な差引
残高は、妥当性検査参照ゾーン（すなわち、参照ゾーン
２では、《１》の妥当性検査ビットを有するゾーン）に
ある前の差引残高である。ここで、再び、再開機構は、
有効参照（参照２）に書き込まれた金額の読み出しから
開始し得る。前以て、取引カウンタの第１の使用可能な
ビットの二重書き込みは差引残高及びその妥当性検査ビ
ットが《０》である参照をリセットする。
引残高は書き込みと見なされなく、低い重みビットが書
き込まれるべきか否かは分からない。唯一の明確な差引
残高は、妥当性検査参照ゾーン（すなわち、参照ゾーン
２では、《１》の妥当性検査ビットを有するゾーン）に
ある前の差引残高である。ここで、再び、再開機構は、
有効参照（参照２）に書き込まれた金額の読み出しから
開始し得る。前以て、取引カウンタの第１の使用可能な
ビットの二重書き込みは差引残高及びその妥当性検査ビ
ットが《０》である参照をリセットする。
【００４７】書き込まれた差引残高が正しいと推定する
ならば、妥当性検査ビットが配置される。差引残高ゾー
ンに妥当性検査ビットを書き込むことは、関連参照ゾー
ンに妥当性検査ビットの同時書き込みを伴い、二重書き
込みによって他の参照ゾーン（前述の例におけるゾーン
２）の消去を許可する。
ならば、妥当性検査ビットが配置される。差引残高ゾー
ンに妥当性検査ビットを書き込むことは、関連参照ゾー
ンに妥当性検査ビットの同時書き込みを伴い、二重書き
込みによって他の参照ゾーン（前述の例におけるゾーン
２）の消去を許可する。
【００４８】
【表１０】
【００４９】この時、電話ボックスからカードが取り除
かれるならば、再開機構は実行することが可能である。
この点からの操作を続けるために差引残高（その妥当性
検査ビットを含む）と参照ゾーンの一つとの間の一致を
検査するのに十分である。参照ビットの二重書き込み
は、使用されていない参照ゾーン（差引残高と一致しな
いゾーン）の消去を引き起こす。
かれるならば、再開機構は実行することが可能である。
この点からの操作を続けるために差引残高（その妥当性
検査ビットを含む）と参照ゾーンの一つとの間の一致を
検査するのに十分である。参照ビットの二重書き込み
は、使用されていない参照ゾーン（差引残高と一致しな
いゾーン）の消去を引き起こす。
【００５０】
【表１１】
【００５１】この操作は差引残高の更新を終了する。本
発明の一つの変形例は、下記のような参照ビットの取り
扱いからなる。すなわち、差引残高ゾーンにおける妥当
性検査ビットの書き込みは、関連参照ゾーンにおける妥
当性検査ビットの同時書き込み及び他の参照（前述の例
ではゾーン２）の参照ビットの消去を伴い、システムビ
ットの二重書き込みは二重書き込みによる参照の消去を
引き起こす。
発明の一つの変形例は、下記のような参照ビットの取り
扱いからなる。すなわち、差引残高ゾーンにおける妥当
性検査ビットの書き込みは、関連参照ゾーンにおける妥
当性検査ビットの同時書き込み及び他の参照（前述の例
ではゾーン２）の参照ビットの消去を伴い、システムビ
ットの二重書き込みは二重書き込みによる参照の消去を
引き起こす。
【図１】Ｔ２Ｇタイプのカードのコンポーネントのブロ
ック図である。
ック図である。
【図２】本発明の一部として使用される簡単なＴ２Ｇカ
ード、《金銭》Ｔ２Ｇカード及び付加機構によって実行
される内部機構を示すメモリイメージを示す図である。
ード、《金銭》Ｔ２Ｇカード及び付加機構によって実行
される内部機構を示すメモリイメージを示す図である。
１ アドレスカウンタ ２ 列 ３ 制御デコーダ ４ 制御ロジック ５ 行 ６ ＥＥＰＲＯＭメモリ ７ 書き込み電圧生成 ８ 認証ユニット ９ ヒューズ
フロントページの続き (51)Int.Cl.6 識別記号 庁内整理番号 ＦＩ 技術表示箇所 Ｈ０４Ｍ 17/00 Ｇ１１Ｃ 17/00 ３０９Ｆ
Claims (15)
- 【請求項１】 少なくとも２ビットを各々が有する少な
くとも２つのレベルのカウンタで形成され、計算器原理
に従って使用されうるカウンタゾーンと、 少なくとも２ビットを各々が有する少なくとも２つの参
照レジスタで形成され、前記カウンタの全消去を示すた
めに使用される第１の参照ゾーンとを有するスマートカ
ードであって、 書き込み及び読み出しの際にアクセス可能であり、前記
カウンタゾーンの内容が増分された場合には単独で消去
可能である差引残高ゾーンと、 前記差引残高ゾーンに関連する２つのフィールドに構築
される第２の参照ゾーンとを具備し、 前記差引残高のビットの書き込みが、前記差引残高ゾー
ン及び前記第２の参照ゾーンに同時に行われ、前記差引
残高ゾーン及び前記第２の参照ゾーン各々は、存在する
前記差引残高が完全に書き込まれているかどうかを知り
得る１つの妥当性検査ビットを備えることを特徴とする
スマートカード。 - 【請求項２】 書き込み及び読み出しの際にアクセス可
能であり、前記カウンタゾーンの内容が増分された場合
には単独で消去可能である認証ゾーンと、 前記認証ゾーンに関連する２つのフィールドに構築され
る第３の参照ゾーンとを具備し、 前記認証のビットの書き込みが、前記認証ゾーン及び前
記第３の参照ゾーンに同時に行われ、前記認証ゾーン及
び前記第３の参照ゾーン各々は、存在する前記認証が完
全に書き込まれているかどうかを知り得る１つの妥当性
検査ビットを備えることを特徴とする請求項１記載のス
マートカード。 - 【請求項３】 前記スマートカードは電気的に消去可能
なメモリを具備することを特徴とする請求項１記載のス
マートカード。 - 【請求項４】 前記メモリはＥＥＰＲＯＭメモリである
ことを特徴とする請求項３記載のスマートカード。 - 【請求項５】 前記スマートカードはプリペイド式カー
ドであることを特徴とする請求項１〜４の何れかに記載
のスマートカード。 - 【請求項６】 前記スマートカードは勘定単位の記録が
可能であり、該勘定単位は前記カードが使用されるにつ
れ減少又は増分され、これら単位は貨幣価値を有する可
能性のあることを特徴とする請求項１〜４の何れかに記
載のスマートカード。 - 【請求項７】 前記スマートカードは電話カードである
ことを特徴とする請求項１〜４の何れかに記載のスマー
トカード。 - 【請求項８】 妥当性検査ビットが、存在する差引残高
が完全に書き込まれているかどうかを明確に知ることを
可能にし、二重書き込み機構を実行している場合にこの
妥当性検査ビットが配置され、このビットが配置されな
い場合、前記差引残高が書き込まれていないとみなさ
れ、 前の差引残高に基づく取引再開機構が２つのフィールド
に構築されるデータフィールドの参照ゾーンに依存する
ことを特徴とする金銭モードで使用されるスマートカー
ドの除去防止方法。 - 【請求項９】 妥当性検査ビットが、存在する認証が完
全に書き込まれているかどうかを明確に知ることを可能
にし、このビットが、二重書き込み機構を実施している
ときに配置され、このビットが配置されていない場合に
は前記認証が書き込まれていないとみなされ、 前の認証に基づく取引再開機構が２つのフィールドに構
築されるデータフィールドの参照レジスタゾーンに依存
することを特徴とする請求項８記載の金銭モードで使用
されるスマートカードの除去防止方法。 - 【請求項１０】 書き込みが差引残高ゾーン及び参照ゾ
ーンに同時に実行されることを特徴とする請求項８記載
の金銭モードで使用されるスマートカードの除去防止方
法。 - 【請求項１１】 各参照ゾーンはカードの回路によって
制御されていることを特徴とする請求項８又は請求項９
記載の金銭モードで使用されるスマートカードの除去防
止方法。 - 【請求項１２】 各参照ゾーンは２つのゾーンに分割さ
れることを特徴とする請求項１１記載の金銭モードで使
用されるスマートカードの除去防止方法。 - 【請求項１３】 前記参照ゾーン間のチルトは、前記妥
当性検査ビットが等しい場合には、各参照ゾーンの妥当
性検査ビットの値によって、又は、前記差引残高あるい
は参照差引残高のそれぞれの値によって制御されること
を特徴とする請求項１２記載の金銭モードで使用される
スマートカードの除去防止方法。 - 【請求項１４】 対応する妥当性検査ビットが配置され
ていない場合には、参照ゾーンはリセットのときに消去
されることを特徴とする請求項１３記載の金銭モードで
使用されるスマートカードの除去防止方法。 - 【請求項１５】 前記妥当性検査ビットの二重書き込み
は、前の差引残高に対応する前記参照ゾーンの消去を引
き起こすことを特徴とする請求項１４記載の金銭モード
で使用されるスマートカードの除去防止方法。
Applications Claiming Priority (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| FR9504992A FR2733615B1 (fr) | 1995-04-26 | 1995-04-26 | Carte a memoire et procede de mise en oeuvre d'une telle carte |
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