JPH08305500A - 記憶制御装置、それを含むデータ記憶システムおよび二重ペア抑止方法 - Google Patents
記憶制御装置、それを含むデータ記憶システムおよび二重ペア抑止方法Info
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- JPH08305500A JPH08305500A JP8088562A JP8856296A JPH08305500A JP H08305500 A JPH08305500 A JP H08305500A JP 8088562 A JP8088562 A JP 8088562A JP 8856296 A JP8856296 A JP 8856296A JP H08305500 A JPH08305500 A JP H08305500A
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-
- G—PHYSICS
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- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F11/00—Error detection; Error correction; Monitoring
- G06F11/07—Responding to the occurrence of a fault, e.g. fault tolerance
- G06F11/16—Error detection or correction of the data by redundancy in hardware
- G06F11/20—Error detection or correction of the data by redundancy in hardware using active fault-masking, e.g. by switching out faulty elements or by switching in spare elements
- G06F11/2053—Error detection or correction of the data by redundancy in hardware using active fault-masking, e.g. by switching out faulty elements or by switching in spare elements where persistent mass storage functionality or persistent mass storage control functionality is redundant
- G06F11/2056—Error detection or correction of the data by redundancy in hardware using active fault-masking, e.g. by switching out faulty elements or by switching in spare elements where persistent mass storage functionality or persistent mass storage control functionality is redundant by mirroring
- G06F11/2082—Data synchronisation
-
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- Memory System Of A Hierarchy Structure (AREA)
Abstract
(57)【要約】 （修正有）
【課題】単一又は多数の記憶サブシステムに跨る多数の
二重ペアをアトミックに抑止するデータ記憶システムを
提供する。 【解決手段】二重ペアは、それらの二次ＤＡＳＤ上にデ
ータがシーケンス整合した順序で維持されるように抑止
される。ホスト・プロセッサは二重ペアの一次ＤＡＳＤ
に書き込まれるべきレコード及びレコード更新を発生す
る。記憶制御装置は二重ペアの二次ＤＡＳＤにレコード
及びレコード更新の複写を指示する。シーケンス整合性
は二重ペアを抑止することにより二次ＤＡＳＤにおいて
維持される。二重ペアの静止は、進行中の書込みＩ／Ｏ
も一次ＤＡＳＤに対して完了する。記憶制御装置は、そ
の後の書込みリクエストに対して長いビジー信号を生じ
ることによってホスト・プロセッサからのその後の書込
みＩ／Ｏも閉め出す。レコーディングの変更による二重
ペアの抑止は、アプリケーションが、抑止する時間と再
設定する時間との間に更新する一次ＤＡＳＤの物理的ア
ドレスをマークするよう記憶制御装置に指示する。
二重ペアをアトミックに抑止するデータ記憶システムを
提供する。 【解決手段】二重ペアは、それらの二次ＤＡＳＤ上にデ
ータがシーケンス整合した順序で維持されるように抑止
される。ホスト・プロセッサは二重ペアの一次ＤＡＳＤ
に書き込まれるべきレコード及びレコード更新を発生す
る。記憶制御装置は二重ペアの二次ＤＡＳＤにレコード
及びレコード更新の複写を指示する。シーケンス整合性
は二重ペアを抑止することにより二次ＤＡＳＤにおいて
維持される。二重ペアの静止は、進行中の書込みＩ／Ｏ
も一次ＤＡＳＤに対して完了する。記憶制御装置は、そ
の後の書込みリクエストに対して長いビジー信号を生じ
ることによってホスト・プロセッサからのその後の書込
みＩ／Ｏも閉め出す。レコーディングの変更による二重
ペアの抑止は、アプリケーションが、抑止する時間と再
設定する時間との間に更新する一次ＤＡＳＤの物理的ア
ドレスをマークするよう記憶制御装置に指示する。
Description
【０００１】
【発明の属する技術分野】本発明は、概して云えば、デ
ータ記憶技法に関するものであり、更に詳しく云えば、
多数の装置又は装置サブシステムにまたがる二重複写オ
ペレーション或いは遠隔二重複写オペレーションをアト
ミックに抑止するためのシステムに関するものである。
ータ記憶技法に関するものであり、更に詳しく云えば、
多数の装置又は装置サブシステムにまたがる二重複写オ
ペレーション或いは遠隔二重複写オペレーションをアト
ミックに抑止するためのシステムに関するものである。
【０００２】
【従来の技術】データ処理システムは、処理データと関
連して、一般に、大量のデータを記憶する必要がある。
そのデータは、効果的にアクセスされ、修正され、そし
て再記憶され得るものである。データ記憶装置は、一般
に、効率的且つコスト効果的なデータ記憶装置を提供す
るために、幾つかの異なるレベルに或いは階層的に分割
される。第１レベルの又は最高レベルのデータ記憶装置
は、通常、動的又は静的ランダム・アクセス・メモリ
（ＤＲＡＭ又はＳＲＡＭ）と呼ばれる電子的メモリを包
含する。電子的メモリは、数百万バイトのデータが各回
路上に記憶可能であり且つそのようなデータ・バイトへ
のアクセスがナノ秒単位で測定されるという半導体集積
回路の形式を取る。その電子的メモリは、アクセスが全
体的に電子的であるので、データに対する最速のアクセ
スを与える。
連して、一般に、大量のデータを記憶する必要がある。
そのデータは、効果的にアクセスされ、修正され、そし
て再記憶され得るものである。データ記憶装置は、一般
に、効率的且つコスト効果的なデータ記憶装置を提供す
るために、幾つかの異なるレベルに或いは階層的に分割
される。第１レベルの又は最高レベルのデータ記憶装置
は、通常、動的又は静的ランダム・アクセス・メモリ
（ＤＲＡＭ又はＳＲＡＭ）と呼ばれる電子的メモリを包
含する。電子的メモリは、数百万バイトのデータが各回
路上に記憶可能であり且つそのようなデータ・バイトへ
のアクセスがナノ秒単位で測定されるという半導体集積
回路の形式を取る。その電子的メモリは、アクセスが全
体的に電子的であるので、データに対する最速のアクセ
スを与える。
【０００３】第２レベルのデータ記憶装置は、通常、直
接アクセス記憶装置（ＤＡＳＤ）を包含する。ＤＡＳＤ
は、例えば、データのビットを形成する「１」又は
「０」を表すためのディスク表面におけるミクロン単位
の大きさの磁気的に又は光学的に変更されたスポットと
してデータのビットを記憶する磁気的又は光学的ディス
クより成る。磁気的ＤＡＳＤは、残留磁気材料でもって
被覆された１つ又は複数個のディスクを有する。それら
のディスクは、保護された環境内で回転可能に装着され
る。各ディスクは、多くの同心円トラック、即ち、密接
した間隔の円に分けられる。データは、各トラックに沿
ってビット毎に順次に記憶される。ハード・ディスク・
アセンブリ（ＨＤＡ）として知られたアクセス機構は、
一般に、１つ又は複数個の読取り／書込みヘッドを有
し、ディスクがそれらの読取り／書込みヘッドを通って
回転する時、トラックを横切って移動してそれらのディ
スクの表面との間でデータを転送するように各ＤＡＳＤ
に設けられる。ＤＡＳＤは数ギガバイトのデータを記憶
することができ、そのようなデータへのアクセスは一般
にミリ秒単位（電子的メモリよりも数桁の大きさで遅
い）で測定される。ＤＡＳＤに記憶されたデータへのア
クセスは、ディスク及びＨＤＡを所望のデータ記憶ロケ
ーションに物理的に位置づける必要があるために遅くな
る。
接アクセス記憶装置（ＤＡＳＤ）を包含する。ＤＡＳＤ
は、例えば、データのビットを形成する「１」又は
「０」を表すためのディスク表面におけるミクロン単位
の大きさの磁気的に又は光学的に変更されたスポットと
してデータのビットを記憶する磁気的又は光学的ディス
クより成る。磁気的ＤＡＳＤは、残留磁気材料でもって
被覆された１つ又は複数個のディスクを有する。それら
のディスクは、保護された環境内で回転可能に装着され
る。各ディスクは、多くの同心円トラック、即ち、密接
した間隔の円に分けられる。データは、各トラックに沿
ってビット毎に順次に記憶される。ハード・ディスク・
アセンブリ（ＨＤＡ）として知られたアクセス機構は、
一般に、１つ又は複数個の読取り／書込みヘッドを有
し、ディスクがそれらの読取り／書込みヘッドを通って
回転する時、トラックを横切って移動してそれらのディ
スクの表面との間でデータを転送するように各ＤＡＳＤ
に設けられる。ＤＡＳＤは数ギガバイトのデータを記憶
することができ、そのようなデータへのアクセスは一般
にミリ秒単位（電子的メモリよりも数桁の大きさで遅
い）で測定される。ＤＡＳＤに記憶されたデータへのア
クセスは、ディスク及びＨＤＡを所望のデータ記憶ロケ
ーションに物理的に位置づける必要があるために遅くな
る。
【０００４】第３レベル、即ち低レベルのデータ記憶装
置はテープ・ライブラリ、又はテープ及びＤＡＳＤライ
ブラリを含む。データに対するアクセスはライブラリで
はずっと遅くなる。それは、ロボットがその必要なデー
タ記憶媒体を選択し及びロードする必要があるためであ
る。利点は、非常に大きいデータ記憶容量、例えば、テ
ラバイトのデータ記憶のためにコストが減少することで
ある。テープ記憶装置はバックアップ目的で使用される
ことが多い。即ち、第２レベルの階層に記憶されたデー
タは磁気テープにおいて保護するために複写される。テ
ープ又はライブラリに記憶されたデータへのアクセス
は、現在、秒単位のレベルである。
置はテープ・ライブラリ、又はテープ及びＤＡＳＤライ
ブラリを含む。データに対するアクセスはライブラリで
はずっと遅くなる。それは、ロボットがその必要なデー
タ記憶媒体を選択し及びロードする必要があるためであ
る。利点は、非常に大きいデータ記憶容量、例えば、テ
ラバイトのデータ記憶のためにコストが減少することで
ある。テープ記憶装置はバックアップ目的で使用される
ことが多い。即ち、第２レベルの階層に記憶されたデー
タは磁気テープにおいて保護するために複写される。テ
ープ又はライブラリに記憶されたデータへのアクセス
は、現在、秒単位のレベルである。
【０００５】バックアップ・データを複写させること
は、多くのビジネスにとって必須のことである。それ
は、ビジネスにとってデータ喪失が大災害になり得るた
めである。一次記憶レベルで失われたデータを回復する
ために必要な時間も重要な回復の考察事項である。テー
プ又はライブラリ・バックアップにおける速度の改良は
二重複写を含んでいる。二重複写の一例は追加のＤＡＳ
Ｄを設けて、データがその追加のＤＡＳＤに書き込まれ
るようにする（ミラーリングとも呼ばれる）。そこで、
一次ＤＡＳＤが故障すると、二次ＤＡＳＤがデータに関
して頼みにされる。この方法の欠点は、必要なＤＡＳＤ
の数が２倍になることである。
は、多くのビジネスにとって必須のことである。それ
は、ビジネスにとってデータ喪失が大災害になり得るた
めである。一次記憶レベルで失われたデータを回復する
ために必要な時間も重要な回復の考察事項である。テー
プ又はライブラリ・バックアップにおける速度の改良は
二重複写を含んでいる。二重複写の一例は追加のＤＡＳ
Ｄを設けて、データがその追加のＤＡＳＤに書き込まれ
るようにする（ミラーリングとも呼ばれる）。そこで、
一次ＤＡＳＤが故障すると、二次ＤＡＳＤがデータに関
して頼みにされる。この方法の欠点は、必要なＤＡＳＤ
の数が２倍になることである。
【０００６】２倍の記憶装置を設ける必要性を克服する
もう１つのデータ・バックアップ方法は、低価格ディス
クの冗長配列（ＲＡＩＤ）構成またはディスク・アレイ
にデータを書き込むことに関連する。この場合、データ
は、それが多くのＤＡＳＤの間で配分されるように書き
込まれる。１つのＤＡＳＤだけが障害を生じた場合、失
われたデータは残りのデータ及びエラー訂正手順を使用
することによって回復可能である。現在、幾つかの異な
るＲＡＩＤ構成が利用可能である。
もう１つのデータ・バックアップ方法は、低価格ディス
クの冗長配列（ＲＡＩＤ）構成またはディスク・アレイ
にデータを書き込むことに関連する。この場合、データ
は、それが多くのＤＡＳＤの間で配分されるように書き
込まれる。１つのＤＡＳＤだけが障害を生じた場合、失
われたデータは残りのデータ及びエラー訂正手順を使用
することによって回復可能である。現在、幾つかの異な
るＲＡＩＤ構成が利用可能である。
【０００７】前述のバックアップ解決法は、一般には、
記憶装置又は媒体が障害を生じた場合にデータを回復さ
せるには十分である。これらのバックアップ方法は装置
の障害に対しては有用である。それは、二次データが一
次データのミラーであるためである。即ち、二次データ
は一次データと同じボリューム通し番号（ＶＯＬＳＥ
Ｒ）を有する。一方、システム障害回復は、ミラーされ
た二次データを使用して得ることはできない。従って、
システム全体或いはその場所を破壊するような災害、例
えば、地震、火事、爆発、台風等が発生した場合、デー
タを回復するためには更なる保護が必要である。災害回
復は、データの二次複写が一次データから離れたロケー
ションに保管されることを必要とする。災害保護を行う
既知の方法は、日毎又は週毎をベースにデータをテープ
にバックアップすることである。そこで、そのテープは
搬送手段によって取り上げられ、通常、一次データ・ロ
ケーションから数キロメートル離れた安全な保管領域に
持って行かれる。このバックアップ方法では、バックア
ップ・データを検索するのに数日を必要とするという問
題、及び数時間又は数日分のデータが失われ或いは不良
化している間に、保管ロケーションが同じ災害によって
破壊されることがあるという問題が提起されている。わ
ずかに改良されたバックアップ法は、毎晩、データをバ
ックアップ・ロケーションに搬送するものである。これ
は、更に離れたロケーションにデータを記憶することを
可能にする。バックアップが二重複写法におけるように
継続的には生じないため、バックアップとバックアップ
との間に或データが失われることがある。従って、ユー
ザにとっては許容し得ないかなりの量のデータが失われ
ることがある。
記憶装置又は媒体が障害を生じた場合にデータを回復さ
せるには十分である。これらのバックアップ方法は装置
の障害に対しては有用である。それは、二次データが一
次データのミラーであるためである。即ち、二次データ
は一次データと同じボリューム通し番号（ＶＯＬＳＥ
Ｒ）を有する。一方、システム障害回復は、ミラーされ
た二次データを使用して得ることはできない。従って、
システム全体或いはその場所を破壊するような災害、例
えば、地震、火事、爆発、台風等が発生した場合、デー
タを回復するためには更なる保護が必要である。災害回
復は、データの二次複写が一次データから離れたロケー
ションに保管されることを必要とする。災害保護を行う
既知の方法は、日毎又は週毎をベースにデータをテープ
にバックアップすることである。そこで、そのテープは
搬送手段によって取り上げられ、通常、一次データ・ロ
ケーションから数キロメートル離れた安全な保管領域に
持って行かれる。このバックアップ方法では、バックア
ップ・データを検索するのに数日を必要とするという問
題、及び数時間又は数日分のデータが失われ或いは不良
化している間に、保管ロケーションが同じ災害によって
破壊されることがあるという問題が提起されている。わ
ずかに改良されたバックアップ法は、毎晩、データをバ
ックアップ・ロケーションに搬送するものである。これ
は、更に離れたロケーションにデータを記憶することを
可能にする。バックアップが二重複写法におけるように
継続的には生じないため、バックアップとバックアップ
との間に或データが失われることがある。従って、ユー
ザにとっては許容し得ないかなりの量のデータが失われ
ることがある。
【０００８】更に最近紹介されたデータ災害回復法は遠
隔二重複写を含む。その方法では、データは遠く離れて
バックアップされるのみならず、連続的に（同期的に、
或いは非同期的に）もバックアップされる。１つのホス
ト・プロセッサから他のホスト・プロセッサに、或い
は、１つの記憶制御装置から他の記憶制御装置に、或い
はそれらの組合せでその二重化されたデータをコミュニ
ケートするためには、そのプロセスを実現するためのか
なりの量の制御データが必要である。しかし、高いオー
バヘッドは一次サイトの処理を維持するために二次サイ
トを損なうことがあり、従って、災害が発生した場合、
二次サイトが一次サイトを回復させることができるとい
う能力に影響することがある。
隔二重複写を含む。その方法では、データは遠く離れて
バックアップされるのみならず、連続的に（同期的に、
或いは非同期的に）もバックアップされる。１つのホス
ト・プロセッサから他のホスト・プロセッサに、或い
は、１つの記憶制御装置から他の記憶制御装置に、或い
はそれらの組合せでその二重化されたデータをコミュニ
ケートするためには、そのプロセスを実現するためのか
なりの量の制御データが必要である。しかし、高いオー
バヘッドは一次サイトの処理を維持するために二次サイ
トを損なうことがあり、従って、災害が発生した場合、
二次サイトが一次サイトを回復させることができるとい
う能力に影響することがある。
【０００９】二重複写は、ＤＡＳＤサブシステムにおい
て二重ペアを形成する一次ボリューム及び二次ボリュー
ムを必然的に伴う。ＤＡＳＤサブシステムにおける複写
動作は、その複写されたボリュームに対するＩ／Ｏコマ
ンドによって制御される。そのようなＩ／Ｏコマンド
は、二重ペアを設定又は抑止するために、或いは二重ペ
アのステータスを待ち行列化するために装置毎の制御を
行う。しかし、装置毎の制御がすべての災害回復アプリ
ケーションにとって十分であるわけではない。二次ロケ
ーションにおける複写されたデータは、その複写された
データが元のデータと時間的整合（順次整合）している
限り使用可能である。歴史的には、Ｉ／Ｏコマンドはデ
ータを複写する間そのシステムを停止させることによっ
てそのような整合性を確保し、従って、データに対する
更なる更新が生じなかったことを保証した。この方法に
対する改良はＴ０又は同時複写として知られ、それはシ
ステムが停止している時間を減少させるが、依然として
抑止が必要であった。
て二重ペアを形成する一次ボリューム及び二次ボリュー
ムを必然的に伴う。ＤＡＳＤサブシステムにおける複写
動作は、その複写されたボリュームに対するＩ／Ｏコマ
ンドによって制御される。そのようなＩ／Ｏコマンド
は、二重ペアを設定又は抑止するために、或いは二重ペ
アのステータスを待ち行列化するために装置毎の制御を
行う。しかし、装置毎の制御がすべての災害回復アプリ
ケーションにとって十分であるわけではない。二次ロケ
ーションにおける複写されたデータは、その複写された
データが元のデータと時間的整合（順次整合）している
限り使用可能である。歴史的には、Ｉ／Ｏコマンドはデ
ータを複写する間そのシステムを停止させることによっ
てそのような整合性を確保し、従って、データに対する
更なる更新が生じなかったことを保証した。この方法に
対する改良はＴ０又は同時複写として知られ、それはシ
ステムが停止している時間を減少させるが、依然として
抑止が必要であった。
【００１０】実時間二重複写、例えば、拡張遠隔複写
（ＸＲＣ）又は同格（ピアツーピア）通信遠隔複写（Ｐ
ＰＲＣ）は、それらの複写が災害回復にとって使用可能
であるように二次ボリュームにまたがる時間的整合性を
保証する。しかし、もう一度云うが、一次システムの抑
止は装置毎の制御にとって必要なことである。これらの
抑止は或システムおいては受け入れ難い崩壊を生じさせ
る。ＸＲＣシステムは、ソフトウエア制御のデータ・ム
ーバを介した解決法を与える。その場合、二次装置が部
分的に複写オペレーションの非同期的性質によって時間
整合するように、単一のコマンドがセッションを停止さ
せる。このデータ・ムーバの解決法は、データをボリュ
ーム毎に同期的に複写する二重複写又はＰＰＲＣバック
アップ環境においては利用し得ない。各ボリュームは如
何なる他のボリュームからも独立した複写であるが、一
組のボリュームにおけるデータが論理的に従属すること
はあり得る。
（ＸＲＣ）又は同格（ピアツーピア）通信遠隔複写（Ｐ
ＰＲＣ）は、それらの複写が災害回復にとって使用可能
であるように二次ボリュームにまたがる時間的整合性を
保証する。しかし、もう一度云うが、一次システムの抑
止は装置毎の制御にとって必要なことである。これらの
抑止は或システムおいては受け入れ難い崩壊を生じさせ
る。ＸＲＣシステムは、ソフトウエア制御のデータ・ム
ーバを介した解決法を与える。その場合、二次装置が部
分的に複写オペレーションの非同期的性質によって時間
整合するように、単一のコマンドがセッションを停止さ
せる。このデータ・ムーバの解決法は、データをボリュ
ーム毎に同期的に複写する二重複写又はＰＰＲＣバック
アップ環境においては利用し得ない。各ボリュームは如
何なる他のボリュームからも独立した複写であるが、一
組のボリュームにおけるデータが論理的に従属すること
はあり得る。
【００１１】従って、必要なことは、一組の独立した装
置に対する複写動作のシーケンス整合の抑止を、システ
ム・オペレーション抑止を必要とすることなく、システ
ム・オペレーションにおける最小の遅延でもって生じさ
せることができる災害回復システムである。
置に対する複写動作のシーケンス整合の抑止を、システ
ム・オペレーション抑止を必要とすることなく、システ
ム・オペレーションにおける最小の遅延でもって生じさ
せることができる災害回復システムである。
【００１２】
【発明が解決しようとする課題】本発明の目的は、同期
的二重複写記憶システムにおいて多数の装置をアトミッ
クに制御するための改良された設計及び方法を提供する
ことにある。
的二重複写記憶システムにおいて多数の装置をアトミッ
クに制御するための改良された設計及び方法を提供する
ことにある。
【００１３】本発明のもう１つの目的は、二次データ記
憶装置におけるデータの論理的従属性を維持しながら、
システム・オペレーションを抑止することなく多数の同
期的二重ペアを静止させるための改良された方法及びシ
ステムを提供することにある。
憶装置におけるデータの論理的従属性を維持しながら、
システム・オペレーションを抑止することなく多数の同
期的二重ペアを静止させるための改良された方法及びシ
ステムを提供することにある。
【００１４】
【課題を解決するための手段】本発明の第１実施例によ
れば、レコード及びレコード更新の複写が進行中である
間、第１及び第２二重ペアを抑止するための方法が与え
られる。その方法を実行するためのデータ記憶システム
は、レコード及びレコード更新を生じさせるアプリケー
ションを実行するホスト・プロセッサを含む。第１二重
ペアは一次データ記憶装置及び二次データ記憶装置を含
み、一方、第２二重ペアも一次データ記憶装置及び二次
データ記憶装置を含む。ホスト・プロセッサと第１及び
第２二重ペアの一次データ記憶装置との間には記憶制御
装置が結合される。その方法は、記憶制御装置において
ホスト・プロセッサからの初期静止コマンドに応答して
アプリケーションから第１二重ペアの一次データ記憶装
置へのその後のレコード及びレコード更新の書込みを禁
止することによって第１二重ペアを静止させる。
れば、レコード及びレコード更新の複写が進行中である
間、第１及び第２二重ペアを抑止するための方法が与え
られる。その方法を実行するためのデータ記憶システム
は、レコード及びレコード更新を生じさせるアプリケー
ションを実行するホスト・プロセッサを含む。第１二重
ペアは一次データ記憶装置及び二次データ記憶装置を含
み、一方、第２二重ペアも一次データ記憶装置及び二次
データ記憶装置を含む。ホスト・プロセッサと第１及び
第２二重ペアの一次データ記憶装置との間には記憶制御
装置が結合される。その方法は、記憶制御装置において
ホスト・プロセッサからの初期静止コマンドに応答して
アプリケーションから第１二重ペアの一次データ記憶装
置へのその後のレコード及びレコード更新の書込みを禁
止することによって第１二重ペアを静止させる。
【００１５】又、その方法は、記憶制御装置においてホ
スト・プロセッサからのその後の静止コマンドに応答し
てアプリケーションから第２二重ペアの一次データ記憶
装置へのその後のレコード及びレコード更新の書込みを
禁止することによって第２二重ペアを静止させる。これ
は、シーケンス整合した順序で第１及び第２二重ペアの
二次データ記憶装置に複写されたレコード及びレコード
更新を調整する。そこで、第１及び第２二重ペアはホス
ト・プロセッサから抑止コマンドを受けた後に記憶制御
装置によって抑止され、複写動作は禁止される。そこ
で、記憶制御装置は、第１及び第２二重ペアが抑止され
そして二次データ記憶装置にレコードを複写することな
くその後のレコード及びレコード更新が一次データ記憶
装置に書き込まれる。しかし、二重ペアは最初に静止さ
せられたので、すべての二次データ記憶装置が特定の時
点においてアプリケーションに関してシーケンス整合す
る。
スト・プロセッサからのその後の静止コマンドに応答し
てアプリケーションから第２二重ペアの一次データ記憶
装置へのその後のレコード及びレコード更新の書込みを
禁止することによって第２二重ペアを静止させる。これ
は、シーケンス整合した順序で第１及び第２二重ペアの
二次データ記憶装置に複写されたレコード及びレコード
更新を調整する。そこで、第１及び第２二重ペアはホス
ト・プロセッサから抑止コマンドを受けた後に記憶制御
装置によって抑止され、複写動作は禁止される。そこ
で、記憶制御装置は、第１及び第２二重ペアが抑止され
そして二次データ記憶装置にレコードを複写することな
くその後のレコード及びレコード更新が一次データ記憶
装置に書き込まれる。しかし、二重ペアは最初に静止さ
せられたので、すべての二次データ記憶装置が特定の時
点においてアプリケーションに関してシーケンス整合す
る。
【００１６】本発明のもう１つの実施例では、レコード
及びレコード更新を第１及び第２二重ペアに複写するた
めの、及びレコード及びレコード更新の複写が進行中で
ある間、各二重ペアを抑止するための記憶制御装置がデ
ータ記憶システムに設けられる。データ記憶システム
は、アプリケーションを実行するホスト・プロセッサを
含み、各二重ペアは、更に一次データ記憶装置及び二次
データ記憶装置を含む。記憶制御装置はホスト・プロセ
ッサと各一次データ記憶装置との間に結合される。アプ
リケーションはレコード及びレコード更新を発生し、静
止二重ペア・コマンド及び抑止二重ペア・コマンドを発
生する。レコード及びレコード更新は一次記憶装置に記
憶され、一方、それらの各複写は二次記憶装置に記憶さ
れる。
及びレコード更新を第１及び第２二重ペアに複写するた
めの、及びレコード及びレコード更新の複写が進行中で
ある間、各二重ペアを抑止するための記憶制御装置がデ
ータ記憶システムに設けられる。データ記憶システム
は、アプリケーションを実行するホスト・プロセッサを
含み、各二重ペアは、更に一次データ記憶装置及び二次
データ記憶装置を含む。記憶制御装置はホスト・プロセ
ッサと各一次データ記憶装置との間に結合される。アプ
リケーションはレコード及びレコード更新を発生し、静
止二重ペア・コマンド及び抑止二重ペア・コマンドを発
生する。レコード及びレコード更新は一次記憶装置に記
憶され、一方、それらの各複写は二次記憶装置に記憶さ
れる。
【００１７】記憶制御装置における記憶装置パスは、ホ
スト・プロセッサと第１及び第２二重ペアとの間のレコ
ード及びレコード更新を指示する。更に、記憶装置パス
は、アプリケーションからの静止二重ペア・コマンドに
応答して第１及び第２二重ペアを静止させる。レコード
及びレコード更新が各二次データ記憶装置に複写され且
つシーケンス整合した順序で同期化されるように、アプ
リケーションからの抑止二重ペア・コマンドに応答して
第１及び第２二重ペアが記憶装置パスによって抑止され
る。二重ペアの前記二次データ記憶装置に複写されるべ
きレコード及びレコード更新を最初に記憶するためのメ
モリが設けられる。
スト・プロセッサと第１及び第２二重ペアとの間のレコ
ード及びレコード更新を指示する。更に、記憶装置パス
は、アプリケーションからの静止二重ペア・コマンドに
応答して第１及び第２二重ペアを静止させる。レコード
及びレコード更新が各二次データ記憶装置に複写され且
つシーケンス整合した順序で同期化されるように、アプ
リケーションからの抑止二重ペア・コマンドに応答して
第１及び第２二重ペアが記憶装置パスによって抑止され
る。二重ペアの前記二次データ記憶装置に複写されるべ
きレコード及びレコード更新を最初に記憶するためのメ
モリが設けられる。
【００１８】
【発明の実施の形態】代表的なデータ処理システムは、
データを計算及び操作するための、例えば、少なくとも
１つのＩＢＭ３９９０記憶制御機構を接続されたデータ
機能記憶管理サブシステム／多重仮想システム（ＤＦＳ
ＭＳ／ＭＶＳ）ソフトウエアを実行するためのＩＢＭシ
ステム／３７０或いはＩＢＭシステム／３９０のような
ホスト・プロセッサの形式を取るものでよい。一般に、
記憶制御装置はメモリ・コントローラ及びそれに組み込
まれた１つ又は複数個のキャッシュ・メモリ・タイプを
含む。記憶制御装置は、更に、ＩＢＭ３３８０又は３３
９０のような直接アクセス記憶装置（ＤＡＳＤ）のグル
ープに接続される。ホスト・プロセッサは大きな計算力
を与えるけれども、記憶制御装置は効率的に転送するた
めに、ステージ／デステージするために、変換するため
に、及び一般に大きなデータ・ベースをアクセスするた
めに必要な機能を与える。
データを計算及び操作するための、例えば、少なくとも
１つのＩＢＭ３９９０記憶制御機構を接続されたデータ
機能記憶管理サブシステム／多重仮想システム（ＤＦＳ
ＭＳ／ＭＶＳ）ソフトウエアを実行するためのＩＢＭシ
ステム／３７０或いはＩＢＭシステム／３９０のような
ホスト・プロセッサの形式を取るものでよい。一般に、
記憶制御装置はメモリ・コントローラ及びそれに組み込
まれた１つ又は複数個のキャッシュ・メモリ・タイプを
含む。記憶制御装置は、更に、ＩＢＭ３３８０又は３３
９０のような直接アクセス記憶装置（ＤＡＳＤ）のグル
ープに接続される。ホスト・プロセッサは大きな計算力
を与えるけれども、記憶制御装置は効率的に転送するた
めに、ステージ／デステージするために、変換するため
に、及び一般に大きなデータ・ベースをアクセスするた
めに必要な機能を与える。
【００１９】データ記憶システムにおいてデータを保護
する１つの形式は１つのＤＡＳＤのデータを他のＤＡＳ
Ｄ上にバックアップすることである。データ・バックア
ップを行うためのこの手順は、一般に、二重複写と呼ば
れる。データは一次ＤＡＳＤに記憶され、二次ＤＡＳＤ
に複写される。それらの一次及び二次ＤＡＳＤは二重ペ
アを形成する。二重複写二重ペアの一次及び二次装置は
別個の装置ストリングにグループ分け可能であるが、そ
れらは同じ記憶制御装置に接続されなければならない。
その同じ記憶制御装置に接続される要件のために、二重
複写は、データ・バックアップのための受け入れ可能な
方法であるが、それは災害回復システムにとって実施可
能ではない。
する１つの形式は１つのＤＡＳＤのデータを他のＤＡＳ
Ｄ上にバックアップすることである。データ・バックア
ップを行うためのこの手順は、一般に、二重複写と呼ば
れる。データは一次ＤＡＳＤに記憶され、二次ＤＡＳＤ
に複写される。それらの一次及び二次ＤＡＳＤは二重ペ
アを形成する。二重複写二重ペアの一次及び二次装置は
別個の装置ストリングにグループ分け可能であるが、そ
れらは同じ記憶制御装置に接続されなければならない。
その同じ記憶制御装置に接続される要件のために、二重
複写は、データ・バックアップのための受け入れ可能な
方法であるが、それは災害回復システムにとって実施可
能ではない。
【００２０】一般的なデータ処理システムに対する災害
回復保護は、一次ＤＡＳＤに記憶された一次データが二
次又は遠隔ロケーションにバックアップされることを必
要とする。一次及び二次ロケーションを分ける距離はユ
ーザにとって受け入れ可能なリスクのレベルに依存し、
数キロメートルから数千キロメートルまで変わり得るも
のである。二次又は遠隔ロケーションは、バックアップ
・データの複写を行うことに加えて、一次システムがデ
ィスエーブルされた場合に一次システムに対する処理を
引き継ぐのに十分なシステム情報も持たなければならな
い。これは、単一の記憶制御装置が一次及び二次サイト
において一次及び二次ＤＡＳＤストリングの両方にはデ
ータを書き込まないために、部分的には当然である。代
わりに、一次データが一次記憶制御装置に接続された一
次ＤＡＳＤストリング上に記憶され、一方、二次データ
が二次記憶制御装置に接続された二次ＤＡＳＤストリン
グ上に記憶される。
回復保護は、一次ＤＡＳＤに記憶された一次データが二
次又は遠隔ロケーションにバックアップされることを必
要とする。一次及び二次ロケーションを分ける距離はユ
ーザにとって受け入れ可能なリスクのレベルに依存し、
数キロメートルから数千キロメートルまで変わり得るも
のである。二次又は遠隔ロケーションは、バックアップ
・データの複写を行うことに加えて、一次システムがデ
ィスエーブルされた場合に一次システムに対する処理を
引き継ぐのに十分なシステム情報も持たなければならな
い。これは、単一の記憶制御装置が一次及び二次サイト
において一次及び二次ＤＡＳＤストリングの両方にはデ
ータを書き込まないために、部分的には当然である。代
わりに、一次データが一次記憶制御装置に接続された一
次ＤＡＳＤストリング上に記憶され、一方、二次データ
が二次記憶制御装置に接続された二次ＤＡＳＤストリン
グ上に記憶される。
【００２１】二次サイトは一次サイトから十分に離れて
いなければならないのみならず、一次データを実時間で
バックアップできなければならない。一次データが或最
小の遅延で更新される時、二次サイトは一次データをバ
ックアップする必要がある。更に、二次サイトは、一次
サイトで走っていてデータ又は更新を発生するアプリケ
ーション・プログラム（例えば、ＩＭＳ、ＤＢ２）に関
係なく、一次データをバックアップしなければならな
い。二次サイトで必要とされる困難なタスクは、二次デ
ータが順序整合していなければならないことである。即
ち、二次データは一次データと同じ順次順序（順次整
合）で複写される。それはかなりのシステム考察を必要
とする。順次整合性は、多数の記憶制御装置（その各々
がデータ処理システムにおける多数のＤＡＳＤを制御す
る）の存在によって複雑にされる。順次整合がない場
合、一次データと整合しない二次データがその結果とし
て生じ、従って災害回復を不良化するであろう。
いなければならないのみならず、一次データを実時間で
バックアップできなければならない。一次データが或最
小の遅延で更新される時、二次サイトは一次データをバ
ックアップする必要がある。更に、二次サイトは、一次
サイトで走っていてデータ又は更新を発生するアプリケ
ーション・プログラム（例えば、ＩＭＳ、ＤＢ２）に関
係なく、一次データをバックアップしなければならな
い。二次サイトで必要とされる困難なタスクは、二次デ
ータが順序整合していなければならないことである。即
ち、二次データは一次データと同じ順次順序（順次整
合）で複写される。それはかなりのシステム考察を必要
とする。順次整合性は、多数の記憶制御装置（その各々
がデータ処理システムにおける多数のＤＡＳＤを制御す
る）の存在によって複雑にされる。順次整合がない場
合、一次データと整合しない二次データがその結果とし
て生じ、従って災害回復を不良化するであろう。
【００２２】遠隔のデータ二重化は２つの一般的なカテ
ゴリ、即ち、同期的なもの及び非同期的なものに分けら
れる。同期的遠隔複写は、一次データを二次ロケーショ
ンに送ること、及び一次ＤＡＳＤ入出力（Ｉ／Ｏ）オペ
レーションを終了する（一次ホストにチャネル終了（Ｃ
Ｅ）及び装置終了（ＤＥ）を与える）前にそのようなデ
ータの受信を確認することを含む。従って、二次的確認
を待っている間、同期的複写は一次ＤＡＳＤのＩ／Ｏ応
答時間を遅らせる。一次Ｉ／Ｏ応答遅延は一次システム
と二次システムとの間の距離に比例して増加する（遠隔
距離を数十キロメートルに制限する要因）。しかし、同
期的複写は、比較的わずかなシステム・オーバヘッドで
もって二次サイトにおいて整合したデータを順次に与え
る。
ゴリ、即ち、同期的なもの及び非同期的なものに分けら
れる。同期的遠隔複写は、一次データを二次ロケーショ
ンに送ること、及び一次ＤＡＳＤ入出力（Ｉ／Ｏ）オペ
レーションを終了する（一次ホストにチャネル終了（Ｃ
Ｅ）及び装置終了（ＤＥ）を与える）前にそのようなデ
ータの受信を確認することを含む。従って、二次的確認
を待っている間、同期的複写は一次ＤＡＳＤのＩ／Ｏ応
答時間を遅らせる。一次Ｉ／Ｏ応答遅延は一次システム
と二次システムとの間の距離に比例して増加する（遠隔
距離を数十キロメートルに制限する要因）。しかし、同
期的複写は、比較的わずかなシステム・オーバヘッドで
もって二次サイトにおいて整合したデータを順次に与え
る。
【００２３】非同期的遠隔複写は、データが二次サイト
において確認される前に一次ＤＡＳＤのＩ／Ｏオペレー
ションが完了する（一次ホストにチャネル終了（ＣＥ）
及び装置終了（ＤＥ）を与える）ので、一次アプリケー
ション・システムのより良いパフォーマンスを与える。
従って、一次ＤＡＳＤのＩ／Ｏ応答時間は二次サイトま
での距離に依存せず、二次サイトは一次サイトから数千
キロメートルも離れていてもよい。しかし、二次サイト
で受信されるデータは一次更新の順序ではないことがよ
くあるので、データ・シーケンスの整合性を確実にする
ためには大量のシステム・オーバヘッドが必要である。
一次サイトにおける障害は、一次ロケーションと二次ロ
ケーションとの間で伝送中であったデータが失われると
いう結果を生じることがある。
において確認される前に一次ＤＡＳＤのＩ／Ｏオペレー
ションが完了する（一次ホストにチャネル終了（ＣＥ）
及び装置終了（ＤＥ）を与える）ので、一次アプリケー
ション・システムのより良いパフォーマンスを与える。
従って、一次ＤＡＳＤのＩ／Ｏ応答時間は二次サイトま
での距離に依存せず、二次サイトは一次サイトから数千
キロメートルも離れていてもよい。しかし、二次サイト
で受信されるデータは一次更新の順序ではないことがよ
くあるので、データ・シーケンスの整合性を確実にする
ためには大量のシステム・オーバヘッドが必要である。
一次サイトにおける障害は、一次ロケーションと二次ロ
ケーションとの間で伝送中であったデータが失われると
いう結果を生じることがある。
【００２４】（ａ）非同期的遠隔複写 非同期的遠隔データのシャドウィングは、一次サイトと
二次サイトを大きな距離によって隔てることによって１
つの災害が一次サイト及び二次サイトの両方を不良化さ
せる確率を減少させる必要がある時、或いは一次アプリ
ケーション・パフォーマンスのインパクトを最小にする
必要がある時に使用される。一次サイト及び二次サイト
の間の距離が地球を横切って延びることができる時、多
数の一次サブシステムの背後の多数の二次サブシステム
までの多数のＤＡＳＤボリュームにまたがる書込み更新
の同期化は更にかなり複雑になる。レコード書込み更新
は、二次記憶装置サブシステムにおけるシャドウィング
のために一次記憶制御装置から一次データ・ムーバを介
して二次データ・ムーバまで配送可能であるが、それら
の間で送られる制御データの量は最小にされなければな
らない。それは、幾つかの記憶制御装置の背後における
多数のＤＡＳＤボリュームにまたがって一次システムで
生じるように、幾つかの記憶制御装置にまたがって二次
システムにおいて正確な順序のレコード書込み更新を再
構成することが依然としてできることを必要とする。
二次サイトを大きな距離によって隔てることによって１
つの災害が一次サイト及び二次サイトの両方を不良化さ
せる確率を減少させる必要がある時、或いは一次アプリ
ケーション・パフォーマンスのインパクトを最小にする
必要がある時に使用される。一次サイト及び二次サイト
の間の距離が地球を横切って延びることができる時、多
数の一次サブシステムの背後の多数の二次サブシステム
までの多数のＤＡＳＤボリュームにまたがる書込み更新
の同期化は更にかなり複雑になる。レコード書込み更新
は、二次記憶装置サブシステムにおけるシャドウィング
のために一次記憶制御装置から一次データ・ムーバを介
して二次データ・ムーバまで配送可能であるが、それら
の間で送られる制御データの量は最小にされなければな
らない。それは、幾つかの記憶制御装置の背後における
多数のＤＡＳＤボリュームにまたがって一次システムで
生じるように、幾つかの記憶制御装置にまたがって二次
システムにおいて正確な順序のレコード書込み更新を再
構成することが依然としてできることを必要とする。
【００２５】（ｂ）同期的遠隔複写 災害回復のための同期的実時間遠隔複写は、複写された
ＤＡＳＤボリュームがセットを形成することを必要とす
る。そのようなセットの形成は、更に、各セットを構成
するボリューム（ＶＯＬＳＥＲ）及び一次サイトの等価
物を識別するための十分な量のシステム情報が二次サイ
トに与えられることを必要とする。重要なこととして、
二次サイトは一次サイトと共に「二重ペア」を形成し、
二次サイトは、１つ又は複数個のボリュームがそのセッ
トと同期していない時、即ち、「障害ある二重」が生じ
た時を認識しなければならない。接続障害は、非同期的
遠隔複写における接続障害よりも同期的遠隔複写におけ
る接続障害の方がずっと可視的である。それは、代わり
のパスが再試行される間、一次ＤＡＳＤ Ｉ／Ｏが遅れ
るためである。一次サイトは、二次サイトに対する更新
が待ち行列化される時、その一次サイトが継続すること
を可能にするために複写を中止又は抑止することができ
る。二次サイトを示すために一次サイトがそのような更
新をマークすることは同期しない。二次サイトを一次サ
イトとの同期外れにする例外条件を認識することは、二
次サイトが災害回復のためにいつでも使用可能であるた
めには必要である。エラー状態及び回復アクションは二
次サイトを一次サイトと不整合にしてはならない。
ＤＡＳＤボリュームがセットを形成することを必要とす
る。そのようなセットの形成は、更に、各セットを構成
するボリューム（ＶＯＬＳＥＲ）及び一次サイトの等価
物を識別するための十分な量のシステム情報が二次サイ
トに与えられることを必要とする。重要なこととして、
二次サイトは一次サイトと共に「二重ペア」を形成し、
二次サイトは、１つ又は複数個のボリュームがそのセッ
トと同期していない時、即ち、「障害ある二重」が生じ
た時を認識しなければならない。接続障害は、非同期的
遠隔複写における接続障害よりも同期的遠隔複写におけ
る接続障害の方がずっと可視的である。それは、代わり
のパスが再試行される間、一次ＤＡＳＤ Ｉ／Ｏが遅れ
るためである。一次サイトは、二次サイトに対する更新
が待ち行列化される時、その一次サイトが継続すること
を可能にするために複写を中止又は抑止することができ
る。二次サイトを示すために一次サイトがそのような更
新をマークすることは同期しない。二次サイトを一次サ
イトとの同期外れにする例外条件を認識することは、二
次サイトが災害回復のためにいつでも使用可能であるた
めには必要である。エラー状態及び回復アクションは二
次サイトを一次サイトと不整合にしてはならない。
【００２６】しかし、二次ＤＡＳＤが存在し且つアクセ
ス可能である時に二次サイトと一次サイトとの間の接続
を維持することはデータ内容の同期状態を保証するもの
ではない。二次サイトは、多くの理由で一次サイトとの
同期状態を緩めることが可能である。二重ペアが形成さ
れる時、二次サイトは、先ず、同期外れとなり、そして
初期データ複写が完了する時に同期に達する。一次サイ
トは、それが更新されたデータを二次サイトに書き込む
ことができない場合に二重ペアを解くことが可能であ
り、その場合、一次サイトは、更新アプリケーションが
継続するように、抑止二重ペア状態の下で一次ＤＡＳＤ
に更新を書き込む。従って、一次サイトは露出状態で、
即ち、二重ペアが回復するまで現在の災害保護複写なし
で実行しようとする。二重ペアを回復する時、二次サイ
トは直ちには同期しない。未決の更新を適用した後、二
次サイトは同期に戻る。一次サイトは、そのボリューム
に対する抑止コマンドを一次ＤＡＳＤに発生することに
よって二次サイトに同期を失わせることもできる。二次
サイトは、抑止コマンドが終了し、二重ペアが再設定さ
れ、未決の更新が複写された後に一次サイトと再同期す
る。オンライン保守は同期化を失わせることもできる。
ス可能である時に二次サイトと一次サイトとの間の接続
を維持することはデータ内容の同期状態を保証するもの
ではない。二次サイトは、多くの理由で一次サイトとの
同期状態を緩めることが可能である。二重ペアが形成さ
れる時、二次サイトは、先ず、同期外れとなり、そして
初期データ複写が完了する時に同期に達する。一次サイ
トは、それが更新されたデータを二次サイトに書き込む
ことができない場合に二重ペアを解くことが可能であ
り、その場合、一次サイトは、更新アプリケーションが
継続するように、抑止二重ペア状態の下で一次ＤＡＳＤ
に更新を書き込む。従って、一次サイトは露出状態で、
即ち、二重ペアが回復するまで現在の災害保護複写なし
で実行しようとする。二重ペアを回復する時、二次サイ
トは直ちには同期しない。未決の更新を適用した後、二
次サイトは同期に戻る。一次サイトは、そのボリューム
に対する抑止コマンドを一次ＤＡＳＤに発生することに
よって二次サイトに同期を失わせることもできる。二次
サイトは、抑止コマンドが終了し、二重ペアが再設定さ
れ、未決の更新が複写された後に一次サイトと再同期す
る。オンライン保守は同期化を失わせることもできる。
【００２７】二次ボリュームが一次ボリュームと同期し
ていない時、二次ボリュームは二次システム回復及び一
次アプリケーションのリザンプションに対して使用可能
ではない。二次サイトにおける同期外れのボリューム
は、そのように識別されなければならず、二次サイト回
復引継手順は、アプリケーション・アクセスを否定する
（ボリューム・オフラインを強制するか、或いはそれら
のＶＯＬＳＥＲを変更する）ための同期外れボリューム
を識別する必要がある。二次サイトは、一次サイトのホ
ストがアクセス不能である任意の時間に一次サイトを回
復させるよう要求可能であり、従って、二次サイトは、
すべてのボリュームの同期状態に関するすべての関連情
報を必要とする。二次記憶制御装置である二次記憶装置
サブシステムは、一次サイトに一次サイト遭遇の例外に
よる同期化をブレークさせるすべての条件を決定するこ
とはできない。例えば、二次サイトが知らない一次Ｉ／
Ｏパス又はリンクの障害のために一次サイトが二次ピア
をアクセスすることができない場合、一次サイトは二重
ペアをブレークすることが可能である。この場合、二重
ペアがブレークされることを一次サイトが表す時、二次
サイトは同期状態を示す。
ていない時、二次ボリュームは二次システム回復及び一
次アプリケーションのリザンプションに対して使用可能
ではない。二次サイトにおける同期外れのボリューム
は、そのように識別されなければならず、二次サイト回
復引継手順は、アプリケーション・アクセスを否定する
（ボリューム・オフラインを強制するか、或いはそれら
のＶＯＬＳＥＲを変更する）ための同期外れボリューム
を識別する必要がある。二次サイトは、一次サイトのホ
ストがアクセス不能である任意の時間に一次サイトを回
復させるよう要求可能であり、従って、二次サイトは、
すべてのボリュームの同期状態に関するすべての関連情
報を必要とする。二次記憶制御装置である二次記憶装置
サブシステムは、一次サイトに一次サイト遭遇の例外に
よる同期化をブレークさせるすべての条件を決定するこ
とはできない。例えば、二次サイトが知らない一次Ｉ／
Ｏパス又はリンクの障害のために一次サイトが二次ピア
をアクセスすることができない場合、一次サイトは二重
ペアをブレークすることが可能である。この場合、二重
ペアがブレークされることを一次サイトが表す時、二次
サイトは同期状態を示す。
【００２８】同期外れの二重ペア・ボリュームが存在す
ることを、外部コミュニケーションが二次サイトに知ら
せることがある。これは、ユーザ・システム管理機能を
使用することによって実現可能である。一次Ｉ／Ｏオペ
レーションはチャネル終了／装置終了／ユニット・チェ
ック（ＣＥ／ＤＥ／ＵＣ）状態でもって終了し、センス
・データはそのエラーの性質を表す。この形式のＩ／Ｏ
構成によって、エラー回復プログラム（ＥＲＰ）はその
エラーを処理し、Ｉ／Ｏが終了したことを一次アプリケ
ーションに知らせる前に適当メッセージを二次プロセッ
サに送る。そこで、ユーザは、ＥＲＰが二重ペア・メッ
セージを抑止したことを認識してその情報を二次ロケー
ションに確保するように応答可能である。二次サイトが
一次サイトの場所で動作的になることに依存する時、始
動手順は二次ＤＡＳＤオンラインを二次ホストに与え
る。その場合、二次ＤＡＳＤサブシステムに記憶された
同期ステータスは、同期外れボリュームがアプリケーシ
ョン割当てのためのオンラインにされないことを保証す
るために検索される。すべてのＥＲＰ抑止二重ペア・メ
ッセージとマージされたこの同期ステータスは二次同期
外れボリュームの完全な画像を与える。
ることを、外部コミュニケーションが二次サイトに知ら
せることがある。これは、ユーザ・システム管理機能を
使用することによって実現可能である。一次Ｉ／Ｏオペ
レーションはチャネル終了／装置終了／ユニット・チェ
ック（ＣＥ／ＤＥ／ＵＣ）状態でもって終了し、センス
・データはそのエラーの性質を表す。この形式のＩ／Ｏ
構成によって、エラー回復プログラム（ＥＲＰ）はその
エラーを処理し、Ｉ／Ｏが終了したことを一次アプリケ
ーションに知らせる前に適当メッセージを二次プロセッ
サに送る。そこで、ユーザは、ＥＲＰが二重ペア・メッ
セージを抑止したことを認識してその情報を二次ロケー
ションに確保するように応答可能である。二次サイトが
一次サイトの場所で動作的になることに依存する時、始
動手順は二次ＤＡＳＤオンラインを二次ホストに与え
る。その場合、二次ＤＡＳＤサブシステムに記憶された
同期ステータスは、同期外れボリュームがアプリケーシ
ョン割当てのためのオンラインにされないことを保証す
るために検索される。すべてのＥＲＰ抑止二重ペア・メ
ッセージとマージされたこの同期ステータスは二次同期
外れボリュームの完全な画像を与える。
【００２９】図１を参照すると、一次サイト１４及び二
次サイト１５を有する災害回復システム１０が示され
る。この場合、二次サイト１５は、例えば、一次サイト
１４から２０キロメートル離れて位置している。一次サ
イト１４は一次ホスト・プロセッサ１を含み、それはそ
こで走るアプリケーション及びシステムＩ／Ｏ及びエラ
ー回復プログラム２（以後、Ｉ／Ｏ＆ＥＲＰ２と呼ぶ）
を有する。一次プロセッサ１は、例えば、ＤＦＳＭＳ／
ＭＶＳオペレーティング・ソフトウエアで走るＩＢＭエ
ンタープライズ・システム／９０００（ＥＳ／９００
０）プロセッサでよく、そこで走る幾つかのアプリケー
ション・プログラムを持つものでよい。一次記憶制御装
置３、例えば、ＩＢＭ３９９０モデル６記憶制御機構
は、チャネル１２を介して一次プロセッサ１２に接続さ
れる。その分野では知られているように、幾つかのその
ような記憶制御装置３が一次プロセッサ１に接続可能で
あり、或いは、幾つかの一次プロセッサ１が一次記憶制
御装置３に接続可能である。一次ＤＡＳＤ４、例えば、
ＩＢＭ３３９０ＤＡＳＤは一次記憶制御装置３に接続さ
れる。幾つかの一次ＤＡＳＤ４が一次記憶制御装置３に
接続可能である。一次記憶制御装置３及びそれに接続さ
れた一次ＤＡＳＤ４は一次サブ記憶システムを形成す
る。更に、一次記憶制御装置３及び一次ＤＡＳＤ４は単
一の統合ユニットであってもよい。
次サイト１５を有する災害回復システム１０が示され
る。この場合、二次サイト１５は、例えば、一次サイト
１４から２０キロメートル離れて位置している。一次サ
イト１４は一次ホスト・プロセッサ１を含み、それはそ
こで走るアプリケーション及びシステムＩ／Ｏ及びエラ
ー回復プログラム２（以後、Ｉ／Ｏ＆ＥＲＰ２と呼ぶ）
を有する。一次プロセッサ１は、例えば、ＤＦＳＭＳ／
ＭＶＳオペレーティング・ソフトウエアで走るＩＢＭエ
ンタープライズ・システム／９０００（ＥＳ／９００
０）プロセッサでよく、そこで走る幾つかのアプリケー
ション・プログラムを持つものでよい。一次記憶制御装
置３、例えば、ＩＢＭ３９９０モデル６記憶制御機構
は、チャネル１２を介して一次プロセッサ１２に接続さ
れる。その分野では知られているように、幾つかのその
ような記憶制御装置３が一次プロセッサ１に接続可能で
あり、或いは、幾つかの一次プロセッサ１が一次記憶制
御装置３に接続可能である。一次ＤＡＳＤ４、例えば、
ＩＢＭ３３９０ＤＡＳＤは一次記憶制御装置３に接続さ
れる。幾つかの一次ＤＡＳＤ４が一次記憶制御装置３に
接続可能である。一次記憶制御装置３及びそれに接続さ
れた一次ＤＡＳＤ４は一次サブ記憶システムを形成す
る。更に、一次記憶制御装置３及び一次ＤＡＳＤ４は単
一の統合ユニットであってもよい。
【００３０】二次サイト１５は二次ホスト・プロセッサ
５、例えば、ＩＢＭ ＥＳ／９０００を含み、それはチ
ャネル１３を介して二次記憶制御装置６、例えば、ＩＢ
Ｍ３９９０モデル６に接続される。更に、ＤＡＳＤ７が
その記憶制御装置６に接続される。一次プロセッサ１は
少なくとも１つのホスト間コミュニケーション・リンク
１１、例えば、チャネル・リンク又は電話Ｔ１／Ｔ３ラ
イン・リンク等によって二次プロセッサ５に接続され
る。一次プロセッサ１は、例えば、多数のエンタープラ
イズ・システム接続（ＥＳＣＯＭ）リンク９による二次
記憶制御装置６との直接接続を持つようにしてもよい。
その結果、Ｉ／Ｏ＆ＥＲＰ２は、必要に応じて二次記憶
制御装置６とコミュニケートすることができる。一次記
憶制御装置３は多数の同格通信リンク８、例えば、多数
のＥＳＣＯＭリンクを介して二次記憶制御装置６とコミ
ュニケートする。
５、例えば、ＩＢＭ ＥＳ／９０００を含み、それはチ
ャネル１３を介して二次記憶制御装置６、例えば、ＩＢ
Ｍ３９９０モデル６に接続される。更に、ＤＡＳＤ７が
その記憶制御装置６に接続される。一次プロセッサ１は
少なくとも１つのホスト間コミュニケーション・リンク
１１、例えば、チャネル・リンク又は電話Ｔ１／Ｔ３ラ
イン・リンク等によって二次プロセッサ５に接続され
る。一次プロセッサ１は、例えば、多数のエンタープラ
イズ・システム接続（ＥＳＣＯＭ）リンク９による二次
記憶制御装置６との直接接続を持つようにしてもよい。
その結果、Ｉ／Ｏ＆ＥＲＰ２は、必要に応じて二次記憶
制御装置６とコミュニケートすることができる。一次記
憶制御装置３は多数の同格通信リンク８、例えば、多数
のＥＳＣＯＭリンクを介して二次記憶制御装置６とコミ
ュニケートする。
【００３１】書込みＩ／Ｏオペレーションが一次プロセ
ッサ１において走るアプリケーション・プログラムによ
って実行される時、そのＩ／Ｏオペレーションが成功裏
に完了したことを表すハードウエア・ステータスのチャ
ネル終了／装置終了（ＣＥ／ＤＥ）が与えられる。一次
プロセッサ１のオペレーティング・システム・ソフトウ
エアは、Ｉ／Ｏオペレーションの成功した完了時にアプ
リケーションに書込みＩ／Ｏオペレーションの成功をマ
ークし、従って、アプリケーション・プログラムが、成
功裏に完了した第１の又は前の書込みＩ／Ｏオペレーシ
ョンに従属した次の書込みＩ／Ｏオペレーションに継続
することを許容する。一方、その書込みＩ／Ｏオペレー
ションが不成功であった場合、チャネル終了／装置終了
／ユニット・チェック（以後、ＣＥ／ＤＥ／ＵＣと呼
ぶ）のＩ／Ｏステータスが一次プロセッサ１のオペレー
ティング・システム・ソフトウエアに与えられる。ユニ
ット・チェックを与えると、Ｉ／Ｏ＆ＥＲＰ２は、障害
のあったＩ／Ｏオペレーションの性質に関する特殊セン
ス情報を一次記憶制御装置３から得る制御を行う。或ボ
リュームに特有のエラーが生じた場合、そのエラーに関
連した特有のステータスがＩ／Ｏ＆ＥＲＰ２に与えられ
る。しかる後、Ｉ／Ｏ＆ＥＲＰ２は、一次記憶制御装置
３及び二次記憶制御装置６との間の、或いは、最悪の場
合には、一次プロセッサ１及び二次プロセッサ５との間
のデータ整合性を維持するために新しい同格通信同期エ
ラー回復を行うことができる。
ッサ１において走るアプリケーション・プログラムによ
って実行される時、そのＩ／Ｏオペレーションが成功裏
に完了したことを表すハードウエア・ステータスのチャ
ネル終了／装置終了（ＣＥ／ＤＥ）が与えられる。一次
プロセッサ１のオペレーティング・システム・ソフトウ
エアは、Ｉ／Ｏオペレーションの成功した完了時にアプ
リケーションに書込みＩ／Ｏオペレーションの成功をマ
ークし、従って、アプリケーション・プログラムが、成
功裏に完了した第１の又は前の書込みＩ／Ｏオペレーシ
ョンに従属した次の書込みＩ／Ｏオペレーションに継続
することを許容する。一方、その書込みＩ／Ｏオペレー
ションが不成功であった場合、チャネル終了／装置終了
／ユニット・チェック（以後、ＣＥ／ＤＥ／ＵＣと呼
ぶ）のＩ／Ｏステータスが一次プロセッサ１のオペレー
ティング・システム・ソフトウエアに与えられる。ユニ
ット・チェックを与えると、Ｉ／Ｏ＆ＥＲＰ２は、障害
のあったＩ／Ｏオペレーションの性質に関する特殊セン
ス情報を一次記憶制御装置３から得る制御を行う。或ボ
リュームに特有のエラーが生じた場合、そのエラーに関
連した特有のステータスがＩ／Ｏ＆ＥＲＰ２に与えられ
る。しかる後、Ｉ／Ｏ＆ＥＲＰ２は、一次記憶制御装置
３及び二次記憶制御装置６との間の、或いは、最悪の場
合には、一次プロセッサ１及び二次プロセッサ５との間
のデータ整合性を維持するために新しい同格通信同期エ
ラー回復を行うことができる。
【００３２】図２を参照すると、エラー回復手順が示さ
れる。図２において、ステップ２０１は、一次プロセッ
サ１において走るアプリケーション・プログラムがデー
タ更新を一次記憶制御装置３に送ることを含む。ステッ
プ２０３において、そのデータ更新が一次ＤＡＳＤ４に
書き込まれ、そして、そのデータ更新は二次記憶制御装
置６にシャドウされる。ステップ２０５において、一次
サイト及び二次サイトが同期しているかどうかを決定す
るために、二重ペア・ステータスがチェックされる。そ
の二重ペア・ステータスが同期状態にある場合、一次プ
ロセッサ１においてそこで走るアプリケーション・プロ
グラムを介して処理が継続する間、ステップ２０７にお
いて、データ更新が二次ＤＡＳＤ７に書き込まれる。
れる。図２において、ステップ２０１は、一次プロセッ
サ１において走るアプリケーション・プログラムがデー
タ更新を一次記憶制御装置３に送ることを含む。ステッ
プ２０３において、そのデータ更新が一次ＤＡＳＤ４に
書き込まれ、そして、そのデータ更新は二次記憶制御装
置６にシャドウされる。ステップ２０５において、一次
サイト及び二次サイトが同期しているかどうかを決定す
るために、二重ペア・ステータスがチェックされる。そ
の二重ペア・ステータスが同期状態にある場合、一次プ
ロセッサ１においてそこで走るアプリケーション・プロ
グラムを介して処理が継続する間、ステップ２０７にお
いて、データ更新が二次ＤＡＳＤ７に書き込まれる。
【００３３】二重ペアが「障害」状態にある場合、ステ
ップ２０９において、一次記憶制御装置３は、その二重
ペアが抑止したこと或いは障害を生じたことを一次プロ
セッサ１に知らせる。その二重ペアは、コミュニケーシ
ョン・リンク８を介した一次記憶制御装置３及び二次記
憶制御装置６の間のコミュニケーション障害のために
「障害」となることがある。それとは別に、二重ペアは
一次サブシステム或いは二次サブシステムにおけるエラ
ーのために「障害」となることがある。その障害がコミ
ュニケーション・リンク８にある場合、一次記憶制御装
置３は、二次記憶制御装置６に直接にその障害をコミュ
ニケートすることができない。ステップ２１１におい
て、一次記憶制御装置３はＩ／ＯステータスＣＥ／ＤＥ
／ＵＣを一次プロセッサ１に戻す。Ｉ／Ｏ＆ＥＲＰ２は
アプリケーション・プログラムを静止させ、従って、書
込みＩ／Ｏオペレーションをリクエストするアプリケー
ションに制御を戻す前に、エラー回復及びデータ整合性
のために、ステップ２１３において、一次プロセッサ１
の制御を行う。
ップ２０９において、一次記憶制御装置３は、その二重
ペアが抑止したこと或いは障害を生じたことを一次プロ
セッサ１に知らせる。その二重ペアは、コミュニケーシ
ョン・リンク８を介した一次記憶制御装置３及び二次記
憶制御装置６の間のコミュニケーション障害のために
「障害」となることがある。それとは別に、二重ペアは
一次サブシステム或いは二次サブシステムにおけるエラ
ーのために「障害」となることがある。その障害がコミ
ュニケーション・リンク８にある場合、一次記憶制御装
置３は、二次記憶制御装置６に直接にその障害をコミュ
ニケートすることができない。ステップ２１１におい
て、一次記憶制御装置３はＩ／ＯステータスＣＥ／ＤＥ
／ＵＣを一次プロセッサ１に戻す。Ｉ／Ｏ＆ＥＲＰ２は
アプリケーション・プログラムを静止させ、従って、書
込みＩ／Ｏオペレーションをリクエストするアプリケー
ションに制御を戻す前に、エラー回復及びデータ整合性
のために、ステップ２１３において、一次プロセッサ１
の制御を行う。
【００３４】図３を参照すると、記憶制御装置３２５、
例えば、ＩＢＭ３９９０記憶制御機構は、例えば、デー
タ機能記憶管理サブシステム／多重仮想システム（ＤＦ
ＳＭＳ／ＭＶＳ）を走らせるＩＢＭシステム／３７０或
いはＩＢＭエンタープライズ・システム／９０００（Ｅ
Ｓ／９０００）プロセッサのようなホスト・プロセッサ
３１０を含むデータ処理システムに接続されるものとし
て更に詳細に示される。記憶制御装置３２５は、更に、
ＩＢＭ３３８０又は３３９０ＤＡＳＤのような直接アク
セス記憶装置（ＤＡＳＤ）３７５に接続される。記憶サ
ブシステムは記憶制御装置３２５及びＤＡＳＤ３７５に
よって形成される。その記憶サブシステムは、コミュニ
ケーション・リンク３２１を介してホスト・プロセッサ
３１０に接続される。そのコミュニケーション・リンク
３２１は、ホスト・プロセッサ３１０のチャネル３２０
に及び記憶制御装置３２５のポートＡ−Ｄ、Ｅ−Ｈに接
続する。コミュニケーション・リンク３２１は、並列又
は直列リンク、例えば、エンタープライズ・システム接
続（ＥＳＣＯＭ）直列ファイバ光学リンクであってもよ
い。
例えば、ＩＢＭ３９９０記憶制御機構は、例えば、デー
タ機能記憶管理サブシステム／多重仮想システム（ＤＦ
ＳＭＳ／ＭＶＳ）を走らせるＩＢＭシステム／３７０或
いはＩＢＭエンタープライズ・システム／９０００（Ｅ
Ｓ／９０００）プロセッサのようなホスト・プロセッサ
３１０を含むデータ処理システムに接続されるものとし
て更に詳細に示される。記憶制御装置３２５は、更に、
ＩＢＭ３３８０又は３３９０ＤＡＳＤのような直接アク
セス記憶装置（ＤＡＳＤ）３７５に接続される。記憶サ
ブシステムは記憶制御装置３２５及びＤＡＳＤ３７５に
よって形成される。その記憶サブシステムは、コミュニ
ケーション・リンク３２１を介してホスト・プロセッサ
３１０に接続される。そのコミュニケーション・リンク
３２１は、ホスト・プロセッサ３１０のチャネル３２０
に及び記憶制御装置３２５のポートＡ−Ｄ、Ｅ−Ｈに接
続する。コミュニケーション・リンク３２１は、並列又
は直列リンク、例えば、エンタープライズ・システム接
続（ＥＳＣＯＭ）直列ファイバ光学リンクであってもよ
い。
【００３５】記憶制御装置３２５は二重クラスタ３６
０、３６１を含む。その二重クラスタ３６０、３６１は
別々の電源（図示されていない）を有し、更に、コミュ
ニケーション・インターフェースを与えるためのポート
Ａ−Ｄ、Ｅ−Ｈ３３０を含む。不揮発性記憶装置（ＮＶ
Ｍ）３７０及びキャッシュ３４５の両方が一時的データ
記憶装置に与えられ、クラスタ３６０、３６１の両方に
アクセス可能である。記憶装置パス０ー３ ３４０がＤ
ＡＳＤ３７５への必要なパスを与える。重要製品データ
がＶＰＤ３９５及び３９６に維持される。記憶制御装置
３２５と同様の記憶制御装置が米国特許第５,０５１,８
８７号に開示されている。
０、３６１を含む。その二重クラスタ３６０、３６１は
別々の電源（図示されていない）を有し、更に、コミュ
ニケーション・インターフェースを与えるためのポート
Ａ−Ｄ、Ｅ−Ｈ３３０を含む。不揮発性記憶装置（ＮＶ
Ｍ）３７０及びキャッシュ３４５の両方が一時的データ
記憶装置に与えられ、クラスタ３６０、３６１の両方に
アクセス可能である。記憶装置パス０ー３ ３４０がＤ
ＡＳＤ３７５への必要なパスを与える。重要製品データ
がＶＰＤ３９５及び３９６に維持される。記憶制御装置
３２５と同様の記憶制御装置が米国特許第５,０５１,８
８７号に開示されている。
【００３６】図４は記憶制御装置の記憶装置パス４０１
を更に詳細に示す。前に図３に示されたように、記憶制
御装置は４つの記憶装置パスを有し、各記憶装置パスは
他の３つと同じである。従って、１つの記憶装置パスだ
けを詳細に説明することにする。記憶装置パス４０１は
上部のチャネル・ポート４３０によって８×２スイッチ
４０２に接続され、下部の装置ポート４３２によって複
数個のＤＡＳＤに接続される。記憶装置パス４０１は、
そのパス内で生じるすべてのオペレーションを制御する
マイクロプロセッサ４１０を含む。マイクロプロセッサ
４１０は、ホスト・プロセッサから受け取ったチャネル
・コマンドを翻訳することができ、接続されたＤＡＳＤ
を制御することもできる。マイクロプロセッサ４１０
は、外部サポート機構を通して制御メモリ又は制御記憶
装置（図示されていない）にロードされたマイクロ命令
を実行する。
を更に詳細に示す。前に図３に示されたように、記憶制
御装置は４つの記憶装置パスを有し、各記憶装置パスは
他の３つと同じである。従って、１つの記憶装置パスだ
けを詳細に説明することにする。記憶装置パス４０１は
上部のチャネル・ポート４３０によって８×２スイッチ
４０２に接続され、下部の装置ポート４３２によって複
数個のＤＡＳＤに接続される。記憶装置パス４０１は、
そのパス内で生じるすべてのオペレーションを制御する
マイクロプロセッサ４１０を含む。マイクロプロセッサ
４１０は、ホスト・プロセッサから受け取ったチャネル
・コマンドを翻訳することができ、接続されたＤＡＳＤ
を制御することもできる。マイクロプロセッサ４１０
は、外部サポート機構を通して制御メモリ又は制御記憶
装置（図示されていない）にロードされたマイクロ命令
を実行する。
【００３７】図４には、共用制御アレイ（ＳＣＡ）４３
４も示される。ＳＣＡ４３４はその記憶制御装置の４つ
の記憶装置パスすべてによって共用される情報を含む。
記憶装置パス４０１における各マイクロプロセッサ４１
０は共用の情報を得るためにＳＣＡ４３４をアクセスす
る。一般的な共用の情報は、４つの記憶装置パスすべて
のマイクロプロセッサにより使用される外部レジスタ、
装置ステータス、及びチャネル再接続データを含む。
４も示される。ＳＣＡ４３４はその記憶制御装置の４つ
の記憶装置パスすべてによって共用される情報を含む。
記憶装置パス４０１における各マイクロプロセッサ４１
０は共用の情報を得るためにＳＣＡ４３４をアクセスす
る。一般的な共用の情報は、４つの記憶装置パスすべて
のマイクロプロセッサにより使用される外部レジスタ、
装置ステータス、及びチャネル再接続データを含む。
【００３８】記憶装置パス４０１はポート・アダプタ
（ＰＡ）４１２を含み、そのポート・アダプタはキャッ
シュ４２０、不揮発性記憶装置（ＮＶＭ）４２２、及び
自動データ転送（ＡＤＴ）バッファの間でデータを転送
するためのデータ・パス及び制御ラインを与える。その
ＡＤＴバッファはＡＤＴ回路４１４及び速度変更バッフ
ァ４１６より成る。速度変更バッファ４１６は、そのＤ
ＡＳＤのデータ転送速度及びチャネルに対するホスト・
プロセッサのデータ転送速度の間の差を補償する。一般
に、データ処理システムでは、チャネルと記憶制御装置
との間のデータ転送速度、又はチャネル転送速度は、Ｄ
ＡＳＤと記憶制御装置との間のデータ転送速度又はＤＡ
ＳＤ転送速度よりもずっと高い。
（ＰＡ）４１２を含み、そのポート・アダプタはキャッ
シュ４２０、不揮発性記憶装置（ＮＶＭ）４２２、及び
自動データ転送（ＡＤＴ）バッファの間でデータを転送
するためのデータ・パス及び制御ラインを与える。その
ＡＤＴバッファはＡＤＴ回路４１４及び速度変更バッフ
ァ４１６より成る。速度変更バッファ４１６は、そのＤ
ＡＳＤのデータ転送速度及びチャネルに対するホスト・
プロセッサのデータ転送速度の間の差を補償する。一般
に、データ処理システムでは、チャネルと記憶制御装置
との間のデータ転送速度、又はチャネル転送速度は、Ｄ
ＡＳＤと記憶制御装置との間のデータ転送速度又はＤＡ
ＳＤ転送速度よりもずっと高い。
【００３９】ポート・アダプタ４１２は上位キャッシュ
・ポート４２４及び下位キャッシュ・ポート４２６を使
用してキャッシュ４２０、ＮＶＳ４２２、及びＡＤＴバ
ッファ（４１４、４１６より成る）の間のデータ・パス
を与える。これらの２つのポートは、キャッシュ４２０
に関連する２つの同時転送を可能にする。例えば、下位
キャッシュ・ポート４２６を使用してデータがＤＡＳＤ
からキャッシュ４２０に転送されるのと同時に、上位キ
ャッシュ・ポート４２４を使用してデータがキャッシュ
４２０からチャネルに転送可能である。データ転送はマ
イクロプロセッサ４１０によって開始され、そしてそれ
が一旦開始されると、完了するまでマイクロプロセッサ
の介入なしにＡＤＴ回路４１４によって制御される。
・ポート４２４及び下位キャッシュ・ポート４２６を使
用してキャッシュ４２０、ＮＶＳ４２２、及びＡＤＴバ
ッファ（４１４、４１６より成る）の間のデータ・パス
を与える。これらの２つのポートは、キャッシュ４２０
に関連する２つの同時転送を可能にする。例えば、下位
キャッシュ・ポート４２６を使用してデータがＤＡＳＤ
からキャッシュ４２０に転送されるのと同時に、上位キ
ャッシュ・ポート４２４を使用してデータがキャッシュ
４２０からチャネルに転送可能である。データ転送はマ
イクロプロセッサ４１０によって開始され、そしてそれ
が一旦開始されると、完了するまでマイクロプロセッサ
の介入なしにＡＤＴ回路４１４によって制御される。
【００４０】記憶装置パス４０１は、直接ＤＡＳＤオペ
レーション時に、又はキャッシュ・オペレーション時
に、又は高速書込みオペレーション時に、ホスト・プロ
セッサから複数個のＤＡＳＤの１つへのデータ・レコー
ドの転送を指示する。直接ＤＡＳＤオペレーションは、
データの一時記憶のためにキャッシュ又はＮＶＳを使用
することなく、ホスト・プロセッサと複数個のＤＡＳＤ
の１つとの間のデータの転送を含む。この場合、記憶装
置パス４０１はＡＤＴバッファ４１４、４１６を使用し
て、ＤＡＳＤへ転送するためのデータを一時的に記憶す
る。
レーション時に、又はキャッシュ・オペレーション時
に、又は高速書込みオペレーション時に、ホスト・プロ
セッサから複数個のＤＡＳＤの１つへのデータ・レコー
ドの転送を指示する。直接ＤＡＳＤオペレーションは、
データの一時記憶のためにキャッシュ又はＮＶＳを使用
することなく、ホスト・プロセッサと複数個のＤＡＳＤ
の１つとの間のデータの転送を含む。この場合、記憶装
置パス４０１はＡＤＴバッファ４１４、４１６を使用し
て、ＤＡＳＤへ転送するためのデータを一時的に記憶す
る。
【００４１】キャッシュ・オペレーション時に、記憶装
置パス４０１はデータをキャッシュ・メモリ４２０に記
憶し且つそのデータをＤＡＳＤにブランチする。この場
合、そのデータは上部のチャネル・ポート４３０を使用
してＡＤＴバッファ４１４、４１６転送される。そこ
で、データは、上位キャッシュ・ポート４２４を使用し
てＡＤＴバッファ４１４、４１６からキャッシュ・メモ
リ４２０に転送され、下部の装置ポート４３２を使用し
てＤＡＳＤに転送される。データは、それがＤＡＳＤに
ブランチされた後、或時間的期間の間キャッシュ・メモ
リ４２０に残っている。ホスト・プロセッサがデータ
を、それが更新される前に読み取るようリクエストする
場合、記憶装置パス４０１はそのデータをキャッシュ４
２０から読み取るよう指示することができ、それによっ
てデータ処理システムのパフォーマンスを向上させるこ
とができる。
置パス４０１はデータをキャッシュ・メモリ４２０に記
憶し且つそのデータをＤＡＳＤにブランチする。この場
合、そのデータは上部のチャネル・ポート４３０を使用
してＡＤＴバッファ４１４、４１６転送される。そこ
で、データは、上位キャッシュ・ポート４２４を使用し
てＡＤＴバッファ４１４、４１６からキャッシュ・メモ
リ４２０に転送され、下部の装置ポート４３２を使用し
てＤＡＳＤに転送される。データは、それがＤＡＳＤに
ブランチされた後、或時間的期間の間キャッシュ・メモ
リ４２０に残っている。ホスト・プロセッサがデータ
を、それが更新される前に読み取るようリクエストする
場合、記憶装置パス４０１はそのデータをキャッシュ４
２０から読み取るよう指示することができ、それによっ
てデータ処理システムのパフォーマンスを向上させるこ
とができる。
【００４２】高速の書込みオペレーション時に、記憶装
置パス４０１は最初にデータをキャッシュ４２０及びＮ
ＶＳ４２２に記憶する。そのデータは、その後、ＮＶＳ
４２２からＤＡＳＤにデステージされる。この高速書込
みの場合、データは上部のチャネル・ポート４３０を使
用してＡＤＴバッファ４１４、４１６に転送される。し
かる後、データはＡＤＴバッファ４１４、４１６から上
位キャッシュ・ポート４２４を使用してキャッシュ４２
０へ及び下位キャッシュ・ポート４２６を使用してＮＶ
Ｓ４２２へ転送される。キャッシュ・オペレーションの
時のように、ホスト・プロセッサがデータを、それが更
新される前に読み取るようリクエストされる場合、記憶
装置パス４０１はデータをキャッシュ４２０から読み取
るよう指示することができ、それによって、データ処理
システムのパフォーマンスを向上させることができる。
置パス４０１は最初にデータをキャッシュ４２０及びＮ
ＶＳ４２２に記憶する。そのデータは、その後、ＮＶＳ
４２２からＤＡＳＤにデステージされる。この高速書込
みの場合、データは上部のチャネル・ポート４３０を使
用してＡＤＴバッファ４１４、４１６に転送される。し
かる後、データはＡＤＴバッファ４１４、４１６から上
位キャッシュ・ポート４２４を使用してキャッシュ４２
０へ及び下位キャッシュ・ポート４２６を使用してＮＶ
Ｓ４２２へ転送される。キャッシュ・オペレーションの
時のように、ホスト・プロセッサがデータを、それが更
新される前に読み取るようリクエストされる場合、記憶
装置パス４０１はデータをキャッシュ４２０から読み取
るよう指示することができ、それによって、データ処理
システムのパフォーマンスを向上させることができる。
【００４３】図５を参照すると、二重複写災害回復機能
及び遠隔二重複写災害回復機能の両方を実施できるデー
タ処理システムが示される。ホスト・プロセッサ５０
１、例えば、ＩＢＭ ＥＳ／９０００は２つの記憶サブ
システム５０２、５０３にコミュニケートする。記憶制
御装置５１０、例えば、ＩＢＭ３９９０モデル３は、Ｉ
ＢＭ３９９０のようなＤＡＳＤ５１２、５１４、５１
６、５２２、５２４及び５２６に接続され、ホスト・プ
ロセッサ５０１と同じ一次サイトに置かれた１つの記憶
サブシステム５０２を構成する。この記憶サブシステム
５０２は一次ＤＡＳＤ５１２、５１４、及び５１６に書
かれたデータを、それぞれ二次ＤＡＳＤ５２２、５２
４、及び５２６上にバックアップする二重複写オペレー
ションを遂行する。ＤＡＳＤ５１２、５２２は１つの二
重ペアを形成する。同様に、２つの更なる二重ペアがＤ
ＡＳＤ５１４、５２４及びＤＡＳＤ５１６、５２６によ
って形成される。
及び遠隔二重複写災害回復機能の両方を実施できるデー
タ処理システムが示される。ホスト・プロセッサ５０
１、例えば、ＩＢＭ ＥＳ／９０００は２つの記憶サブ
システム５０２、５０３にコミュニケートする。記憶制
御装置５１０、例えば、ＩＢＭ３９９０モデル３は、Ｉ
ＢＭ３９９０のようなＤＡＳＤ５１２、５１４、５１
６、５２２、５２４及び５２６に接続され、ホスト・プ
ロセッサ５０１と同じ一次サイトに置かれた１つの記憶
サブシステム５０２を構成する。この記憶サブシステム
５０２は一次ＤＡＳＤ５１２、５１４、及び５１６に書
かれたデータを、それぞれ二次ＤＡＳＤ５２２、５２
４、及び５２６上にバックアップする二重複写オペレー
ションを遂行する。ＤＡＳＤ５１２、５２２は１つの二
重ペアを形成する。同様に、２つの更なる二重ペアがＤ
ＡＳＤ５１４、５２４及びＤＡＳＤ５１６、５２６によ
って形成される。
【００４４】ホスト・プロセッサ５０１において走るア
プリケーション・プログラムが記憶サブシステム５０２
に書き込まれるべきレコードを発生する時、ホスト・プ
ロセッサ５０１は、先ず、そのレコードを記憶サブシス
テム５０２の記憶制御装置５１０に転送する。記憶制御
装置５１０は、そのレコードを受け取り、転送の成功を
信号するチャネル終了（ＣＥ）をホスト・プロセッサに
発生する。そこで、記憶制御装置５１０は、そのレコー
ドを一次ＤＡＳＤ５１２へ転送し、一次ＤＡＳＤ５１２
へのレコードの書込みの成功を信号する装置終了（Ｄ
Ｅ）をホスト・プロセッサ５０１に発生する。ホスト・
プロセッサ５０１は、今や、その後のレコードを一次Ｄ
ＡＳＤ５１２、５１４、５１６の１つに書き込むか、或
いは前に書き込まれたデータを一次ＤＡＳＤ５１２、５
１４、５１６から読み取るという記憶サブシステム５０
２に対する次のオペレーションを遂行することができ
る。そこで、その記憶制御装置は、一次ＤＡＳＤ５１２
に書き込まれたレコードの複写を二次ＤＡＳＤ５２２に
転送し、そのレコードのバックアップ・バージョンを与
える。
プリケーション・プログラムが記憶サブシステム５０２
に書き込まれるべきレコードを発生する時、ホスト・プ
ロセッサ５０１は、先ず、そのレコードを記憶サブシス
テム５０２の記憶制御装置５１０に転送する。記憶制御
装置５１０は、そのレコードを受け取り、転送の成功を
信号するチャネル終了（ＣＥ）をホスト・プロセッサに
発生する。そこで、記憶制御装置５１０は、そのレコー
ドを一次ＤＡＳＤ５１２へ転送し、一次ＤＡＳＤ５１２
へのレコードの書込みの成功を信号する装置終了（Ｄ
Ｅ）をホスト・プロセッサ５０１に発生する。ホスト・
プロセッサ５０１は、今や、その後のレコードを一次Ｄ
ＡＳＤ５１２、５１４、５１６の１つに書き込むか、或
いは前に書き込まれたデータを一次ＤＡＳＤ５１２、５
１４、５１６から読み取るという記憶サブシステム５０
２に対する次のオペレーションを遂行することができ
る。そこで、その記憶制御装置は、一次ＤＡＳＤ５１２
に書き込まれたレコードの複写を二次ＤＡＳＤ５２２に
転送し、そのレコードのバックアップ・バージョンを与
える。
【００４５】ホスト・プロセッサ５０１は、記憶制御装
置５３０、例えば、ＩＢＭ３９９０モデル６、及び幾つ
かのＤＡＳＤ５３２、５３４、５３６、例えば、ＩＢＭ
３３９０或いはＩＢＭ ＲＡＭＡＣより成る他の記憶サ
ブシステム５０３に接続される。この記憶サブシステム
５０３は災害回復システムのための一次サイトを与え
る。ＤＡＳＤ５３２、５３４、５３６は二重ペアの一次
ＤＡＳＤとして働く。一次記憶サブシステム５０３は、
災害回復システムを完成するための第２の遠隔サイトに
おける二次記憶サブシステム５０４に接続される。一次
記憶サブシステム５０３及び二次記憶サブシステム５０
４の間の接続５５０は直接コミュニケーション・リン
ク、例えば、エンタープライズ・システム接続（ＥＳＣ
ＯＭ）リンクを通して行われる。二次記憶サブシステム
５０４は、ＩＢＭ３３９０或いはＩＢＭ ＲＡＭＡＣの
ような幾つかのＤＡＳＤ５４２、５４４、５４６に接続
された記憶制御装置５４０、例えば、ＩＢＭ３９９０モ
デル６より成る。二次記憶サブシステム５０４における
ＤＡＳＤ５４２、５４４、５４６は遠隔二重複写オペレ
ーションに対する二次ＤＡＳＤとして働く。図５におけ
る災害回復システムには、３つの二重ペアが示される。
ＤＡＳＤ５３２、５４２は第１二重ペアを形成し、ＤＡ
ＳＤ５３４、５４４は第２二重ペアを形成し、ＤＡＳＤ
５３６、５４６は第３二重ペアを形成する。従って、例
えば、ホスト・プロセッサ５０１は一次記憶サブシステ
ム５０３の記憶制御装置５３０を通して一次ＤＡＳＤ５
３２にレコードを書き込む。このレコードの複写は、そ
の後、一次記憶制御装置５３０によって二次記憶制御装
置５４０に転送され、その二重ペアの二次ＤＡＳＤ５４
２に記憶される。
置５３０、例えば、ＩＢＭ３９９０モデル６、及び幾つ
かのＤＡＳＤ５３２、５３４、５３６、例えば、ＩＢＭ
３３９０或いはＩＢＭ ＲＡＭＡＣより成る他の記憶サ
ブシステム５０３に接続される。この記憶サブシステム
５０３は災害回復システムのための一次サイトを与え
る。ＤＡＳＤ５３２、５３４、５３６は二重ペアの一次
ＤＡＳＤとして働く。一次記憶サブシステム５０３は、
災害回復システムを完成するための第２の遠隔サイトに
おける二次記憶サブシステム５０４に接続される。一次
記憶サブシステム５０３及び二次記憶サブシステム５０
４の間の接続５５０は直接コミュニケーション・リン
ク、例えば、エンタープライズ・システム接続（ＥＳＣ
ＯＭ）リンクを通して行われる。二次記憶サブシステム
５０４は、ＩＢＭ３３９０或いはＩＢＭ ＲＡＭＡＣの
ような幾つかのＤＡＳＤ５４２、５４４、５４６に接続
された記憶制御装置５４０、例えば、ＩＢＭ３９９０モ
デル６より成る。二次記憶サブシステム５０４における
ＤＡＳＤ５４２、５４４、５４６は遠隔二重複写オペレ
ーションに対する二次ＤＡＳＤとして働く。図５におけ
る災害回復システムには、３つの二重ペアが示される。
ＤＡＳＤ５３２、５４２は第１二重ペアを形成し、ＤＡ
ＳＤ５３４、５４４は第２二重ペアを形成し、ＤＡＳＤ
５３６、５４６は第３二重ペアを形成する。従って、例
えば、ホスト・プロセッサ５０１は一次記憶サブシステ
ム５０３の記憶制御装置５３０を通して一次ＤＡＳＤ５
３２にレコードを書き込む。このレコードの複写は、そ
の後、一次記憶制御装置５３０によって二次記憶制御装
置５４０に転送され、その二重ペアの二次ＤＡＳＤ５４
２に記憶される。
【００４６】ホスト・プロセッサにおいて走るアプリケ
ーションは記憶サブシステムにＩ／Ｏオペレーションを
発生する。Ｉ／Ｏオペレーションの例は、ＤＡＳＤから
の読取り、ＤＡＳＤへの書込み、及びデータの転送を必
要としないＤＡＳＤに対する他のコマンドである。アプ
リケーションは、Ｉ／Ｏに無関係の他のＩ／Ｏオペレー
ションを条件としないＩ／Ｏオペレーション、又はＩ／
Ｏに従属した他のＩ／Ｏオペレーションを条件とするＩ
／Ｏオペレーションを発生することができる。従属した
Ｉ／Ｏの例として、アプリケーションは、一次ＤＡＳＤ
５３２にレコードを書き込むことによって第１Ｉ／Ｏを
発生し、しかる後、レコードを指示するインデックスを
他の一次ＤＡＳＤに書き込むことによって第２Ｉ／Ｏを
発生してもよい。第２Ｉ／Ｏは従属Ｉ／Ｏである。
ーションは記憶サブシステムにＩ／Ｏオペレーションを
発生する。Ｉ／Ｏオペレーションの例は、ＤＡＳＤから
の読取り、ＤＡＳＤへの書込み、及びデータの転送を必
要としないＤＡＳＤに対する他のコマンドである。アプ
リケーションは、Ｉ／Ｏに無関係の他のＩ／Ｏオペレー
ションを条件としないＩ／Ｏオペレーション、又はＩ／
Ｏに従属した他のＩ／Ｏオペレーションを条件とするＩ
／Ｏオペレーションを発生することができる。従属した
Ｉ／Ｏの例として、アプリケーションは、一次ＤＡＳＤ
５３２にレコードを書き込むことによって第１Ｉ／Ｏを
発生し、しかる後、レコードを指示するインデックスを
他の一次ＤＡＳＤに書き込むことによって第２Ｉ／Ｏを
発生してもよい。第２Ｉ／Ｏは従属Ｉ／Ｏである。
【００４７】従属Ｉ／Ｏは、データ処理システムが多数
のサブシステムに跨って多数の二重ペアを抑止しようと
する時に問題を生じることがある。その問題は、第２Ｉ
／Ｏに対する二重ペア５３４、５４４が抑止される前に
レコードを指示するインデックスが二次ＤＡＳＤ５４４
に複写されるが、そのレコードが二次ＤＡＳＤ５４２に
複写される前に第１Ｉ／Ｏに対する二重ペア５３２、５
４２が抑止される場合に生じる。この例では、二次ＤＡ
ＳＤにおけるデータはシーケンス整合した順序で同期さ
れない。レコードに対するインデックスは二次ＤＡＳＤ
５４４に複写されているが、そのレコードは二次ＤＡＳ
Ｄ５４２に複写されてない。従って、多数の記憶サブシ
ステムに跨って多数の二重ペアを抑止することは、第１
Ｉ／Ｏがそれの二重ペアの二次ＤＡＳＤに複写されない
場合、第２の従属したＩ／Ｏがそれの二重ペアの二次Ｄ
ＡＳＤに複写できないことを必要とする。
のサブシステムに跨って多数の二重ペアを抑止しようと
する時に問題を生じることがある。その問題は、第２Ｉ
／Ｏに対する二重ペア５３４、５４４が抑止される前に
レコードを指示するインデックスが二次ＤＡＳＤ５４４
に複写されるが、そのレコードが二次ＤＡＳＤ５４２に
複写される前に第１Ｉ／Ｏに対する二重ペア５３２、５
４２が抑止される場合に生じる。この例では、二次ＤＡ
ＳＤにおけるデータはシーケンス整合した順序で同期さ
れない。レコードに対するインデックスは二次ＤＡＳＤ
５４４に複写されているが、そのレコードは二次ＤＡＳ
Ｄ５４２に複写されてない。従って、多数の記憶サブシ
ステムに跨って多数の二重ペアを抑止することは、第１
Ｉ／Ｏがそれの二重ペアの二次ＤＡＳＤに複写されない
場合、第２の従属したＩ／Ｏがそれの二重ペアの二次Ｄ
ＡＳＤに複写できないことを必要とする。
【００４８】図６を参照すると、二次装置におけるデー
タがシーケンス整合した順序で同期したままであるよう
に多数の二重ペアを抑止するための方法を説明する流れ
図が示される。ステップ６１０において、ホスト・プロ
セッサは特殊な二重ペアに対する静止二重ペア・コマン
ドを記憶制御装置に発生する。記憶制御装置はそのコマ
ンドを受け、その二重ペアを静止させる。二重ペアを静
止させることは、進行中の何れの現在のＩ／Ｏオペレー
ションも完了することを可能にし、指定された二重ペア
に対する如何なる将来のＩ／Ｏオペレーションも記憶制
御装置又はホスト・プロセッサにおいて待ち行列化され
ないようにする。ステップ６２０は、更なる二重ペアが
静止される必要があるかどうかを決定する。それが肯定
される場合、ステップ６１０が更なる二重ペアの各々に
対して繰り返される。それが否定される場合、ステップ
６３０は、すべての二重ペアが静止させられそして二重
ペアの二次ＤＡＳＤにおけるデータがシーケンス整合し
た順序で同期化されることを表す。二次ＤＡＳＤにおけ
るシーケンス整合性を得る手順の詳細が図７に示され
る。
タがシーケンス整合した順序で同期したままであるよう
に多数の二重ペアを抑止するための方法を説明する流れ
図が示される。ステップ６１０において、ホスト・プロ
セッサは特殊な二重ペアに対する静止二重ペア・コマン
ドを記憶制御装置に発生する。記憶制御装置はそのコマ
ンドを受け、その二重ペアを静止させる。二重ペアを静
止させることは、進行中の何れの現在のＩ／Ｏオペレー
ションも完了することを可能にし、指定された二重ペア
に対する如何なる将来のＩ／Ｏオペレーションも記憶制
御装置又はホスト・プロセッサにおいて待ち行列化され
ないようにする。ステップ６２０は、更なる二重ペアが
静止される必要があるかどうかを決定する。それが肯定
される場合、ステップ６１０が更なる二重ペアの各々に
対して繰り返される。それが否定される場合、ステップ
６３０は、すべての二重ペアが静止させられそして二重
ペアの二次ＤＡＳＤにおけるデータがシーケンス整合し
た順序で同期化されることを表す。二次ＤＡＳＤにおけ
るシーケンス整合性を得る手順の詳細が図７に示され
る。
【００４９】ステップ６４０において、ホスト・プロセ
ッサは指定された二重ペアに対する抑止二重ペア・コマ
ンドを記憶制御装置に発生する。記憶制御装置はそのコ
マンドを受け取り、二重ペアを抑止する。その二重ペア
を抑止することは静止を解放し、一次システム・アプリ
ケーションの読取り及び書込みが二重ペアの一次ＤＡＳ
Ｄに再開することを可能にする。一方、抑止された状態
は、これらの変化を二重ペアの二次ＤＡＳＤに複写する
ことを妨げる。ホスト・プロセッサから一次ＤＡＳＤへ
のその後の書込みオペレーションは記憶制御装置によっ
て二次ＤＡＳＤに複写されない。代わりに、記憶制御装
置は、ホスト・プロセッサからのコマンドに応答して二
重ペアを終了させるか、或いはその後の書込みオペレー
ションの物理的ＤＡＳＤアドレス、即ち、特定の一次Ｄ
ＡＳＤにおける物理的ロケーションをレコードすること
ができる。二重ペアが終了する場合、その二重ペアが抑
止された後に一次ＤＡＳＤに書き込まれたレコードは、
その二重ペアがその後に再設定される時には二次ＤＡＳ
Ｄに複写されないであろう。しかし、二重ペアがレコー
ディングの変更を抑止される場合、その二重ペアが抑止
された後に一次ＤＡＳＤに書き込まれたレコードは、そ
の二重ペアがその後に再設定される時、二次ＤＡＳＤに
複写されるであろう。
ッサは指定された二重ペアに対する抑止二重ペア・コマ
ンドを記憶制御装置に発生する。記憶制御装置はそのコ
マンドを受け取り、二重ペアを抑止する。その二重ペア
を抑止することは静止を解放し、一次システム・アプリ
ケーションの読取り及び書込みが二重ペアの一次ＤＡＳ
Ｄに再開することを可能にする。一方、抑止された状態
は、これらの変化を二重ペアの二次ＤＡＳＤに複写する
ことを妨げる。ホスト・プロセッサから一次ＤＡＳＤへ
のその後の書込みオペレーションは記憶制御装置によっ
て二次ＤＡＳＤに複写されない。代わりに、記憶制御装
置は、ホスト・プロセッサからのコマンドに応答して二
重ペアを終了させるか、或いはその後の書込みオペレー
ションの物理的ＤＡＳＤアドレス、即ち、特定の一次Ｄ
ＡＳＤにおける物理的ロケーションをレコードすること
ができる。二重ペアが終了する場合、その二重ペアが抑
止された後に一次ＤＡＳＤに書き込まれたレコードは、
その二重ペアがその後に再設定される時には二次ＤＡＳ
Ｄに複写されないであろう。しかし、二重ペアがレコー
ディングの変更を抑止される場合、その二重ペアが抑止
された後に一次ＤＡＳＤに書き込まれたレコードは、そ
の二重ペアがその後に再設定される時、二次ＤＡＳＤに
複写されるであろう。
【００５０】ステップ６５０は、更なる二重ペアが抑止
される必要があるかどうかを決定する。それが肯定され
る場合、ステップ６４０が更なる二重ペアの各々に対し
て繰り返される。それが否定される場合、ステップ６６
０は、すべての二重ペアが抑止されそしてその二重ペア
の二次ＤＡＳＤにおけるデータがシーケンス整合順序で
同期化されることを表し、ホスト・プロセッサにおける
アプリケーションが一次ＤＡＳＤを使用して走ろうとし
ていることを表す。
される必要があるかどうかを決定する。それが肯定され
る場合、ステップ６４０が更なる二重ペアの各々に対し
て繰り返される。それが否定される場合、ステップ６６
０は、すべての二重ペアが抑止されそしてその二重ペア
の二次ＤＡＳＤにおけるデータがシーケンス整合順序で
同期化されることを表し、ホスト・プロセッサにおける
アプリケーションが一次ＤＡＳＤを使用して走ろうとし
ていることを表す。
【００５１】図７は、二重ペアを静止させるために取ら
れるステップを表す流れ図を示す。ステップ７１０は、
ホスト・プロセッサからの静止二重ペア・コマンドが記
憶制御装置において受信されたかどうかを決定する。そ
のようなコマンドが受信されなかった場合、静止二重ペ
ア・プロセスは終了する。それが肯定された場合、記憶
制御装置は静止二重ペア・コマンドに応答してその指定
された二重ペアの一次ＤＡＳＤに特有な長いビジー・フ
ラッグをセットする。ステップ７２０は、記憶制御装置
が、静止コマンドの前に開始し且つ現在進行中の二重ペ
アに対する何れの書込みオペレーションを完了させるこ
とを表す。ステップ７３０において、長いビジー・フラ
ッグは、ホスト・プロセッサによる二重ペアへのその後
のＩ／Ｏリクエストに応答して、ホスト・プロセッサへ
の長いビジー信号を生じるように記憶制御装置に指示す
る。従って、その長いビジー信号は、長いビジー・オペ
レーションが終了するまで、ホスト・プロセッサからの
その後のＩ／Ｏオペレーションをホスト・プロセッサに
おいて待ち行列化させる。この待ち行列化は記憶制御装
置においても生じ得るが、ホスト・プロセッサはよりよ
い待ち行列プラットフォームを与える。
れるステップを表す流れ図を示す。ステップ７１０は、
ホスト・プロセッサからの静止二重ペア・コマンドが記
憶制御装置において受信されたかどうかを決定する。そ
のようなコマンドが受信されなかった場合、静止二重ペ
ア・プロセスは終了する。それが肯定された場合、記憶
制御装置は静止二重ペア・コマンドに応答してその指定
された二重ペアの一次ＤＡＳＤに特有な長いビジー・フ
ラッグをセットする。ステップ７２０は、記憶制御装置
が、静止コマンドの前に開始し且つ現在進行中の二重ペ
アに対する何れの書込みオペレーションを完了させるこ
とを表す。ステップ７３０において、長いビジー・フラ
ッグは、ホスト・プロセッサによる二重ペアへのその後
のＩ／Ｏリクエストに応答して、ホスト・プロセッサへ
の長いビジー信号を生じるように記憶制御装置に指示す
る。従って、その長いビジー信号は、長いビジー・オペ
レーションが終了するまで、ホスト・プロセッサからの
その後のＩ／Ｏオペレーションをホスト・プロセッサに
おいて待ち行列化させる。この待ち行列化は記憶制御装
置においても生じ得るが、ホスト・プロセッサはよりよ
い待ち行列プラットフォームを与える。
【００５２】図６及び図７に示された方法は、図５の構
成を使用して説明可能である。ホスト・プロセッサ５０
１は、記憶サブシステム５０３の一次ＤＡＳＤ５３４に
第１Ｉ／Ｏを書き込み、しかる後、記憶サブシステム５
０３の一次ＤＡＳＤ５３２に第２Ｉ／Ｏ、即ち、従属Ｉ
／Ｏを書き込む。そこで、ホスト・プロセッサ５０１
は、記憶サブシステム５０２、５０３、５０４における
６つの二重ペアすべてに対して連続した静止二重ペア・
コマンドを発生する。二重ペア５３４、５４４に対する
その静止コマンドは、二重ペア５３２、５４２に対する
静止コマンドの前に発生される必要はない。
成を使用して説明可能である。ホスト・プロセッサ５０
１は、記憶サブシステム５０３の一次ＤＡＳＤ５３４に
第１Ｉ／Ｏを書き込み、しかる後、記憶サブシステム５
０３の一次ＤＡＳＤ５３２に第２Ｉ／Ｏ、即ち、従属Ｉ
／Ｏを書き込む。そこで、ホスト・プロセッサ５０１
は、記憶サブシステム５０２、５０３、５０４における
６つの二重ペアすべてに対して連続した静止二重ペア・
コマンドを発生する。二重ペア５３４、５４４に対する
その静止コマンドは、二重ペア５３２、５４２に対する
静止コマンドの前に発生される必要はない。
【００５３】二重ペア５３２、５４２が静止させる時、
二重ペア５３４、５４４に対する第１Ｉ／Ｏは次の３つ
の可能な状態のうちのどれかにある。即ち、 （１）そのＩ／Ｏは、一次ＤＡＳＤ５３４及び二次ＤＡ
ＳＤ５４４の両方に対して完了可能である。 （２）そのＩ／Ｏは、記憶制御装置５１０によって長い
ビジーに保持可能であり、従って、一次ＤＡＳＤ５３４
或いは二次ＤＡＳＤ５４４に未だ転送可能ではない。 （３）そのＩ／Ｏは、一次ＤＡＳＤ５３４に対して進行
中であり、記憶制御装置５３０が長いビジーでもってそ
の後のＩ／Ｏを締め出す前に二次ＤＡＳＤ５４４に対し
て完了可能である。
二重ペア５３４、５４４に対する第１Ｉ／Ｏは次の３つ
の可能な状態のうちのどれかにある。即ち、 （１）そのＩ／Ｏは、一次ＤＡＳＤ５３４及び二次ＤＡ
ＳＤ５４４の両方に対して完了可能である。 （２）そのＩ／Ｏは、記憶制御装置５１０によって長い
ビジーに保持可能であり、従って、一次ＤＡＳＤ５３４
或いは二次ＤＡＳＤ５４４に未だ転送可能ではない。 （３）そのＩ／Ｏは、一次ＤＡＳＤ５３４に対して進行
中であり、記憶制御装置５３０が長いビジーでもってそ
の後のＩ／Ｏを締め出す前に二次ＤＡＳＤ５４４に対し
て完了可能である。
【００５４】第１Ｉ／Ｏに対して状態２が生じた場合、
二重ペア５３２、５４２に対する第２Ｉ／Ｏは、それが
従属Ｉ／Ｏであり且つ第１Ｉ／Ｏの完了を条件とされな
いので発生されなかったであろう。従って、第１Ｉ／Ｏ
及び第２Ｉ／Ｏ共、二重ペアを静止させる前に転送され
ないであろうし、二次ＤＡＳＤ５３４及び５４２はシー
ケンス整合性を維持するであろう。
二重ペア５３２、５４２に対する第２Ｉ／Ｏは、それが
従属Ｉ／Ｏであり且つ第１Ｉ／Ｏの完了を条件とされな
いので発生されなかったであろう。従って、第１Ｉ／Ｏ
及び第２Ｉ／Ｏ共、二重ペアを静止させる前に転送され
ないであろうし、二次ＤＡＳＤ５３４及び５４２はシー
ケンス整合性を維持するであろう。
【００５５】第１Ｉ／Ｏに対して状態１又は３の何れか
が生じた場合、第２Ｉ／Ｏは第１Ｉ／Ｏと同様に次の３
つの可能な状態のうちのどれかにある。即ち、 （Ａ）そのＩ／Ｏは、一次ＤＡＳＤ５３２及び二次ＤＡ
ＳＤ５４２の両方に対して完了可能である。 （Ｂ）そのＩ／Ｏは、記憶制御装置５３０によって長い
ビジーに保持可能であり、従って、一次ＤＡＳＤ５３２
或いは二次ＤＡＳＤ５４２には未だ転送可能ではない。 （Ｃ）そのＩ／Ｏは、一次ＤＡＳＤ５３２に対して進行
中であり、記憶制御装置５３０が長いビジーでもってそ
の後のＩ／Ｏを締め出す前に二次ＤＡＳＤ５４２に対し
て完了可能である。 従属Ｉ／Ｏに対して状態Ｂが生じた場合、その従属Ｉ／
Ｏはそれの静止コマンド前に二重ペア５３２、５４２に
転送されないが、第１Ｉ／Ｏはそれの静止コマンドの前
に二重ペア５３４、５４４に対して完了する。しかし、
これは二次ＤＡＳＤ５４４及び５４２においてシーケン
ス整合性を維持する。
が生じた場合、第２Ｉ／Ｏは第１Ｉ／Ｏと同様に次の３
つの可能な状態のうちのどれかにある。即ち、 （Ａ）そのＩ／Ｏは、一次ＤＡＳＤ５３２及び二次ＤＡ
ＳＤ５４２の両方に対して完了可能である。 （Ｂ）そのＩ／Ｏは、記憶制御装置５３０によって長い
ビジーに保持可能であり、従って、一次ＤＡＳＤ５３２
或いは二次ＤＡＳＤ５４２には未だ転送可能ではない。 （Ｃ）そのＩ／Ｏは、一次ＤＡＳＤ５３２に対して進行
中であり、記憶制御装置５３０が長いビジーでもってそ
の後のＩ／Ｏを締め出す前に二次ＤＡＳＤ５４２に対し
て完了可能である。 従属Ｉ／Ｏに対して状態Ｂが生じた場合、その従属Ｉ／
Ｏはそれの静止コマンド前に二重ペア５３２、５４２に
転送されないが、第１Ｉ／Ｏはそれの静止コマンドの前
に二重ペア５３４、５４４に対して完了する。しかし、
これは二次ＤＡＳＤ５４４及び５４２においてシーケン
ス整合性を維持する。
【００５６】第１Ｉ／Ｏに対する状態１又は３と関連し
て状態Ａ又はＣが従属Ｉ／Ｏに対して生じた場合、シー
ケンス整合性が二次ＤＡＳＤ５４４及び５４２において
維持される。何れの組合せにおいても、第１Ｉ／Ｏ及び
従属Ｉ／Ｏはそれぞれの二次ＤＡＳＤ５４４及び５４２
に対して完了する。その状況は、従属Ｉ／Ｏがそれの二
次ＤＡＳＤ５４２に複写され且つ第１Ｉ／Ｏがそれの二
次ＤＡＳＤ５４４に複写されない場合には生じない。従
って、二次ＤＡＳＤは同期化され、一次ＤＡＳＤが更新
されたシーケンスと整合した順序で維持される。
て状態Ａ又はＣが従属Ｉ／Ｏに対して生じた場合、シー
ケンス整合性が二次ＤＡＳＤ５４４及び５４２において
維持される。何れの組合せにおいても、第１Ｉ／Ｏ及び
従属Ｉ／Ｏはそれぞれの二次ＤＡＳＤ５４４及び５４２
に対して完了する。その状況は、従属Ｉ／Ｏがそれの二
次ＤＡＳＤ５４２に複写され且つ第１Ｉ／Ｏがそれの二
次ＤＡＳＤ５４４に複写されない場合には生じない。従
って、二次ＤＡＳＤは同期化され、一次ＤＡＳＤが更新
されたシーケンスと整合した順序で維持される。
【００５７】この例は同期的遠隔複写構成における二重
ペアを扱ったけれども、その方法はサブシステム５０１
のような二重複写構成における二重ペアにも、及び遠隔
複写構成或いは二重複写構成における多数の記憶制御装
置にまたがる二重ペアにも適用する。
ペアを扱ったけれども、その方法はサブシステム５０１
のような二重複写構成における二重ペアにも、及び遠隔
複写構成或いは二重複写構成における多数の記憶制御装
置にまたがる二重ペアにも適用する。
【００５８】本発明をその好適な実施例に関連して詳し
く示し且つ説明したけれども、本発明の精神及び技術範
囲を逸脱することなく、形式及び詳細における種々の変
更を行うことが可能であることは当業者には明らかなこ
とであろう。例えば、レコード更新のフォーマットは決
定的なものではなく、そのようなフォーマットはＣＫ
Ｄ、ＥＣＫＤ、固定ブロックアーキテクチャ（ＦＢＡ）
等であってもよい。更に、記憶装置はＤＡＳＤ装置に限
定されることを意味するものではない。
く示し且つ説明したけれども、本発明の精神及び技術範
囲を逸脱することなく、形式及び詳細における種々の変
更を行うことが可能であることは当業者には明らかなこ
とであろう。例えば、レコード更新のフォーマットは決
定的なものではなく、そのようなフォーマットはＣＫ
Ｄ、ＥＣＫＤ、固定ブロックアーキテクチャ（ＦＢＡ）
等であってもよい。更に、記憶装置はＤＡＳＤ装置に限
定されることを意味するものではない。
【００５９】まとめとして、本発明の構成に関して以下
の事項を開示する。 （１）レコード及びレコード更新を書き込むこと及びバ
ックアップの目的で前記レコード及びレコード更新を複
写することができるデータ記憶システムにおいて、前記
データ記憶システムはレコード及びレコード更新を発生
するアプリケーションを走らせるホスト・プロセッサ
と、一次データ記憶装置及び二次データ記憶装置を有す
る第１二重ペアと、一次データ記憶装置及び二次データ
記憶装置を有する第２二重ペアと、前記ホスト・プロセ
ッサと前記第１二重ペア及び第２二重ペアの前記一次デ
ータ記憶装置との間に接続された記憶制御装置とを含
み、レコード及びレコード更新の複写が進行中である時
に第１及び第２二重ペアを抑止するための方法にして、
前記アプリケーションから前記第１二重ペアの一次デー
タ記憶装置への将来のレコード及びレコード更新の書込
みを禁止するために前記ホスト・プロセッサからの初期
静止コマンドに応答して前記記憶制御装置によって前記
第１二重ペアを静止させるステップと、前記アプリケー
ションから前記第２二重ペアの一次データ記憶装置への
将来のレコード及びレコード更新の書込みを禁止するた
めに及びシーケンス整合した順序における前記第１及び
第２二重ペアの前記二次データ記憶装置に複写されたレ
コード及びレコード更新を同期化するために前記ホスト
・プロセッサからのその後の静止コマンドに応答して前
記記憶制御装置によって前記第１二重ペアを静止させる
ステップと、前記アプリケーションから前記第１及び第
２二重ペアの一次データ記憶装置に送られたレコード及
びレコード更新を前記第１及び第２二重ペアの二次デー
タ記憶装置に前記記憶制御装置によって複写することを
禁止するために、前記記憶制御装置が前記ホスト・プロ
セッサから抑止コマンドを受けることによって前記第１
及び第２二重ペアを抑止するステップと、前記第１及び
第２二重ペアが抑止されること及びその後のレコード及
びレコード更新が前記第１及び第２二重ペアの前記二次
データ記憶装置に前記レコードを複写することなく前記
第１及び第２二重ペアを前記一次データ記憶装置に書込
み可能であることを前記記憶制御装置によって前記アプ
リケーションに信号するステップと、を含む方法。 （２）前記静止させるステップは前記アプリケーション
から前記二重ペアの一次データ記憶装置へのレコード及
びレコード更新のその後の書込みを禁止するための長い
ビジー信号を前記記憶制御装置から前記ホスト・プロセ
ッサに発生するステップを含むことを特徴とする上記
（１）に記載の方法。 （３）前記記憶制御装置は、前記二重ペアが再設定され
る場合、前記ホスト・プロセッサから前記一次データ記
憶装置に転送されたその後のレコード及びレコード更新
が前記二次データ記憶装置へのその後の複写のためにマ
ークされないように前記二重ペアを終了させることを特
徴とする上記（１）に記載の方法。 （４）前記記憶制御装置は、前記二重ペアが再設定され
る場合、前記レコード及びレコード更新が前記二次デー
タ記憶装置に複写されるように、前記二重ペアの抑止の
後に前記ホスト・プロセッサから前記一次データ記憶装
置に転送されたレコード及びレコード更新をマークする
ことを特徴とする上記（１）に記載の方法。 （５）レコード及びレコード更新を第１及び第２二重ペ
アに複写することができるデータ処理システムにおいて
レコード及びレコード更新の複写が進行中である時に各
二重ペアを抑止するための記憶制御装置にして、前記デ
ータ記憶システムはアプリケーションを走らせるホスト
・プロセッサを含み、前記第１及び第２二重ペアの各々
は一次データ記憶装置及び二次データ記憶装置を有し、
前記記憶制御装置はホスト・プロセッサと前記第１及び
第２二重ペアの前記一次データ記憶装置との間に接続さ
れ、前記アプリケーションはレコード及びレコード更新
を発生し及び静止二重ペア・コマンド及び抑止二重ペア
・コマンドを発生し、前記一次データ記憶装置は前記レ
コード及びレコード更新を記憶し、前記二次データ記憶
装置は前記レコード及びレコード更新の複写を記憶する
ものにおいて、前記ホスト・プロセッサと前記第１及び
第２二重ペアとの間のレコード及びレコード更新を指示
するための記憶装置パスであって、前記アプリケーショ
ンからの前記静止二重ペア・コマンドに応答して前記第
１及び第２二重ペアを静止させ、前記レコード及びレコ
ード更新が前記二重ペアの各々における前記二次データ
記憶装置の各々に複写され且つシーケンス整合順序で同
期化されるように前記アプリケーションからの前記抑止
二重ペア・コマンドに応答して前記第１及び第２二重ペ
アを抑止する記憶装置パスと、前記記憶装置パスに接続
され、前記二重ペアの二次データ記憶装置に複写される
べき前記レコード及びレコード更新を記憶するためのメ
モリと、を含む記憶制御装置。 （６）前記メモリはキャッシュ・メモリであることを特
徴とする上記（５）に記載の記憶制御装置。 （７）レコード及びレコード更新をシーケンス整合した
順序で記憶するための不揮発性記憶装置（ＮＶＳ）を含
み、前記レコード及びレコード更新はその後前記二重ペ
アの二次データ記憶装置に複写されることを特徴とする
上記（５）に記載の記憶制御装置。 （８）前記二重ペアが抑止される時、前記レコード更新
を受ける前記二重ペアと関連した物理的アドレスをマー
クするために前記ＮＶＳにおけるビットマップを含み、
前記レコード更新は前記二重ペアが抑止されている時に
前記一次データ記憶装置に書き込まれ、一旦前記二重ペ
アが再設定されると前記二次データ記憶装置に複写され
ることを特徴とする上記（７）に記載の記憶制御装置。 （９）前記記憶装置パスは、前記ホスト・プロセッサか
ら前記二重ペアの一次データ記憶装置に現在書き込まれ
ている前記レコード更新が完了することを可能にするた
めに、及びその後のレコード更新が前記ホスト・プロセ
ッサから前記二重ペアの一次データ記憶装置に書き込ま
れることを禁止するために、前記静止二重ペア・コマン
ドに応答して長いビジー信号を前記ホスト・プロセッサ
に発生することを特徴とする上記（５）に記載の記憶制
御装置。 （１０）複数個のレコード更新を発生するアプリケーシ
ョンを走らせ、及び静止二重ペア・コマンド及び抑止二
重ペア・コマンドを発生するホスト・プロセッサと、前
記ホスト・プロセッサに接続されたチャネルと、各々が
一次データ記憶装置及び二次データ記憶装置を有する第
１及び第２二重ペアであって、前記一次データ記憶装置
の各々は複数個のレコード更新を記憶し、前記二次デー
タ記憶装置の各々は前記複数個のレコード更新の複写を
記憶するものと、前記チャネルによって前記ホスト・プ
ロセッサに接続され、更に、前記第１及び第２二重ペア
の一次データ記憶装置の各々に接続された記憶制御装置
と、を含み、前記記憶制御装置は、前記ホスト・プロセ
ッサから転送された複数個のレコード更新を最初に記憶
するためのメモリと、前記チャネルと前記一次データ記
憶装置の各々との間に接続された記憶装置パスと、を含
み、前記メモリは前記記憶装置パスに接続されること、
及び前記記憶装置パスは前記ホスト・プロセッサと前記
一次データ記憶装置の間で前記メモリを介して前記複数
個のレコード更新の移動を指示し、前記ホスト・プロセ
ッサから前記静止二重ペア・コマンド及び前記抑止二重
ペア・コマンドを受け取り、前記複数個のレコード更新
をシーケンス整合した順序で同期化するために前記複数
個のレコード更新の複写を前記二次データ記憶装置に転
送すること、を特徴とするデータ記憶システム。 （１１）前記記憶制御装置におけるメモリはキャッシュ
・メモリであることを特徴とする上記（１０）に記載の
データ記憶システム。 （１２）前記記憶制御装置において前記記憶装置パスに
接続された不揮発性記憶装置（ＮＶＳ）を含み、前記Ｎ
ＶＳはレコード及びレコード更新をシーケンス整合した
順序で記憶すること及び前記レコード及びレコード更新
は前記二重ペアの二次データ記憶装置に複写されること
を特徴とする上記（１０）に記載のデータ記憶システ
ム。 （１３）前記二重ペアの各々の各二次データ記憶装置は
前記一次データ記憶装置の各々に対して遠隔の二次サイ
トに置かれること、及び前記二次サイトは前記一次サイ
トにおける前記記憶制御装置から前記レコード及びレコ
ード更新を受けるための及び前記各二次データ記憶装置
に接続された記憶制御装置を含むことを特徴とする上記
（１０）に記載のデータ記憶システム。 （１４）前記二重ペアの各々における前記各二次データ
記憶装置は前記一次データ記憶装置の各々に対して遠隔
の二次サイトに置かれること、及び前記二次サイトはホ
スト・プロセッサと、前記ホスト・プロセッサに接続さ
れたチャネルと、前記チャネルによって前記ホスト・プ
ロセッサに接続され、更に前記各二次データ記憶装置に
接続された記憶制御装置と、を含むことを特徴とする上
記（１０）に記載のデータ記憶システム。 （１５）前記記憶制御装置における前記記憶装置パス
は、前記ホスト・プロセッサから前記二重ペアの一次デ
ータ記憶装置に現在書き込まれている前記レコード更新
が完了することを可能にするために、及びその後のレコ
ード更新が前記ホスト・プロセッサから前記二重ペアの
一次データ記憶装置に書き込まれることを禁止するため
に、前記静止二重ペア・コマンドに応答して長いビジー
信号を前記ホスト・プロセッサに発生することを特徴と
する上記（１０）に記載のデータ記憶システム。
の事項を開示する。 （１）レコード及びレコード更新を書き込むこと及びバ
ックアップの目的で前記レコード及びレコード更新を複
写することができるデータ記憶システムにおいて、前記
データ記憶システムはレコード及びレコード更新を発生
するアプリケーションを走らせるホスト・プロセッサ
と、一次データ記憶装置及び二次データ記憶装置を有す
る第１二重ペアと、一次データ記憶装置及び二次データ
記憶装置を有する第２二重ペアと、前記ホスト・プロセ
ッサと前記第１二重ペア及び第２二重ペアの前記一次デ
ータ記憶装置との間に接続された記憶制御装置とを含
み、レコード及びレコード更新の複写が進行中である時
に第１及び第２二重ペアを抑止するための方法にして、
前記アプリケーションから前記第１二重ペアの一次デー
タ記憶装置への将来のレコード及びレコード更新の書込
みを禁止するために前記ホスト・プロセッサからの初期
静止コマンドに応答して前記記憶制御装置によって前記
第１二重ペアを静止させるステップと、前記アプリケー
ションから前記第２二重ペアの一次データ記憶装置への
将来のレコード及びレコード更新の書込みを禁止するた
めに及びシーケンス整合した順序における前記第１及び
第２二重ペアの前記二次データ記憶装置に複写されたレ
コード及びレコード更新を同期化するために前記ホスト
・プロセッサからのその後の静止コマンドに応答して前
記記憶制御装置によって前記第１二重ペアを静止させる
ステップと、前記アプリケーションから前記第１及び第
２二重ペアの一次データ記憶装置に送られたレコード及
びレコード更新を前記第１及び第２二重ペアの二次デー
タ記憶装置に前記記憶制御装置によって複写することを
禁止するために、前記記憶制御装置が前記ホスト・プロ
セッサから抑止コマンドを受けることによって前記第１
及び第２二重ペアを抑止するステップと、前記第１及び
第２二重ペアが抑止されること及びその後のレコード及
びレコード更新が前記第１及び第２二重ペアの前記二次
データ記憶装置に前記レコードを複写することなく前記
第１及び第２二重ペアを前記一次データ記憶装置に書込
み可能であることを前記記憶制御装置によって前記アプ
リケーションに信号するステップと、を含む方法。 （２）前記静止させるステップは前記アプリケーション
から前記二重ペアの一次データ記憶装置へのレコード及
びレコード更新のその後の書込みを禁止するための長い
ビジー信号を前記記憶制御装置から前記ホスト・プロセ
ッサに発生するステップを含むことを特徴とする上記
（１）に記載の方法。 （３）前記記憶制御装置は、前記二重ペアが再設定され
る場合、前記ホスト・プロセッサから前記一次データ記
憶装置に転送されたその後のレコード及びレコード更新
が前記二次データ記憶装置へのその後の複写のためにマ
ークされないように前記二重ペアを終了させることを特
徴とする上記（１）に記載の方法。 （４）前記記憶制御装置は、前記二重ペアが再設定され
る場合、前記レコード及びレコード更新が前記二次デー
タ記憶装置に複写されるように、前記二重ペアの抑止の
後に前記ホスト・プロセッサから前記一次データ記憶装
置に転送されたレコード及びレコード更新をマークする
ことを特徴とする上記（１）に記載の方法。 （５）レコード及びレコード更新を第１及び第２二重ペ
アに複写することができるデータ処理システムにおいて
レコード及びレコード更新の複写が進行中である時に各
二重ペアを抑止するための記憶制御装置にして、前記デ
ータ記憶システムはアプリケーションを走らせるホスト
・プロセッサを含み、前記第１及び第２二重ペアの各々
は一次データ記憶装置及び二次データ記憶装置を有し、
前記記憶制御装置はホスト・プロセッサと前記第１及び
第２二重ペアの前記一次データ記憶装置との間に接続さ
れ、前記アプリケーションはレコード及びレコード更新
を発生し及び静止二重ペア・コマンド及び抑止二重ペア
・コマンドを発生し、前記一次データ記憶装置は前記レ
コード及びレコード更新を記憶し、前記二次データ記憶
装置は前記レコード及びレコード更新の複写を記憶する
ものにおいて、前記ホスト・プロセッサと前記第１及び
第２二重ペアとの間のレコード及びレコード更新を指示
するための記憶装置パスであって、前記アプリケーショ
ンからの前記静止二重ペア・コマンドに応答して前記第
１及び第２二重ペアを静止させ、前記レコード及びレコ
ード更新が前記二重ペアの各々における前記二次データ
記憶装置の各々に複写され且つシーケンス整合順序で同
期化されるように前記アプリケーションからの前記抑止
二重ペア・コマンドに応答して前記第１及び第２二重ペ
アを抑止する記憶装置パスと、前記記憶装置パスに接続
され、前記二重ペアの二次データ記憶装置に複写される
べき前記レコード及びレコード更新を記憶するためのメ
モリと、を含む記憶制御装置。 （６）前記メモリはキャッシュ・メモリであることを特
徴とする上記（５）に記載の記憶制御装置。 （７）レコード及びレコード更新をシーケンス整合した
順序で記憶するための不揮発性記憶装置（ＮＶＳ）を含
み、前記レコード及びレコード更新はその後前記二重ペ
アの二次データ記憶装置に複写されることを特徴とする
上記（５）に記載の記憶制御装置。 （８）前記二重ペアが抑止される時、前記レコード更新
を受ける前記二重ペアと関連した物理的アドレスをマー
クするために前記ＮＶＳにおけるビットマップを含み、
前記レコード更新は前記二重ペアが抑止されている時に
前記一次データ記憶装置に書き込まれ、一旦前記二重ペ
アが再設定されると前記二次データ記憶装置に複写され
ることを特徴とする上記（７）に記載の記憶制御装置。 （９）前記記憶装置パスは、前記ホスト・プロセッサか
ら前記二重ペアの一次データ記憶装置に現在書き込まれ
ている前記レコード更新が完了することを可能にするた
めに、及びその後のレコード更新が前記ホスト・プロセ
ッサから前記二重ペアの一次データ記憶装置に書き込ま
れることを禁止するために、前記静止二重ペア・コマン
ドに応答して長いビジー信号を前記ホスト・プロセッサ
に発生することを特徴とする上記（５）に記載の記憶制
御装置。 （１０）複数個のレコード更新を発生するアプリケーシ
ョンを走らせ、及び静止二重ペア・コマンド及び抑止二
重ペア・コマンドを発生するホスト・プロセッサと、前
記ホスト・プロセッサに接続されたチャネルと、各々が
一次データ記憶装置及び二次データ記憶装置を有する第
１及び第２二重ペアであって、前記一次データ記憶装置
の各々は複数個のレコード更新を記憶し、前記二次デー
タ記憶装置の各々は前記複数個のレコード更新の複写を
記憶するものと、前記チャネルによって前記ホスト・プ
ロセッサに接続され、更に、前記第１及び第２二重ペア
の一次データ記憶装置の各々に接続された記憶制御装置
と、を含み、前記記憶制御装置は、前記ホスト・プロセ
ッサから転送された複数個のレコード更新を最初に記憶
するためのメモリと、前記チャネルと前記一次データ記
憶装置の各々との間に接続された記憶装置パスと、を含
み、前記メモリは前記記憶装置パスに接続されること、
及び前記記憶装置パスは前記ホスト・プロセッサと前記
一次データ記憶装置の間で前記メモリを介して前記複数
個のレコード更新の移動を指示し、前記ホスト・プロセ
ッサから前記静止二重ペア・コマンド及び前記抑止二重
ペア・コマンドを受け取り、前記複数個のレコード更新
をシーケンス整合した順序で同期化するために前記複数
個のレコード更新の複写を前記二次データ記憶装置に転
送すること、を特徴とするデータ記憶システム。 （１１）前記記憶制御装置におけるメモリはキャッシュ
・メモリであることを特徴とする上記（１０）に記載の
データ記憶システム。 （１２）前記記憶制御装置において前記記憶装置パスに
接続された不揮発性記憶装置（ＮＶＳ）を含み、前記Ｎ
ＶＳはレコード及びレコード更新をシーケンス整合した
順序で記憶すること及び前記レコード及びレコード更新
は前記二重ペアの二次データ記憶装置に複写されること
を特徴とする上記（１０）に記載のデータ記憶システ
ム。 （１３）前記二重ペアの各々の各二次データ記憶装置は
前記一次データ記憶装置の各々に対して遠隔の二次サイ
トに置かれること、及び前記二次サイトは前記一次サイ
トにおける前記記憶制御装置から前記レコード及びレコ
ード更新を受けるための及び前記各二次データ記憶装置
に接続された記憶制御装置を含むことを特徴とする上記
（１０）に記載のデータ記憶システム。 （１４）前記二重ペアの各々における前記各二次データ
記憶装置は前記一次データ記憶装置の各々に対して遠隔
の二次サイトに置かれること、及び前記二次サイトはホ
スト・プロセッサと、前記ホスト・プロセッサに接続さ
れたチャネルと、前記チャネルによって前記ホスト・プ
ロセッサに接続され、更に前記各二次データ記憶装置に
接続された記憶制御装置と、を含むことを特徴とする上
記（１０）に記載のデータ記憶システム。 （１５）前記記憶制御装置における前記記憶装置パス
は、前記ホスト・プロセッサから前記二重ペアの一次デ
ータ記憶装置に現在書き込まれている前記レコード更新
が完了することを可能にするために、及びその後のレコ
ード更新が前記ホスト・プロセッサから前記二重ペアの
一次データ記憶装置に書き込まれることを禁止するため
に、前記静止二重ペア・コマンドに応答して長いビジー
信号を前記ホスト・プロセッサに発生することを特徴と
する上記（１０）に記載のデータ記憶システム。
【図１】同期的遠隔データ・シャドウ機能を持った災害
回復システムのブロック図である。
回復システムのブロック図である。
【図２】図１の災害回復システムに従って同期的遠隔複
写を行うためのフローチャートである。
写を行うためのフローチャートである。
【図３】データ処理システムにおいて接続される記憶制
御装置を更に詳細に示すブロック図である。
御装置を更に詳細に示すブロック図である。
【図４】データ処理システムにおける記憶制御装置に接
続された記憶装置パスを更に詳細に示すブロック図であ
る。
続された記憶装置パスを更に詳細に示すブロック図であ
る。
【図５】多数のデータ記憶装置サブシステムにまたがる
多数の二重ペアを示すブロック図である。
多数の二重ペアを示すブロック図である。
【図６】ホスト・アプリケーションから送られたすべて
のデータが二次データ記憶装置において同期化されるよ
うに多数の二重ペアを抑止するための方法のフローチャ
ートである。
のデータが二次データ記憶装置において同期化されるよ
うに多数の二重ペアを抑止するための方法のフローチャ
ートである。
【図７】図６に示された方法の静止ステップを更に詳細
に示すフローチャートである。
に示すフローチャートである。
１０ 災害回復システム １４ 一次サイト １５ 二次サイト
───────────────────────────────────────────────────── フロントページの続き (72)発明者 ロバート・フレデリック・ケーン アメリカ合衆国アリゾナ州、ツーソン、イ ー・コレシコ・ストリート 8338 (72)発明者 ウィリアム・フランク・ミッカ アメリカ合衆国アリゾナ州、ツーソン、イ ー・ラエスパルダ 3921 (72)発明者 ロバート・ウェズリー・ショムラー アメリカ合衆国カリフォルニア州、モーガ ン・ヒル、パイドモント・コート 17015
Claims (15)
- 【請求項１】レコード及びレコード更新を書き込むこと
及びバックアップの目的で前記レコード及びレコード更
新を複写することができるデータ記憶システムにおい
て、前記データ記憶システムはレコード及びレコード更
新を発生するアプリケーションを走らせるホスト・プロ
セッサと、一次データ記憶装置及び二次データ記憶装置
を有する第１二重ペアと、一次データ記憶装置及び二次
データ記憶装置を有する第２二重ペアと、前記ホスト・
プロセッサと前記第１二重ペア及び第２二重ペアの前記
一次データ記憶装置との間に接続された記憶制御装置と
を含み、レコード及びレコード更新の複写が進行中であ
る時に第１及び第２二重ペアを抑止するための方法にし
て、 前記アプリケーションから前記第１二重ペアの一次デー
タ記憶装置への将来のレコード及びレコード更新の書込
みを禁止するために前記ホスト・プロセッサからの初期
静止コマンドに応答して前記記憶制御装置によって前記
第１二重ペアを静止させるステップと、 前記アプリケーションから前記第２二重ペアの一次デー
タ記憶装置への将来のレコード及びレコード更新の書込
みを禁止するために及びシーケンス整合した順序におけ
る前記第１及び第２二重ペアの前記二次データ記憶装置
に複写されたレコード及びレコード更新を同期化するた
めに前記ホスト・プロセッサからのその後の静止コマン
ドに応答して前記記憶制御装置によって前記第１二重ペ
アを静止させるステップと、 前記アプリケーションから前記第１及び第２二重ペアの
一次データ記憶装置に送られたレコード及びレコード更
新を前記第１及び第２二重ペアの二次データ記憶装置に
前記記憶制御装置によって複写することを禁止するため
に、前記記憶制御装置が前記ホスト・プロセッサから抑
止コマンドを受けることによって前記第１及び第２二重
ペアを抑止するステップと、 前記第１及び第２二重ペアが抑止されること及びその後
のレコード及びレコード更新が前記第１及び第２二重ペ
アの前記二次データ記憶装置に前記レコードを複写する
ことなく前記第１及び第２二重ペアを前記一次データ記
憶装置に書込み可能であることを前記記憶制御装置によ
って前記アプリケーションに信号するステップと、 を含む方法。 - 【請求項２】前記静止させるステップは前記アプリケー
ションから前記二重ペアの一次データ記憶装置へのレコ
ード及びレコード更新のその後の書込みを禁止するため
の長いビジー信号を前記記憶制御装置から前記ホスト・
プロセッサに発生するステップを含むことを特徴とする
請求項１に記載の方法。 - 【請求項３】前記記憶制御装置は、前記二重ペアが再設
定される場合、前記ホスト・プロセッサから前記一次デ
ータ記憶装置に転送されたその後のレコード及びレコー
ド更新が前記二次データ記憶装置へのその後の複写のた
めにマークされないように前記二重ペアを終了させるこ
とを特徴とする請求項１に記載の方法。 - 【請求項４】前記記憶制御装置は、前記二重ペアが再設
定される場合、前記レコード及びレコード更新が前記二
次データ記憶装置に複写されるように、前記二重ペアの
抑止の後に前記ホスト・プロセッサから前記一次データ
記憶装置に転送されたレコード及びレコード更新をマー
クすることを特徴とする請求項１に記載の方法。 - 【請求項５】レコード及びレコード更新を第１及び第２
二重ペアに複写することができるデータ処理システムに
おいてレコード及びレコード更新の複写が進行中である
時に各二重ペアを抑止するための記憶制御装置にして、
前記データ記憶システムはアプリケーションを走らせる
ホスト・プロセッサを含み、前記第１及び第２二重ペア
の各々は一次データ記憶装置及び二次データ記憶装置を
有し、前記記憶制御装置はホスト・プロセッサと前記第
１及び第２二重ペアの前記一次データ記憶装置との間に
接続され、前記アプリケーションはレコード及びレコー
ド更新を発生し及び静止二重ペア・コマンド及び抑止二
重ペア・コマンドを発生し、前記一次データ記憶装置は
前記レコード及びレコード更新を記憶し、前記二次デー
タ記憶装置は前記レコード及びレコード更新の複写を記
憶するものにおいて、 前記ホスト・プロセッサと前記第１及び第２二重ペアと
の間のレコード及びレコード更新を指示するための記憶
装置パスであって、前記アプリケーションからの前記静
止二重ペア・コマンドに応答して前記第１及び第２二重
ペアを静止させ、前記レコード及びレコード更新が前記
二重ペアの各々における前記二次データ記憶装置の各々
に複写され且つシーケンス整合順序で同期化されるよう
に前記アプリケーションからの前記抑止二重ペア・コマ
ンドに応答して前記第１及び第２二重ペアを抑止する記
憶装置パスと、 前記記憶装置パスに接続され、前記二重ペアの二次デー
タ記憶装置に複写されるべき前記レコード及びレコード
更新を記憶するためのメモリと、 を含む記憶制御装置。 - 【請求項６】前記メモリはキャッシュ・メモリであるこ
とを特徴とする請求項５に記載の記憶制御装置。 - 【請求項７】レコード及びレコード更新をシーケンス整
合した順序で記憶するための不揮発性記憶装置（ＮＶ
Ｓ）を含み、前記レコード及びレコード更新はその後前
記二重ペアの二次データ記憶装置に複写されることを特
徴とする請求項５に記載の記憶制御装置。 - 【請求項８】前記二重ペアが抑止される時、前記レコー
ド更新を受ける前記二重ペアと関連した物理的アドレス
をマークするために前記ＮＶＳにおけるビットマップを
含み、前記レコード更新は前記二重ペアが抑止されてい
る時に前記一次データ記憶装置に書き込まれ、一旦前記
二重ペアが再設定されると前記二次データ記憶装置に複
写されることを特徴とする請求項７に記載の記憶制御装
置。 - 【請求項９】前記記憶装置パスは、前記ホスト・プロセ
ッサから前記二重ペアの一次データ記憶装置に現在書き
込まれている前記レコード更新が完了することを可能に
するために、及びその後のレコード更新が前記ホスト・
プロセッサから前記二重ペアの一次データ記憶装置に書
き込まれることを禁止するために、前記静止二重ペア・
コマンドに応答して長いビジー信号を前記ホスト・プロ
セッサに発生することを特徴とする請求項５に記載の記
憶制御装置。 - 【請求項１０】複数個のレコード更新を発生するアプリ
ケーションを走らせ、及び静止二重ペア・コマンド及び
抑止二重ペア・コマンドを発生するホスト・プロセッサ
と、 前記ホスト・プロセッサに接続されたチャネルと、 各々が一次データ記憶装置及び二次データ記憶装置を有
する第１及び第２二重ペアであって、前記一次データ記
憶装置の各々は複数個のレコード更新を記憶し、前記二
次データ記憶装置の各々は前記複数個のレコード更新の
複写を記憶するものと、 前記チャネルによって前記ホスト・プロセッサに接続さ
れ、更に、前記第１及び第２二重ペアの一次データ記憶
装置の各々に接続された記憶制御装置と、 を含み、前記記憶制御装置は、 前記ホスト・プロセッサから転送された複数個のレコー
ド更新を最初に記憶するためのメモリと、 前記チャネルと前記一次データ記憶装置の各々との間に
接続された記憶装置パスと、 を含み、 前記メモリは前記記憶装置パスに接続されること、及び
前記記憶装置パスは前記ホスト・プロセッサと前記一次
データ記憶装置の間で前記メモリを介して前記複数個の
レコード更新の移動を指示し、前記ホスト・プロセッサ
から前記静止二重ペア・コマンド及び前記抑止二重ペア
・コマンドを受け取り、前記複数個のレコード更新をシ
ーケンス整合した順序で同期化するために前記複数個の
レコード更新の複写を前記二次データ記憶装置に転送す
ること、 を特徴とするデータ記憶システム。 - 【請求項１１】前記記憶制御装置におけるメモリはキャ
ッシュ・メモリであることを特徴とする請求項１０に記
載のデータ記憶システム。 - 【請求項１２】前記記憶制御装置において前記記憶装置
パスに接続された不揮発性記憶装置（ＮＶＳ）を含み、
前記ＮＶＳはレコード及びレコード更新をシーケンス整
合した順序で記憶すること及び前記レコード及びレコー
ド更新は前記二重ペアの二次データ記憶装置に複写され
ることを特徴とする請求項１０に記載のデータ記憶シス
テム。 - 【請求項１３】前記二重ペアの各々の各二次データ記憶
装置は前記一次データ記憶装置の各々に対して遠隔の二
次サイトに置かれること、及び前記二次サイトは前記一
次サイトにおける前記記憶制御装置から前記レコード及
びレコード更新を受けるための及び前記各二次データ記
憶装置に接続された記憶制御装置を含むことを特徴とす
る請求項１０に記載のデータ記憶システム。 - 【請求項１４】前記二重ペアの各々における前記各二次
データ記憶装置は前記一次データ記憶装置の各々に対し
て遠隔の二次サイトに置かれること、及び前記二次サイ
トはホスト・プロセッサと、 前記ホスト・プロセッサに接続されたチャネルと、 前記チャネルによって前記ホスト・プロセッサに接続さ
れ、更に前記各二次データ記憶装置に接続された記憶制
御装置と、 を含むことを特徴とする請求項１０に記載のデータ記憶
システム。 - 【請求項１５】前記記憶制御装置における前記記憶装置
パスは、前記ホスト・プロセッサから前記二重ペアの一
次データ記憶装置に現在書き込まれている前記レコード
更新が完了することを可能にするために、及びその後の
レコード更新が前記ホスト・プロセッサから前記二重ペ
アの一次データ記憶装置に書き込まれることを禁止する
ために、前記静止二重ペア・コマンドに応答して長いビ
ジー信号を前記ホスト・プロセッサに発生することを特
徴とする請求項１０に記載のデータ記憶システム。
Applications Claiming Priority (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| US424930 | 1995-04-19 | ||
| US08/424,930 US5692155A (en) | 1995-04-19 | 1995-04-19 | Method and apparatus for suspending multiple duplex pairs during back up processing to insure storage devices remain synchronized in a sequence consistent order |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH08305500A true JPH08305500A (ja) | 1996-11-22 |
| JP3655963B2 JP3655963B2 (ja) | 2005-06-02 |
Family
ID=23684480
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP08856296A Expired - Fee Related JP3655963B2 (ja) | 1995-04-19 | 1996-04-10 | 記憶制御装置、それを含むデータ記憶システムおよび二重ペア抑止方法 |
Country Status (2)
| Country | Link |
|---|---|
| US (1) | US5692155A (ja) |
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