JPH08107520A - スーパーインポーズ回路 - Google Patents
スーパーインポーズ回路Info
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- JPH08107520A JPH08107520A JP24263894A JP24263894A JPH08107520A JP H08107520 A JPH08107520 A JP H08107520A JP 24263894 A JP24263894 A JP 24263894A JP 24263894 A JP24263894 A JP 24263894A JP H08107520 A JPH08107520 A JP H08107520A
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Abstract
(57)【要約】
【目的】 簡易回路で文字等を重畳するとともに、同文
字等の輝度レベルを自由に設定する。 【構成】 供給されたコンポジット映像信号１０をデジ
タルデータに変換するＡ／Ｄ変換部１と、前記デジタル
データを一端子に入力し他の端子に文字・記号デジタル
データを入力し両データを演算するとともに入力した選
択信号に基づき出力を選択的に切り換える演算部２と、
アナログ信号に変換するＤ／Ａ変換部３と、前記コンポ
ジット映像信号１０の同期信号を検出する同期検出部４
と、検出された同期信号の位相に一致した同期信号及び
クロック信号を生成する同期／クロック生成部５と、前
記同期信号及びクロック信号に基づき文字・記号データ
を出力する文字データ発生部６と、前記演算部２へ供給
する選択信号を生成する選択信号生成部７とでなる。
字等の輝度レベルを自由に設定する。 【構成】 供給されたコンポジット映像信号１０をデジ
タルデータに変換するＡ／Ｄ変換部１と、前記デジタル
データを一端子に入力し他の端子に文字・記号デジタル
データを入力し両データを演算するとともに入力した選
択信号に基づき出力を選択的に切り換える演算部２と、
アナログ信号に変換するＤ／Ａ変換部３と、前記コンポ
ジット映像信号１０の同期信号を検出する同期検出部４
と、検出された同期信号の位相に一致した同期信号及び
クロック信号を生成する同期／クロック生成部５と、前
記同期信号及びクロック信号に基づき文字・記号データ
を出力する文字データ発生部６と、前記演算部２へ供給
する選択信号を生成する選択信号生成部７とでなる。
Description
【０００１】
【産業上の利用分野】本発明は、映像信号に文字・記号
等のデータを重畳するスーパーインポーズ回路に関す
る。
等のデータを重畳するスーパーインポーズ回路に関す
る。
【０００２】
【従来の技術】図５の（ロ）に示すＣＣＴＶ（閉回路テ
レビ）システムでは異なる対象を撮影するための、例え
ば、２台のビデオカメラ１、ビデオカメラ２（６０）な
どを設置し、適宜、信号切替部６１で切り替えて１方の
カメラを選択することができる。そして、前記カメラの
撮影した、例えば、ＮＴＳＣ方式の映像信号を、同信号
切替部６１で選択し、スーパーインポーズ処理部６２に
て同映像信号に撮影カメラ番号などの所要データを重畳
し、同軸ケーブル等の伝送系６３を経由して、監視室な
どに設置してあるモニタ部６４に画像を写すことができ
る。あるいは、伝送された映像信号はＶＴＲなどに記録
することも可能であった。
レビ）システムでは異なる対象を撮影するための、例え
ば、２台のビデオカメラ１、ビデオカメラ２（６０）な
どを設置し、適宜、信号切替部６１で切り替えて１方の
カメラを選択することができる。そして、前記カメラの
撮影した、例えば、ＮＴＳＣ方式の映像信号を、同信号
切替部６１で選択し、スーパーインポーズ処理部６２に
て同映像信号に撮影カメラ番号などの所要データを重畳
し、同軸ケーブル等の伝送系６３を経由して、監視室な
どに設置してあるモニタ部６４に画像を写すことができ
る。あるいは、伝送された映像信号はＶＴＲなどに記録
することも可能であった。
【０００３】前述のＣＣＴＶシステムのスーパーインポ
ーズ処理部６２で使用する、従来のスーパーインポーズ
回路を、図５（イ）に示す。５０は入力した、例えば、
ＮＴＳＣ方式に準拠したコンポジットビデオ形式の映像
信号である。５１は前記映像信号５０の同期信号を検出
する同期検出部である。５２は前記映像信号５０に位相
ロックした同期信号及びクロックを生成する同期／クロ
ック生成部である。５３はＹ／Ｃ分離部であり、５４は
Ｙ信号、Ｃ信号からＲＧＢ信号を復調するＲＧＢ復調部
である。５５は、前記映像信号５０に位相同期したＲＧ
Ｂ信号の文字データを発生する文字発生部である。５６
は高速スイッチ部である。５７はＲＧＢ信号からＮＴＳ
Ｃ方式に準拠したコンポジットビデオ形式の映像信号を
生成するエンコード部である。
ーズ処理部６２で使用する、従来のスーパーインポーズ
回路を、図５（イ）に示す。５０は入力した、例えば、
ＮＴＳＣ方式に準拠したコンポジットビデオ形式の映像
信号である。５１は前記映像信号５０の同期信号を検出
する同期検出部である。５２は前記映像信号５０に位相
ロックした同期信号及びクロックを生成する同期／クロ
ック生成部である。５３はＹ／Ｃ分離部であり、５４は
Ｙ信号、Ｃ信号からＲＧＢ信号を復調するＲＧＢ復調部
である。５５は、前記映像信号５０に位相同期したＲＧ
Ｂ信号の文字データを発生する文字発生部である。５６
は高速スイッチ部である。５７はＲＧＢ信号からＮＴＳ
Ｃ方式に準拠したコンポジットビデオ形式の映像信号を
生成するエンコード部である。
【０００４】動作について説明する。映像信号５０はＹ
／Ｃ分離部５３で輝度信号Ｙと色信号Ｃとに分離された
後、ＲＧＢ復調部５４でＲ、Ｇ、Ｂの３原色に分解され
る。一方、映像信号５０は同期検出部５１にも入力さ
れ、信号中の同期信号が取り出され、水平同期信号、垂
直同期信号の位相が検出される。同水平同期信号およ
び、垂直同期信号の位相に基づき、同期／クロック生成
部５２にてＰＬＬ（フェイズ・ロックド・ループ）回路
等により、所要のクロックおよび同期信号が生成され
る。文字発生部５５は前記クロックおよび同期信号に基
づき、表示タイミングに合わせて、文字あるいは記号等
のパターン情報のＲＧＢ信号と、切り換え制御信号とを
出力する。高速スイッチ部５６は、ＲＧＢ復調部５４か
らのＲＧＢ信号と、文字発生部５５からのＲＧＢ信号と
を画素単位で切り換えて、何れか一方を出力する。エン
コード部５７はＲＧＢ信号からＮＴＳＣ方式に準拠した
コンポジットビデオ形式の映像信号を生成する。
／Ｃ分離部５３で輝度信号Ｙと色信号Ｃとに分離された
後、ＲＧＢ復調部５４でＲ、Ｇ、Ｂの３原色に分解され
る。一方、映像信号５０は同期検出部５１にも入力さ
れ、信号中の同期信号が取り出され、水平同期信号、垂
直同期信号の位相が検出される。同水平同期信号およ
び、垂直同期信号の位相に基づき、同期／クロック生成
部５２にてＰＬＬ（フェイズ・ロックド・ループ）回路
等により、所要のクロックおよび同期信号が生成され
る。文字発生部５５は前記クロックおよび同期信号に基
づき、表示タイミングに合わせて、文字あるいは記号等
のパターン情報のＲＧＢ信号と、切り換え制御信号とを
出力する。高速スイッチ部５６は、ＲＧＢ復調部５４か
らのＲＧＢ信号と、文字発生部５５からのＲＧＢ信号と
を画素単位で切り換えて、何れか一方を出力する。エン
コード部５７はＲＧＢ信号からＮＴＳＣ方式に準拠した
コンポジットビデオ形式の映像信号を生成する。
【０００５】ところで、従来のスーパーインポーズ回路
では、文字発生部５５として市販のキャラクタジェネレ
ータを内蔵したディスプレイコントローラＩＣを使用す
る場合がある。この場合、表示できる文字や記号等の種
類が少なかったり、画面上の表示位置が限定される。特
に、文字や記号等の表示の階調数が殆どの場合１階調で
あり、ＣＣＴＶシステムでは重畳した文字や記号等の表
示が見難い問題があった。また、別の方法として文字発
生部５５に市販の大容量のＲＯＭを内蔵したディスプレ
イコントローラＩＣを使用する場合がある。この場合、
表示できる文字のフォントを構成するドットや記号等を
構成するドットが、予め決まっていて、変えられないこ
と、或いは、外部から制御命令を与える必要があり、使
いづらい問題があった。特に、文字や記号等の表示を見
やすくするために表示の階調数を増加させる場合、大容
量ＲＯＭが必要となりコストが増大する問題があった。
では、文字発生部５５として市販のキャラクタジェネレ
ータを内蔵したディスプレイコントローラＩＣを使用す
る場合がある。この場合、表示できる文字や記号等の種
類が少なかったり、画面上の表示位置が限定される。特
に、文字や記号等の表示の階調数が殆どの場合１階調で
あり、ＣＣＴＶシステムでは重畳した文字や記号等の表
示が見難い問題があった。また、別の方法として文字発
生部５５に市販の大容量のＲＯＭを内蔵したディスプレ
イコントローラＩＣを使用する場合がある。この場合、
表示できる文字のフォントを構成するドットや記号等を
構成するドットが、予め決まっていて、変えられないこ
と、或いは、外部から制御命令を与える必要があり、使
いづらい問題があった。特に、文字や記号等の表示を見
やすくするために表示の階調数を増加させる場合、大容
量ＲＯＭが必要となりコストが増大する問題があった。
【０００６】
【発明が解決しようとする課題】本発明は上記問題点に
鑑みなされたもので、低廉で表示階調レベルを自由に設
定できるスーパーインポーズ回路を提供することを目的
とする。
鑑みなされたもので、低廉で表示階調レベルを自由に設
定できるスーパーインポーズ回路を提供することを目的
とする。
【０００７】
【課題を解決するための手段】上記目的を達成するため
に、供給された映像信号をデジタルデータに変換するＡ
／Ｄ変換部と、前記デジタルデータを一端子に入力し他
の端子に文字・記号デジタルデータを入力し両データを
演算するとともに入力した選択信号に基づき出力を選択
的に切り換える演算部と、前記演算部が出力するデジタ
ルデータをアナログ信号に変換するＤ／Ａ変換部と、前
記映像信号の同期信号を検出する同期検出部と、検出さ
れた同期信号の位相に一致した同期信号及びクロック信
号を生成する同期／クロック生成部と、前記同期信号及
びクロック信号に基づき文字・記号データを出力する文
字データ発生部と、前記演算部へ供給する選択信号を生
成する選択信号生成部とからなる。
に、供給された映像信号をデジタルデータに変換するＡ
／Ｄ変換部と、前記デジタルデータを一端子に入力し他
の端子に文字・記号デジタルデータを入力し両データを
演算するとともに入力した選択信号に基づき出力を選択
的に切り換える演算部と、前記演算部が出力するデジタ
ルデータをアナログ信号に変換するＤ／Ａ変換部と、前
記映像信号の同期信号を検出する同期検出部と、検出さ
れた同期信号の位相に一致した同期信号及びクロック信
号を生成する同期／クロック生成部と、前記同期信号及
びクロック信号に基づき文字・記号データを出力する文
字データ発生部と、前記演算部へ供給する選択信号を生
成する選択信号生成部とからなる。
【０００８】
【作用】以上のように構成したので、演算部は図３の
（ロ) 、（ハ）に示すように演算する。量子化した映像
信号入力をＶ（V0,V1,・・V7) 、文字・記号信号入力を
ＰとしたときＡは、前記ＶとＰの論理積演算の結果であ
り、ＢはＰの反転入力とＶとの論理和演算の結果であ
る。図３（ニ）に示すように、文字・記号の部分を
『０』、背景の部分を『１』として１階調のビットマッ
プデータを、例えば、ＲＯＭに記憶させておき、同ビッ
トマップデータＰを映像信号入力Ｖに同期させて、前記
演算部に供給すると、演算部の量子化ビット毎の出力
は、選択信号Ｓ＝０の場合、前記論理積演算の結果で
あるＡを出力し、選択信号Ｓ＝１の場合、前記論理和
演算の結果であるＢを出力する。
（ロ) 、（ハ）に示すように演算する。量子化した映像
信号入力をＶ（V0,V1,・・V7) 、文字・記号信号入力を
ＰとしたときＡは、前記ＶとＰの論理積演算の結果であ
り、ＢはＰの反転入力とＶとの論理和演算の結果であ
る。図３（ニ）に示すように、文字・記号の部分を
『０』、背景の部分を『１』として１階調のビットマッ
プデータを、例えば、ＲＯＭに記憶させておき、同ビッ
トマップデータＰを映像信号入力Ｖに同期させて、前記
演算部に供給すると、演算部の量子化ビット毎の出力
は、選択信号Ｓ＝０の場合、前記論理積演算の結果で
あるＡを出力し、選択信号Ｓ＝１の場合、前記論理和
演算の結果であるＢを出力する。
【０００９】
【実施例】以下、本発明によるスーパーインポーズ回路
について、図を用いて詳細に説明する。図１は、本発明
によるスーパーインポーズ回路の実施例ブロック図であ
る。１は供給されたコンポジット映像信号１０を所定の
サンプルタイミング、例えば、４ｆｓｃ（色副搬送波の
４倍の周波数）等でデジタルデータに変換するＡ／Ｄ変
換部である。２は、前記デジタルデータを一端子に入力
し、他の端子に文字・記号デジタルデータを入力し、両
データを演算するとともに入力した選択信号に基づき出
力を選択的に切り換える演算部である。３は、前記演算
部２が出力するデータをアナログ信号に変換するＤ／Ａ
変換部である。４は、前記コンポジット映像信号１０の
同期信号を検出する同期検出部である。５は検出された
同期信号の位相に一致した同期信号及びクロック信号を
生成する同期／クロック生成部である。６は、前記同期
信号及びクロック信号に基づき文字・記号データを出力
する文字データ発生部である。７は、前記演算部２へ供
給する選択信号を生成する選択信号生成部である。
について、図を用いて詳細に説明する。図１は、本発明
によるスーパーインポーズ回路の実施例ブロック図であ
る。１は供給されたコンポジット映像信号１０を所定の
サンプルタイミング、例えば、４ｆｓｃ（色副搬送波の
４倍の周波数）等でデジタルデータに変換するＡ／Ｄ変
換部である。２は、前記デジタルデータを一端子に入力
し、他の端子に文字・記号デジタルデータを入力し、両
データを演算するとともに入力した選択信号に基づき出
力を選択的に切り換える演算部である。３は、前記演算
部２が出力するデータをアナログ信号に変換するＤ／Ａ
変換部である。４は、前記コンポジット映像信号１０の
同期信号を検出する同期検出部である。５は検出された
同期信号の位相に一致した同期信号及びクロック信号を
生成する同期／クロック生成部である。６は、前記同期
信号及びクロック信号に基づき文字・記号データを出力
する文字データ発生部である。７は、前記演算部２へ供
給する選択信号を生成する選択信号生成部である。
【００１０】本発明によるスーパーインポーズ回路の動
作概要を図１、図２に従い説明する。コンポジット映像
信号１０をＡ／Ｄ変換部１で、例えば、４倍のｆｓｃ
（色副搬送波）のサンプルタイミング等でデジタルデー
タに変換しフレーム画像のデジタルデータを得る。同期
検出部４は前記コンポジット映像信号１０の同期信号を
検出し、同期／クロック生成部５が検出された同期信号
の位相に一致した同期信号及びクロック信号を生成す
る。文字データ発生部６を構成する、例えば、ＲＯＭに
記憶した端子に文字・記号の１階調のビットマップデー
タを、前記フレーム画像に同期して走査線の相応したド
ットデータ毎に演算部２へ入力する。この時、前記ＲＯ
Ｍ７には、予め、希望の位置に文字等をドット毎に、例
えば、文字部分のデータを‘０’背景のデータを‘１’
としたデジタルデータで書き込んでおく。従って、演算
部２で前記１階調のビットマップデータと、前記フレー
ム画像のデジタルデータとを演算し、フレーム画像に所
定の輝度レベルの文字を重畳する。但し、選択信号生成
部７から演算部２へ供給するレベル選択信号により、演
算部２の出力デジタル値を変えるので、重畳文字の輝度
レベルを任意レベルに自由に設定できる。尚、図４に示
すように他の実施例として、Ａ／Ｄ変換部１の出力をビ
デオＲＡＭ等でなる画像蓄積部８にフレーム画像として
取り込み、文字データ発生部６とタイミングを合わせて
読み出し、演算部２へ各データを供給する構成としても
良い。
作概要を図１、図２に従い説明する。コンポジット映像
信号１０をＡ／Ｄ変換部１で、例えば、４倍のｆｓｃ
（色副搬送波）のサンプルタイミング等でデジタルデー
タに変換しフレーム画像のデジタルデータを得る。同期
検出部４は前記コンポジット映像信号１０の同期信号を
検出し、同期／クロック生成部５が検出された同期信号
の位相に一致した同期信号及びクロック信号を生成す
る。文字データ発生部６を構成する、例えば、ＲＯＭに
記憶した端子に文字・記号の１階調のビットマップデー
タを、前記フレーム画像に同期して走査線の相応したド
ットデータ毎に演算部２へ入力する。この時、前記ＲＯ
Ｍ７には、予め、希望の位置に文字等をドット毎に、例
えば、文字部分のデータを‘０’背景のデータを‘１’
としたデジタルデータで書き込んでおく。従って、演算
部２で前記１階調のビットマップデータと、前記フレー
ム画像のデジタルデータとを演算し、フレーム画像に所
定の輝度レベルの文字を重畳する。但し、選択信号生成
部７から演算部２へ供給するレベル選択信号により、演
算部２の出力デジタル値を変えるので、重畳文字の輝度
レベルを任意レベルに自由に設定できる。尚、図４に示
すように他の実施例として、Ａ／Ｄ変換部１の出力をビ
デオＲＡＭ等でなる画像蓄積部８にフレーム画像として
取り込み、文字データ発生部６とタイミングを合わせて
読み出し、演算部２へ各データを供給する構成としても
良い。
【００１１】図３は本発明によるスーパーインポーズ回
路の演算部の実施例回路図及びその作用を説明する図で
ある。図３（イ）に示すように、演算部２はフレーム画
像のデジタルデータの量子化ビット毎に、反転器２２
と、同反転器２２を１つの入力に接続した２入力のＯＲ
ゲート２１と、２入力のＡＮＤゲート２０と、前記ＯＲ
ゲート２１と、前記ＡＮＤゲート２０とを並列に接続し
それらの出力を入力に接続するとともに何れか一方をレ
ベル選択信号Ｓに基づき選択出力するマルチプレクサ２
３とでなる
路の演算部の実施例回路図及びその作用を説明する図で
ある。図３（イ）に示すように、演算部２はフレーム画
像のデジタルデータの量子化ビット毎に、反転器２２
と、同反転器２２を１つの入力に接続した２入力のＯＲ
ゲート２１と、２入力のＡＮＤゲート２０と、前記ＯＲ
ゲート２１と、前記ＡＮＤゲート２０とを並列に接続し
それらの出力を入力に接続するとともに何れか一方をレ
ベル選択信号Ｓに基づき選択出力するマルチプレクサ２
３とでなる
【００１２】本発明によるスーパーインポーズ回路の演
算部の詳細動作を、図３に従い説明する。図３の（ロ)
、（ハ）に示すように演算部２は演算を行う。例え
ば、映像信号入力Ｖを８ビット（V0,V1,・・V7) で量子
化し、文字・記号信号入力をＰとしたときＡは、前記Ｖ
とＰの論理積演算の結果を表す。また、ＢはＰの反転入
力とＶとの論理和演算の結果を表す。ここで、例えば、
２５６種類の階調を得るために、レベル選択信号Ｓを８
ビット（S0,S1,・・S7) で構成し、演算部２の量子化ビ
ットに対応させてマルチプレクサ２３に供給する。同マ
ルチプレクサ２３は各ビットのＳの値がＳ＝０の場合、
前記論理積演算の結果であるＡを出力し、レベル選択信
号Ｓ＝１の場合、前記論理和演算の結果であるＢを出力
する。一方、図３（ニ）に示すように、文字・記号の部
分を『０』、背景の部分を『１』と１階調のビットマッ
プデータを、例えば、ＲＯＭに記憶させておき、同ビッ
トマップデータＰを映像信号入力Ｖに同期させて演算部
２に供給する。従って、図３の（ロ) 、（ハ）に示すよ
うに、演算部２の量子化ビット毎の出力は、レベル選択
信号Ｓ＝０の場合は、文字・記号の部分（Ｐ＝０）では
『０』を、また、背景の部分（Ｐ＝１）では映像信号入
力Ｖをそのまま出力する。レベル選択信号Ｓ＝１の場合
は、文字・記号の部分（Ｐ＝０）では『１』を、また、
背景の部分（Ｐ＝１）では映像信号入力Ｖをそのまま出
力する。具体的な例で説明する。映像信号入力Ｖを８ビ
ットで量子化し、Ｓを８ビットで構成する場合、例え
ば、Ｓ＝１ＡＨ（０００１１０１０Ｂ）とすると、演算
部２の出力Ｙの内重畳された文字・記号の部分は階調が
２５６で『２６／２５６』の輝度レベルとなる。また、
Ｓ＝００Ｈでは、『０／２５６』（最低）の輝度レベル
となり、Ｓ＝ＦＦＨでは、『２５６／２５６』（最高）
の輝度レベルとなる。尚、選択信号生成部７は、量子化
ビット毎に設けたディップスイッチを使用し『０』又
は、『１』を供給するように構成するが、別の方法とし
て、マイコンからデータを供給する方法であっても良
い。また、演算部２の論理回路は上記構成に限定するも
ので無く、論理和及び論理積及び反転を組み合わせてな
る上記構成の回路と相対回路であっても良い。
算部の詳細動作を、図３に従い説明する。図３の（ロ)
、（ハ）に示すように演算部２は演算を行う。例え
ば、映像信号入力Ｖを８ビット（V0,V1,・・V7) で量子
化し、文字・記号信号入力をＰとしたときＡは、前記Ｖ
とＰの論理積演算の結果を表す。また、ＢはＰの反転入
力とＶとの論理和演算の結果を表す。ここで、例えば、
２５６種類の階調を得るために、レベル選択信号Ｓを８
ビット（S0,S1,・・S7) で構成し、演算部２の量子化ビ
ットに対応させてマルチプレクサ２３に供給する。同マ
ルチプレクサ２３は各ビットのＳの値がＳ＝０の場合、
前記論理積演算の結果であるＡを出力し、レベル選択信
号Ｓ＝１の場合、前記論理和演算の結果であるＢを出力
する。一方、図３（ニ）に示すように、文字・記号の部
分を『０』、背景の部分を『１』と１階調のビットマッ
プデータを、例えば、ＲＯＭに記憶させておき、同ビッ
トマップデータＰを映像信号入力Ｖに同期させて演算部
２に供給する。従って、図３の（ロ) 、（ハ）に示すよ
うに、演算部２の量子化ビット毎の出力は、レベル選択
信号Ｓ＝０の場合は、文字・記号の部分（Ｐ＝０）では
『０』を、また、背景の部分（Ｐ＝１）では映像信号入
力Ｖをそのまま出力する。レベル選択信号Ｓ＝１の場合
は、文字・記号の部分（Ｐ＝０）では『１』を、また、
背景の部分（Ｐ＝１）では映像信号入力Ｖをそのまま出
力する。具体的な例で説明する。映像信号入力Ｖを８ビ
ットで量子化し、Ｓを８ビットで構成する場合、例え
ば、Ｓ＝１ＡＨ（０００１１０１０Ｂ）とすると、演算
部２の出力Ｙの内重畳された文字・記号の部分は階調が
２５６で『２６／２５６』の輝度レベルとなる。また、
Ｓ＝００Ｈでは、『０／２５６』（最低）の輝度レベル
となり、Ｓ＝ＦＦＨでは、『２５６／２５６』（最高）
の輝度レベルとなる。尚、選択信号生成部７は、量子化
ビット毎に設けたディップスイッチを使用し『０』又
は、『１』を供給するように構成するが、別の方法とし
て、マイコンからデータを供給する方法であっても良
い。また、演算部２の論理回路は上記構成に限定するも
ので無く、論理和及び論理積及び反転を組み合わせてな
る上記構成の回路と相対回路であっても良い。
【００１３】
【発明の効果】以上説明したように、本発明は低廉で重
畳した文字等の表示の輝度レベルを自由に設定できるス
ーパーインポーズ回路を提供する。従って、ＣＣＴＶシ
ステムのスーパーインポーズ処理部において撮影される
一定の背景に対して重畳する文字や記号等の表示の輝度
レベルを自由にかえて見やすい輝度レベルに設定できる
メリットがある。更に、重畳する文字や記号等のデータ
は１ビットの量子化データであるので、例えば、ＲＯＭ
に前記１ビットの量子化データを記憶させる場合、少な
いＲＯＭ容量で記憶できるので、コストの低廉化が計れ
る。
畳した文字等の表示の輝度レベルを自由に設定できるス
ーパーインポーズ回路を提供する。従って、ＣＣＴＶシ
ステムのスーパーインポーズ処理部において撮影される
一定の背景に対して重畳する文字や記号等の表示の輝度
レベルを自由にかえて見やすい輝度レベルに設定できる
メリットがある。更に、重畳する文字や記号等のデータ
は１ビットの量子化データであるので、例えば、ＲＯＭ
に前記１ビットの量子化データを記憶させる場合、少な
いＲＯＭ容量で記憶できるので、コストの低廉化が計れ
る。
【図１】本発明によるスーパーインポーズ回路の実施例
ブロック図である。
ブロック図である。
【図２】本発明によるスーパーインポーズ回路の動作概
要を説明する図である。
要を説明する図である。
【図３】本発明によるスーパーインポーズ回路の演算部
の実施例回路図及びその作用を説明する図である。
の実施例回路図及びその作用を説明する図である。
【図４】本発明によるスーパーインポーズ回路の他の実
施例ブロック図である。
施例ブロック図である。
【図５】ＣＣＴＶシステム及び従来のスーパーインポー
ズ回路の実施例ブロック図である。
ズ回路の実施例ブロック図である。
１ Ａ／Ｄ変換部 ２ 演算部 ３ Ｄ／Ａ変換部 ４ 同期検出部 ５ 同期／クロック生成部 ６ 文字データ発生部 ７ 選択信号生成部 ８ 画像蓄積部 １０ コンポジット映像信号 ２０ ＡＮＤゲート ２１ ＯＲゲート ２２ 反転器 ２３ マルチプレクサ ５０ 映像信号 ５１ 同期検出部 ５２ 同期／クロック生成部 ５３ Ｙ／Ｃ分離部 ５４ ＲＧＢ復調部 ５５ 文字発生部 ５６ 高速スイッチ部 ５７ エンコード部 ６０ ビデオカメラ ６１ 信号切替部 ６２ スーパーインポーズ処理部 ６３ 伝送系 ６４ モニタ部
Claims (8)
- 【請求項１】 供給された映像信号をデジタルデータに
変換するＡ／Ｄ変換部と、前記デジタルデータを一端子
に入力し他の端子に文字・記号デジタルデータを入力し
両データを演算するとともに入力した選択信号に基づき
出力を選択的に切り換える演算部と、前記演算部が出力
するデジタルデータをアナログ信号に変換するＤ／Ａ変
換部と、前記映像信号の同期信号を検出する同期検出部
と、検出された同期信号の位相に一致した同期信号及び
クロック信号を生成する同期／クロック生成部と、前記
同期信号及びクロック信号に基づき文字・記号データを
出力する文字データ発生部と、前記演算部へ供給する選
択信号を生成する選択信号生成部とからなるスーパーイ
ンポーズ回路。 - 【請求項２】 上記演算部を、反転器と、同反転器を１
つの入力に接続した２入力のＯＲゲートと、２入力のＡ
ＮＤゲートと、前記ＯＲゲートと前記ＡＮＤゲートとを
並列に接続しそれらの出力を入力に接続するとともに何
れか一方を選択出力するマルチプレクサとでなる請求項
１記載のスーパーインポーズ回路。 - 【請求項３】 供給された映像信号をデジタルデータに
変換するＡ／Ｄ変換部と、前記デジタルデータをフレー
ム毎に蓄積する画像蓄積部と、前記画像蓄積部から読み
出したデータを一端子に入力するとともに他の端子に文
字・記号デジタルデータを入力し両データを演算し入力
した選択信号に基づき出力を選択的に切り換える演算部
と、前記演算部が出力するデジタルデータをアナログ信
号に変換するＤ／Ａ変換部と、前記映像信号の同期信号
を検出する同期検出部と、検出された同期信号の位相に
一致した同期信号及びクロック信号を生成する同期／ク
ロック生成部と、前記同期信号及びクロック信号に基づ
き文字・記号データを出力する文字データ発生部と、前
記演算部へ供給する選択信号を生成する選択信号生成部
とからなるスーパーインポーズ回路。 - 【請求項４】 上記画像蓄積部をビデオＲＡＭで構成す
ることを特徴とした請求項３記載のスーパーインポーズ
回路。 - 【請求項５】 上記文字データ発生部をフレーム画像を
階調が１ビットのビットマップデータを記憶させたＲＯ
Ｍで構成することを特徴とした請求項１及び３記載のス
ーパーインポーズ回路。 - 【請求項６】 上記演算部の論理回路を、請求項２記載
の論理回路と相対の回路で構成することを特徴とした請
求項１及び３記載のスーパーインポーズ回路。 - 【請求項７】 上記選択信号生成部を量子化ビット毎に
設けたディップスイッチで構成することを特徴とした請
求項１及び３記載のスーパーインポーズ回路。 - 【請求項８】 上記選択信号生成部を量子化ビット毎に
所要データを供給するマイコンで構成することを特徴と
した請求項１及び３記載のスーパーインポーズ回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP24263894A JPH08107520A (ja) | 1994-10-06 | 1994-10-06 | スーパーインポーズ回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP24263894A JPH08107520A (ja) | 1994-10-06 | 1994-10-06 | スーパーインポーズ回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH08107520A true JPH08107520A (ja) | 1996-04-23 |
Family
ID=17092033
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP24263894A Pending JPH08107520A (ja) | 1994-10-06 | 1994-10-06 | スーパーインポーズ回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH08107520A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2002077894A (ja) * | 2000-08-25 | 2002-03-15 | Clarion Co Ltd | 車両用スーパーインポーズ装置 |
-
1994
- 1994-10-06 JP JP24263894A patent/JPH08107520A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2002077894A (ja) * | 2000-08-25 | 2002-03-15 | Clarion Co Ltd | 車両用スーパーインポーズ装置 |
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