JPH0799452B2 - 表示駆動回路 - Google Patents

表示駆動回路

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JPH0799452B2
JPH0799452B2 JP1105235A JP10523589A JPH0799452B2 JP H0799452 B2 JPH0799452 B2 JP H0799452B2 JP 1105235 A JP1105235 A JP 1105235A JP 10523589 A JP10523589 A JP 10523589A JP H0799452 B2 JPH0799452 B2 JP H0799452B2
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Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は、交流で駆動される装置や各種素子、特にEL
(エレクトロルネッセンス)表示素子やパッシブアドレ
ッシング型およびアクティブアドレッシング型の液晶表
示画素をマトリクス配列した液晶表示素子の駆動におい
て、共通タイミグ電極駆動用の集積回路の構成、及びこ
れを用いた動回路の構成に関するものである。
〔従来技術とその課題〕
交流駆動される電気部品や素子は数多くあり、これらの
駆動に必要な電圧は商用電源電圧をトランスで変圧して
用いる。周波数が商用電源と異なる場合は半導体素子を
用いて直流電源電圧から交流駆動波形を作成・増幅し、
その電圧の調整は直流電源電圧の調整・波形調整・トラ
ンスの巻線比調整で行なっている。これと別に表示駆動
波形電圧発生回路を小体積かつ軽量で実現するために半
導体素子を用いた回路で波形や電圧を制御することもで
きる。
この場合の電圧発生回路の直流電圧電源には、駆動交流
電圧実効値の 倍以上の値が必要である。高い交流電圧を得るにはプッ
シュプル駆動の手法があり、交流振幅が互いに逆極性の
2つの電圧発生回路を用意し、両電圧の差で素子を駆動
することにより、最大で電源電圧の2倍の駆動電圧の発
生が可能である。プッシュプル駆動での直流電圧成分は
同極性同振幅にすることにより相殺されてゼロになる。
多数の素子を駆動する場合には、素子をマトリクス状に
配置して上記のプッシュプル駆動の原理で駆動する。す
なわち、群分類された形が規定されるタイミング信号電
圧で駆動し、素子の他方の側を各素子駆動の点滅に応じ
て該タイミング信号と逆極性駆動波形か同極性駆動波形
かの信号で駆動するように選択する。その種の駆動の例
が、たとえばSociety of Information Display会誌Vol.
26/1,'85,9−15頁に見られる。このような駆動上の工夫
で直流電源電圧より高圧の交流電圧が素子の両端子に印
加出来るが、いずれにせよ高電圧駆動の素子の駆動には
高耐圧の半導体スイッチング素子が必要である。本発明
はかかる要求に対し、比較的低い耐圧の半導体集積回路
を用いてその電源耐圧以上の規則的な高電圧の駆動波形
を発生する回路および集積回路を提供するものである。
一般に表示画素の駆動回路では、表示素子の数が多いの
でマトリクス式駆動が用いられる。液晶やELの表示素子
の駆動にはトランジスタを用いた多出力端子の集積回路
が用いられるが、高集積密度化には低電圧動作化を要
し、高耐圧化を実現するには低集積密度化を要し、また
高速性を実現するには低電圧動作化を要し、これらを共
に満足する集積回路の実験は相当困難であった。通常、
相補型電界効果トランジスタ集積回路(以下C/MOS−IC
と記す)の標準的な設計の電源電圧は5ボルトであり、
これよりも高い電源電圧で設計する場合のC/MOS−ICの
回路集積精度はかなり低下し、また、ICの動作速度も低
下傾向にある。例えば5ボルト動作のICの応答速度が50
MHzに対し、25ボルト動作ICの応答速度は5MHz程度であ
り、集積密度も1/4程度に低下している。この動作速度
の不足により、液晶表示素子の細密画像表示が困難視さ
れていた。一つの解決方法は、一つのICの内で高速応答
を要求される部分を5ボルト設計とし、論理レベル変換
回路を増設して論理振幅を大きく増幅し、大振幅動作部
分を高耐圧設計として接続し、高速動作と高耐圧の二つ
の要求を満足させる。しかし、この構成では大面積を要
するレベルシフタを多数集積回路内部に設けるため、IC
のチップ面積が大になり、あるいはICチップ一つ当たり
に詰込む機能が少なくなり、極めて不経済なICとなって
いた。本発明者は、先に特開昭60−249191号公報でこの
問題に対する一つの改良を提案した。これはパルス発生
回路の出力である第一のパルス信号から、クランプ回路
を用いて電圧レベルの異なる第二のパルス信号を作成
し、両者を合成して電源電圧以上の電位差を持つパルス
信号を得る方法であるが、第一のパルス信号の低電位と
第二のパルス信号の高電位が近接した関係に固定され
る、利用できる電圧の種類が限られる、などの点で限界
のあるものであった。
〔課題を解決するための手段〕
本発明においては、上記困難を解消するため、駆動回路
の新しい構成を工夫し、一定電位差を持ち接地電位に対
して電位の変動する定電圧電源と、接地電位に対して電
位の変動しない定電圧電源を共に用意し、これらを用い
て駆動用集積回路を駆動し、ICの動作電源電圧よりも高
い対接地駆動電圧を発生する。上記対接地電圧が変動す
る定電圧源は、パルス発生回路の出力を、定電圧電源回
路にコンデンサを介してダイオードもしくはトランジス
タでクランプする事により、容易に実現できる。駆動出
力電圧波形は、集積回路の内部の電源線の低電位側電位
を基準とした電圧波形と、集積回路の低電位側電源線の
接地に対する変動電位との合成電位になっている。
〔実施例〕
以下に、本発明の内容を実施例に基づき、詳しく説明す
る。
第1図Aは、本発明における変動電圧源の各電位と出力
電位の接地電位に対する関係を示すものであって、さら
にVD(t)は変動電源の正極側、VS(t)は変動電源の
負極側、VM+は正極側中間電源、VM−は負極側中間電源
の各端子電位であり、TP1、TP2…TPnは各々タイミング
電圧波形である。ICの動作電源電圧Vicは Vic=〔VD(t)−VS(t)〕 となり、出力電圧差{VD2−VS2}よりも小である。比率
では約2/3〜1/2になる。第1図Aに示されている電位VD
(t)、VS(t)は、接地電位を基準としていて変動し
て見える。ICの動作電圧は必ずしも一定である必要はな
いが、誤動作や雑音混入の可能性を減じるためには、短
時間の急激な電源電圧変動がない方がよい。第1BにIC内
部の電圧関係を示すが、これは接地レベルを基準とする
第1図Aの電位をVS(t)基準で表してVDD、VSSとした
ものであり、ICの内部の動作電源電圧はこのように一定
の直流電圧に相当するものとなる。第1図Aに示すよう
な電圧系は、パルス電圧源と直流電圧源を用意し、パル
スクランプ回路により両者を合成する事で容意に実現で
きる。第2図A、B、Cに電圧合成の機能構成図、また
第3図に具体的な変動電源式駆動回路の構成例を示す。
第2図Aは変動電源の構成の実施例を示しており、204
・236・238は直流電源、220は駆動IC、222はパルス源、
208・206はコンデンサ、216・218はダイオードである。
コンデンサ208とダイオード218で電源238への正電位側
クランプ回路、同じくコンデンサ206とダイオード216で
電源236への負電位側クランプ回路を構成する。224は増
幅回路で、IC220の駆動電源を兼ね、低インピーダンス
構成である。増幅回路224のパルス出力電圧はクランプ
回路208・218の機能により直流電圧源238の正極電位に
パルス電圧波形の低電位側がクランプされてVD(t)と
なり、同時に負電位側クランプ回路206・216により直流
電圧源236の負電位側にパルス電圧の高電位側がクラン
プされてVS(t)となる。したがってIC220には増幅回
路224の出力電圧と電源236・238の出力電圧の和、すな
わち両電源の出力電圧の和に相当する電圧が印加され
る。クランプ回路のダイオード216・218及び増幅回路22
4に用いたスイッチング素子において電圧降下があれ
ば、その分だけ僅かに電圧が降下する。ここで、ダイオ
ードと並列に電界効果トランジスタを接続するとダイオ
ードの順方向電圧降下を抑圧出来て、クランプ効率が良
い。同様にバイポーラトランジスタをダイオードと並列
接続しても良い。
第2図Bに電界効果トランジスタ250・252を用いた並列
接続実施例、第2図Cにバイポーラトランジスタ260・2
62を用いた並列接続例を示す。いずれもダイオードの順
方向電圧降下を抑圧している。
第3図は本発明の変動電源回路の一実施例である。302
・322・348は直流電源であり、310はパルス出力回路、3
12は変動電源で駆動される液晶駆動用のIC、314は液晶
表示素子である。330は上記液晶駆動ICを駆動する変動
電源回路であり、電源322・348と低インピーダンスのク
ランプ回路324・342とからなる。316・318は、それぞれ
NチャネルおよびPチャネルの電界効果トランジスタで
あって、低インピーダンスの相補型インバータ回路を形
成し、パルス振幅を電力増幅する回路となっている。こ
のインバータ回路は高出力低損失動作の実現のため、入
力ゲート回路にレベルシフト用のクランプ回路336・338
を設け、小振幅のパルス信号から大振幅のパルスを作成
する際の貫通電流を抑圧している。NチャネルおよびP
チャネルの電界効果トランジスタをNPN・PNPのパイポー
ラ型トランジスタに置き換えても良い。336は入力パル
ス信号Sin360の低電位側を電源302の負極側に一致させ
るクランプ回路であり、338は同様に入力パルス信号Sin
の高電位側を正極側に一致させるクランプ回路である。
342・324は、上記大振幅低インピーダンスのパルスの高
レベルを電源322の負極側に、またパルスの低レベルを
正極側にそれぞれ一致させる低インピーダンスのクラン
プ回路であり、容量の比較的大きめのコンデンサと電流
の流せるダイオードを用いている。
IC312の正極側基板電位には第1図Aの変動電源の最高
電位VD(t)が、負極側基板電位には最低電位VS(t)
が印加され、また両電位間の一定の電位{VM+およびVM
−}が同時に供給される。両者の中間の接地電位VM0を
供給する事もある。ICの負電位VS(t)を基準にし、こ
れをVSSと表現すると、第1図BのようにICの正負の電
源基板間にはVDD−VSS(=Vic)の電圧が印加されてお
り、 Vic=VD(t)−VS(t) =一定 である。またVSS基準で見ると、変動する中間電位のVM
+VM−とが同時に印加されているように見える。クラン
プ回路の電圧降下が0の場合、電源302と電322(電源34
8も同じ)の各出力電圧VB1とVB2の合成電圧 {VB1+2・VB2} が上記ICに引火され、上記ICの出力電圧の電位差は、第
1図の様に合成されて、 2・{VB1+VB2} となる。さらに、必要に応じて変動する電位以内にいく
つかの任意の電位を設けて2つ以上の中間固定電位を備
えた4レベル以上の複雑な駆動波形も容易に合成出来
る。こ電位は、VD(t)とVS(t)との間の電位であれ
ば、パルス状に変動する電位にしても利用出来る。した
がって、第3図の電源線VD(t)・VS(s)・VM+・VM
−の他にさらにVDM(t)・VSM(t)の如く時間の関数
で波形の変化する電位を設定し、この電位に一定のタイ
ミングで出力端子を接続切り替えする回路が構成出来る
事が容易にわかる。
第4図に、第3図で312とした液晶駆動ICの構成の例を
示す。424は駆動信号を合成する論理回路、410は論理回
路424の信号に基づき駆動出力信号を合成する出力回路
であって、供給される複数の電源電位、たとえばVD
(t)・VM+・VM−・VS(t)から、時間の函数として
スイッチング素子により順次選択し接続し、出力電位を
定めるスイッチングトランジスタを備える。412はこの
液晶駆動ICの最高電位であるVD(t)電位に接続するた
めに用いるPチャネル電界効果トランジスタ、414は最
低電位であるVS(t)に接続するNチャネル電界効果ト
ランジスタである。416・408は中間の電位VM+・VM−に
接続するのに用いる相補型伝送ゲート回路のトランジス
タ対である。スイッチング回路410を駆動するために、
論理回路の論理振幅電圧はスイッチング回路の出力電圧
と同等以上の高電圧とすると、スイッチング回路410の
電圧降下が少なく効率が良い。
422はテスト用の伝送ゲートであって、全ての出力端の
外部接続用端子からあらためて各々スイッチ素子422を
介して共通の導線TESTに接続し、この導線の電位をテス
ト時に必要に応じて測定するか、あるいはテスト信号を
論理回路424に入力して電位を設定し、各出力端子をテ
スト時に任意かつ選択的にTEST線に接続し、その短絡電
流の有無から多数出力端子のICの試験を短時間に確実に
行う。この導線をテスト以外に、例えば駆動時に固定電
位レベル或いは変動電位レベルにして補助的に出力電位
を変調して用いる事も出来る。
〔発明の効果〕
以上の説明したごとく、本発明によれば集積回路の電源
耐圧電圧以上の高電圧の駆動信号を簡単な回路で実現出
来、また標準プロセスの安価な集積回路で高速データ伝
送の可能な高集積度の表示駆動集積回路を実現する事が
出来る。
【図面の簡単な説明】
第1図Aは本発明の変動電源の出力電圧波形図、第1図
Bは該回路のICの内部の電位例を示す波形図、第2図、
第3図及び第4図は本発明に係り、第2図A、B、Cは
クランプ回路を用いた変動電源を備えた回路図、第3図
はレベルシフト回路を具体的に示した変動電源回路図、
第4図は本発明による駆動波形を合成する集積回路の具
体的構成による駆動集積回路図を示す。 302……定電圧源、 336・338……クランプ回路、 322・348……定電圧源、 324・342……クランプ回路、 412、414、416、418、422……電子スイッチ素子。

Claims (6)

    【特許請求の範囲】
  1. 【請求項1】一定周期のパルスを発生するパルス発生手
    段と、該パルス発生手段の出力と交流結合し、電位が変
    動する第一の電源線(VT(t))と、該パルス発生手段
    の出力と交流結合し、該第一の電源線と一定の電位差で
    相等しい変動周期と変動成分電圧波形を持ち、該第一の
    電源線の最低電位と同等以下の電位で変動する第二の電
    源線(VS(t))と、該第一、第二の電源線電位の中間
    の電位で一定の電位をとる第三、第四の電源線(VM+、
    VM−)あるいはそれに続く複数の電源線を有する変動電
    源回路と、前記の各電源線に対する接続を電子的スイッ
    チ素子により一定の周期で切り替えて一定波形の電圧を
    複数個作成し、これらを複数の出力端子に一定の位相差
    で出力する集積回路を備えた表示駆動回路。
  2. 【請求項2】集積回路は、該第一の電源線が集積回路基
    板の正極側に接続され、該第二の電源線が集積回路基板
    の負極側に接続され、該正極基板上に形成されたPチャ
    ンネル電界効果トランジスタと該負極基板上に形成され
    たNチャンネル電界効果トランジスタが相補型電界効果
    トランジスタを構成し、該第三の電源線が該Pチャンネ
    ル電界効果トランジスタのソース側に接続され、該第四
    の電源線が該Nチャンネル電界効果トランジスタのソー
    ス側に接続され、出力端子が該PチャンネルおよびNチ
    ャンネル電界効果トランジスタのドレイン側に接続され
    ていることを特徴とする請求項1に記載の表示駆動回
    路。
  3. 【請求項3】変動電源回路は、該パルス発生手段から供
    給されるパルスを一定の電圧源322、348の正極側および
    負極側に、交流結合素子と、該パルスの電位変動に応じ
    てスイッチングするスイッチング素子との直列回路を介
    して接続してクランプ回路を構成し、その高電位側の交
    流結合素子とスイッチング素子の接続点を該第一の電源
    線に、低電位側の交流結合素子とスイッチング素子の接
    続点を該第二の電源線に、該一定の電圧源の正電極側を
    該第三の電源線に、該一定の電圧源の負電極側を該第四
    の電源線に接続することにより電圧を時間の周期関数と
    して得るものであることを特徴とする請求項1に記載の
    表示駆動回路。
  4. 【請求項4】クランプ回路のスイッチング素子はダイオ
    ード、電界効果トランジスタまたはバイポーラトランジ
    スタのいずれかであることを特徴とする請求項3に記載
    の表示駆動回路。
  5. 【請求項5】クランプ回路のスイッチング素子はダイオ
    ードとトランジスタの並列接続であることを特徴とする
    請求項3に記載の表示駆動回路。
  6. 【請求項6】表示駆動回路は、変動電源電位に接続され
    て接地電位に対する最高電位および最低電位を取る2つ
    の電位レベルと、接地電位に対し一定の電位を持つ固定
    電源電位に接続される正負あるいは中間の電位レベルの
    少なくとも4レベル以上の電位レベルに接続されること
    を特徴とする請求項2に記載の表示駆動回路。
JP1105235A 1989-04-25 1989-04-25 表示駆動回路 Expired - Lifetime JPH0799452B2 (ja)

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DE69021254T DE69021254T2 (de) 1989-04-25 1990-04-25 Anzeigentreiberschaltung.
EP90304468A EP0395387B1 (en) 1989-04-25 1990-04-25 Display drive circuit
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