JPH0745950Y2 - Chip type monolithic ceramic capacitor - Google Patents

Chip type monolithic ceramic capacitor

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JPH0745950Y2
JPH0745950Y2 JP4782689U JP4782689U JPH0745950Y2 JP H0745950 Y2 JPH0745950 Y2 JP H0745950Y2 JP 4782689 U JP4782689 U JP 4782689U JP 4782689 U JP4782689 U JP 4782689U JP H0745950 Y2 JPH0745950 Y2 JP H0745950Y2
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capacitor
ceramic capacitor
capacitance
monolithic ceramic
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博史 伊藤
靖夫 渡邊
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Matsushita Electric Industrial Co Ltd
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Description

【考案の詳細な説明】 産業上の利用分野 本考案は、一般電子機器に使用されるチップ形積層セラ
ミックコンデンサに関するものである。
DETAILED DESCRIPTION OF THE INVENTION Industrial Field of the Invention The present invention relates to a chip type multilayer ceramic capacitor used in general electronic equipment.

従来の技術 従来、この種のチップ形積層セラミックコンデンサは、
第4図(A),(B)に示すような構造で、誘電体磁器
1の内部に交互に積層された内部電極2(2a,2b,2c,…
…)のそれぞれ一方は、誘電体磁器1の両端面部に交互
に引き出され、内部電極2が並列接続されるよう外部電
極3を設けるという構成となっていた。
Conventional Technology Conventionally, this type of chip-type multilayer ceramic capacitor is
Internal electrodes 2 (2a, 2b, 2c, ...) that are alternately laminated inside the dielectric ceramic 1 have a structure as shown in FIGS. 4 (A) and (B).
..) is alternately drawn to both end surfaces of the dielectric ceramic 1 and the external electrodes 3 are provided so that the internal electrodes 2 are connected in parallel.

考案が解決しようとする課題 このような従来の構成では、コンデンサの静電容量は内
部電極2a,2b,2c,……間で形成されるものであるが、チ
ップ形積層セラミックコンデンサをプリント基板等に装
着して使用した際、第4図(A),(B)において、プ
リント基板4のランド部5a,5b間の静電容量は、コンデ
ンサ本体の静電容量の他に、コンデンサの最下層に位置
する内部電極2aとランド部5aとの間に生じる浮遊容量が
加わり、コンデンサ装着後のランド部5a,5b間の静電容
量はコンデンサの容量よりも大きくなるという不都合が
発生し、静電容量が変動するという課題があった。
Problems to be Solved by the Invention In such a conventional configuration, the capacitance of the capacitor is formed between the internal electrodes 2a, 2b, 2c, .. 4A and 4B, the capacitance between the lands 5a and 5b of the printed circuit board 4 is the lowest layer of the capacitor in addition to the capacitance of the capacitor body. The stray capacitance generated between the internal electrode 2a located at the point and the land portion 5a is added, and the electrostatic capacitance between the land portions 5a and 5b after mounting the capacitor becomes larger than the capacitance of the capacitor. There was a problem that the capacity fluctuated.

特に、静電容量が小さい時は、浮遊容量の絶対値が大き
くなり、回路上無視できないものとなっている。
In particular, when the electrostatic capacitance is small, the absolute value of the stray capacitance becomes large and cannot be ignored in the circuit.

また、製品の寸法が幅寸法(W)と厚み寸法(T)とが
同じ寸法の製品の時、第4図(A),(B)に示すよう
に内部電極2a,2b,2cは、その主面部がプリント基板のラ
ンド部5a,5bに対して並行の位置になったり、第5図
(A),(B)に示すようにその主面部が垂直の位置に
なったりして装着されるため、静電容量が変動するとい
う課題があった。なお、第4図,第5図において、6は
取付け用のはんだである。
Further, when the product has the same width (W) and thickness (T), the internal electrodes 2a, 2b, 2c have the same dimensions as shown in FIGS. 4 (A) and 4 (B). The main surface portion is mounted parallel to the lands 5a and 5b of the printed circuit board, or the main surface portion is vertical as shown in FIGS. 5 (A) and 5 (B). Therefore, there is a problem in that the capacitance changes. In FIGS. 4 and 5, 6 is a solder for attachment.

本考案は、このような課題を解決するもので、取付け方
向が変わった場合でも、プリント基板のランド部とチッ
プ形積層セラミックコンデンサの内部電極との間の浮遊
容量の発生を防止し、静電容量が変動することのない製
品を提供することを目的とするものである。
The present invention solves such a problem and prevents stray capacitance between the land portion of the printed circuit board and the internal electrode of the chip-type monolithic ceramic capacitor even when the mounting direction is changed to prevent electrostatic discharge. The purpose is to provide a product whose capacity does not fluctuate.

課題を解決するための手段 この課題を解決するために本考案は、誘電体磁器の内部
に積層された内部電極の外周部に、内部電極および外部
電極に接続されることのないように誘電体磁器を介して
シールド電極を設け、このシールド電極の外周部に絶縁
性材料にて外装を施したものである。
Means for Solving the Problem In order to solve this problem, the present invention provides a dielectric material on the outer peripheral portion of an internal electrode laminated inside a dielectric ceramic so as not to be connected to an internal electrode and an external electrode. A shield electrode is provided via a porcelain, and the outer periphery of this shield electrode is covered with an insulating material.

作用 この構成により、チップ形積層セラミックコンデンサを
プリント基板に装着する場合において、内部電極の外周
部に設けられたシールド電極により、プリント基板のラ
ンド部とコンデンサの内部電極とは分離されることにな
り、プリント基板のランド部とコンデンサの内部電極と
の間における浮遊容量の発生が防止され、静電容量が変
動するという課題が解決されることとなる。
Operation With this configuration, when the chip type monolithic ceramic capacitor is mounted on the printed circuit board, the land part of the printed circuit board and the internal electrode of the capacitor are separated by the shield electrode provided on the outer peripheral part of the internal electrode. Therefore, the generation of stray capacitance between the land portion of the printed circuit board and the internal electrode of the capacitor is prevented, and the problem that the electrostatic capacitance fluctuates is solved.

実施例 第1図は、本考案の一実施例によるチップ形積層セラミ
ックコンデンサの絶縁外装の一部を除いて部分断面図で
ある斜視図である。第1図において、11は誘電体磁器、
12は前記誘電体磁器11の内部にそれぞれの一方が相異な
る端面部に交互に達するように複数設けられた内部電
極、13は前記内部電極12が並列接続されるように前記誘
電体磁器11の両端面部に設けられた外部電極、14は外部
電極13の外周部に前記誘電体磁器11を介して設けられた
シールド電極であり、前記内部電極12および前記外部電
極13とは接続されないようになっている。15はシールド
電極14の外周部に絶縁のために設けられた絶縁性材料か
らなる絶縁外装である。
Embodiment FIG. 1 is a perspective view showing a partial cross-sectional view of a chip type monolithic ceramic capacitor according to an embodiment of the present invention with a part of an insulating sheath removed. In FIG. 1, 11 is a dielectric ceramic,
A plurality of internal electrodes 12 are provided inside the dielectric porcelain 11 so that one of them reaches the different end faces alternately, and 13 of the dielectric porcelain 11 so that the internal electrodes 12 are connected in parallel. External electrodes provided on both end face portions, 14 are shield electrodes provided on the outer peripheral portion of the external electrode 13 via the dielectric ceramic 11, and are not connected to the internal electrode 12 and the external electrode 13. ing. Reference numeral 15 denotes an insulating sheath made of an insulating material provided on the outer peripheral portion of the shield electrode 14 for insulation.

第2図(A),(B)は、前記実施例のチップ形積層セ
ラミックコンデンサがプリント基板に装着された状態の
長さ方向と幅方向の断面図を示すものであり、内部電極
12(12a,12b,12c,……)の主面部はプリント基板16のラ
ンド部17a,17bと並行に位置している。第2図におい
て、コンデンサの静電容量は内部電極12aと12bとで形成
される容量と、内部電極12bと12cとで形成される容量等
がコンデンサの容量全体となるが、シールド電極14がな
い従来の構成ではランド部17aと内部電極12aとの間にも
浮遊容量が生じるが、本実施例ではシールド電極14がラ
ンド部17aと内部電極12aとの間にあるため、ランド部17
aとシールド電極14との間で浮遊容量が生じる。しか
し、シールド電極14は内部電極12aとは接続されていな
いため、コンデンサの容量としては影響しない。
2 (A) and 2 (B) are cross-sectional views in a length direction and a width direction in which the chip type monolithic ceramic capacitor of the above-described embodiment is mounted on a printed circuit board.
The main surface portions of 12 (12a, 12b, 12c, ...) Are located in parallel with the land portions 17a, 17b of the printed board 16. In FIG. 2, the capacitance of the capacitor is the capacitance formed by the internal electrodes 12a and 12b, the capacitance formed by the internal electrodes 12b and 12c, and the like, but the shield electrode 14 is not provided. In the conventional configuration, stray capacitance is also generated between the land portion 17a and the internal electrode 12a, but in the present embodiment, since the shield electrode 14 is between the land portion 17a and the internal electrode 12a, the land portion 17a
Stray capacitance is generated between a and the shield electrode 14. However, since the shield electrode 14 is not connected to the internal electrode 12a, it does not affect the capacitance of the capacitor.

第3図(A),(B)は、同じく本実施例のチップ形積
層セラミックコンデンサがプリント基板に装着された状
態の長さ方向と幅方向の断面図を示すものであり、内部
電極12の主面部はプリント基板16のランド部17a,17bと
垂直に位置している。第3図において、内部電極12とラ
ンド部17a,17bとの間にはシールド電極14があり、前記
と同様に浮遊容量の影響は受けないことになる。このよ
うに、シールド電極14を内部電極12の外周部に設けるこ
とにより、コンデンサの方向性による浮遊容量の影響の
ないものが得られることとなり、静電容量が変動すると
いう課題を解決することができる。
FIGS. 3 (A) and 3 (B) are sectional views in the length direction and the width direction of the state where the chip type monolithic ceramic capacitor of the present example is mounted on the printed circuit board, and shows the internal electrode 12 The main surface portion is positioned perpendicular to the land portions 17a and 17b of the printed board 16. In FIG. 3, the shield electrode 14 is provided between the internal electrode 12 and the lands 17a and 17b, and is not affected by the stray capacitance as described above. As described above, by providing the shield electrode 14 on the outer peripheral portion of the internal electrode 12, it is possible to obtain the one without the influence of the stray capacitance due to the directivity of the capacitor, and it is possible to solve the problem that the capacitance varies. it can.

なお、第2図,第3図において、18は取付け用のはんだ
である。
In FIG. 2 and FIG. 3, 18 is a solder for attachment.

考案の効果 以上のように本考案によれば、コンデンサの内部電極の
外周部にその内部電極および外部電極に接続されないよ
うにシールド電極を設けることにより、コンデンサの内
部電極とプリント基板のランド部との間における浮遊容
量の影響を改善でき、静電容量が変動するということの
ない製品を提供することができるという効果が得られ
る。
As described above, according to the present invention, by providing the shield electrode on the outer peripheral portion of the internal electrode of the capacitor so as not to be connected to the internal electrode and the external electrode, the internal electrode of the capacitor and the land portion of the printed circuit board are formed. It is possible to improve the influence of the stray capacitance during the period and to provide a product in which the capacitance does not fluctuate.

【図面の簡単な説明】[Brief description of drawings]

第1図は本考案の一実施例によるチップ形積層セラミッ
クコンデンサの絶縁外装の一部を除いて部分断面図で示
す斜視図、第2図(A),(B)は同コンデンサがプリ
ント基板に装着された状態の長さ方向と幅方向の断面
図、第3図(A),(B)は同コンデンサが取付け方向
を変えてプリント基板に装着された状態の長さ方向と幅
方向の断面図、第4図(A),(B)は従来のチップ形
積層セラミックコンデンサがプリント基板に装着された
状態の長さ方向と幅方向の断面図、第5図(A),
(B)は同コンデンサが取付け方向を変えてプリント基
板に装着された状態の長さ方向と幅方向の断面図であ
る。 11……誘電体磁器、12,12a,12b,12c……内部電極、13…
…外部電極、14……シールド電極、15……絶縁外装、16
……プリント基板、17,17a,17b……ランド部、18……は
んだ。
FIG. 1 is a perspective view showing a partial cross-sectional view of a chip type monolithic ceramic capacitor according to an embodiment of the present invention with a part of an insulating sheath removed, and FIGS. 2 (A) and 2 (B) show the same capacitor on a printed circuit board. Sectional views in the length direction and the width direction in the mounted state, and FIGS. 3 (A) and 3 (B) are cross sections in the length direction and the width direction in which the capacitor is mounted on the printed circuit board by changing the mounting direction. FIGS. 4 (A) and 4 (B) are cross-sectional views in a length direction and a width direction in which a conventional chip-type monolithic ceramic capacitor is mounted on a printed circuit board, and FIGS.
FIG. 6B is a cross-sectional view in the length direction and the width direction in which the same capacitor is mounted on a printed circuit board by changing the mounting direction. 11 ... Dielectric porcelain, 12,12a, 12b, 12c ... Internal electrodes, 13 ...
… External electrode, 14 …… Shield electrode, 15 …… Insulation sheath, 16
…… Printed circuit board, 17,17a, 17b …… Land part, 18 …… Solder.

Claims (1)

【実用新案登録請求の範囲】[Scope of utility model registration request] 【請求項1】誘電体磁器の内部に複数の内部電極を設
け、前記内部電極の一部を前記誘電体磁器の異なる端面
部に交互に引き出し、前記内部電極が並列接続されるよ
う前記誘電体磁器の端面部に外部電極を設け、前記内部
電極の外周部にその内部電極および前記外部電極に接続
されないように誘電体磁器を介してシールド電極を設
け、このシールド電極の外周部に絶縁性材料にて外装を
施したチップ形積層セラミックコンデンサ。
1. A plurality of internal electrodes are provided inside a dielectric porcelain, a part of the internal electrodes are alternately drawn out to different end face portions of the dielectric porcelain, and the dielectric is connected in parallel. An external electrode is provided on the end surface of the porcelain, and a shield electrode is provided on the outer peripheral portion of the internal electrode via a dielectric ceramic so as not to be connected to the internal electrode and the external electrode. An insulating material is provided on the outer peripheral portion of the shield electrode. Chip-type monolithic ceramic capacitor with exterior.
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