JPH07334120A - 液晶階調表示制御装置 - Google Patents
液晶階調表示制御装置Info
- Publication number
- JPH07334120A JPH07334120A JP13187694A JP13187694A JPH07334120A JP H07334120 A JPH07334120 A JP H07334120A JP 13187694 A JP13187694 A JP 13187694A JP 13187694 A JP13187694 A JP 13187694A JP H07334120 A JPH07334120 A JP H07334120A
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- Japan
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- memory
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- Pending
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Abstract
(57)【要約】
【目的】 非常に簡単な回路によって液晶階調表示制御
装置を実現し、コストの低減を図れる手段を提供するこ
とを目的とする。 【構成】 間引きパターン発生部５をメモリで構成し、
アドレス入力に画素位置の情報を入力し、データ出力と
して、その画素におけるＯＮ／ＯＦＦデータを出力す
る。 【効果】 間引きパターン発生部をメモリで構成するこ
とにより、間引きパターン回路を非常に簡単な構成で実
現でき、コストを低減できる。また、使用するＬＣＤが
変更された場合でも回路を変更することなくメモリに格
納するデータを変更するだけで対応でき、開発納期の短
縮が可能となる。
装置を実現し、コストの低減を図れる手段を提供するこ
とを目的とする。 【構成】 間引きパターン発生部５をメモリで構成し、
アドレス入力に画素位置の情報を入力し、データ出力と
して、その画素におけるＯＮ／ＯＦＦデータを出力す
る。 【効果】 間引きパターン発生部をメモリで構成するこ
とにより、間引きパターン回路を非常に簡単な構成で実
現でき、コストを低減できる。また、使用するＬＣＤが
変更された場合でも回路を変更することなくメモリに格
納するデータを変更するだけで対応でき、開発納期の短
縮が可能となる。
Description
【０００１】
【産業上の利用分野】本発明は、ＳＴＮ型ＬＣＤに階調
表示を行うための液晶階調表示制御装置に関するもので
ある。
表示を行うための液晶階調表示制御装置に関するもので
ある。
【０００２】
【従来の技術】ＳＴＮ型ＬＣＤに階調表示を行う場合、
フレーム間引き方式というものがあり、階調データに応
じて１フレーム毎にＬＣＤ（液晶表示部）に送出するデ
ータを間引くことにより、階調表示を実現していた。し
かしながらフレーム間引き方式は、ＬＣＤの１画面リフ
レッシュレートの極端な周波数の低下が起こり（例え
ば、通常の２値表示の場合には、１フレーム周波数が１
画面リフレッシュレートとなるが８階調の場合には７倍
の７フレーム周波数が１画面リフレッシュレートとな
る）、ＬＣＤ画面にちらつきが発生するという課題があ
った。
フレーム間引き方式というものがあり、階調データに応
じて１フレーム毎にＬＣＤ（液晶表示部）に送出するデ
ータを間引くことにより、階調表示を実現していた。し
かしながらフレーム間引き方式は、ＬＣＤの１画面リフ
レッシュレートの極端な周波数の低下が起こり（例え
ば、通常の２値表示の場合には、１フレーム周波数が１
画面リフレッシュレートとなるが８階調の場合には７倍
の７フレーム周波数が１画面リフレッシュレートとな
る）、ＬＣＤ画面にちらつきが発生するという課題があ
った。
【０００３】そこで従来は、ちらつきを極力抑えるため
に、データの間引きを行う画素をＮ×Ｎの領域の中で１
フレーム毎に変化させ、Ｎ×Ｎ領域全体で見た場合の見
かけ上の１画面リフレッシュレートの周波数低下を防ぐ
方式が考案され、色々なＬＣＤに対応した様々な間引き
パターンが考えだされ実用化されている。
に、データの間引きを行う画素をＮ×Ｎの領域の中で１
フレーム毎に変化させ、Ｎ×Ｎ領域全体で見た場合の見
かけ上の１画面リフレッシュレートの周波数低下を防ぐ
方式が考案され、色々なＬＣＤに対応した様々な間引き
パターンが考えだされ実用化されている。
【０００４】
【発明が解決しようとする課題】しかしながら従来の方
式は、ちらつきを抑える間引きパターンをロジック回路
で構成していたために、回路が複雑になり且つ回路規模
が膨大になるという問題点を有していた。また、ＬＣＤ
が変わった場合には最適な間引きパターンが変わるため
に、間引きパターン回路の再設計が必要となり、ＬＣＤ
の変更に素早く対処することが困難であるという問題点
を有していた。
式は、ちらつきを抑える間引きパターンをロジック回路
で構成していたために、回路が複雑になり且つ回路規模
が膨大になるという問題点を有していた。また、ＬＣＤ
が変わった場合には最適な間引きパターンが変わるため
に、間引きパターン回路の再設計が必要となり、ＬＣＤ
の変更に素早く対処することが困難であるという問題点
を有していた。
【０００５】そこで本発明は、簡単な回路で液晶階調表
示を行える液晶階調表示制御装置を提供することを目的
とする。
示を行える液晶階調表示制御装置を提供することを目的
とする。
【０００６】
【課題を解決するための手段】本発明は、間引きパター
ン発生部をメモリで構成したものである。
ン発生部をメモリで構成したものである。
【０００７】
【作用】上記構成により、間引きパターン発生部を非常
に簡単に構成できる。また、使用するＬＣＤが変更され
た場合でも回路を変更することなく、メモリに格納する
データを変更するだけで対応することができる。
に簡単に構成できる。また、使用するＬＣＤが変更され
た場合でも回路を変更することなく、メモリに格納する
データを変更するだけで対応することができる。
【０００８】
【実施例】以下本発明の一実施例について図面を参照し
ながら説明する。図１は本発明の一実施例における液晶
階調表示制御装置のフレーム間引き方式の概略説明図で
ある。図１は、８フレームを用いて９階調表示を行う場
合の例を示しており、階調０，１，２，３，４，５，
６，７，８のうち中間の２の明るさを出す場合を説明す
る。２の明るさを出すためには、８フレームのうち２フ
レームからＯＮデータ、６フレームからＯＦＦデータを
送出し、ＬＣＤセルにかける実効電圧を調節することに
より、階調を実現する。しかし、同一の画素を常に同じ
フレームで間引いてしまうとちらつきが発生してしま
う。そこで、ＯＮデータを送出する画素を８×８のマト
リックス内でフレーム毎に変化させ、階調領域全体での
ちらつきの発生を防ぐ。このようにフレーム間引き方式
はマトリックス内での画素の間引き方が重要であり、使
用するＬＣＤによっても違う間引きパターンが必要とな
る。
ながら説明する。図１は本発明の一実施例における液晶
階調表示制御装置のフレーム間引き方式の概略説明図で
ある。図１は、８フレームを用いて９階調表示を行う場
合の例を示しており、階調０，１，２，３，４，５，
６，７，８のうち中間の２の明るさを出す場合を説明す
る。２の明るさを出すためには、８フレームのうち２フ
レームからＯＮデータ、６フレームからＯＦＦデータを
送出し、ＬＣＤセルにかける実効電圧を調節することに
より、階調を実現する。しかし、同一の画素を常に同じ
フレームで間引いてしまうとちらつきが発生してしま
う。そこで、ＯＮデータを送出する画素を８×８のマト
リックス内でフレーム毎に変化させ、階調領域全体での
ちらつきの発生を防ぐ。このようにフレーム間引き方式
はマトリックス内での画素の間引き方が重要であり、使
用するＬＣＤによっても違う間引きパターンが必要とな
る。
【０００９】図２は本発明の一実施例における液晶階調
表示制御装置のハードウェア構成図である。図２におい
て、１はＬＣＤに表示するデータを格納するためのビデ
オメモリであり、２はビデオメモリ１から表示データを
読み込むためのメモリインターフェース部であり、３は
読み込んだ階調データをデコードするためのデコード部
であり、４はデータの間引きを行う画素をＮ×Ｎの領域
の中でフレーム毎に変化させるための信号を発生するフ
レームコントロール部であり、５は使用しているＬＣＤ
に固有且つ最適な間引きパターンを発生する間引きパタ
ーン発生部であり、本発明ではこの間引きパターン発生
部５をメモリで構成している。
表示制御装置のハードウェア構成図である。図２におい
て、１はＬＣＤに表示するデータを格納するためのビデ
オメモリであり、２はビデオメモリ１から表示データを
読み込むためのメモリインターフェース部であり、３は
読み込んだ階調データをデコードするためのデコード部
であり、４はデータの間引きを行う画素をＮ×Ｎの領域
の中でフレーム毎に変化させるための信号を発生するフ
レームコントロール部であり、５は使用しているＬＣＤ
に固有且つ最適な間引きパターンを発生する間引きパタ
ーン発生部であり、本発明ではこの間引きパターン発生
部５をメモリで構成している。
【００１０】６は表示データのデコード結果をもとに間
引きパターンのデータを選択するためのセレクタ部であ
り、７はＬＣＤの制御信号及び全体の制御信号を生成す
るためのタイミング発生部であり、８は表示デバイスの
一種であるＬＣＤである。
引きパターンのデータを選択するためのセレクタ部であ
り、７はＬＣＤの制御信号及び全体の制御信号を生成す
るためのタイミング発生部であり、８は表示デバイスの
一種であるＬＣＤである。
【００１１】図３は本発明の一実施例における液晶階調
表示制御装置の階調パターンメモリの構成図である。図
３は８フレームを用いて９階調表示を行う場合のメモリ
の構成を示している。メモリのバス幅は１６ビットであ
り、図示するようにＤ０〜Ｄ３に階調１のパターンを、
Ｄ４〜Ｄ７に階調２のパターンを、Ｄ８〜Ｄ１１に階調
３のパターンを、Ｄ１２〜Ｄ１５に階調４のパターンを
格納する。階調５は階調３の反転パターンであり、階調
６は階調２の反転パターンであり、階調７は階調１の反
転パターンである。階調０と階調８は真っ黒と真っ白で
あり、間引きパターンは必要としない。
表示制御装置の階調パターンメモリの構成図である。図
３は８フレームを用いて９階調表示を行う場合のメモリ
の構成を示している。メモリのバス幅は１６ビットであ
り、図示するようにＤ０〜Ｄ３に階調１のパターンを、
Ｄ４〜Ｄ７に階調２のパターンを、Ｄ８〜Ｄ１１に階調
３のパターンを、Ｄ１２〜Ｄ１５に階調４のパターンを
格納する。階調５は階調３の反転パターンであり、階調
６は階調２の反転パターンであり、階調７は階調１の反
転パターンである。階調０と階調８は真っ黒と真っ白で
あり、間引きパターンは必要としない。
【００１２】以下に、本発明の一実施例の動作を図２の
ハードウェア構成図を参照しながら説明する。ここでは
説明を簡単にするために、８フレームを用いて９階調表
示を行い、階調０，１，２，３，４，５，６，７，８の
うち、中間の２の明るさを表示する場合で説明する。
ハードウェア構成図を参照しながら説明する。ここでは
説明を簡単にするために、８フレームを用いて９階調表
示を行い、階調０，１，２，３，４，５，６，７，８の
うち、中間の２の明るさを表示する場合で説明する。
【００１３】先ず、タイミング発生部７よりメモリの制
御信号を発生し、ビデオメモリ１の階調データをメモリ
インターフェース部２へ読み込み、デコード部３へ送出
する。デコード部３では、階調データをデコードし、セ
レクタ部６へ送出する。フレームコントロール部４で
は、現在の画素の座標及び現在のフレーム数を発生し、
間引きパターン発生部５へ送る。本実施例では間引きパ
ターン発生部５をメモリで構成しており、図３に示して
いるようなフォーマットで、フレーム１からフレーム８
まで、階調１から階調４までの、それぞれの画素のＯＮ
／ＯＦＦデータを格納しておく。アドレスとしてフレー
ムコントロール部４より発生される画素の座標、フレー
ム数を入力することにより、データとして階調１，２，
３，４それぞれのフレーム数に応じた画素のＯＮ／ＯＦ
Ｆデータが出力される。セレクタ部６では階調データに
より、間引きパターン発生部５から送られる階調パター
ンを選択してＬＣＤ８へ送る。
御信号を発生し、ビデオメモリ１の階調データをメモリ
インターフェース部２へ読み込み、デコード部３へ送出
する。デコード部３では、階調データをデコードし、セ
レクタ部６へ送出する。フレームコントロール部４で
は、現在の画素の座標及び現在のフレーム数を発生し、
間引きパターン発生部５へ送る。本実施例では間引きパ
ターン発生部５をメモリで構成しており、図３に示して
いるようなフォーマットで、フレーム１からフレーム８
まで、階調１から階調４までの、それぞれの画素のＯＮ
／ＯＦＦデータを格納しておく。アドレスとしてフレー
ムコントロール部４より発生される画素の座標、フレー
ム数を入力することにより、データとして階調１，２，
３，４それぞれのフレーム数に応じた画素のＯＮ／ＯＦ
Ｆデータが出力される。セレクタ部６では階調データに
より、間引きパターン発生部５から送られる階調パター
ンを選択してＬＣＤ８へ送る。
【００１４】
【発明の効果】以上説明したように本発明の液晶階調表
示制御装置は、間引きパターン発生部をメモリで構成す
ることにより、間引きパターン回路を非常に簡単な構成
で実現し、コストを低減することができる。また。使用
するＬＣＤが変更された場合でも回路を変更することな
く、メモリに格納するデータを変更するだけで対応する
ことができ、開発納期の短縮が可能となる。
示制御装置は、間引きパターン発生部をメモリで構成す
ることにより、間引きパターン回路を非常に簡単な構成
で実現し、コストを低減することができる。また。使用
するＬＣＤが変更された場合でも回路を変更することな
く、メモリに格納するデータを変更するだけで対応する
ことができ、開発納期の短縮が可能となる。
【図１】本発明の一実施例における液晶階調表示制御装
置のフレーム間引き方式の概略説明図
置のフレーム間引き方式の概略説明図
【図２】本発明の一実施例における液晶階調表示制御装
置のハードウェア構成図
置のハードウェア構成図
【図３】本発明の一実施例における液晶階調表示制御装
置の階調パターンメモリの構成図
置の階調パターンメモリの構成図
１ ビデオメモリ ２ メモリインターフェース部 ３ デコード部 ４ フレームコントロール部 ５ 間引きパターン発生部 ６ セレクタ部 ７ タイミング発生部 ８ ＬＣＤ
Claims (1)
- 【請求項１】表示データを格納するビデオメモリと、こ
のビデオメモリから表示データを読み込むメモリインタ
ーフェース部と、読み込んだ階調表示データのデコード
を行うデコード部と、階調表示を行うためにデータの間
引きを行うフレームコントロール部と、データの間引き
を行う画素を小領域の中でフレーム毎に変化させるため
の間引きパターン発生部と、表示データのデコード結果
をもとに間引きパターンのデータを選択するセレクタ部
と、液晶表示部の制御信号及び全体の制御信号を生成す
るタイミング発生部とを備えた液晶階調表示制御装置で
あって、前記間引きパターン発生部をメモリで構成する
ことを特徴とする液晶階調表示制御装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP13187694A JPH07334120A (ja) | 1994-06-14 | 1994-06-14 | 液晶階調表示制御装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP13187694A JPH07334120A (ja) | 1994-06-14 | 1994-06-14 | 液晶階調表示制御装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH07334120A true JPH07334120A (ja) | 1995-12-22 |
Family
ID=15068212
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP13187694A Pending JPH07334120A (ja) | 1994-06-14 | 1994-06-14 | 液晶階調表示制御装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH07334120A (ja) |
-
1994
- 1994-06-14 JP JP13187694A patent/JPH07334120A/ja active Pending
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