JPH07298091A - 同期分離回路 - Google Patents
同期分離回路Info
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- JPH07298091A JPH07298091A JP8208794A JP8208794A JPH07298091A JP H07298091 A JPH07298091 A JP H07298091A JP 8208794 A JP8208794 A JP 8208794A JP 8208794 A JP8208794 A JP 8208794A JP H07298091 A JPH07298091 A JP H07298091A
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Abstract
(57)【要約】
【目的】 映像信号入力のＳ／Ｎにより同期分離回路を
切り換え同期信号を出力することにより、ＶＴＲ再生時
には画像の頭曲がりが発生しないようにし、映像信号入
力のＳ／Ｎが劣化している場合は同期を安定させ画像を
見やすくする。 【構成】 同期分離部２で映像信号入力から同期信号を
分離し、ＡＦＣ回路部３で同期分離部２からの入力に同
期させた同期信号を発生させ、同期クランプ及びレベル
スライス回路４で映像信号入力の同期信号部分のレベル
をクランプしスライスして同期信号を抽出し、ＡＦＣ回
路部３からの出力と同期クランプ及びレベルスライス回
路４からの出力とを切換器１１に入力し、Ｓ／Ｎ判定部
９で映像信号入力のＳ／Ｎと基準のＳ／Ｎレベルとの大
小を判定して切換器１１を切り換えて、同期クランプ及
びレベルスライス回路４からの同期信号とＡＦＣ回路部
３からの同期信号を選択して出力するものである。
切り換え同期信号を出力することにより、ＶＴＲ再生時
には画像の頭曲がりが発生しないようにし、映像信号入
力のＳ／Ｎが劣化している場合は同期を安定させ画像を
見やすくする。 【構成】 同期分離部２で映像信号入力から同期信号を
分離し、ＡＦＣ回路部３で同期分離部２からの入力に同
期させた同期信号を発生させ、同期クランプ及びレベル
スライス回路４で映像信号入力の同期信号部分のレベル
をクランプしスライスして同期信号を抽出し、ＡＦＣ回
路部３からの出力と同期クランプ及びレベルスライス回
路４からの出力とを切換器１１に入力し、Ｓ／Ｎ判定部
９で映像信号入力のＳ／Ｎと基準のＳ／Ｎレベルとの大
小を判定して切換器１１を切り換えて、同期クランプ及
びレベルスライス回路４からの同期信号とＡＦＣ回路部
３からの同期信号を選択して出力するものである。
Description
【０００１】
【産業上の利用分野】本発明は、映像機器等に用いられ
る同期分離回路に関し、特にプラズマディスプレイ等の
垂直方向の表示率（全走査線に対する画面表示される走
査線数の割合）の高い表示装置に用いるのに適した同期
分離回路に関する。
る同期分離回路に関し、特にプラズマディスプレイ等の
垂直方向の表示率（全走査線に対する画面表示される走
査線数の割合）の高い表示装置に用いるのに適した同期
分離回路に関する。
【０００２】
【従来の技術】従来のテレビ等に用いられている同期分
離回路は、図３に示すように映像信号入力に対してロー
パスフィルタ２４で同期信号を分離し、ＡＦＣ回路２５
で分離された同期信号に同期させて同期信号を発振さ
せ、発振させた同期信号に基づき偏向回路を動作させる
ようにしていた。ＡＦＣ回路２５で発振させる同期信号
を映像信号入力から分離した同期信号に同期させるため
に、一般的にＰＬＬ（位相同期）回路が使用されてい
た。
離回路は、図３に示すように映像信号入力に対してロー
パスフィルタ２４で同期信号を分離し、ＡＦＣ回路２５
で分離された同期信号に同期させて同期信号を発振さ
せ、発振させた同期信号に基づき偏向回路を動作させる
ようにしていた。ＡＦＣ回路２５で発振させる同期信号
を映像信号入力から分離した同期信号に同期させるため
に、一般的にＰＬＬ（位相同期）回路が使用されてい
た。
【０００３】
【発明が解決しようとする課題】ところが、ＰＬＬ回路
は、ループフィルタの帯域幅を狭くしてＰＬＬ回路の引
込時間を長くして雑音の影響を受けないようにすると、
ＶＴＲ信号再生時にはＶＴＲ特有のテープの伸び縮み等
により、同期信号の位置がずれたものになるため、ＰＬ
Ｌ回路で正確に位相同期させることが困難となり、表示
画像において頭曲がりが発生するといった問題点があっ
た。しかし、垂直方向の表示率が低い場合は、頭曲がり
の部分が隠れて画面に現れなかったが、プラズマディス
プレイ等の垂直方向の表示率の高い表示装置において
は、画面に表示されるようになるといった問題点があっ
た。このため、ループフィルタの帯域幅を広くして、Ｐ
ＬＬ回路の引込時間を速くするといった方法を用いれ
ば、頭曲がりの発生を防止することができるが、雑音の
影響を受け易くなって弱電界のときに正確な同期分離が
できなくなるため、表示画像が不安定になるといった問
題点があった。本発明は、映像信号入力のＳ／Ｎにより
同期分離回路を切り換えて同期信号を出力することによ
り、ＶＴＲ再生時には画像の頭曲がりが発生しないよう
にし、映像信号入力のＳ／Ｎが劣化している場合は同期
を安定させ画像を見やすくすることが可能な同期分離回
路を提供することを目的とする。
は、ループフィルタの帯域幅を狭くしてＰＬＬ回路の引
込時間を長くして雑音の影響を受けないようにすると、
ＶＴＲ信号再生時にはＶＴＲ特有のテープの伸び縮み等
により、同期信号の位置がずれたものになるため、ＰＬ
Ｌ回路で正確に位相同期させることが困難となり、表示
画像において頭曲がりが発生するといった問題点があっ
た。しかし、垂直方向の表示率が低い場合は、頭曲がり
の部分が隠れて画面に現れなかったが、プラズマディス
プレイ等の垂直方向の表示率の高い表示装置において
は、画面に表示されるようになるといった問題点があっ
た。このため、ループフィルタの帯域幅を広くして、Ｐ
ＬＬ回路の引込時間を速くするといった方法を用いれ
ば、頭曲がりの発生を防止することができるが、雑音の
影響を受け易くなって弱電界のときに正確な同期分離が
できなくなるため、表示画像が不安定になるといった問
題点があった。本発明は、映像信号入力のＳ／Ｎにより
同期分離回路を切り換えて同期信号を出力することによ
り、ＶＴＲ再生時には画像の頭曲がりが発生しないよう
にし、映像信号入力のＳ／Ｎが劣化している場合は同期
を安定させ画像を見やすくすることが可能な同期分離回
路を提供することを目的とする。
【０００４】
【課題を解決するための手段】本願第１の発明の同期分
離回路は、映像信号入力から同期信号を分離する同期分
離部と、この同期分離部からの入力に同期させた同期信
号を発生させるＡＦＣ回路部と、前記映像信号入力の同
期信号部分のレベルをクランプしスライスして同期信号
を抽出する同期信号抽出手段と、前記ＡＦＣ回路部から
の入力と前記同期信号抽出手段からの入力とを切り換え
て出力する切換器と、前記映像信号入力のＳ／Ｎと基準
のＳ／Ｎレベルとの大小を判定して前記切換器を切り換
える制御信号を出力するＳ／Ｎ判定部とを備えたことを
特徴とする。本願第２の発明の同期分離回路は、映像信
号入力から同期信号を分離する同期分離部と、この同期
分離部からの入力に同期させた同期信号を発生させる、
各々異なるループ帯域幅を有する複数のＡＦＣ回路部
と、これらのＡＦＣ回路部からの入力を切り換えて出力
する切換器と、前記映像信号入力のＳ／Ｎと基準のＳ／
Ｎレベルとの大小を判定して前記切換器を切り換える制
御信号を出力するＳ／Ｎ判定部とを備えたことを特徴と
する。
離回路は、映像信号入力から同期信号を分離する同期分
離部と、この同期分離部からの入力に同期させた同期信
号を発生させるＡＦＣ回路部と、前記映像信号入力の同
期信号部分のレベルをクランプしスライスして同期信号
を抽出する同期信号抽出手段と、前記ＡＦＣ回路部から
の入力と前記同期信号抽出手段からの入力とを切り換え
て出力する切換器と、前記映像信号入力のＳ／Ｎと基準
のＳ／Ｎレベルとの大小を判定して前記切換器を切り換
える制御信号を出力するＳ／Ｎ判定部とを備えたことを
特徴とする。本願第２の発明の同期分離回路は、映像信
号入力から同期信号を分離する同期分離部と、この同期
分離部からの入力に同期させた同期信号を発生させる、
各々異なるループ帯域幅を有する複数のＡＦＣ回路部
と、これらのＡＦＣ回路部からの入力を切り換えて出力
する切換器と、前記映像信号入力のＳ／Ｎと基準のＳ／
Ｎレベルとの大小を判定して前記切換器を切り換える制
御信号を出力するＳ／Ｎ判定部とを備えたことを特徴と
する。
【０００５】本願第３の発明の同期分離回路は、前記Ｓ
／Ｎ判定部が前記ＡＦＣ回路部からの入力、あるいは前
記同期分離部からの入力により映像信号入力の信号の平
坦部を抽出する平坦部抽出手段と、この平坦部抽出手段
で抽出された映像信号入力の平坦部分のみを所定期間に
わたって積分する積分回路と、この積分回路からの入力
に対し基準のＳ／Ｎレベルと入力信号のＳ／Ｎの大小を
判定して制御信号を出力するＳ／Ｎ判定回路とからな
り、このＳ／Ｎ判定回路からの制御信号を前記切換器に
入力して、前記切換器をＳ／Ｎに応じて切り換えて同期
信号を出力することを特徴とする。本願第４の発明の同
期分離回路は、前記Ｓ／Ｎ判定回路から出力される制御
信号を保持する保持手段を設けて、この保持手段により
制御信号を保持して前記Ｓ／Ｎ判定回路に入力し、この
入力に応じて前記Ｓ／Ｎ判定回路の基準のＳ／Ｎレベル
を変化させてこのＳ／Ｎ判定回路から出力される制御信
号にヒステリシス特性を持たせることを特徴とする。本
願第５の発明の同期分離回路は、前記平坦部抽出手段が
前記ＡＦＣ回路部からの入力、あるいは前記同期分離部
からの入力に対し、ブランキング期間の無信号部分、若
しくは同期信号部を検出する平坦部検出回路と、前記映
像信号の供給回路に設けられ、前記平坦部検出回路から
の検出信号により開閉するスイッチとからなり、このス
イッチの出力から映像信号入力の信号の平坦部を抽出し
て出力することを特徴とする。
／Ｎ判定部が前記ＡＦＣ回路部からの入力、あるいは前
記同期分離部からの入力により映像信号入力の信号の平
坦部を抽出する平坦部抽出手段と、この平坦部抽出手段
で抽出された映像信号入力の平坦部分のみを所定期間に
わたって積分する積分回路と、この積分回路からの入力
に対し基準のＳ／Ｎレベルと入力信号のＳ／Ｎの大小を
判定して制御信号を出力するＳ／Ｎ判定回路とからな
り、このＳ／Ｎ判定回路からの制御信号を前記切換器に
入力して、前記切換器をＳ／Ｎに応じて切り換えて同期
信号を出力することを特徴とする。本願第４の発明の同
期分離回路は、前記Ｓ／Ｎ判定回路から出力される制御
信号を保持する保持手段を設けて、この保持手段により
制御信号を保持して前記Ｓ／Ｎ判定回路に入力し、この
入力に応じて前記Ｓ／Ｎ判定回路の基準のＳ／Ｎレベル
を変化させてこのＳ／Ｎ判定回路から出力される制御信
号にヒステリシス特性を持たせることを特徴とする。本
願第５の発明の同期分離回路は、前記平坦部抽出手段が
前記ＡＦＣ回路部からの入力、あるいは前記同期分離部
からの入力に対し、ブランキング期間の無信号部分、若
しくは同期信号部を検出する平坦部検出回路と、前記映
像信号の供給回路に設けられ、前記平坦部検出回路から
の検出信号により開閉するスイッチとからなり、このス
イッチの出力から映像信号入力の信号の平坦部を抽出し
て出力することを特徴とする。
【０００６】
【作用】本発明は上記した構成により同期信号を出力す
るようにし、Ｓ／Ｎ判定部で映像信号入力のＳ／Ｎを判
定し、映像信号入力のＳ／Ｎが基準のＳ／Ｎレベルより
大きいとき、又はＶＴＲ信号再生時は、同期信号抽出手
段からの同期信号、あるいはループ帯域幅の広くしたＡ
ＦＣ回路部からの同期信号が切換器から出力されるよう
にしており、従ってＰＬＬ回路を通していないため、あ
るいはループ帯域幅の広いＡＦＣ回路部からの同期信号
が切換器から出力されるようにしており、ＶＴＲ信号再
生時に発生する画像の頭曲がりを防止、あるいは軽減す
ることができる。映像信号入力のＳ／Ｎが基準のＳ／Ｎ
レベルより小さいときは、同期信号抽出手段からの同期
信号を切り換えてＡＦＣ回路部からの同期信号、あるい
はループ帯域幅を狭くしたＡＦＣ回路部からの同期信号
が切換器から出力されるようにしており、従って弱電界
等において映像信号入力のＳ／Ｎが劣化しているときに
も雑音の影響を受けないようにして同期信号を出力でき
るため、表示画像を安定させることが可能となる。
るようにし、Ｓ／Ｎ判定部で映像信号入力のＳ／Ｎを判
定し、映像信号入力のＳ／Ｎが基準のＳ／Ｎレベルより
大きいとき、又はＶＴＲ信号再生時は、同期信号抽出手
段からの同期信号、あるいはループ帯域幅の広くしたＡ
ＦＣ回路部からの同期信号が切換器から出力されるよう
にしており、従ってＰＬＬ回路を通していないため、あ
るいはループ帯域幅の広いＡＦＣ回路部からの同期信号
が切換器から出力されるようにしており、ＶＴＲ信号再
生時に発生する画像の頭曲がりを防止、あるいは軽減す
ることができる。映像信号入力のＳ／Ｎが基準のＳ／Ｎ
レベルより小さいときは、同期信号抽出手段からの同期
信号を切り換えてＡＦＣ回路部からの同期信号、あるい
はループ帯域幅を狭くしたＡＦＣ回路部からの同期信号
が切換器から出力されるようにしており、従って弱電界
等において映像信号入力のＳ／Ｎが劣化しているときに
も雑音の影響を受けないようにして同期信号を出力でき
るため、表示画像を安定させることが可能となる。
【０００７】
【実施例】以下、実施例について図面を参照して説明す
る。図１は、本発明の同期分離回路の第１の実施例を示
すブロック図である。入力端子１にはコンポジットの映
像信号が入力されており、この映像信号入力を分岐させ
て第１を同期分離部２に入力し、同期分離部２で映像信
号入力から同期信号を分離してＡＦＣ回路部３に入力し
ている。ＡＦＣ回路部３では、同期分離部２で分離した
水平同期信号及び垂直同期信号に対して、各々ＡＦＣ回
路を設けて自動周波数制御を行うようにし、あるいは垂
直同期信号はＡＦＣ回路をパススルーさせて水平同期信
号に対してのみ自動周波数制御を行うようにする。
る。図１は、本発明の同期分離回路の第１の実施例を示
すブロック図である。入力端子１にはコンポジットの映
像信号が入力されており、この映像信号入力を分岐させ
て第１を同期分離部２に入力し、同期分離部２で映像信
号入力から同期信号を分離してＡＦＣ回路部３に入力し
ている。ＡＦＣ回路部３では、同期分離部２で分離した
水平同期信号及び垂直同期信号に対して、各々ＡＦＣ回
路を設けて自動周波数制御を行うようにし、あるいは垂
直同期信号はＡＦＣ回路をパススルーさせて水平同期信
号に対してのみ自動周波数制御を行うようにする。
【０００８】ＡＦＣ回路部３では発振回路とＰＬＬ回路
を用い、入力された同期信号に位相同期させた同期信号
を発生させて自動周波数制御を行って出力し、同出力を
分岐させて一方を切換器１１の入力端子の一方に入力
し、他方をＳ／Ｎ判定部９に入力している。映像信号入
力を分岐させた第２を同期信号抽出手段に入力し、同期
信号抽出手段としては同期クランプ及びレベルスライス
回路４を使用し、同期クランプ及びレベルスライス回路
４では映像信号入力の同期信号部分をクランプしてレベ
ルを一定にし、レベルを一定にした同期信号部分をスラ
イスして同期信号部分を抽出して出力し、切換器１１の
入力端子の他方に入力している。
を用い、入力された同期信号に位相同期させた同期信号
を発生させて自動周波数制御を行って出力し、同出力を
分岐させて一方を切換器１１の入力端子の一方に入力
し、他方をＳ／Ｎ判定部９に入力している。映像信号入
力を分岐させた第２を同期信号抽出手段に入力し、同期
信号抽出手段としては同期クランプ及びレベルスライス
回路４を使用し、同期クランプ及びレベルスライス回路
４では映像信号入力の同期信号部分をクランプしてレベ
ルを一定にし、レベルを一定にした同期信号部分をスラ
イスして同期信号部分を抽出して出力し、切換器１１の
入力端子の他方に入力している。
【０００９】Ｓ／Ｎ判定部９としては平坦部抽出手段
と、この平坦部抽出手段で抽出された映像信号入力の平
坦部分のみを所定期間にわたって積分する積分回路６
と、この積分回路６からの入力に対し基準のＳ／Ｎレベ
ルと入力信号のＳ／Ｎの大小を判定して制御信号を出力
するＳ／Ｎ判定回路７とで構成し、平坦部抽出手段はス
イッチ５と平坦部検出回路８とで構成し、ＡＦＣ回路部
３の出力を分岐させて平坦部検出回路８に入力し、平坦
部検出回路８では入力された水平同期信号及び垂直同期
信号をカウントして、ブランキング期間の無信号部分、
若しくは同期信号部を検出して映像信号の平坦部の期間
に相当する平坦部信号を生成し、スイッチ５に制御信号
として入力している。映像信号入力を分岐させた第３を
スイッチ５の入力端子に入力し、平坦部検出回路８から
入力される制御信号により、ブランキング期間の無信号
部分、若しくは同期信号部分の期間のみスイッチ５が導
通状態になるようにして、スイッチ５から映像信号入力
の信号の平坦部のみを抽出して積分回路６に入力してい
る。
と、この平坦部抽出手段で抽出された映像信号入力の平
坦部分のみを所定期間にわたって積分する積分回路６
と、この積分回路６からの入力に対し基準のＳ／Ｎレベ
ルと入力信号のＳ／Ｎの大小を判定して制御信号を出力
するＳ／Ｎ判定回路７とで構成し、平坦部抽出手段はス
イッチ５と平坦部検出回路８とで構成し、ＡＦＣ回路部
３の出力を分岐させて平坦部検出回路８に入力し、平坦
部検出回路８では入力された水平同期信号及び垂直同期
信号をカウントして、ブランキング期間の無信号部分、
若しくは同期信号部を検出して映像信号の平坦部の期間
に相当する平坦部信号を生成し、スイッチ５に制御信号
として入力している。映像信号入力を分岐させた第３を
スイッチ５の入力端子に入力し、平坦部検出回路８から
入力される制御信号により、ブランキング期間の無信号
部分、若しくは同期信号部分の期間のみスイッチ５が導
通状態になるようにして、スイッチ５から映像信号入力
の信号の平坦部のみを抽出して積分回路６に入力してい
る。
【００１０】積分回路６では映像信号入力の信号の平坦
部を所定期間にわたって積分するようにしており、積分
回路６としては加算器及びラッチ回路等を用いて、例え
ば１フィールド、若しくは数フレーム間を積分するよう
にし、積分した信号をＳ／Ｎ判定回路７に入力してい
る。Ｓ／Ｎ判定回路７は基準のＳ／Ｎレベルと入力信号
のＳ／Ｎの大小を判定して、制御信号を出力し切換器１
１に入力して、切換器１１に入力されているＡＦＣ回路
部３からの入力と、同期クランプ及びレベルスライス回
路４からの入力とを選択して出力する。入力信号のＳ／
Ｎが基準のＳ／Ｎレベルより大きいとき、すなわち信号
成分に対してノイズが少ないとき、又はＶＴＲ信号再生
時は、同期クランプ及びレベルスライス回路４からの同
期信号が切換器１１から出力され、入力信号のＳ／Ｎが
基準のＳ／Ｎレベルより小さいとき、すなわち弱電界等
により信号成分に対してノイズが大きいときは、ＡＦＣ
回路部３からの同期信号が切換器１１から出力される。
部を所定期間にわたって積分するようにしており、積分
回路６としては加算器及びラッチ回路等を用いて、例え
ば１フィールド、若しくは数フレーム間を積分するよう
にし、積分した信号をＳ／Ｎ判定回路７に入力してい
る。Ｓ／Ｎ判定回路７は基準のＳ／Ｎレベルと入力信号
のＳ／Ｎの大小を判定して、制御信号を出力し切換器１
１に入力して、切換器１１に入力されているＡＦＣ回路
部３からの入力と、同期クランプ及びレベルスライス回
路４からの入力とを選択して出力する。入力信号のＳ／
Ｎが基準のＳ／Ｎレベルより大きいとき、すなわち信号
成分に対してノイズが少ないとき、又はＶＴＲ信号再生
時は、同期クランプ及びレベルスライス回路４からの同
期信号が切換器１１から出力され、入力信号のＳ／Ｎが
基準のＳ／Ｎレベルより小さいとき、すなわち弱電界等
により信号成分に対してノイズが大きいときは、ＡＦＣ
回路部３からの同期信号が切換器１１から出力される。
【００１１】Ｓ／Ｎ判定回路７で基準のＳ／Ｎレベルと
入力信号のＳ／Ｎの大小を判定して、切換器１１を切り
換えて制御するのみであると、切換器１１が頻繁に切り
換えられて画像が不安定となる恐れがあるため、Ｓ／Ｎ
判定回路７から出力される制御信号にヒステリシス特性
を持たせて切換器１１を切り換えるようにする。Ｓ／Ｎ
判定回路７から出力される制御信号を保持する保持手段
としてラッチ回路１０を設けて、ラッチ回路１０でＳ／
Ｎ判定回路７から出力される制御信号、例えばＨレベル
あるいはＬレベルの制御信号をラッチ回路１０でラッチ
してＳ／Ｎ判定回路７に入力する。Ｓ／Ｎ判定回路７で
基準のＳ／Ｎレベルを例えば３５ｄＢと４０ｄＢとし、
入力信号のＳ／Ｎが３５ｄＢ未満のときはＬレベルの制
御信号を出力するようにし、入力信号のＳ／Ｎが４０ｄ
Ｂを超えるときはＨレベルの制御信号を出力するように
し、３５ｄＢと４０ｄＢの間であるときはラッチ回路１
０から入力される信号が出力されるようにして、Ｓ／Ｎ
判定回路７から出力される制御信号にヒステリシス特性
を持たせて切換器１１を切り換えるようにする。
入力信号のＳ／Ｎの大小を判定して、切換器１１を切り
換えて制御するのみであると、切換器１１が頻繁に切り
換えられて画像が不安定となる恐れがあるため、Ｓ／Ｎ
判定回路７から出力される制御信号にヒステリシス特性
を持たせて切換器１１を切り換えるようにする。Ｓ／Ｎ
判定回路７から出力される制御信号を保持する保持手段
としてラッチ回路１０を設けて、ラッチ回路１０でＳ／
Ｎ判定回路７から出力される制御信号、例えばＨレベル
あるいはＬレベルの制御信号をラッチ回路１０でラッチ
してＳ／Ｎ判定回路７に入力する。Ｓ／Ｎ判定回路７で
基準のＳ／Ｎレベルを例えば３５ｄＢと４０ｄＢとし、
入力信号のＳ／Ｎが３５ｄＢ未満のときはＬレベルの制
御信号を出力するようにし、入力信号のＳ／Ｎが４０ｄ
Ｂを超えるときはＨレベルの制御信号を出力するように
し、３５ｄＢと４０ｄＢの間であるときはラッチ回路１
０から入力される信号が出力されるようにして、Ｓ／Ｎ
判定回路７から出力される制御信号にヒステリシス特性
を持たせて切換器１１を切り換えるようにする。
【００１２】従って、３５ｄＢ及び４０ｄＢの基準値の
境界で切換器１１が頻繁に切り換えられるといったこと
を防止することができ、安定した水平同期信号及び垂直
同期信号を切換器１１の出力端子１２から出力すること
ができる。あるいは、垂直同期信号は同期分離部２から
出力するようにし、水平同期信号は出力端子１２から出
力するようにして同期信号を分離させて出力するように
しても良い。
境界で切換器１１が頻繁に切り換えられるといったこと
を防止することができ、安定した水平同期信号及び垂直
同期信号を切換器１１の出力端子１２から出力すること
ができる。あるいは、垂直同期信号は同期分離部２から
出力するようにし、水平同期信号は出力端子１２から出
力するようにして同期信号を分離させて出力するように
しても良い。
【００１３】また、映像信号入力のＳ／Ｎにより同期分
離回路を切り換えて同期信号を抽出することが可能とな
り、弱電界時のＳ／ＮをＳ／Ｎ判定部９で検出して、Ａ
ＦＣ回路部３からの同期信号が出力されるようにしてお
り、雑音の影響を受けないように安定した同期信号を出
力することができる。さらに、ＶＴＲ信号再生時等で入
力される映像信号のＳ／Ｎが良好な場合は、同期クラン
プ及びレベルスライス回路４からの同期信号が出力され
るようにしており、ＰＬＬ回路を通していないため表示
画像において頭曲がりが発生するといった問題を排除す
ることができる。
離回路を切り換えて同期信号を抽出することが可能とな
り、弱電界時のＳ／ＮをＳ／Ｎ判定部９で検出して、Ａ
ＦＣ回路部３からの同期信号が出力されるようにしてお
り、雑音の影響を受けないように安定した同期信号を出
力することができる。さらに、ＶＴＲ信号再生時等で入
力される映像信号のＳ／Ｎが良好な場合は、同期クラン
プ及びレベルスライス回路４からの同期信号が出力され
るようにしており、ＰＬＬ回路を通していないため表示
画像において頭曲がりが発生するといった問題を排除す
ることができる。
【００１４】図２は、本発明の同期分離回路の第２の実
施例を示すブロック図であり、図中、図１で示したもの
と同一のものは同一の符号を付して説明を省略する。図
１の実施例との相違点はＡＦＣ回路部３として、各々異
なるループ帯域幅を有する複数のＡＦＣ回路部１３
（Ａ）〜１３（Ｎ）を設けて、これらを映像信号入力の
Ｓ／Ｎにより選択して同期信号を出力するようにした点
である。例えば、ＡＦＣ回路部１３（Ａ）のループ帯域
幅を最も狭くし、以下、ＡＦＣ回路部１３（Ｂ）〜１３
（Ｎ）の順に広くして行き、ＡＦＣ回路部１３（Ｎ）の
ループ帯域幅を最も広くし、同期分離部２で映像信号入
力から同期信号を分離して、各々異なるループ帯域幅を
有するＮ個のＡＦＣ回路部１３（Ａ）〜１３（Ｎ）に入
力し、各ＡＦＣ回路部１３（Ａ）〜１３（Ｎ）を切換器
１４の入力側に接続している。
施例を示すブロック図であり、図中、図１で示したもの
と同一のものは同一の符号を付して説明を省略する。図
１の実施例との相違点はＡＦＣ回路部３として、各々異
なるループ帯域幅を有する複数のＡＦＣ回路部１３
（Ａ）〜１３（Ｎ）を設けて、これらを映像信号入力の
Ｓ／Ｎにより選択して同期信号を出力するようにした点
である。例えば、ＡＦＣ回路部１３（Ａ）のループ帯域
幅を最も狭くし、以下、ＡＦＣ回路部１３（Ｂ）〜１３
（Ｎ）の順に広くして行き、ＡＦＣ回路部１３（Ｎ）の
ループ帯域幅を最も広くし、同期分離部２で映像信号入
力から同期信号を分離して、各々異なるループ帯域幅を
有するＮ個のＡＦＣ回路部１３（Ａ）〜１３（Ｎ）に入
力し、各ＡＦＣ回路部１３（Ａ）〜１３（Ｎ）を切換器
１４の入力側に接続している。
【００１５】図１のＳ／Ｎ判定部９とほぼ同様にＳ／Ｎ
判定部１８を構成し、Ｓ／Ｎ判定部１８の平坦部検出回
路１７には同期分離部２で分離した同期信号を入力し、
平坦部検出回路１７では入力された水平同期信号及び垂
直同期信号をカウントして、ブランキング期間の無信号
部分、若しくは同期信号部を検出して映像信号の平坦部
の期間に相当する平坦部信号を生成し、スイッチ５に制
御信号として入力している。Ｓ／Ｎ判定回路１６には、
ＡＦＣ回路部１３（Ａ）〜１３（Ｎ）の各々に対応させ
て例えばＡ〜Ｎ迄の基準のＳ／Ｎレベルを設けて、Ａ，
Ｂ，Ｃ，〜Ｍ，Ｎ迄の基準のＳ／Ｎレベルと積分回路６
からの入力信号のＳ／Ｎの大小を判定して、制御信号を
出力し切換器１４に入力して、切換器１４に接続されて
いるＡＦＣ回路部１３（Ａ）〜１３（Ｎ）からの入力を
選択して出力する。
判定部１８を構成し、Ｓ／Ｎ判定部１８の平坦部検出回
路１７には同期分離部２で分離した同期信号を入力し、
平坦部検出回路１７では入力された水平同期信号及び垂
直同期信号をカウントして、ブランキング期間の無信号
部分、若しくは同期信号部を検出して映像信号の平坦部
の期間に相当する平坦部信号を生成し、スイッチ５に制
御信号として入力している。Ｓ／Ｎ判定回路１６には、
ＡＦＣ回路部１３（Ａ）〜１３（Ｎ）の各々に対応させ
て例えばＡ〜Ｎ迄の基準のＳ／Ｎレベルを設けて、Ａ，
Ｂ，Ｃ，〜Ｍ，Ｎ迄の基準のＳ／Ｎレベルと積分回路６
からの入力信号のＳ／Ｎの大小を判定して、制御信号を
出力し切換器１４に入力して、切換器１４に接続されて
いるＡＦＣ回路部１３（Ａ）〜１３（Ｎ）からの入力を
選択して出力する。
【００１６】例えば、映像信号入力のＳ／ＮがＡより小
さい場合はＡＦＣ回路部１３（Ａ）からの同期信号が切
換器１４から出力されるようにし、映像信号入力のＳ／
ＮがＡより大きく、Ｂより小さい場合はＡＦＣ回路部１
３（Ｂ）からの同期信号が切換器１４から出力されるよ
うにし、順次映像信号入力のＳ／ＮによりＡＦＣ回路部
１３（Ａ）〜（Ｎ）を選択し、映像信号入力のＳ／Ｎが
Ｍより大きく場合は、ＡＦＣ回路部１３（Ｎ）からの同
期信号が切換器１４から出力されるようにする。Ｓ／Ｎ
判定回路１６で基準のＳ／Ｎレベルと入力信号のＳ／Ｎ
の大小を判定して、切換器１４を切り換えて制御するの
みであると、切換器１４が頻繁に切り換えられて画像が
不安定となる恐れがあるため、図１の実施例と同様にＳ
／Ｎ判定回路１６から出力される制御信号にヒステリシ
ス特性を持たせて切換器１４を切り換えるため、Ｓ／Ｎ
判定回路１６から出力される制御信号を保持する保持手
段としてラッチ回路１９を設けるようにしても良い。
さい場合はＡＦＣ回路部１３（Ａ）からの同期信号が切
換器１４から出力されるようにし、映像信号入力のＳ／
ＮがＡより大きく、Ｂより小さい場合はＡＦＣ回路部１
３（Ｂ）からの同期信号が切換器１４から出力されるよ
うにし、順次映像信号入力のＳ／ＮによりＡＦＣ回路部
１３（Ａ）〜（Ｎ）を選択し、映像信号入力のＳ／Ｎが
Ｍより大きく場合は、ＡＦＣ回路部１３（Ｎ）からの同
期信号が切換器１４から出力されるようにする。Ｓ／Ｎ
判定回路１６で基準のＳ／Ｎレベルと入力信号のＳ／Ｎ
の大小を判定して、切換器１４を切り換えて制御するの
みであると、切換器１４が頻繁に切り換えられて画像が
不安定となる恐れがあるため、図１の実施例と同様にＳ
／Ｎ判定回路１６から出力される制御信号にヒステリシ
ス特性を持たせて切換器１４を切り換えるため、Ｓ／Ｎ
判定回路１６から出力される制御信号を保持する保持手
段としてラッチ回路１９を設けるようにしても良い。
【００１７】この場合にはＡ〜Ｎ迄の基準のＳ／Ｎレベ
ルに対して各基準値間に中間の値になる場合、ラッチ回
路１９から入力される信号がＳ／Ｎ判定回路１６から出
力されるようにする。従って、図１の実施例と同様に、
各基準値の境界で切換器１４が頻繁に切り換えられると
いったことを防止することができ、安定した水平同期信
号及び垂直同期信号を切換器１４の出力端子１５から出
力することができる。
ルに対して各基準値間に中間の値になる場合、ラッチ回
路１９から入力される信号がＳ／Ｎ判定回路１６から出
力されるようにする。従って、図１の実施例と同様に、
各基準値の境界で切換器１４が頻繁に切り換えられると
いったことを防止することができ、安定した水平同期信
号及び垂直同期信号を切換器１４の出力端子１５から出
力することができる。
【００１８】また、映像信号入力のＳ／Ｎにより同期分
離回路を切り換えて同期信号を出力することが可能とな
り、弱電界時のＳ／ＮをＳ／Ｎ判定部１８で検出して、
ＡＦＣ回路部１３（Ａ）からの同期信号が出力されるよ
うにしており、雑音の影響を受けないように安定した同
期信号を出力することができる。さらに、ＶＴＲ信号再
生時等で入力される映像信号のＳ／Ｎが良好な場合は、
ＡＦＣ回路部１３（Ｎ）からの同期信号が出力されるよ
うにしており、ＡＦＣ回路部１３（Ｎ）はループ帯域幅
を最も広くしてあり、従って、表示画像において発生す
る頭曲がりを軽減することができる。
離回路を切り換えて同期信号を出力することが可能とな
り、弱電界時のＳ／ＮをＳ／Ｎ判定部１８で検出して、
ＡＦＣ回路部１３（Ａ）からの同期信号が出力されるよ
うにしており、雑音の影響を受けないように安定した同
期信号を出力することができる。さらに、ＶＴＲ信号再
生時等で入力される映像信号のＳ／Ｎが良好な場合は、
ＡＦＣ回路部１３（Ｎ）からの同期信号が出力されるよ
うにしており、ＡＦＣ回路部１３（Ｎ）はループ帯域幅
を最も広くしてあり、従って、表示画像において発生す
る頭曲がりを軽減することができる。
【００１９】
【発明の効果】以上説明したように、本発明によれば映
像信号入力のＳ／Ｎにより同期分離回路を切り換えて同
期信号を出力するようにしており、映像信号入力のＳ／
Ｎが基準のＳ／Ｎレベルより大きいときは、同期信号抽
出手段からの同期信号が出力されるようにしており、従
ってＰＬＬ回路を通していないためＶＴＲ信号再生時に
発生する画像の頭曲がりを防止することができ、映像信
号入力のＳ／Ｎが基準のＳ／Ｎレベルより小さいとき
は、ＡＦＣ回路部からの同期信号が出力されるようにし
ており、従って弱電界のときにも雑音の影響を受けない
ようにして同期信号を出力できるため表示画像を安定さ
せることができる。又は、映像信号入力のＳ／Ｎが基準
のＳ／Ｎレベルより大きいときは、ループ帯域幅の広い
ＡＦＣ回路部からの同期信号が出力されるようにして、
ＶＴＲ信号再生時に発生する画像の頭曲がりを軽減さ
せ、映像信号入力のＳ／Ｎが基準のＳ／Ｎレベルより小
さいときは、ループ帯域幅を狭くしたＡＦＣ回路部から
の同期信号が出力されるようにしており、従って弱電界
のときにも雑音の影響を受けないようにして同期信号を
出力できるため表示画像を安定させることができる。
像信号入力のＳ／Ｎにより同期分離回路を切り換えて同
期信号を出力するようにしており、映像信号入力のＳ／
Ｎが基準のＳ／Ｎレベルより大きいときは、同期信号抽
出手段からの同期信号が出力されるようにしており、従
ってＰＬＬ回路を通していないためＶＴＲ信号再生時に
発生する画像の頭曲がりを防止することができ、映像信
号入力のＳ／Ｎが基準のＳ／Ｎレベルより小さいとき
は、ＡＦＣ回路部からの同期信号が出力されるようにし
ており、従って弱電界のときにも雑音の影響を受けない
ようにして同期信号を出力できるため表示画像を安定さ
せることができる。又は、映像信号入力のＳ／Ｎが基準
のＳ／Ｎレベルより大きいときは、ループ帯域幅の広い
ＡＦＣ回路部からの同期信号が出力されるようにして、
ＶＴＲ信号再生時に発生する画像の頭曲がりを軽減さ
せ、映像信号入力のＳ／Ｎが基準のＳ／Ｎレベルより小
さいときは、ループ帯域幅を狭くしたＡＦＣ回路部から
の同期信号が出力されるようにしており、従って弱電界
のときにも雑音の影響を受けないようにして同期信号を
出力できるため表示画像を安定させることができる。
【図１】本発明の同期分離回路の第１の実施例を示すブ
ロック図である。
ロック図である。
【図２】本発明の同期分離回路の第２の実施例を示すブ
ロック図である。
ロック図である。
【図３】従来例を示す同期分離回路のブロック図であ
る。
る。
１ 入力端子 ２ 同期分離部 ３ ＡＦＣ回路部 ４ 同期クランプ及びレベルスライス回路 ５ スイッチ ６ 積分器 ７ Ｓ／Ｎ判定回路 ８ 平坦部検出回路 ９ Ｓ／Ｎ判定部 １０ ラッチ回路 １１ 切換器 １２ 出力端子 １３ ＡＦＣ回路部 １４ 切換器 １５ 出力端子 １６ Ｓ／Ｎ判定回路 １７ 平坦部検出回路 １８ Ｓ／Ｎ判定部 １９ ラッチ回路 ２４ ローパスフィルタ ２５ ＡＦＣ回路
Claims (5)
- 【請求項１】 映像信号入力から同期信号を分離する同
期分離部と、この同期分離部からの入力に同期させた同
期信号を発生させるＡＦＣ回路部と、前記映像信号入力
の同期信号部分のレベルをクランプしスライスして同期
信号を抽出する同期信号抽出手段と、前記ＡＦＣ回路部
からの入力と前記同期信号抽出手段からの入力とを切り
換えて出力する切換器と、前記映像信号入力のＳ／Ｎと
基準のＳ／Ｎレベルとの大小を判定して前記切換器を切
り換える制御信号を出力するＳ／Ｎ判定部とを備えたこ
とを特徴とする同期分離回路。 - 【請求項２】 映像信号入力から同期信号を分離する同
期分離部と、この同期分離部からの入力に同期させた同
期信号を発生させる、各々異なるループ帯域幅を有する
複数のＡＦＣ回路部と、これらのＡＦＣ回路部からの入
力を切り換えて出力する切換器と、前記映像信号入力の
Ｓ／Ｎと基準のＳ／Ｎレベルとの大小を判定して前記切
換器を切り換える制御信号を出力するＳ／Ｎ判定部とを
備えたことを特徴とする同期分離回路。 - 【請求項３】 前記Ｓ／Ｎ判定部が前記ＡＦＣ回路部か
らの入力、あるいは前記同期分離部からの入力により映
像信号入力の信号の平坦部を抽出する平坦部抽出手段
と、この平坦部抽出手段で抽出された映像信号入力の平
坦部分のみを所定期間にわたって積分する積分回路と、
この積分回路からの入力に対し基準のＳ／Ｎレベルと入
力信号のＳ／Ｎの大小を判定して制御信号を出力するＳ
／Ｎ判定回路とからなり、このＳ／Ｎ判定回路からの制
御信号を前記切換器に入力して、前記切換器をＳ／Ｎに
応じて切り換えて同期信号を出力することを特徴とする
請求項１又は２記載の同期分離回路。 - 【請求項４】 前記Ｓ／Ｎ判定回路から出力される制御
信号を保持する保持手段を設けて、この保持手段により
制御信号を保持して前記Ｓ／Ｎ判定回路に入力し、この
入力に応じて前記Ｓ／Ｎ判定回路の基準のＳ／Ｎレベル
を変化させてこのＳ／Ｎ判定回路から出力される制御信
号にヒステリシス特性を持たせることを特徴とする請求
項３記載の同期分離回路。 - 【請求項５】 前記平坦部抽出手段が前記ＡＦＣ回路部
からの入力、あるいは前記同期分離部からの入力に対
し、ブランキング期間の無信号部分、若しくは同期信号
部を検出する平坦部検出回路と、前記映像信号の供給回
路に設けられ、前記平坦部検出回路からの検出信号によ
り開閉するスイッチとからなり、このスイッチの出力か
ら映像信号入力の信号の平坦部を抽出して出力すること
を特徴とする請求項３記載の同期分離回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8208794A JPH07298091A (ja) | 1994-04-20 | 1994-04-20 | 同期分離回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8208794A JPH07298091A (ja) | 1994-04-20 | 1994-04-20 | 同期分離回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH07298091A true JPH07298091A (ja) | 1995-11-10 |
Family
ID=13764667
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP8208794A Pending JPH07298091A (ja) | 1994-04-20 | 1994-04-20 | 同期分離回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH07298091A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100555455B1 (ko) * | 1998-11-11 | 2006-04-21 | 삼성전자주식회사 | 동기신호 분리장치 및 방법 |
-
1994
- 1994-04-20 JP JP8208794A patent/JPH07298091A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100555455B1 (ko) * | 1998-11-11 | 2006-04-21 | 삼성전자주식회사 | 동기신호 분리장치 및 방법 |
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