JPH07244298A - アクティブマトリクス液晶表示装置 - Google Patents

アクティブマトリクス液晶表示装置

Info

Publication number
JPH07244298A
JPH07244298A JP3616594A JP3616594A JPH07244298A JP H07244298 A JPH07244298 A JP H07244298A JP 3616594 A JP3616594 A JP 3616594A JP 3616594 A JP3616594 A JP 3616594A JP H07244298 A JPH07244298 A JP H07244298A
Authority
JP
Japan
Prior art keywords
electrode
substrate
signal
pixel
liquid crystal
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP3616594A
Other languages
English (en)
Inventor
Yoshiaki Mikami
佳朗 三上
Keiji Nagae
慶治 長江
Yuji Mori
祐二 森
Kazuhiro Kuwabara
和広 桑原
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
G T C KK
GTC KK
Original Assignee
G T C KK
GTC KK
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by G T C KK, GTC KK filed Critical G T C KK
Priority to JP3616594A priority Critical patent/JPH07244298A/ja
Publication of JPH07244298A publication Critical patent/JPH07244298A/ja
Pending legal-status Critical Current

Links

Landscapes

  • Liquid Crystal (AREA)
  • Thin Film Transistor (AREA)

Abstract

(57)【要約】 【目的】 印刷技術を用いて配線を形成する際に、パタ
ーンの寸法変形や層間合わせの際のずれがあっても表示
特性に欠陥が生じないようにしたアクティブマトリクス
液晶表示装置を提供する。 【構成】 電極1の端部を、導電性薄膜により形成され
てなる、該電極端部よりも大きい形状の電極端被覆部2
によって被覆し、かつ該電極1の長手方向およびそれに
直交する方向の電極端部と電極端被覆部2との大きさの
差5、6がいずれも、画素内の該電極1と薄膜トランジ
スタ素子との該電極直交方向の間隔、および該電極1と
画素内および隣接する画素の表示電極との該電極直交方
向の間隔よりも大きくなるように形成する。

Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】本発明は平面ディスプレイに係
り、特に大面積TFTアクティブマトリクス液晶表示装
置に関する。
【0002】
【従来の技術】従来より、薄膜トランジスタ素子(以
下、TFTと略記する)をスイッチング素子として用い
たアクティブマトリクス液晶表示装置について、多くの
研究、開発がなされている。TFTを備えたアクティブ
マトリクス液晶表示装置は、第1の基板とこれに対向す
る第2の基板との間に液晶材料が狭持されたものであ
る。第1の基板は、ガラス基板上に、複数の走査電極
と、複数の信号電極が行列方向に設けられたもので、こ
れら走査電極と信号電極によって区切られた各画素に
は、TFT素子および表示電極がそれぞれ配されてい
る。そして、TFTは、走査電極、信号電極、および表
示電極と、それぞれ接続されている。また、第2の基板
には対向電極が形成されている。
【0003】そして、TFTとしては多結晶シリコン
(以下、p−Siと略記する)を用いたp−Si TF
Tが有望視されている。p−Si TFTは、アモルフ
ァスSi TFTに比べて、電界効果移動度が約30c
2/V・sと高いので、大面積、高解像度の液晶ディ
スプレイを実現するために有用である。また、電界効果
移動度が高いため、液晶表示パネル部の駆動用周辺回路
をTFTを用いて同一基板上に構成することができ、デ
ィスプレイのコンパクト化、低コスト化にも有効であ
る。
【0004】このようなp−Si TFTの製造方法に
ついてはプロシーディングス オブ1988 インター
ナショナル ディスプレイ リサーチ コンファレンス
215〜219頁に報告がなされている。この方法は、
活性層としてp−Si薄膜を形成するために、まず減圧
CVD法を用いて基板温度500℃で成膜した後、窒素
雰囲気中で600℃で焼成することにより、結晶性を向
上させたSi薄膜を形成する。そして、パターン化した
該p−Si層上に、ゲート絶縁膜、ゲートSi層、層間
絶縁用SiO2層、走査電極、信号電極、および表示電
極等を順次形成する。これらの形成は常圧CVD法、減
圧CVD法等により成膜、パターニングを繰り返し行う
ことによってできる。このようにして、高移動度のp−
SiTFTを作製し、これを用いたTFT液晶表示装置
を実現することができる。
【0005】また、大型のディスプレイを製造する手法
としては、プロシーディングス オブ 1991 イン
ターナショナル ディスプレイ リサーチ コンファレ
ンス227〜230頁に報告がなされている。この方法
によれば、レジストパターン形成時に印刷技術を応用す
ることにより40”以上の対角サイズの基板上に安い装
置コスト、高い生産性でレジストパターンを形成するこ
とができる。しかも、これにより形成できるパターンの
細線幅は最小3μm幅であり、このパターニング技術
と、上述のp−Si TFT製造プロセスを組み合わせ
て、シフトレジスタや回路や、8×8マトリクスの液晶
表示装置を作製する試みがなされている。
【0006】
【発明が解決しようとする課題】しかしながら、上記の
印刷技術を用いてレジストパターンを形成する際には印
刷するレジストパターンの伸縮が重要な問題となる。な
ぜなら、例えば上記の印刷方法としてオフセット印刷法
が用いられるが、オフセット印刷法では印刷の際に、版
上のインキパターンを被印刷物であるガラス基板上に写
しとる転写工程において、インキはブランケットと呼ば
れるゴム製の円筒形のドラム表面を介してガラス基板上
に写しとられる。この時、インキを安定して転写するた
めには基板とブランケットとを密着させるために、転写
中は、基板表面の垂直方向に圧力を印加しなくてはなら
ず、その際にブランケットは回転しながら圧力を受ける
ことにより変形するため、版上のインキパターンと印刷
するレジストパターンとに寸法差が発生することが避け
られない。特にブランケット回転方向の寸法差がこれと
直交する回転軸方向の寸法差よりも大きいため、印刷方
向により精度が異なり、印刷パターンと基板上のパター
ンとのずれがブランケット回転方向において発生する恐
れがあった。特に基板サイズが大型になると寸法差が顕
著に発生する可能性があった。
【0007】本発明は前記事情に鑑みてなされたもの
で、印刷技術を用いて大面積の液晶表示装置を構成する
際に層間合わせ精度が低くても、充分な表示特性を得る
ことができるようにしたアクティブマトリクス液晶表示
装置の提供を目的とする。
【0008】
【課題を解決するための手段】上記課題を解決するため
に、本発明の請求項1に記載のアクティブマトリクス液
晶表示装置は、透明絶縁基板からなる第1の基板上に、
複数の走査電極および複数の信号電極が行列方向に配さ
れ、該走査電極と信号電極とによって区切られてなる各
画素に少なくとも、多結晶シリコン層およびこれに直交
するゲート電極からなる薄膜トランジスタ素子、および
表示電極が設けられ、かつ上記第1の基板に対して、絶
縁基板上に対向電極が設けられてなる第2の基板が対向
配置され、該第1の基板と第2の基板との間に液晶材料
が狭持されてなるアクティブマトリクス液晶表示装置で
あって、上記走査電極の端部が、導電性薄膜により形成
されてなる、該電極端部よりも大きい形状の電極端被覆
部によって被覆され、かつ走査電極方向および信号電極
方向の電極端部と電極端被覆部との大きさの差がいずれ
も、画素内の走査電極と薄膜トランジスタ素子との信号
電極方向の間隔、および走査電極と画素内および隣接す
る画素の表示電極との信号電極方向の間隔よりも大きく
形成されてなることを特徴としたものである。
【0009】また本発明の請求項2に記載のアクティブ
マトリクス液晶表示装置は、記信号電極の端部が、導電
性薄膜により形成されてなる、該電極端部よりも大きい
形状の電極端被覆部によって被覆され、かつ走査電極方
向および信号電極方向の電極端部と電極端被覆部との大
きさの差がいずれも、画素内の信号電極と薄膜トランジ
スタ素子との走査電極方向の間隔、および信号電極と画
素内および隣接する画素の表示電極との走査電極方向の
間隔よりも大きく形成されてなることを特徴としたもの
である。本発明の請求項3に記載のアクティブマトリク
ス液晶表示装置は、走査電極の端部が、導電性薄膜によ
り形成されてなる、該電極端部よりも大きい形状の電極
端被覆部によって被覆され、かつ走査電極方向および信
号電極方向の電極端部と電極端被覆部との大きさの差が
いずれも、画素内の走査電極と薄膜トランジスタ素子と
の信号電極方向の間隔、および走査電極と画素内および
隣接する画素の表示電極との信号電極方向の間隔よりも
大きく形成されてなり、かつ信号電極の端部が、導電性
薄膜により形成されてなる、該電極端部よりも大きい形
状の電極端被覆部によって被覆され、かつ走査電極方向
および信号電極方向の電極端部と電極端被覆部との大き
さの差がいずれも、画素内の信号電極と薄膜トランジス
タ素子との走査電極方向の間隔、および信号電極と画素
内および隣接する画素の表示電極との走査電極方向の間
隔よりも大きく形成されてなることを特徴としたもので
ある。
【0010】本発明の請求項4に記載のアクティブマト
リクス液晶表示装置は、請求項1〜3のいずれかに記載
のアクティブマトリクス液晶表示装置であって、電極端
部と電極端被覆部との大きさの差が、走査電極方向と信
号電極方向とで異なることを特徴としたものである。本
発明の請求項5に記載のアクティブマトリクス液晶表示
装置は、走査電極および信号電極の少なくとも一方にお
いて、該電極の外周と、該電極と間隔をおいて隣合う薄
膜トランジスタ素子、表示電極、および該電極と同一基
板上に形成された他の導電性薄膜パターンとの、該電極
の長手方向における間隔が、該電極と直交する方向にお
ける間隔よりも大きく形成されてなることを特徴とした
ものである。本発明の請求項6に記載のアクティブマト
リクス液晶表示装置は、走査電極および信号電極の、画
素内における形状が長方形であることを特徴としたもの
である。
【0011】
【作用】本発明のアクティブマトリクス液晶表示装置
は、走査電極端部が、導電性薄膜により形成された、電
極端部よりも大きい形状の電極端被覆部により被覆され
ており、かつ走査電極方向の電極端部と電極端被覆部と
の大きさの差が、画素内の走査電極とTFTとの信号電
極方向の間隔、および走査電極と画素内および隣接する
画素の表示電極との信号電極方向の間隔よりも大きく形
成されたものである。したがって、液晶表示装置の製造
工程における走査電極形成時のレジストパターンの変形
や、基板上のパターンとマスク上のパターンとの重ね合
わせの際に起こるずれであって、特に走査電極方向のず
れ、あるいは寸法変形に対して、走査電極端部の電極端
被覆部による被覆、電極端被覆部との接続を確保するこ
とができる。
【0012】また本発明のアクティブマトリクス液晶表
示装置は、信号電極端部が、導電性薄膜により形成され
た、電極端部よりも大きい形状の電極端被覆部により被
覆されており、かつ信号電極方向の電極端部と電極端被
覆部との大きさの差が、画素内の信号電極とTFTとの
走査電極方向の間隔、および信号電極と画素内および隣
接する画素の表示電極との走査電極方向の間隔よりも大
きく形成されたものである。したがって、液晶表示装置
の製造工程における信号電極形成時のレジストパターン
の変形や、基板上のパターンとマスク上のパターンとの
重ね合わせの際に起こるずれであって、特に信号電極方
向のずれ、あるいは寸法変形に対して、信号電極端部の
電極端被覆部による被覆、電極端被覆部との接続を確保
することができる。
【0013】また本発明のアクティブマトリクス液晶表
示装置は、走査電極および信号電極の少なくとも一方に
おいて、該電極の外周と、該電極と間隔をおいて隣合う
TFT、表示電極、および該電極と同一基板上に形成さ
れた他の導電性薄膜パターンとの、該電極の長手方向に
おける間隔が、該電極と直交する方向における間隔より
も大きく形成することによって、電極の長手方向のずれ
の許容範囲を大きくし、電極形成時に生じるずれの大き
さが方向によって不均一であっても、配線の接触による
欠陥発生を防止できるようにしたものである。
【0014】
【実施例】以下、図面を参照して本発明のアクティブマ
トリクス液晶表示装置を詳しく説明する。図1〜3は本
発明のアクティブマトリクス液晶表示装置の第1の実施
例を示したもので、図1(a)は走査電極を示す平面
図、(b)は走査電極端部を示す部分拡大図である。図
2(a)は信号電極を示す平面図、(b)は信号電極端
部を示す部分拡大図である。図3は画素部分の構成図で
ある。図中符号1は走査電極を示す。走査電極1は、導
電性薄膜であるAl、Cr、Ta、Cuなどにより形成
されており、形状は、画素部では互いに並行な帯状でそ
の間隔は画素ピッチに等しい。信号電極3も同様に、導
電性薄膜であるAl、Cr、Ta、Cuなどにより形成
されており、形状は、画素部では互いに並行な帯状でそ
の間隔は画素ピッチに等しい。図3において図中符号1
1は走査電極、12は信号電極をそれぞれ示す。画素内
部には、p−Si層10aとこれに直交するゲート電極
10bからなるTFT10、表示電極14、蓄積容量配
線13が形成されており、TFT10に信号を供給する
ために走査電極11、信号電極12が配置されている。
また、TFT10と走査電極11はゲートコンタクトホ
ール15、TFT10と信号電極12はドレインコンタ
クトホール16とによりそれぞれ接続されている。
【0015】画素内における走査電極11および信号電
極12の形状は、いずれも長方形になっている。また、
画素内での走査電極11と周囲の配線パターンとの位置
関係については、図3に示すように走査電極11を長方
形とすることによって、走査電極11のパターニング工
程において、左右方向すなわち走査電極長手方向(以
下、単に走査電極方向という)にずれても画素性能に影
響することがなく、画素内部では欠陥とはならない。ま
た、走査電極11のパターンが他のパターンに対して上
下方向すなわち信号電極長手方向(以下、単に信号電極
方向という)にずれて、走査電極11と、ゲートコンタ
クトホール15とが接触しなくなる場合には、画素が機
能しなくなる。このため本実施例の画素では、走査電極
11のずれの許容範囲は信号電極方向が狭く、走査電極
方向には広いという性質をもつことがわかる。また、信
号電極12については、走査電極11と同様に、画素内
部において信号電極12の形状を長方形とすることによ
って、信号電極12以外のパターンに対して、信号電極
方向にずれても画素欠陥は発生しない。しかし、走査電
極方向にずれた場合は、ドレインコンタクトホール16
と信号電極12とが接触しなくなるため画素欠陥が発生
する。したがって、信号電極12については、ずれの許
容範囲は信号電極方向が広く、走査電極方向には狭いと
いう性質をもつことがわかる。
【0016】一方、画素部以外の端子引出部および端子
部については、図1および2に示すように、走査電極1
および信号電極3の端部が、走査電極端被覆部2および
信号電極端被覆部4でそれぞれ覆われており、外部信号
線と接続できるようになっている。走査電極端被覆部
2、2……(または信号電極端被覆部4、4……)は、
基板外部からの電気信号を各走査電極1、1……(また
は各信号電極3、3……)ごとに供給するためにボンデ
ィングまたはフレキシブルプリント電極などの外部配線
と接続する部分であり、この部分の走査電極1、1……
(または信号電極3、3……)の間隔は画素部に比べて
大きくする必要がある。また、電極端被覆部2、4の材
料としては、低抵抗薄膜のAl、Cr、Ta、Cu等を
用いることができるが、特にITOは表面硬度が他の金
属よりも固いため、外部配線と接触しても変形が少な
く、この用途に好適である。
【0017】図1において、走査電極端被覆部2は、走
査電極端部よりも大きい形状に形成され、かつ走査電極
方向の電極端部と電極端被覆部との大きさの差(図中符
号5で示す)および信号電極方向の電極端部と電極端被
覆部との大きさの差(図中符号6で示す)がいずれも、
画素内の走査電極11とTFT10との信号電極方向の
間隔(図中符号30で示す)、および走査電極11と画
素内および隣接する画素の表示電極14との信号電極方
向の間隔(図中符号31、32で示す)よりも大きく形
成されている。また、走査電極1の端部を覆う走査電極
端被覆部2の形状を、走査電極方向のマージン5を信号
電極方向のマージン6よりも大きくすることにより、走
査電極1が、基板上で走査電極方向すなわち電極の長手
方向にずれた場合でも電極端部は必ず電極端被覆部2に
より覆われており、外部配線の接続位置は基板上で変化
しないので、外部接続が精度良く行われる。ここで、走
査電極方向のずれが、画素ピッチよりも大きくなると画
素欠陥が生じるので、走査電極方向のマージン5の大き
さは、最大で走査電極方向の画素ピッチと同様の大きさ
とすることができる。
【0018】同様に信号電極3については、図2に示す
ように、信号電極端被覆部4は、信号電極端部よりも大
きい形状に形成され、かつ信号電極方向の電極端部と電
極端被覆部との大きさの差(図中符号7で示す)および
走査電極方向の電極端部と電極端被覆部との大きさの差
(図中符号8で示す)がいずれも、画素内の信号電極1
2とTFT10との走査電極方向の間隔(図中符号33
で示す)、および信号電極12と画素内および隣接する
画素の表示電極14との走査電極方向の間隔(図中符号
34、35で示す)よりも大きく形成されている。ま
た、信号電極3の端部を覆う信号電極端被覆部4の形状
を、信号電極方向のマージン7を走査電極方向のマージ
ン8よりも大きくすることにより、信号電極3が、基板
上で信号電極方向すなわち電極の長手方向にずれた場合
でも電極端部は必ず電極端被覆部4により覆われてお
り、外部配線の接続位置は基板上で変化しないので、外
部接続が精度良く行われる。ここで、上記走査電極の場
合と同様、信号電極方向のマージン7の大きさは、最大
で信号電極方向の画素ピッチと同様の大きさとすること
ができる。
【0019】この結果、走査電極および信号電極のパタ
ーン形成工程でオフセット印刷法を用いても、印刷の際
のブランケットの回転方向が、電極パターンの長手方向
となるように版を配置することによって、電極の長手方
向であれば、電極と、基板上の他のパターンとのずれが
たとえ画素ピッチ程度に大きく発生しても、表示欠陥と
ならず良好な表示を得ることができる。
【0020】ここでいうパターン形成工程での印刷の適
用方法とは、以下の通りである。まず耐薬品性、または
耐ドライエッチング性のあるインキを用い、形成するパ
ターンをガラス基板上の薄膜上に直接オフセット印刷法
により印刷する。次にインキを乾燥または、UV照射に
より凝固させ、この基板をウェットエッチングまたはド
ライエッチングなどによりエッチングすることにより、
インキに覆われない部分のみが選択的にエッチングされ
る。その後、インキを溶剤または酸素プラズマ中に暴露
することによりレジストパターンのみが剥離し、パター
ニングされた薄膜が形成される。むろん、本発明に適用
する印刷法としては、凸版印刷、凹版印刷、スクリーン
印刷、および各種オフセット印刷等のいずれの方式でも
可能であることは言うまでもない。しかし、いずれの印
刷法でも、回転するドラムを用い、表面に版を組付けた
り、薄いシート状の版を用い、張力により版を固定した
り、といった版材もしくは、非印刷物の張力、圧縮な
ど、大型基板上で、画素サイズに比べ少なくない、例え
ば10μm程度以上の弾性変形を起こす要因を有してい
る。このことは、原版に対する印刷パターンの寸法差が
発生する要因を有しており、しかも多くの場合印刷面内
で方向により不均一な変形を起こすため、いずれの印刷
法に対しても本発明が有効であることは明らかである。
【0021】図4は本発明のアクティブマトリクス液晶
表示装置の第2の実施例を示したもので、画素部分の構
成図である。この例では、印刷を用いて電極パターンを
形成する際に、電極配線が交差する部分(図中符号20
で示す)のみ配線幅が狭く形成されている。このように
配線交差部20の配線幅を狭くすることにより、交差配
線容量を低減するとともに配線インピーダンスを低減す
ることができ、良好な表示が得られるとともに印刷を用
いた場合の配線欠陥の発生を低く抑えることができる。
その際、信号電極12のレジストパターンを印刷法によ
り形成しようとすると、電極幅が変化する部分(図中符
号21で示す)ではインキパターンの断線が発生しやす
く、配線の断線が発生しやすい。そこで、電極幅が変化
する部分21では図4に示すように、テーパーをつけ、
次第に幅が変化するようにすることにより、断線を少な
くし、歩留まりをさらに向上させることができる。
【0022】また本実施例において、信号電極12の外
周と、信号電極12と間隔をおいて隣合うTFT10の
ゲート電極10bとの、信号電極方向における間隔(図
中符号40で示す)が、走査電極方向における間隔(図
中符号41で示す)よりも大きく形成されている。同様
に、信号電極12の外周と、信号電極12と間隔をおい
て隣合う表示電極14との、信号電極方向における間隔
(図中符号42で示す)が、走査電極方向における間隔
(図中符号43で示す)よりも大きく形成されている。
このことにより、本実施例の画素では、信号電極12の
ずれの許容範囲は、走査電極方向よりも信号電極方向の
ほうが広く、電極形成時に生じるずれの大きさが方向に
よって不均一であっても、ずれの大きい方向を信号電極
方向とすることによって配線の接触による欠陥発生を防
止することができる。さらに、走査電極11の画素内の
形状が長方形でない場合には、走査電極11の外周と、
走査電極11と間隔をおいて隣合うTFT10のp−S
i層10a、表示電極14、および蓄積容量配線13等
の同一基板上に形成された他の導電性薄膜パターンと
の、走査電極方向における間隔が、信号電極方向におけ
る間隔よりも大きくなるように形成することによって、
同様に、電極形成時に生じるずれの大きさが、方向によ
って不均一であっても、配線の接触による欠陥発生を防
止することができる。
【0023】
【発明の効果】以上説明したように本発明のアクティブ
マトリクス液晶表示装置によれば、電極パターン形成時
において方向性のある原版と印刷パターンとに寸法差が
あっても良好な表示特性を得ることができ、印刷技術を
用いて大面積の液晶表示装置を構成する際に層間合わせ
精度が低くても、充分な表示特性を有するアクティブマ
トリクス液晶表示装置を得ることができる。
【図面の簡単な説明】
【図1】本発明の第1の実施例における(a)走査電極
を示す平面図、(b)走査電極端部を示す部分拡大図で
ある。
【図2】本発明の第1の実施例における(a)信号電極
を示す平面図、(b)信号電極端部を示す部分拡大図で
ある。
【図3】本発明の第1の実施例における画素部分の構成
図である。
【図4】本発明の第2の実施例における画素部分の構成
図である。
【符号の説明】
1 走査電極 2 走査電極端被覆部 3 信号電極 4 信号電極端被覆部 10a 多結晶シリコン層 10b ゲート電極 10 薄膜トランジスタ素子 11 走査電極 12 信号電極 14 表示電極
フロントページの続き (72)発明者 桑原 和広 東京都中央区東日本橋1−6−5 株式会 社ジーティシー内

Claims (6)

    【特許請求の範囲】
  1. 【請求項1】 透明絶縁基板からなる第1の基板上に、
    複数の走査電極および複数の信号電極が行列方向に配さ
    れ、該走査電極と信号電極とによって区切られてなる各
    画素に少なくとも、多結晶シリコン層およびこれに直交
    するゲート電極からなる薄膜トランジスタ素子、および
    表示電極が設けられ、かつ上記第1の基板に対して、絶
    縁基板上に対向電極が設けられてなる第2の基板が対向
    配置され、該第1の基板と第2の基板との間に液晶材料
    が狭持されてなるアクティブマトリクス液晶表示装置で
    あって、 上記走査電極の端部が、導電性薄膜により形成されてな
    る、該電極端部よりも大きい形状の電極端被覆部によっ
    て被覆され、かつ走査電極方向および信号電極方向の電
    極端部と電極端被覆部との大きさの差がいずれも、画素
    内の走査電極と薄膜トランジスタ素子との信号電極方向
    の間隔、および走査電極と画素内および隣接する画素の
    表示電極との信号電極方向の間隔よりも大きく形成され
    てなることを特徴とするアクティブマトリクス液晶表示
    装置。
  2. 【請求項2】 透明絶縁基板からなる第1の基板上に、
    複数の走査電極および複数の信号電極が行列方向に配さ
    れ、該走査電極と信号電極とによって区切られてなる各
    画素に少なくとも、多結晶シリコン層およびこれに直交
    するゲート電極からなる薄膜トランジスタ素子、および
    表示電極が設けられ、かつ上記第1の基板に対して、絶
    縁基板上に対向電極が設けられてなる第2の基板が対向
    配置され、該第1の基板と第2の基板との間に液晶材料
    が狭持されてなるアクティブマトリクス液晶表示装置で
    あって、 上記信号電極の端部が、導電性薄膜により形成されてな
    る、該電極端部よりも大きい形状の電極端被覆部によっ
    て被覆され、かつ走査電極方向および信号電極方向の電
    極端部と電極端被覆部との大きさの差がいずれも、画素
    内の信号電極と薄膜トランジスタ素子との走査電極方向
    の間隔、および信号電極と画素内および隣接する画素の
    表示電極との走査電極方向の間隔よりも大きく形成され
    てなることを特徴とするアクティブマトリクス液晶表示
    装置。
  3. 【請求項3】 透明絶縁基板からなる第1の基板上に、
    複数の走査電極および複数の信号電極が行列方向に配さ
    れ、該走査電極と信号電極とによって区切られてなる各
    画素に少なくとも、多結晶シリコン層およびこれに直交
    するゲート電極からなる薄膜トランジスタ素子、および
    表示電極が設けられ、かつ上記第1の基板に対して、絶
    縁基板上に対向電極が設けられてなる第2の基板が対向
    配置され、該第1の基板と第2の基板との間に液晶材料
    が狭持されてなるアクティブマトリクス液晶表示装置で
    あって、 上記走査電極の端部が、導電性薄膜により形成されてな
    る、該電極端部よりも大きい形状の電極端被覆部によっ
    て被覆され、かつ走査電極方向および信号電極方向の電
    極端部と電極端被覆部との大きさの差がいずれも、画素
    内の走査電極と薄膜トランジスタ素子との信号電極方向
    の間隔、および走査電極と画素内および隣接する画素の
    表示電極との信号電極方向の間隔よりも大きく形成され
    てなり、 かつ上記信号電極の端部が、導電性薄膜により形成され
    てなる、該電極端部よりも大きい形状の電極端被覆部に
    よって被覆され、かつ走査電極方向および信号電極方向
    の電極端部と電極端被覆部との大きさの差がいずれも、
    画素内の信号電極と薄膜トランジスタ素子との走査電極
    方向の間隔、および信号電極と画素内および隣接する画
    素の表示電極との走査電極方向の間隔よりも大きく形成
    されてなることを特徴とするアクティブマトリクス液晶
    表示装置。
  4. 【請求項4】 上記電極端部と電極端被覆部との大きさ
    の差が、走査電極方向と信号電極方向とで異なることを
    特徴とする請求項1〜3のいずれかに記載のアクティブ
    マトリクス液晶表示装置。
  5. 【請求項5】 透明絶縁基板からなる第1の基板上に、
    複数の走査電極および複数の信号電極が行列方向に配さ
    れ、該走査電極と信号電極とによって区切られてなる各
    画素に少なくとも、多結晶シリコン層およびこれに直交
    するゲート電極からなる薄膜トランジスタ素子、および
    表示電極が設けられ、かつ上記第1の基板に対して、絶
    縁基板上に対向電極が設けられてなる第2の基板が対向
    配置され、該第1の基板と第2の基板との間に液晶材料
    が狭持されてなるアクティブマトリクス液晶表示装置で
    あって、 上記走査電極および信号電極の少なくとも一方におい
    て、該電極の外周と、該電極と間隔をおいて隣合う薄膜
    トランジスタ素子、表示電極、および該電極と同一基板
    上に形成された他の導電性薄膜パターンとの、該電極の
    長手方向における間隔が、該電極と直交する方向におけ
    る間隔よりも大きく形成されてなることを特徴とするア
    クティブマトリクス液晶表示装置。
  6. 【請求項6】 透明絶縁基板からなる第1の基板上に、
    複数の走査電極および複数の信号電極が行列方向に配さ
    れ、該走査電極と信号電極とによって区切られてなる各
    画素に少なくとも、多結晶シリコン層およびこれに直交
    するゲート電極からなる薄膜トランジスタ素子、および
    表示電極が設けられ、かつ上記第1の基板に対して、絶
    縁基板上に対向電極が設けられてなる第2の基板が対向
    配置され、該第1の基板と第2の基板との間に液晶材料
    が狭持されてなるアクティブマトリクス液晶表示装置で
    あって、 上記走査電極および信号電極の、画素内における形状が
    長方形であることを特徴とするアクティブマトリクス液
    晶表示装置。
JP3616594A 1994-03-07 1994-03-07 アクティブマトリクス液晶表示装置 Pending JPH07244298A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP3616594A JPH07244298A (ja) 1994-03-07 1994-03-07 アクティブマトリクス液晶表示装置

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP3616594A JPH07244298A (ja) 1994-03-07 1994-03-07 アクティブマトリクス液晶表示装置

Publications (1)

Publication Number Publication Date
JPH07244298A true JPH07244298A (ja) 1995-09-19

Family

ID=12462156

Family Applications (1)

Application Number Title Priority Date Filing Date
JP3616594A Pending JPH07244298A (ja) 1994-03-07 1994-03-07 アクティブマトリクス液晶表示装置

Country Status (1)

Country Link
JP (1) JPH07244298A (ja)

Cited By (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US6686229B2 (en) 2001-03-02 2004-02-03 Koninklijke Philips Electronics N.V. Thin film transistors and method of manufacture
JP2006332165A (ja) * 2005-05-24 2006-12-07 Toppan Printing Co Ltd 薄膜トランジスタの製造方法
JP2009054727A (ja) * 2007-08-24 2009-03-12 Sanyo Electric Co Ltd 太陽電池の製造方法
JP2010034163A (ja) * 2008-07-25 2010-02-12 Sanyo Electric Co Ltd 太陽電池の製造方法及び太陽電池モジュールの製造方法

Citations (6)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS6019189A (ja) * 1983-07-13 1985-01-31 キヤノン株式会社 カラ−表示装置
JPS62223727A (ja) * 1986-03-25 1987-10-01 Seiko Epson Corp 液晶パネル
JPH02244126A (ja) * 1989-03-17 1990-09-28 Fujitsu Ltd 薄膜トランジスタパネルの製造方法
JPH0426825A (ja) * 1990-05-22 1992-01-30 Alps Electric Co Ltd 薄膜トランジスタアレイおよびその製造方法
JPH0451120A (ja) * 1990-06-19 1992-02-19 Nec Corp 薄膜電界効果型トランジスタ駆動液晶表示素子アレイ
JPH04152325A (ja) * 1990-10-17 1992-05-26 Hitachi Ltd 液晶表示装置

Patent Citations (6)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS6019189A (ja) * 1983-07-13 1985-01-31 キヤノン株式会社 カラ−表示装置
JPS62223727A (ja) * 1986-03-25 1987-10-01 Seiko Epson Corp 液晶パネル
JPH02244126A (ja) * 1989-03-17 1990-09-28 Fujitsu Ltd 薄膜トランジスタパネルの製造方法
JPH0426825A (ja) * 1990-05-22 1992-01-30 Alps Electric Co Ltd 薄膜トランジスタアレイおよびその製造方法
JPH0451120A (ja) * 1990-06-19 1992-02-19 Nec Corp 薄膜電界効果型トランジスタ駆動液晶表示素子アレイ
JPH04152325A (ja) * 1990-10-17 1992-05-26 Hitachi Ltd 液晶表示装置

Cited By (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US6686229B2 (en) 2001-03-02 2004-02-03 Koninklijke Philips Electronics N.V. Thin film transistors and method of manufacture
JP2006332165A (ja) * 2005-05-24 2006-12-07 Toppan Printing Co Ltd 薄膜トランジスタの製造方法
JP2009054727A (ja) * 2007-08-24 2009-03-12 Sanyo Electric Co Ltd 太陽電池の製造方法
JP4578510B2 (ja) * 2007-08-24 2010-11-10 三洋電機株式会社 太陽電池の製造方法
JP2010034163A (ja) * 2008-07-25 2010-02-12 Sanyo Electric Co Ltd 太陽電池の製造方法及び太陽電池モジュールの製造方法

Similar Documents

Publication Publication Date Title
US6614500B2 (en) Liquid crystal display having a dummy source pad and method for manufacturing the same
US6184948B1 (en) Liquid crystal display device having a plurality of error detecting shorting bars and a method of manufacturing the same
US6831318B2 (en) Thin film transistor array
KR100975734B1 (ko) 횡전계방식 액정 표시 장치용 어레이 기판 및 그 제조 방법
US8730418B2 (en) Array substrate and method for manufacturing the same
WO2002001286A1 (fr) Substrat a reseau de tft et dispositif d'affichage a cristaux liquides utilisant ce dernier
US6759348B1 (en) Pattern and its forming method of liquid crystal display device
TW569439B (en) Method of manufacturing a plate comprising array of thin film transistor, the plate and an active matrix liquid crystal display comprising the plate
JPH06208137A (ja) 薄膜トランジスタマトリクスの製造方法
US6567135B1 (en) Liquid crystal display device and method for fabricating the same
JP2002190598A (ja) 薄膜トランジスタアレイ基板およびその製造方法
JPH07244298A (ja) アクティブマトリクス液晶表示装置
JP2002268585A (ja) アクティブマトリクス基板およびその製造方法
US6940565B2 (en) Liquid crystal display device and fabricating method thereof
KR101205767B1 (ko) 액상의 유기 반도체물질을 이용한 액정표시장치용 어레이기판의 제조방법
US20040149683A1 (en) Method for forming pattern using printing process
KR100905017B1 (ko) 액정표시소자 및 그 제조방법
US7297565B2 (en) Liquid crystal display device and fabricating method thereof
US8105762B2 (en) Method for forming pattern using printing process
KR101023319B1 (ko) 액정 표시 장치용 어레이 기판 및 그 제조 방법
JPH0527261A (ja) アクテイブマトリクス基板の製造方法
JP2809892B2 (ja) 大面積回路基板のレジストパターン形成方法
KR20030058327A (ko) 액정 표시 장치용 어레이 기판 및 그의 제조 방법
JPS63119256A (ja) アクテイブマトリクス基板の製造方法
KR100268302B1 (ko) 액정 표시 장치의 구조 및 그 액정 표시 장치의 제조방법

Legal Events

Date Code Title Description
A02 Decision of refusal

Free format text: JAPANESE INTERMEDIATE CODE: A02

Effective date: 19970401