JPH0715307A - ソリッドステートリレー - Google Patents
ソリッドステートリレーInfo
- Publication number
- JPH0715307A JPH0715307A JP14406193A JP14406193A JPH0715307A JP H0715307 A JPH0715307 A JP H0715307A JP 14406193 A JP14406193 A JP 14406193A JP 14406193 A JP14406193 A JP 14406193A JP H0715307 A JPH0715307 A JP H0715307A
- Authority
- JP
- Japan
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- voltage
- turned
- emitting element
- capacitor
- light emitting
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- Thyristor Switches And Gates (AREA)
- Electronic Switches (AREA)
Abstract
(57)【要約】
【目的】入力電圧が低くくても動作するソリッドステー
トリレーを提供する。 【構成】発光素子１ａとフォトトライアック１ｂとは光
結合される。フォトトライアック１ｂは、発光素子１ａ
が発光し、かつゼロクロス検出回路５からゲート電流が
入力されるとオンになる。ゼロクロス検出回路５は、出
力端子１０の間の電圧がゼロクロス電圧になったときに
フォトトライアック１ｂにゲート電流を与える。フォト
トライアック１ｂがオンになれば、抵抗３の両端に電圧
が生じてトライアック２がオンになる。トライアック２
には抵抗４ａとコンデンサ４ｂとの直列回路であるスナ
バ回路４が並列接続されている。また、出力端子１０の
間にはコンデンサ４ｂの電荷を放電させる抵抗６が接続
される。コンデンサ４ｂの電荷が抵抗６を通して放電さ
れることによって、出力端子１０の間の電圧は印加電圧
の波形に追随して変化する。
トリレーを提供する。 【構成】発光素子１ａとフォトトライアック１ｂとは光
結合される。フォトトライアック１ｂは、発光素子１ａ
が発光し、かつゼロクロス検出回路５からゲート電流が
入力されるとオンになる。ゼロクロス検出回路５は、出
力端子１０の間の電圧がゼロクロス電圧になったときに
フォトトライアック１ｂにゲート電流を与える。フォト
トライアック１ｂがオンになれば、抵抗３の両端に電圧
が生じてトライアック２がオンになる。トライアック２
には抵抗４ａとコンデンサ４ｂとの直列回路であるスナ
バ回路４が並列接続されている。また、出力端子１０の
間にはコンデンサ４ｂの電荷を放電させる抵抗６が接続
される。コンデンサ４ｂの電荷が抵抗６を通して放電さ
れることによって、出力端子１０の間の電圧は印加電圧
の波形に追随して変化する。
Description
【０００１】
【産業上の利用分野】本発明は、出力端間に抵抗とコン
デンサとの直列回路であるスナバ回路が接続され、出力
端間の電圧がゼロクロス電圧になるのに同期してオンに
なる主スイッチング素子を備えたソリッドステートリレ
ーに関するものである。
デンサとの直列回路であるスナバ回路が接続され、出力
端間の電圧がゼロクロス電圧になるのに同期してオンに
なる主スイッチング素子を備えたソリッドステートリレ
ーに関するものである。
【０００２】
【従来の技術】従来より、発光ダイオードのような発光
素子１ａと発光素子１ａに光結合され補助スイッチング
素子となるフォトトライアック１ｂとを備える図３に示
すようなソリッドステートリレーが知られている。発光
素子１ａには入力制限用の抵抗１４が直列接続され、こ
の直列回路の両端は入力端子９にそれぞれ接続されてい
る。フォトトライアック１ｂの一端には２個の抵抗４
ａ，１５が直列接続され、フォトトライアック１ｂの他
端には抵抗３が直列接続される。ここに、抵抗１５はフ
ォトトライアック１ｂへの電流を制限するために設けら
れている。フォトトライアック１ｂと抵抗３，４ａ，１
５との直列回路は主スイッチング素子となるトライアッ
ク２に並列接続され、トライアック２の両端はそれぞれ
出力端子１０に接続されている。また、抵抗４ａはコン
デンサ４ｂと直列接続されてスナバ回路４を構成し、ス
ナバ回路４はトライアック２と並列接続されている。上
記抵抗３はトライアック２のゲートとＴ1 端子との間に
接続される。ところで、フォトトライアック１ｂにゲー
ト電流を与えるためのゼロクロス検出回路５が設けられ
ており、ゼロクロス検出回路５では、出力端子１０の間
の電圧が規定のゼロクロス電圧になると制御信号を出力
してフォトトライアック１ｂにゲート電流を与えるよう
になっている。このゼロクロス検出回路５と発光素子１
ａとフォトトライアック１ｂとによってフォトトライア
ックカプラ１が構成される。
素子１ａと発光素子１ａに光結合され補助スイッチング
素子となるフォトトライアック１ｂとを備える図３に示
すようなソリッドステートリレーが知られている。発光
素子１ａには入力制限用の抵抗１４が直列接続され、こ
の直列回路の両端は入力端子９にそれぞれ接続されてい
る。フォトトライアック１ｂの一端には２個の抵抗４
ａ，１５が直列接続され、フォトトライアック１ｂの他
端には抵抗３が直列接続される。ここに、抵抗１５はフ
ォトトライアック１ｂへの電流を制限するために設けら
れている。フォトトライアック１ｂと抵抗３，４ａ，１
５との直列回路は主スイッチング素子となるトライアッ
ク２に並列接続され、トライアック２の両端はそれぞれ
出力端子１０に接続されている。また、抵抗４ａはコン
デンサ４ｂと直列接続されてスナバ回路４を構成し、ス
ナバ回路４はトライアック２と並列接続されている。上
記抵抗３はトライアック２のゲートとＴ1 端子との間に
接続される。ところで、フォトトライアック１ｂにゲー
ト電流を与えるためのゼロクロス検出回路５が設けられ
ており、ゼロクロス検出回路５では、出力端子１０の間
の電圧が規定のゼロクロス電圧になると制御信号を出力
してフォトトライアック１ｂにゲート電流を与えるよう
になっている。このゼロクロス検出回路５と発光素子１
ａとフォトトライアック１ｂとによってフォトトライア
ックカプラ１が構成される。
【０００３】上記構成のソリッドステートリレーを用い
て負荷１３を制御する場合に、商用電源のような交流電
源１１とダイオード１２と負荷１３とを直列に接続して
この直列回路を両出力端子１０の間に接続することがあ
る。負荷１３としては、たとえば、ソレノイドやモータ
を用いるものとする。この場合に以下のように動作す
る。
て負荷１３を制御する場合に、商用電源のような交流電
源１１とダイオード１２と負荷１３とを直列に接続して
この直列回路を両出力端子１０の間に接続することがあ
る。負荷１３としては、たとえば、ソレノイドやモータ
を用いるものとする。この場合に以下のように動作す
る。
【０００４】すなわち、入力端子９に適宣電圧を印加す
ると発光素子１ａが発光し、フォトトライアック１ｂで
受光される。このとき、フォトトライアック１ｂにゲー
ト電流が流れていなければフォトトライアック１ｂはオ
フに保たれている。一方、交流電源１１の出力はダイオ
ード１２によって半波整流され負荷１３を通して出力端
子１０間に印加される。ゼロクロス検出回路５では半波
波形のゼロクロス電圧を検出し制御信号をフォトトライ
アック１ｂのゲートに入力する。このとき、発光素子１
ａが点灯していれば抵抗３に電流が流れ、この抵抗３の
両端に電位差が生じる。したがって、トライアック２に
ゲート電流が流れてトライアック２がオンになり、負荷
１３に給電されることになる。
ると発光素子１ａが発光し、フォトトライアック１ｂで
受光される。このとき、フォトトライアック１ｂにゲー
ト電流が流れていなければフォトトライアック１ｂはオ
フに保たれている。一方、交流電源１１の出力はダイオ
ード１２によって半波整流され負荷１３を通して出力端
子１０間に印加される。ゼロクロス検出回路５では半波
波形のゼロクロス電圧を検出し制御信号をフォトトライ
アック１ｂのゲートに入力する。このとき、発光素子１
ａが点灯していれば抵抗３に電流が流れ、この抵抗３の
両端に電位差が生じる。したがって、トライアック２に
ゲート電流が流れてトライアック２がオンになり、負荷
１３に給電されることになる。
【０００５】
【発明が解決しようとする課題】上記従来構成では、交
流電源１１をダイオード１２で半波整流した波形は図４
に破線で示すような波形になるのであるが、トライアッ
ク２の両端間にスナバ回路４が接続されているものであ
るから、コンデンサ４ｂの充放電によって出力端子１０
の間の電圧Ｖ0 は、図４（ｂ）に示すような電圧波形に
なる。入力端子９の間に印加される電圧が十分に高いと
きには、フォトトライアック１ｂのリーク電流が多くな
るから、コンデンサ４ｂの電荷がフォトトライアック１
ｂを通して放電され、交流電源１１の半サイクル程度の
時間内で出力端子１０の間の電圧をゼロクロス検出回路
５に設定されたゼロクロス電圧Ｖｚ以下に下げることが
できる。したがって、交流電源１１の１サイクルごとに
フォトトライアック１ｂにゲート電流を与えることが可
能になり、発光素子１ａの点灯・消灯に応じてトライア
ック２をオン・オフさせることができる。
流電源１１をダイオード１２で半波整流した波形は図４
に破線で示すような波形になるのであるが、トライアッ
ク２の両端間にスナバ回路４が接続されているものであ
るから、コンデンサ４ｂの充放電によって出力端子１０
の間の電圧Ｖ0 は、図４（ｂ）に示すような電圧波形に
なる。入力端子９の間に印加される電圧が十分に高いと
きには、フォトトライアック１ｂのリーク電流が多くな
るから、コンデンサ４ｂの電荷がフォトトライアック１
ｂを通して放電され、交流電源１１の半サイクル程度の
時間内で出力端子１０の間の電圧をゼロクロス検出回路
５に設定されたゼロクロス電圧Ｖｚ以下に下げることが
できる。したがって、交流電源１１の１サイクルごとに
フォトトライアック１ｂにゲート電流を与えることが可
能になり、発光素子１ａの点灯・消灯に応じてトライア
ック２をオン・オフさせることができる。
【０００６】しかしながら、入力端子９に印加される電
圧が低いときには、フォトトライアック１ｂのリーク電
流が少なくなり、コンデンサ４ｂの電荷が十分に放出さ
れないものであるから、出力端子１０の間の電圧Ｖ0 は
図４（ａ）のような電圧波形となってゼロクロス電圧Ｖ
ｚまで下がらず、結果的に、ゼロクロス検出回路５でフ
ォトトライアック１ｂにゲート電流を与えることができ
なくなって、発光素子１ａの点灯・消灯に応じてトライ
アック２をオン・オフさせることができなくなるという
問題が生じる。
圧が低いときには、フォトトライアック１ｂのリーク電
流が少なくなり、コンデンサ４ｂの電荷が十分に放出さ
れないものであるから、出力端子１０の間の電圧Ｖ0 は
図４（ａ）のような電圧波形となってゼロクロス電圧Ｖ
ｚまで下がらず、結果的に、ゼロクロス検出回路５でフ
ォトトライアック１ｂにゲート電流を与えることができ
なくなって、発光素子１ａの点灯・消灯に応じてトライ
アック２をオン・オフさせることができなくなるという
問題が生じる。
【０００７】すなわち、上記従来構成では、入力電圧を
高くしなければ正常に動作させることができず、動作感
度が低いという問題を有している。本発明は上記問題点
に鑑みて発明したものであり、低い入力電圧でも正常に
動作するようにして動作感度を高めたソリッドステート
リレーを提供することを目的とするものである。
高くしなければ正常に動作させることができず、動作感
度が低いという問題を有している。本発明は上記問題点
に鑑みて発明したものであり、低い入力電圧でも正常に
動作するようにして動作感度を高めたソリッドステート
リレーを提供することを目的とするものである。
【０００８】
【課題を解決するための手段】本発明では、上記目的を
達成するために、入力信号に呼応して点灯・消灯する発
光素子と、受光素子に光結合され発光素子からの光を受
光している期間に制御信号が入力されるとオン・オフい
ずれかの状態に反転する補助スイッチング素子と、出力
端間に接続され補助スイッチング素子のオン・オフに応
じてオン・オフされる主スイッチング素子と、抵抗とコ
ンデンサとの直列回路であって主スイッチング素子に並
列接続されたスナバ回路と、出力端間の電圧が規定のゼ
ロクロス電圧になると補助スイッチング素子への制御信
号を発生するゼロクロス検出回路と、少なくとも発光素
子の点灯期間にコンデンサの電荷を放電させる放電回路
とから成ることを特徴とする。
達成するために、入力信号に呼応して点灯・消灯する発
光素子と、受光素子に光結合され発光素子からの光を受
光している期間に制御信号が入力されるとオン・オフい
ずれかの状態に反転する補助スイッチング素子と、出力
端間に接続され補助スイッチング素子のオン・オフに応
じてオン・オフされる主スイッチング素子と、抵抗とコ
ンデンサとの直列回路であって主スイッチング素子に並
列接続されたスナバ回路と、出力端間の電圧が規定のゼ
ロクロス電圧になると補助スイッチング素子への制御信
号を発生するゼロクロス検出回路と、少なくとも発光素
子の点灯期間にコンデンサの電荷を放電させる放電回路
とから成ることを特徴とする。
【０００９】
【作用】上記構成によれば、少なくとも発光素子の点灯
期間にコンデンサの電荷を放電させる放電回路を挿入し
ていることによって、発光素子が点灯すればスナバ回路
のコンデンサの電荷を放電回路を通して放出することが
でき、外部から印加される電圧変化に対して出力端間の
電圧変化をほぼ追随させることができるのである。した
がって、交流電圧を半波整流した電圧波形が出力端間に
印加されているような状態であっても、スナバ回路のコ
ンデンサの影響をほとんど受けることなくゼロクロス検
出回路では、交流電圧波形の半サイクル程度の時間内に
ゼロクロス電圧を検出して補助スイッチング素子に制御
信号を与えることができるのであって、入力電圧を高め
ることなく主スイッチング素子を確実にオン・オフさせ
ることができるのである。すなわち、入力電圧が低くて
も動作させることができ、動作感度が従来構成よりも高
くなるのである。
期間にコンデンサの電荷を放電させる放電回路を挿入し
ていることによって、発光素子が点灯すればスナバ回路
のコンデンサの電荷を放電回路を通して放出することが
でき、外部から印加される電圧変化に対して出力端間の
電圧変化をほぼ追随させることができるのである。した
がって、交流電圧を半波整流した電圧波形が出力端間に
印加されているような状態であっても、スナバ回路のコ
ンデンサの影響をほとんど受けることなくゼロクロス検
出回路では、交流電圧波形の半サイクル程度の時間内に
ゼロクロス電圧を検出して補助スイッチング素子に制御
信号を与えることができるのであって、入力電圧を高め
ることなく主スイッチング素子を確実にオン・オフさせ
ることができるのである。すなわち、入力電圧が低くて
も動作させることができ、動作感度が従来構成よりも高
くなるのである。
【００１０】
【実施例】（実施例１）本実施例は、図１に示すよう
に、図３に示した従来構成と基本的には同様の構成を有
しており、出力端子１０の間に放電回路としての抵抗６
を接続した点が異なるだけであるから、主として相違点
について説明する。
に、図３に示した従来構成と基本的には同様の構成を有
しており、出力端子１０の間に放電回路としての抵抗６
を接続した点が異なるだけであるから、主として相違点
について説明する。
【００１１】図１の構成により、スナバ回路４のコンデ
ンサ４ｂの電荷は抵抗６を通して放電されることにな
る。したがって、発光素子１ａが消灯していて、フォト
トライアック１ｂがオフである期間には、コンデンサ４
ｂの電荷が抵抗６を通して放電されることによって、出
力端子１０の間に印加されている半波整流波形のうちの
休止期間（電圧が０Ｖである期間）に、出力端子１０の
間の電圧Ｖ0 をゼロクロス検出回路５に設定されている
ゼロクロス電圧まで引き下げることができる。したがっ
て、入力電圧が低くフォトトライアック１ｂでのリーク
電流が少なくても、発光素子１ａの点灯・消灯に呼応す
るようにトライアック２をオン・オフさせることがで
き、高感度のソリッドステートリレーを提供できるので
ある。
ンサ４ｂの電荷は抵抗６を通して放電されることにな
る。したがって、発光素子１ａが消灯していて、フォト
トライアック１ｂがオフである期間には、コンデンサ４
ｂの電荷が抵抗６を通して放電されることによって、出
力端子１０の間に印加されている半波整流波形のうちの
休止期間（電圧が０Ｖである期間）に、出力端子１０の
間の電圧Ｖ0 をゼロクロス検出回路５に設定されている
ゼロクロス電圧まで引き下げることができる。したがっ
て、入力電圧が低くフォトトライアック１ｂでのリーク
電流が少なくても、発光素子１ａの点灯・消灯に呼応す
るようにトライアック２をオン・オフさせることがで
き、高感度のソリッドステートリレーを提供できるので
ある。
【００１２】（実施例２）本実施例では、出力端子１０
の間に抵抗６とＭＯＳＦＥＴ７ａのドレイン−ソース間
との直列回路を接続し、発光素子１ａに直列接続された
発光ダイオードなどからなる別の発光素子７ｂの点灯時
にＭＯＳＦＥＴ７ａをオンにするように駆動している点
が図３に示した従来構成とは相違する。ここに、発光素
子７ｂは、図示していない受光素子と光結合されてお
り、この受光素子の出力によってＭＯＳＦＥＴ７ａが駆
動されるようになっている。発光素子７ｂの点灯に応じ
てＭＯＳＦＥＴ７ａをオンにする構成としては周知の構
成を採用することができる。
の間に抵抗６とＭＯＳＦＥＴ７ａのドレイン−ソース間
との直列回路を接続し、発光素子１ａに直列接続された
発光ダイオードなどからなる別の発光素子７ｂの点灯時
にＭＯＳＦＥＴ７ａをオンにするように駆動している点
が図３に示した従来構成とは相違する。ここに、発光素
子７ｂは、図示していない受光素子と光結合されてお
り、この受光素子の出力によってＭＯＳＦＥＴ７ａが駆
動されるようになっている。発光素子７ｂの点灯に応じ
てＭＯＳＦＥＴ７ａをオンにする構成としては周知の構
成を採用することができる。
【００１３】本実施例の構成では、抵抗６にＭＯＳＦＥ
Ｔ７ａを直列接続し、発光素子７ａの点灯時にのみＭＯ
ＳＦＥＴ７ａをオンにするのであって、入力電圧が印加
されていなければ、ＭＯＳＦＥＴ７ａがオフになってい
て図３に示した従来構成と同様に、フォトトライアック
１ｂでのリークがほとんどなく、入力電圧が印加された
ときには抵抗６を通してコンデンサ４ｂの電荷を放出す
ることによってゼロクロス電圧の検出を可能とすること
ができるのである。すなわち、トライアック２のオフ時
には抵抗６を通して負荷１３に電流が流れることがない
ようにし、かつ入力電圧が印加されたときには、入力電
圧が低くてもトライアック２を確実にオンさせるのであ
る。
Ｔ７ａを直列接続し、発光素子７ａの点灯時にのみＭＯ
ＳＦＥＴ７ａをオンにするのであって、入力電圧が印加
されていなければ、ＭＯＳＦＥＴ７ａがオフになってい
て図３に示した従来構成と同様に、フォトトライアック
１ｂでのリークがほとんどなく、入力電圧が印加された
ときには抵抗６を通してコンデンサ４ｂの電荷を放出す
ることによってゼロクロス電圧の検出を可能とすること
ができるのである。すなわち、トライアック２のオフ時
には抵抗６を通して負荷１３に電流が流れることがない
ようにし、かつ入力電圧が印加されたときには、入力電
圧が低くてもトライアック２を確実にオンさせるのであ
る。
【００１４】なお、上記実施例では、入力電圧の印加時
にフォトトライアック１ｂおよびトライアック２がオン
になるように構成してあるが、入力電圧の印加時にフォ
トトライアック１ｂやトライアック２がオフになる構成
であってもよい。また、フォトトライアック１ｂに代え
てフォトサイリスタなどの他のスイッチング素子を用い
ることも可能であり、トライアック２に代えてサイリス
タなどの他のスイッチング素子を採用することも可能で
ある。
にフォトトライアック１ｂおよびトライアック２がオン
になるように構成してあるが、入力電圧の印加時にフォ
トトライアック１ｂやトライアック２がオフになる構成
であってもよい。また、フォトトライアック１ｂに代え
てフォトサイリスタなどの他のスイッチング素子を用い
ることも可能であり、トライアック２に代えてサイリス
タなどの他のスイッチング素子を採用することも可能で
ある。
【００１５】
【発明の効果】本発明は上述のように、少なくとも発光
素子の点灯期間にコンデンサの電荷を放電させる放電回
路を備えるので、発光素子が点灯するとスナバ回路のコ
ンデンサの電荷を放電回路を通して放出することがで
き、外部から印加される電圧変化に対して出力端間の電
圧変化をほぼ追随させることができるという効果を奏す
る。すなわち、交流電圧を半波整流した電圧波形が出力
端間に印加されているような状態であっても、スナバ回
路のコンデンサの影響をほとんど受けることなくゼロク
ロス検出回路では、交流電圧波形の半サイクル程度の時
間内にゼロクロス電圧を検出して補助スイッチング素子
に制御信号を与えることができるのであって、入力電圧
を高めることなく主スイッチング素子を確実にオン・オ
フさせることができ、その結果、入力電圧が低くても動
作させることができて、動作感度が従来構成よりも高く
なるという利点がある。
素子の点灯期間にコンデンサの電荷を放電させる放電回
路を備えるので、発光素子が点灯するとスナバ回路のコ
ンデンサの電荷を放電回路を通して放出することがで
き、外部から印加される電圧変化に対して出力端間の電
圧変化をほぼ追随させることができるという効果を奏す
る。すなわち、交流電圧を半波整流した電圧波形が出力
端間に印加されているような状態であっても、スナバ回
路のコンデンサの影響をほとんど受けることなくゼロク
ロス検出回路では、交流電圧波形の半サイクル程度の時
間内にゼロクロス電圧を検出して補助スイッチング素子
に制御信号を与えることができるのであって、入力電圧
を高めることなく主スイッチング素子を確実にオン・オ
フさせることができ、その結果、入力電圧が低くても動
作させることができて、動作感度が従来構成よりも高く
なるという利点がある。
【図１】実施例１を示す回路図である。
【図２】実施例２を示す回路図である。
【図３】従来例を示す回路図である。
【図４】（ａ）は従来例の入力電圧が低い状態を示す動
作説明図である。（ｂ）は従来例の入力電圧が高い状態
を示す動作説明図である。
作説明図である。（ｂ）は従来例の入力電圧が高い状態
を示す動作説明図である。
１ フォトトライアックカプラ １ａ 発光素子 １ｂ フォトトライアック ２ トライアック ３ 抵抗 ４ スナバ回路 ４ａ 抵抗 ４ｂ コンデンサ ５ ゼロクロス検出回路 ６ 抵抗 ７ａ ＭＯＳＦＥＴ ７ｂ 発光素子 ９ 入力端子 １０ 出力端子 １１ 交流電源 １２ ダイオード １３ 負荷
Claims (1)
- 【請求項１】 入力信号に呼応して点灯・消灯する発光
素子と、受光素子に光結合され発光素子からの光を受光
している期間に制御信号が入力されるとオン・オフいず
れかの状態に反転する補助スイッチング素子と、出力端
間に接続され補助スイッチング素子のオン・オフに応じ
てオン・オフされる主スイッチング素子と、抵抗とコン
デンサとの直列回路であって主スイッチング素子に並列
接続されたスナバ回路と、出力端間の電圧が規定のゼロ
クロス電圧になると補助スイッチング素子への制御信号
を発生するゼロクロス検出回路と、少なくとも発光素子
の点灯期間にコンデンサの電荷を放電させる放電回路と
から成ることを特徴とするソリッドステートリレー。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14406193A JPH0715307A (ja) | 1993-06-15 | 1993-06-15 | ソリッドステートリレー |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14406193A JPH0715307A (ja) | 1993-06-15 | 1993-06-15 | ソリッドステートリレー |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0715307A true JPH0715307A (ja) | 1995-01-17 |
Family
ID=15353402
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP14406193A Withdrawn JPH0715307A (ja) | 1993-06-15 | 1993-06-15 | ソリッドステートリレー |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0715307A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2009028189A1 (ja) * | 2007-08-31 | 2009-03-05 | Tkr Corporation | ソリッドステートリレー |
| CN103095262A (zh) * | 2011-11-04 | 2013-05-08 | 欧姆龙株式会社 | 固态继电器和负载驱动电路 |
-
1993
- 1993-06-15 JP JP14406193A patent/JPH0715307A/ja not_active Withdrawn
Cited By (6)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2009028189A1 (ja) * | 2007-08-31 | 2009-03-05 | Tkr Corporation | ソリッドステートリレー |
| CN103095262A (zh) * | 2011-11-04 | 2013-05-08 | 欧姆龙株式会社 | 固态继电器和负载驱动电路 |
| US20130113382A1 (en) * | 2011-11-04 | 2013-05-09 | Omron Corporation | Solid state relay and load drive circuit |
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