JPH06236230A - 座標検出装置 - Google Patents
座標検出装置Info
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- JPH06236230A JPH06236230A JP2252493A JP2252493A JPH06236230A JP H06236230 A JPH06236230 A JP H06236230A JP 2252493 A JP2252493 A JP 2252493A JP 2252493 A JP2252493 A JP 2252493A JP H06236230 A JPH06236230 A JP H06236230A
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Abstract
(57)【要約】
【目的】 検出速度が速く、速い筆記速度にも追従でき
る座標検出装置を実現でき、また、ハードウェア量を減
らし、これに伴なって制御部の出力ポート数をも減少さ
せることが可能な座標検出装置を提供すること。 【構成】 １対の電導性膜から成るアナログタッチパネ
ルの入力位置を検出するための座標検出装置において、
座標検出用電圧入力端子を、前記アナログタッチパネル
が押下されていないときは有効入力範囲外の電位となる
ように、所定の抵抗によりプルアップまたはプルダウン
し、前記アナログタッチパネルの出力電位を所定値と比
較することにより前記アナログタッチパネルの押下を検
出して座標検出を行うことを特徴とする座標検出装置、
または、前記アナログタッチパネルを構成する各電導性
膜を駆動する１対のスイッチ素子のうち、片方のスイッ
チ素子を遅れてオフする如く構成したことを特徴とする
座標検出装置
る座標検出装置を実現でき、また、ハードウェア量を減
らし、これに伴なって制御部の出力ポート数をも減少さ
せることが可能な座標検出装置を提供すること。 【構成】 １対の電導性膜から成るアナログタッチパネ
ルの入力位置を検出するための座標検出装置において、
座標検出用電圧入力端子を、前記アナログタッチパネル
が押下されていないときは有効入力範囲外の電位となる
ように、所定の抵抗によりプルアップまたはプルダウン
し、前記アナログタッチパネルの出力電位を所定値と比
較することにより前記アナログタッチパネルの押下を検
出して座標検出を行うことを特徴とする座標検出装置、
または、前記アナログタッチパネルを構成する各電導性
膜を駆動する１対のスイッチ素子のうち、片方のスイッ
チ素子を遅れてオフする如く構成したことを特徴とする
座標検出装置
Description
【０００１】
【産業上の利用分野】本発明は、アナログタッチパネル
を用いたペン入力ディジタイザ等に適用するに好適な座
標検出装置に関し、特に低コストかつ高速化に有効な座
標検出装置に関する。
を用いたペン入力ディジタイザ等に適用するに好適な座
標検出装置に関し、特に低コストかつ高速化に有効な座
標検出装置に関する。
【０００２】
【従来の技術】アナログタッチパネルは、ペン入力ディ
ジタイザ等に利用されている入力手段の一種である。と
ころで、このアナログタッチパネルにおいて座標検出を
行うためには、まず、ペンがＤＯＷＮしているか否かを
検出する必要がある。従来から用いられている一般的な
アナログタッチパネルのドライブ回路を図８に、そのド
ライブフローを図９に示す。図８において、１０は１チ
ップＣＰＵ等から構成される制御部、１１はＹ軸アナロ
グタッチパネル、１２はＸ軸アナログタッチパネル、１
３はアナログスイッチ、１４はプルダウン抵抗、ＳＸ
１，ＳＸ２，ＳＹ１およびＳＹ２はスイッチ素子を示し
ている。図８に示した回路では、ペンがＤＯＷＮしてい
るか否かを検出するための専用のアナログスイッチ１３
とプルダウン抵抗１４とを設けて、制御部１０で、図９
に示すように動作で、Ｘ，Ｙ座標検出前に、必ずペンが
ＤＯＷＮしているか否かをチェックしていた。なお、ア
ナログタッチパネルのより詳細な構造等に関しては、例
えば、特開昭62-189525号公報に開示された技術を参考
にすることができる。
ジタイザ等に利用されている入力手段の一種である。と
ころで、このアナログタッチパネルにおいて座標検出を
行うためには、まず、ペンがＤＯＷＮしているか否かを
検出する必要がある。従来から用いられている一般的な
アナログタッチパネルのドライブ回路を図８に、そのド
ライブフローを図９に示す。図８において、１０は１チ
ップＣＰＵ等から構成される制御部、１１はＹ軸アナロ
グタッチパネル、１２はＸ軸アナログタッチパネル、１
３はアナログスイッチ、１４はプルダウン抵抗、ＳＸ
１，ＳＸ２，ＳＹ１およびＳＹ２はスイッチ素子を示し
ている。図８に示した回路では、ペンがＤＯＷＮしてい
るか否かを検出するための専用のアナログスイッチ１３
とプルダウン抵抗１４とを設けて、制御部１０で、図９
に示すように動作で、Ｘ，Ｙ座標検出前に、必ずペンが
ＤＯＷＮしているか否かをチェックしていた。なお、ア
ナログタッチパネルのより詳細な構造等に関しては、例
えば、特開昭62-189525号公報に開示された技術を参考
にすることができる。
【０００３】
【発明が解決しようとする課題】上記従来技術において
は、毎回、ペンＤＯＷＮ検出を行ってから座標検出を行
わなければならないため、処理速度が遅く、速い筆記速
度に追従できないという問題があった。また、ペンＤＯ
ＷＮ検出専用のアナログスイッチが必要であり、コスト
的にも問題を有するものであった。更に、各スイッチ素
子をそれぞれ専用の出力ポートで制御する必要があり、
合計５本もの出力ポートを使用せざるを得ないため、機
器設計の自由度が大幅に制約されるという問題もあっ
た。これに対しては、例えば、特開平1-158521号公報に
開示されているように、アナログタッチパネルの入力位
置精度を向上させるため、一対の電導性膜の各々が一辺
をスイッチを介して第１の定電圧源に接続され、他辺を
電圧計と所定の抵抗値を有する抵抗との並列接続を介し
て第２の定電圧源に接続されたものが知られている。こ
の回路では、ＣＰＵが制御するスイッチは、１Ｘ，１Ｙ
の２個でよいが、このスイッチを切ったとき、タッチパ
ネルに蓄積された電荷は、４Ｘ，４Ｙの抵抗を通して放
電されるため、放電時間が長くなり、速い検出速度が得
られないという別の問題があった。本発明は上記事情に
鑑みてなされたもので、その目的とするところは、従来
の技術における上述の如き問題を解消し、検出速度が速
く、速い筆記速度にも追従できる座標検出装置を提供す
ることにある。また、本発明の他の目的は、ハードウェ
ア量を減らし、これに伴なって制御部の出力ポート数を
も減少させることが可能な座標検出装置を提供すること
にある。
は、毎回、ペンＤＯＷＮ検出を行ってから座標検出を行
わなければならないため、処理速度が遅く、速い筆記速
度に追従できないという問題があった。また、ペンＤＯ
ＷＮ検出専用のアナログスイッチが必要であり、コスト
的にも問題を有するものであった。更に、各スイッチ素
子をそれぞれ専用の出力ポートで制御する必要があり、
合計５本もの出力ポートを使用せざるを得ないため、機
器設計の自由度が大幅に制約されるという問題もあっ
た。これに対しては、例えば、特開平1-158521号公報に
開示されているように、アナログタッチパネルの入力位
置精度を向上させるため、一対の電導性膜の各々が一辺
をスイッチを介して第１の定電圧源に接続され、他辺を
電圧計と所定の抵抗値を有する抵抗との並列接続を介し
て第２の定電圧源に接続されたものが知られている。こ
の回路では、ＣＰＵが制御するスイッチは、１Ｘ，１Ｙ
の２個でよいが、このスイッチを切ったとき、タッチパ
ネルに蓄積された電荷は、４Ｘ，４Ｙの抵抗を通して放
電されるため、放電時間が長くなり、速い検出速度が得
られないという別の問題があった。本発明は上記事情に
鑑みてなされたもので、その目的とするところは、従来
の技術における上述の如き問題を解消し、検出速度が速
く、速い筆記速度にも追従できる座標検出装置を提供す
ることにある。また、本発明の他の目的は、ハードウェ
ア量を減らし、これに伴なって制御部の出力ポート数を
も減少させることが可能な座標検出装置を提供すること
にある。
【０００４】
【課題を解決するための手段】本発明の上記目的は、１
対の電導性膜から成るアナログタッチパネルの入力位置
を検出するための座標検出装置において、座標検出用電
圧入力端子を、前記アナログタッチパネルが押下されて
いないときは有効入力範囲外の電位となるように、所定
の抵抗によりプルアップまたはプルダウンし、前記アナ
ログタッチパネルの出力電位を所定値と比較することに
より前記アナログタッチパネルの押下を検出して座標検
出を行うことを特徴とする座標検出装置、または、前記
アナログタッチパネルを構成する各電導性膜を駆動する
１対のスイッチ素子のうち、片方のスイッチ素子を遅れ
てオフする如く構成したことを特徴とする座標検出装置
によって達成される。
対の電導性膜から成るアナログタッチパネルの入力位置
を検出するための座標検出装置において、座標検出用電
圧入力端子を、前記アナログタッチパネルが押下されて
いないときは有効入力範囲外の電位となるように、所定
の抵抗によりプルアップまたはプルダウンし、前記アナ
ログタッチパネルの出力電位を所定値と比較することに
より前記アナログタッチパネルの押下を検出して座標検
出を行うことを特徴とする座標検出装置、または、前記
アナログタッチパネルを構成する各電導性膜を駆動する
１対のスイッチ素子のうち、片方のスイッチ素子を遅れ
てオフする如く構成したことを特徴とする座標検出装置
によって達成される。
【０００５】
【作用】本発明に係る座標検出回路においては、プルア
ップまたはプルダウン抵抗により、アナログタッチパネ
ルが押下されていないときの出力電圧値は、有効入力範
囲外の電位となる。従って、専用の押下検出回路等を設
けなくても、上述の出力電圧値からアナログタッチパネ
ルの押下判断を行うことが可能になる。これは、ハード
ウェア的には、押下検出回路が不要になるということで
あり、また、処理手順の上では、座標検出の前に押下検
出を行わなくてもよいということで、その分、高速な座
標検出処理が可能になる。また、アナログタッチパネル
を駆動するスイッチをオフ遅延機能を有するスイッチと
することで、制御端子数を減少させることが可能にな
り、機器設計の自由度が向上する。
ップまたはプルダウン抵抗により、アナログタッチパネ
ルが押下されていないときの出力電圧値は、有効入力範
囲外の電位となる。従って、専用の押下検出回路等を設
けなくても、上述の出力電圧値からアナログタッチパネ
ルの押下判断を行うことが可能になる。これは、ハード
ウェア的には、押下検出回路が不要になるということで
あり、また、処理手順の上では、座標検出の前に押下検
出を行わなくてもよいということで、その分、高速な座
標検出処理が可能になる。また、アナログタッチパネル
を駆動するスイッチをオフ遅延機能を有するスイッチと
することで、制御端子数を減少させることが可能にな
り、機器設計の自由度が向上する。
【０００６】
【実施例】以下、本発明の実施例を図面に基づいて詳細
に説明する。図１に、本発明の一実施例に係るアナログ
タッチパネルのドライブ回路のハード構成を示す。ここ
で、記号１０〜１２，ＳＸ１，ＳＸ２，ＳＹ１およびＳ
Ｙ２は図８に示したと同じ構成要素を示しており、制御
部１０のＸ，Ｙ座標に対応した電圧入力端子ＡＮＸ，Ａ
ＮＹは、プルダウン抵抗１５，１６によりプルダウンさ
れている。なお、この抵抗１５，１６の値は、タッチパ
ネルの面抵抗値より十分大きく、Ａ／Ｄコンバータの入
力インピーダンスより十分小さな値とする。実際には、
タッチパネルの面抵抗値は数百オーム、Ａ／Ｄコンバー
タの入力インピーダンスは数百メガオームであるので、
上述の抵抗１５，１６は、数百キロオームとすればよ
い。また、ドライブスイッチのＧＮＤ側には、図２に例
示するようなＯＦＦ遅延回路１７を入れて、電源側のコ
ントロール端子を共通にして、Ｘ軸，Ｙ軸をそれぞれ、
１本ずつのポートで制御するように構成している。図５
は、アナログタッチパネルの領域図と、Ｙ押下位置にお
けるＡＮＹの入力電圧のグラフである。タッチパネル
は、通常、外部から見える範囲(見切り)の中に規定の有
効入力範囲を設け、この範囲の入力電圧から所定解像度
の座標値を算出する。
に説明する。図１に、本発明の一実施例に係るアナログ
タッチパネルのドライブ回路のハード構成を示す。ここ
で、記号１０〜１２，ＳＸ１，ＳＸ２，ＳＹ１およびＳ
Ｙ２は図８に示したと同じ構成要素を示しており、制御
部１０のＸ，Ｙ座標に対応した電圧入力端子ＡＮＸ，Ａ
ＮＹは、プルダウン抵抗１５，１６によりプルダウンさ
れている。なお、この抵抗１５，１６の値は、タッチパ
ネルの面抵抗値より十分大きく、Ａ／Ｄコンバータの入
力インピーダンスより十分小さな値とする。実際には、
タッチパネルの面抵抗値は数百オーム、Ａ／Ｄコンバー
タの入力インピーダンスは数百メガオームであるので、
上述の抵抗１５，１６は、数百キロオームとすればよ
い。また、ドライブスイッチのＧＮＤ側には、図２に例
示するようなＯＦＦ遅延回路１７を入れて、電源側のコ
ントロール端子を共通にして、Ｘ軸，Ｙ軸をそれぞれ、
１本ずつのポートで制御するように構成している。図５
は、アナログタッチパネルの領域図と、Ｙ押下位置にお
けるＡＮＹの入力電圧のグラフである。タッチパネル
は、通常、外部から見える範囲(見切り)の中に規定の有
効入力範囲を設け、この範囲の入力電圧から所定解像度
の座標値を算出する。
【０００７】ここで、前述のように、ＡＮＹ端子は抵抗
１５，１６によりプルダウンされているため、ペンが押
下されていないときは、ほぼ、０Ｖ付近の電位となる。
従って、ＡＮＹの電位が図５のＹBからＹCの範囲にある
とき、ペンＤＯＷＮしていると判断することができる。
つまり、ＹB≦ＡＮＹ≦ＹCのときは座標値を出力し、０
≦ＡＮＹ＜ＹB、または、ＹC＜ＡＮＹの場合にはペンが
ＵＰしているとして、ペンＵＰフラグを出力するよう
に、ＣＰＵのプログラムを作成する。図６に、ＣＰＵの
プログラムの一例を示す。図６に示すプログラムは、座
標検出の基本動作を示すものであり、スタート後、ま
ず、上述のペンＵＰフラグをクリアし(ステップ21)、出
力ポートＯＰ１からの信号で、スイッチ素子ＳＸ１，Ｓ
Ｘ２をオンする(ステップ22)。そして、ＡＮＸ端子の入
力を読み取り、これをＡ／Ｄ変換して図示されていない
レジスタに保持する(ステップ23)。次に、出力ポートＯ
Ｐ１からの信号で、スイッチ素子ＳＸ１，ＳＸ２をオフ
する(ステップ24)。そして、読み取ったＡＮＸ端子の入
力の値がＸB≦ＡＮＸ≦ＸCの条件を満たしているか否か
をチェックし(ステップ25)、満たしていない場合にはペ
ンＵＰがあったものとして、ペンＵＰフラグをセット
(ステップ31)して、リターンする。
１５，１６によりプルダウンされているため、ペンが押
下されていないときは、ほぼ、０Ｖ付近の電位となる。
従って、ＡＮＹの電位が図５のＹBからＹCの範囲にある
とき、ペンＤＯＷＮしていると判断することができる。
つまり、ＹB≦ＡＮＹ≦ＹCのときは座標値を出力し、０
≦ＡＮＹ＜ＹB、または、ＹC＜ＡＮＹの場合にはペンが
ＵＰしているとして、ペンＵＰフラグを出力するよう
に、ＣＰＵのプログラムを作成する。図６に、ＣＰＵの
プログラムの一例を示す。図６に示すプログラムは、座
標検出の基本動作を示すものであり、スタート後、ま
ず、上述のペンＵＰフラグをクリアし(ステップ21)、出
力ポートＯＰ１からの信号で、スイッチ素子ＳＸ１，Ｓ
Ｘ２をオンする(ステップ22)。そして、ＡＮＸ端子の入
力を読み取り、これをＡ／Ｄ変換して図示されていない
レジスタに保持する(ステップ23)。次に、出力ポートＯ
Ｐ１からの信号で、スイッチ素子ＳＸ１，ＳＸ２をオフ
する(ステップ24)。そして、読み取ったＡＮＸ端子の入
力の値がＸB≦ＡＮＸ≦ＸCの条件を満たしているか否か
をチェックし(ステップ25)、満たしていない場合にはペ
ンＵＰがあったものとして、ペンＵＰフラグをセット
(ステップ31)して、リターンする。
【０００８】一方、ステップ25におけるチェックで、Ｘ
B≦ＡＮＸ≦ＸCの条件を満たしている場合は、ステップ
26に進み、出力ポートＯＰ２からの信号で、スイッチ素
子ＳＹ１，ＳＹ２をオンする。そして、ＡＮＹ端子の入
力を読み取り、これをＡ／Ｄ変換して図示されていない
レジスタに保持する(ステップ27)。次に、出力ポートＯ
Ｐ２からの信号で、スイッチ素子ＳＹ１，ＳＹ２をオフ
する(ステップ28)。そして、先程と全く同様にし、読み
取ったＡＮＹ端子の入力の値がＹB≦ＡＮＹ≦ＹCの条件
を満たしているか否かをチェックし(ステップ29)、満た
していない場合にはペンＵＰがあったものとして、ペン
ＵＰフラグをセット(ステップ31)して、リターンする。
ステップ29におけるチェックで、ＹB≦ＡＮＹ≦ＹCの条
件を満たしている場合は、ステップ30に進み、Ａ／Ｄ変
換値から座標値を算出して、図示されていない出力用受
け渡しレジスタに格納する。上記実施例に示した動作に
よれば、座標検出の前にペンＤＯＷＮ検出を行う必要が
なくなるために、押下検出回路が不要になるばかりでな
く、処理速度が向上し、速い筆記速度に充分追従できる
ようになるという効果が得られる。
B≦ＡＮＸ≦ＸCの条件を満たしている場合は、ステップ
26に進み、出力ポートＯＰ２からの信号で、スイッチ素
子ＳＹ１，ＳＹ２をオンする。そして、ＡＮＹ端子の入
力を読み取り、これをＡ／Ｄ変換して図示されていない
レジスタに保持する(ステップ27)。次に、出力ポートＯ
Ｐ２からの信号で、スイッチ素子ＳＹ１，ＳＹ２をオフ
する(ステップ28)。そして、先程と全く同様にし、読み
取ったＡＮＹ端子の入力の値がＹB≦ＡＮＹ≦ＹCの条件
を満たしているか否かをチェックし(ステップ29)、満た
していない場合にはペンＵＰがあったものとして、ペン
ＵＰフラグをセット(ステップ31)して、リターンする。
ステップ29におけるチェックで、ＹB≦ＡＮＹ≦ＹCの条
件を満たしている場合は、ステップ30に進み、Ａ／Ｄ変
換値から座標値を算出して、図示されていない出力用受
け渡しレジスタに格納する。上記実施例に示した動作に
よれば、座標検出の前にペンＤＯＷＮ検出を行う必要が
なくなるために、押下検出回路が不要になるばかりでな
く、処理速度が向上し、速い筆記速度に充分追従できる
ようになるという効果が得られる。
【０００９】また、上記実施例に示した動作において
は、図２に示したＯＦＦ遅延回路１７の作用により、ス
イッチ素子ＳＸ１(電源側)，ＳＸ２(ＧＮＤ側)は、オン
時には同時にオンされるが、オフ時にはＳＸ２(ＧＮＤ
側)が遅れてオフされる。これにより、両スイッチ素子
を同時にオフした場合に発生する、前述の、タッチパネ
ルに蓄積された電荷の放電時間の遅れ(図３参照)がなく
なり、図４に示すような、シャープな放電が可能にな
る。この放電時間の遅れがなくなることにより、ハード
ウェア的にも速度向上が実現される効果がある。更に、
ペンをＤＯＷＮまたはＵＰした瞬間の入力をＡ／Ｄ変換
してしまうと、タッチパネルの接触抵抗，チャタリング
等の影響により、ＡＮＹの値が座標値に対応した正しい
値にならず、全く異なった値になってしまう可能性があ
る。実際の操作においては、これを防止するために、図
７に示すように、一つ上のモジュールで、上述の座標検
出ステップで得た座標値(ステップ41)をメモリに記憶し
ておき(ステップ43)、これと次に検出した座標値(ステ
ップ44)とを比較して、その差が予め定めた所定値内で
あれ場合にのみ、得られた座標を用いて処理を実行する
(ステップ46と47)ようにしている。
は、図２に示したＯＦＦ遅延回路１７の作用により、ス
イッチ素子ＳＸ１(電源側)，ＳＸ２(ＧＮＤ側)は、オン
時には同時にオンされるが、オフ時にはＳＸ２(ＧＮＤ
側)が遅れてオフされる。これにより、両スイッチ素子
を同時にオフした場合に発生する、前述の、タッチパネ
ルに蓄積された電荷の放電時間の遅れ(図３参照)がなく
なり、図４に示すような、シャープな放電が可能にな
る。この放電時間の遅れがなくなることにより、ハード
ウェア的にも速度向上が実現される効果がある。更に、
ペンをＤＯＷＮまたはＵＰした瞬間の入力をＡ／Ｄ変換
してしまうと、タッチパネルの接触抵抗，チャタリング
等の影響により、ＡＮＹの値が座標値に対応した正しい
値にならず、全く異なった値になってしまう可能性があ
る。実際の操作においては、これを防止するために、図
７に示すように、一つ上のモジュールで、上述の座標検
出ステップで得た座標値(ステップ41)をメモリに記憶し
ておき(ステップ43)、これと次に検出した座標値(ステ
ップ44)とを比較して、その差が予め定めた所定値内で
あれ場合にのみ、得られた座標を用いて処理を実行する
(ステップ46と47)ようにしている。
【００１０】ステップ46におけるチェックで所定値以上
の差がある場合には、途中でペンＵＰがあったものと判
断し、得られた座標は捨てることになる。なお、Ｘ軸側
についても、同様の処理を行う。上記実施例によれば、
Ａ／Ｄ変換入力部をプルダウンしておき、常に、Ｘ軸，
Ｙ軸の出力電圧変換値を監視することにより、ペンが押
下されているか否かを判断することが可能になり、座標
検出の前に特別なペンＤＯＷＮ検出を行う必要がなくな
るため、処理速度が向上するという効果が得られる。ま
た、前回の座標データとの比較処理を行うことで、ペン
がＵＰ，ＤＯＷＮした瞬間の異常座標データを取り込む
ことなく、正確な座標検出を行うことが可能になる。な
お、上記実施例は本発明の一例を示したものであり、本
発明はこれに限定されるべきものではないことは言うま
でもない。例えば、上記実施例においては、ＧＮＤ側を
抵抗１５，１６によりプルダウンした例を示したが、こ
れを、電源側をプルアップ抵抗によりプルアップしても
よいという如くである。
の差がある場合には、途中でペンＵＰがあったものと判
断し、得られた座標は捨てることになる。なお、Ｘ軸側
についても、同様の処理を行う。上記実施例によれば、
Ａ／Ｄ変換入力部をプルダウンしておき、常に、Ｘ軸，
Ｙ軸の出力電圧変換値を監視することにより、ペンが押
下されているか否かを判断することが可能になり、座標
検出の前に特別なペンＤＯＷＮ検出を行う必要がなくな
るため、処理速度が向上するという効果が得られる。ま
た、前回の座標データとの比較処理を行うことで、ペン
がＵＰ，ＤＯＷＮした瞬間の異常座標データを取り込む
ことなく、正確な座標検出を行うことが可能になる。な
お、上記実施例は本発明の一例を示したものであり、本
発明はこれに限定されるべきものではないことは言うま
でもない。例えば、上記実施例においては、ＧＮＤ側を
抵抗１５，１６によりプルダウンした例を示したが、こ
れを、電源側をプルアップ抵抗によりプルアップしても
よいという如くである。
【００１１】
【発明の効果】以上、詳細に説明した如く、本発明によ
れば、検出速度が速く、速い筆記速度にも追従できる座
標検出装置を実現でき、また、ハードウェア量を減ら
し、これに伴なって制御部の出力ポート数をも減少させ
ることが可能な座標検出装置を実現できるという顕著な
効果を奏するものである。
れば、検出速度が速く、速い筆記速度にも追従できる座
標検出装置を実現でき、また、ハードウェア量を減ら
し、これに伴なって制御部の出力ポート数をも減少させ
ることが可能な座標検出装置を実現できるという顕著な
効果を奏するものである。
【図１】本発明の一実施例に係るアナログタッチパネル
のドライブ回路のハード構成を示す図である。
のドライブ回路のハード構成を示す図である。
【図２】実施例に係るアナログタッチパネルドライブ回
路中のＯＦＦ遅延回路の構成例を示す図である。
路中のＯＦＦ遅延回路の構成例を示す図である。
【図３】従来技術におけるタッチパネルに蓄積された電
荷の放電時間の遅れを示す図である。
荷の放電時間の遅れを示す図である。
【図４】図２に示したＯＦＦ遅延回路による、タッチパ
ネルに蓄積された電荷の放電時間の遅れ解消を示す図で
ある。
ネルに蓄積された電荷の放電時間の遅れ解消を示す図で
ある。
【図５】実施例に係るアナログタッチパネルの領域図
と、Ｙ押下位置におけるＡＮＹの入力電圧のグラフであ
る。
と、Ｙ押下位置におけるＡＮＹの入力電圧のグラフであ
る。
【図６】実施例に係るアナログタッチパネルドライブ回
路中の制御部(ＣＰＵ)の座標検出の下位プログラムの一
例を示す図である。
路中の制御部(ＣＰＵ)の座標検出の下位プログラムの一
例を示す図である。
【図７】実施例に係るアナログタッチパネルドライブ回
路中の制御部(ＣＰＵ)の座標検出の上位プログラムの一
例を示す図である。
路中の制御部(ＣＰＵ)の座標検出の上位プログラムの一
例を示す図である。
【図８】従来の一般的なアナログタッチパネルのドライ
ブ回路を示す図である。
ブ回路を示す図である。
【図９】図８に示した回路のドライブフロー図である。
１０：制御部、１１：Ｙ軸アナログタッチパネル、１
２：Ｘ軸アナログタッチパネル、ＳＸ１，ＳＸ２，ＳＹ
１およびＳＹ２：スイッチ素子、１５，１６：プルダウ
ン抵抗、１７：ＯＦＦ遅延回路。
２：Ｘ軸アナログタッチパネル、ＳＸ１，ＳＸ２，ＳＹ
１およびＳＹ２：スイッチ素子、１５，１６：プルダウ
ン抵抗、１７：ＯＦＦ遅延回路。
Claims (5)
- 【請求項１】 １対の電導性膜から成るアナログタッチ
パネルの入力位置を検出するための座標検出装置におい
て、座標検出用電圧入力端子を、前記アナログタッチパ
ネルが押下されていないときは有効入力範囲外の電位と
なるように、所定の抵抗によりプルアップまたはプルダ
ウンし、前記アナログタッチパネルの出力電位を所定値
と比較することにより前記アナログタッチパネルの押下
を検出して座標検出を行うことを特徴とする座標検出装
置。 - 【請求項２】 前記アナログタッチパネルの押下を検出
して行った座標検出結果を前回の座標検出結果と比較し
て、これらの間に所定値以上の差がある場合には、途中
でペンＵＰがあったと判断して当該座標検出結果を捨て
ることを特徴とする請求項１記載の座標検出装置。 - 【請求項３】 １対の電導性膜から成るアナログタッチ
パネルの入力位置を検出するための座標検出装置におい
て、前記アナログタッチパネルを構成する各電導性膜を
駆動する１対のスイッチ素子のうち、片方のスイッチ素
子を遅れてオフする如く構成したことを特徴とする座標
検出装置。 - 【請求項４】 １対の電導性膜から成るアナログタッチ
パネルの入力位置を検出するための座標検出装置におい
て、前記アナログタッチパネルを構成する各電導性膜を
駆動する１対のスイッチ素子のうち、片方のスイッチ素
子を遅れてオフする如く構成するとともに、座標検出用
電圧入力端子を、前記アナログタッチパネルが押下され
ていないときは有効入力範囲外の電位となるように、所
定の抵抗によりプルアップまたはプルダウンし、前記ア
ナログタッチパネルの出力電位を所定値と比較すること
により前記アナログタッチパネルの押下を検出して座標
検出を行うことを特徴とする座標検出装置。 - 【請求項５】 前記アナログタッチパネルの押下を検出
して行った座標検出結果を前回の座標検出結果と比較し
て、これらの間に所定値以上の差がある場合には、途中
でペンＵＰがあったと判断して当該座標検出結果を捨て
ることを特徴とする請求項４記載の座標検出装置。
Priority Applications (3)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2252493A JPH06236230A (ja) | 1993-02-10 | 1993-02-10 | 座標検出装置 |
| TW083101023A TW257852B (en) | 1993-02-10 | 1994-02-07 | Coordinates detecting device |
| CN94102796.1A CN1098798A (zh) | 1993-02-10 | 1994-02-09 | 坐标检测设备 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2252493A JPH06236230A (ja) | 1993-02-10 | 1993-02-10 | 座標検出装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH06236230A true JPH06236230A (ja) | 1994-08-23 |
Family
ID=12085178
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2252493A Pending JPH06236230A (ja) | 1993-02-10 | 1993-02-10 | 座標検出装置 |
Country Status (3)
| Country | Link |
|---|---|
| JP (1) | JPH06236230A (ja) |
| CN (1) | CN1098798A (ja) |
| TW (1) | TW257852B (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO1997009670A1 (fr) * | 1995-09-08 | 1997-03-13 | Smk Corporation | Tablette du type a resistance sensible a la pression et procede de detection de la pression d'une plume associe a ladite tablette |
Families Citing this family (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| CN100377055C (zh) * | 2004-12-22 | 2008-03-26 | 盛群半导体股份有限公司 | 触控感应装置的判读方法 |
| CN100336005C (zh) * | 2004-12-27 | 2007-09-05 | 盛群半导体股份有限公司 | 触控感应装置的判读方法 |
-
1993
- 1993-02-10 JP JP2252493A patent/JPH06236230A/ja active Pending
-
1994
- 1994-02-07 TW TW083101023A patent/TW257852B/zh active
- 1994-02-09 CN CN94102796.1A patent/CN1098798A/zh active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO1997009670A1 (fr) * | 1995-09-08 | 1997-03-13 | Smk Corporation | Tablette du type a resistance sensible a la pression et procede de detection de la pression d'une plume associe a ladite tablette |
Also Published As
| Publication number | Publication date |
|---|---|
| TW257852B (en) | 1995-09-21 |
| CN1098798A (zh) | 1995-02-15 |
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