JPH0546951B2 - - Google Patents
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- Publication number
- JPH0546951B2 JPH0546951B2 JP26533984A JP26533984A JPH0546951B2 JP H0546951 B2 JPH0546951 B2 JP H0546951B2 JP 26533984 A JP26533984 A JP 26533984A JP 26533984 A JP26533984 A JP 26533984A JP H0546951 B2 JPH0546951 B2 JP H0546951B2
- Authority
- JP
- Japan
- Prior art keywords
- supplied
- terminal
- data
- signal
- memory
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Lifetime
Links
- 238000010586 diagram Methods 0.000 description 4
- 239000004973 liquid crystal related substance Substances 0.000 description 1
Landscapes
- Control Of Indicators Other Than Cathode Ray Tubes (AREA)
Description
【発明の詳細な説明】
〔産業上の利用分野〕
この発明は、表示素子をダイナミツク点灯制御
するための、表示素子の駆動回路に関するもので
ある。
するための、表示素子の駆動回路に関するもので
ある。
従来、螢光表示管、液晶などの表示素子をダイ
ナミツク駆動する場合、表示データを記憶するメ
モリを設け、このメモリから順次読出したデータ
を表示素子に供給して、表示を行なつている。
ナミツク駆動する場合、表示データを記憶するメ
モリを設け、このメモリから順次読出したデータ
を表示素子に供給して、表示を行なつている。
第2図はこのような従来装置の一例を示すブロ
ツク図である。同図において、1は端子Sに書込
み信号WR.Pが供給されている時は端子Aに供給
されている信号を端子Oから送出し、端子Sに書
込み信号WR.Pが供給されていない時は端子Bに
供給されている信号を端子Oから送出する切換器
である。2は端子WRに書込み信号WR.Pが供給
されている時は端子DAに供給されているデータ
を、端子ADRに供給されている信号が表わすア
ドレスに書込み、端子WRに書込み信号WR.Pが
供給されていない時は端子ADRに供給されてい
る信号が表わすアドレスに書込まれているデータ
を端子DAから読出すメモリである。3は端子G
に書込み信号WR.Pが供給された時だけ、端子I
に供給されている信号を端子Oから送出するゲー
ト、4はシフトレジスタ、5はアノードドライ
バ、6は螢光表示管、7はクロツク信号発生器、
8はカウンタ、9はグリツドドライバである。1
0はカウンタ8から供給される信号に応じてシフ
トレジスタ4およびグリツドドライバ9に供給す
るために必要なタイミング信号を発生させるコン
トロール回路である。
ツク図である。同図において、1は端子Sに書込
み信号WR.Pが供給されている時は端子Aに供給
されている信号を端子Oから送出し、端子Sに書
込み信号WR.Pが供給されていない時は端子Bに
供給されている信号を端子Oから送出する切換器
である。2は端子WRに書込み信号WR.Pが供給
されている時は端子DAに供給されているデータ
を、端子ADRに供給されている信号が表わすア
ドレスに書込み、端子WRに書込み信号WR.Pが
供給されていない時は端子ADRに供給されてい
る信号が表わすアドレスに書込まれているデータ
を端子DAから読出すメモリである。3は端子G
に書込み信号WR.Pが供給された時だけ、端子I
に供給されている信号を端子Oから送出するゲー
ト、4はシフトレジスタ、5はアノードドライ
バ、6は螢光表示管、7はクロツク信号発生器、
8はカウンタ、9はグリツドドライバである。1
0はカウンタ8から供給される信号に応じてシフ
トレジスタ4およびグリツドドライバ9に供給す
るために必要なタイミング信号を発生させるコン
トロール回路である。
このように構成された装置において、書込時は
外部の機器から端子WR.Pに書込み信号が供給さ
れるので、書込みを行なうデータが端子WR.Dか
らゲート3を介してメモリ2の端子DAに供給さ
れ、アドレスデータが端子WR.Aから切換器1を
介してメモリ2の端子ADRに供給される。一方、
書込信号はメモリ2の端子WRにも供給されてい
るので、端子DAに供給されたデータが、端子
ADRに供給されているアドレス信号が表わすア
ドレスに書込まれる。
外部の機器から端子WR.Pに書込み信号が供給さ
れるので、書込みを行なうデータが端子WR.Dか
らゲート3を介してメモリ2の端子DAに供給さ
れ、アドレスデータが端子WR.Aから切換器1を
介してメモリ2の端子ADRに供給される。一方、
書込信号はメモリ2の端子WRにも供給されてい
るので、端子DAに供給されたデータが、端子
ADRに供給されているアドレス信号が表わすア
ドレスに書込まれる。
端子WR、Pに書込み信号が供給されていない
時は、カウンタ8の出力が切換器1を介してメモ
リ2の端子ADRに供給されるので、その信号が
表わすアドレスに書込まれているデータが端子
DAから読出される。読出されたデータはシフト
レジスタ4に取込まれ、アノードドライバ5を介
して螢光表示管6のアノードを駆動する。また、
コントロール回路10は適当なタイミングで桁選
択信号を発生し、グリツドドライバ9を介して螢
光表示管6のグリツドを駆動し、表示が行なわれ
る。そして、メモリ2からのデータの読出および
表示が繰返して行なわれることによつて継続した
表示が行なわれる。
時は、カウンタ8の出力が切換器1を介してメモ
リ2の端子ADRに供給されるので、その信号が
表わすアドレスに書込まれているデータが端子
DAから読出される。読出されたデータはシフト
レジスタ4に取込まれ、アノードドライバ5を介
して螢光表示管6のアノードを駆動する。また、
コントロール回路10は適当なタイミングで桁選
択信号を発生し、グリツドドライバ9を介して螢
光表示管6のグリツドを駆動し、表示が行なわれ
る。そして、メモリ2からのデータの読出および
表示が繰返して行なわれることによつて継続した
表示が行なわれる。
しかしながら、このような従来の装置は表示と
書込とのタイミングの同期をとつていないので、
書込信号は任意のタイミングで供給される。この
ため、書込が行なわれる時、シフトレジスタ4に
取込まれるデータはメモリ2から読出されたデー
タでなく、書込を行なうデータとなり、螢光表示
管6での表示にフリツカが生じるという欠点を有
していた。
書込とのタイミングの同期をとつていないので、
書込信号は任意のタイミングで供給される。この
ため、書込が行なわれる時、シフトレジスタ4に
取込まれるデータはメモリ2から読出されたデー
タでなく、書込を行なうデータとなり、螢光表示
管6での表示にフリツカが生じるという欠点を有
していた。
このような欠点を解消するためにこの発明は、
クロツク信号によつてリセツトされる分周器を介
してカウンタを駆動するようにしたものである。
クロツク信号によつてリセツトされる分周器を介
してカウンタを駆動するようにしたものである。
書込信号が供給されている期間はカウンタのカ
ウント動作が中断されるので、シフトレジスタに
新たなデータが取込まれない。
ウント動作が中断されるので、シフトレジスタに
新たなデータが取込まれない。
第1図はこの発明の一実施例を示すブロツク図
であり、第2図と同一部分は同記号を用いてい
る。図において、11,12は分周器であり、端
子Rにリセツト信号が供給されるとリセツトされ
るようになつている。グリツドドライバ13は端
子INHに書込信号が供給された時、出力信号を
送出しないようになつている。
であり、第2図と同一部分は同記号を用いてい
る。図において、11,12は分周器であり、端
子Rにリセツト信号が供給されるとリセツトされ
るようになつている。グリツドドライバ13は端
子INHに書込信号が供給された時、出力信号を
送出しないようになつている。
このように構成された装置において、クロツク
信号発生器7から出力されるクロツク信号は分周
器11,12を介してカウンタ8に供給され、カ
ウントされる。その後は従来装置と同様にメモリ
2から読出されたデータが螢光表示管6で表示さ
れる。
信号発生器7から出力されるクロツク信号は分周
器11,12を介してカウンタ8に供給され、カ
ウントされる。その後は従来装置と同様にメモリ
2から読出されたデータが螢光表示管6で表示さ
れる。
一方、端子WR.Pに書込信号が供給されると分
周器11,12はリセツトされるので、カウンタ
8およびコントロール回路10の動作が停止され
る。この時、シフトレジスタ4の入力には書込み
を行なうためのデータが供給されるが、コントロ
ール回路10からデータの取込みを行なうための
信号が供給されないので、シフトレジスタ4は新
たなデータを取込まず、表示フリツカは生じな
い。一方、グリツドドライバ13は端子INHに
書込信号が供給されるので、出力信号を送出しな
い。このため、データ書込中は表示が中断され
る。そして、書込信号が供給されなくなると、再
びカウンタ8が動作するので、螢光表示管6の表
示が再開される。なお、分周器は2個以上用いる
ことによつて調速が容易になる。
周器11,12はリセツトされるので、カウンタ
8およびコントロール回路10の動作が停止され
る。この時、シフトレジスタ4の入力には書込み
を行なうためのデータが供給されるが、コントロ
ール回路10からデータの取込みを行なうための
信号が供給されないので、シフトレジスタ4は新
たなデータを取込まず、表示フリツカは生じな
い。一方、グリツドドライバ13は端子INHに
書込信号が供給されるので、出力信号を送出しな
い。このため、データ書込中は表示が中断され
る。そして、書込信号が供給されなくなると、再
びカウンタ8が動作するので、螢光表示管6の表
示が再開される。なお、分周器は2個以上用いる
ことによつて調速が容易になる。
以上説明したようにこの発明は、書込信号によ
つてリセツトされる分周器を介してクロツク信号
発生器から発生するクロツク信号のカウントを行
なうものであるから、書込時はカウンタの動作が
中断され、表示動作が進行しないので、表示にフ
リツカが発生せず、見易い表示が行なえるという
効果を有する。
つてリセツトされる分周器を介してクロツク信号
発生器から発生するクロツク信号のカウントを行
なうものであるから、書込時はカウンタの動作が
中断され、表示動作が進行しないので、表示にフ
リツカが発生せず、見易い表示が行なえるという
効果を有する。
第1図はこの発明の一実施例を示すブロツク
図、第2図は従来装置の一例を示すブロツク図で
ある。 1……切換器、2……メモリ、3……ゲート、
4……シフトレジスタ、5……アノードドライ
バ、6……螢光表示管、7……クロツク信号発生
器、8……カウンタ、10,11……分周器、1
3……グリツドドライバ。
図、第2図は従来装置の一例を示すブロツク図で
ある。 1……切換器、2……メモリ、3……ゲート、
4……シフトレジスタ、5……アノードドライ
バ、6……螢光表示管、7……クロツク信号発生
器、8……カウンタ、10,11……分周器、1
3……グリツドドライバ。
Claims (1)
- 1 書込信号が供給されている時はデータ端子に
供給されるデータがメモリに書込まれ、書込み信
号が供給されていない時はメモリに書込まれてい
るデータが読出されるとともに、クロツク信号発
生器で発生するクロツク信号をカウントするカウ
ンタの出力信号によつてメモリから読出されたデ
ータを表示素子に供給する表示素子の駆動回路に
おいて、クロツク信号を分周して前記カウンタに
供給するとともに、書込信号が供給された時に分
周結果がリセツトされる分周器を備えたことを特
徴とする表示素子の駆動回路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP26533984A JPS61144693A (ja) | 1984-12-18 | 1984-12-18 | 表示素子の駆動回路 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP26533984A JPS61144693A (ja) | 1984-12-18 | 1984-12-18 | 表示素子の駆動回路 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS61144693A JPS61144693A (ja) | 1986-07-02 |
JPH0546951B2 true JPH0546951B2 (ja) | 1993-07-15 |
Family
ID=17415810
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP26533984A Granted JPS61144693A (ja) | 1984-12-18 | 1984-12-18 | 表示素子の駆動回路 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS61144693A (ja) |
-
1984
- 1984-12-18 JP JP26533984A patent/JPS61144693A/ja active Granted
Also Published As
Publication number | Publication date |
---|---|
JPS61144693A (ja) | 1986-07-02 |
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