JPH05342820A - 画面探索時探索画面のロッキング回路 - Google Patents

画面探索時探索画面のロッキング回路

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JPH05342820A
JPH05342820A JP3206997A JP20699791A JPH05342820A JP H05342820 A JPH05342820 A JP H05342820A JP 3206997 A JP3206997 A JP 3206997A JP 20699791 A JP20699791 A JP 20699791A JP H05342820 A JPH05342820 A JP H05342820A
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signal
viss
pulse
video signal
image memory
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JP3206997A
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Se Young Jung
世 永 鄭
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Abstract

(57)【要約】 【構成】 ビデオ信号再生器10の再生ビデオ信号をデ
ィジタル信号で変換させ記録させてこれを読み出す画像
メモリ部60を構成し、VISSパルスを一定時間遅延
させたVISSパルス遅延部80の出力からモーター制
御部90の画像メモリ部60の動作を制御させる一方、
出力選択器20の動作を制御してビデオ信号再生器10
と画像メモリ部60の出力信号を選択的にモニター40
に印加させるようにした。 【効果】 VISS機能利用時再生画面間に先ず再生さ
れたビデオ信号の最終画像が停止画面でディスプレーさ
れるので、探索画面確認に便利であり、また探索時の退
屈がなくなる。

Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】本発明は、一つのテープに多い種
類のプログラムが録画されている場合願うプログラムを
速く探すことのできる画面探索装置(ビデオ インデッ
クス サーチシステム、以下“VISS”という)を備
えたVTRに係わり、特にプログラムの初期に何秒間か
再生される画面を次のプログラムの初期画面が現れる時
まで停止画面でディスプレイさせる画面探索時探索画面
ロッキング回路に関する。
【0002】
【従来の技術】一般に、一つの記録用テープに多数個の
プログラムが録画されている場合願うプログラムを速い
時間に探すことができるようにするVISS機能を備え
たVTRが多いが、VISS機能はプログラムの始まり
部分を約5秒間再生させた後巻戻しあるいは高速前進
(早送り)動作を遂行させ次のプログラムの始めの部分
で再び5秒間再生する動作をすることにより、使用者が
願うプログラムを速い時間に探すことができるようにな
っているが、約5秒間再生した後次のプログラムの始め
の部分が検出されて再生される時までの期間は何も見え
なくなるものであった。従ってVISS機能利用時テー
プが巻戻しあるいは高速前進動作を遂行する時には画面
にどの画像も現われなくてプログラムの内容を確認する
ことができないばかりでなく、使用者がプログラムを探
す時間まで退屈を感じさせる問題点があった。
【0003】
【発明が解決しようとする課題】本発明はこのような問
題点を解決するためのもので、本発明の目的はVISS
機能利用時プログラム始めの初期で再生された後次のプ
ログラムの始めの地点まで何の画像も現われないことを
改善して、プログラムの初期で再生される画面の最終画
像を停止画面で次のプログラムが検出される時までディ
スプレイさせてくれるようにすることにより、VISS
機能利用時画面に何も現われない期間を無くすことがで
きるようにした画面探索時探索画面ロッキング回路を提
供しようとすることにある。
【0004】
【課題を解決するための手段】このような目的を達成す
るための本発明の特徴はビデオヘッドで検出されたビデ
オ信号を処理してビデオ出力端に印加させるビデオ信号
再生器と、コントロールヘッドで検出されたVISS信
号をパルスで変換させる信号検出器と、上記VISS信
号検出器のパルス信号でキャプスタンモーターの駆動を
制御するモーター制御部とから構成されてVISS機能
を行うVTRにおいて、上記VISS信号検出器のパル
ス信号を一定時間遅延させるVISSパルス遅延部と、
上記ビデオ信号再生器の再生ビデオ信号を上記VISS
パルス遅延部の遅延パルスで記録させてこれを読み出す
画像メモリ手段と、上記メモリ手段で読み出された信号
と上記ビデオ信号再生器の出力信号を上記VISSパル
ス遅延部の遅延パルスで選択して出力させる出力選択器
とを含んで構成される画面探索時探索画面ロッキング回
路にある。
【0005】
【実施例】以下、本発明による望ましい一実施例を添付
図面を参照して詳細に説明する。図1は本発明による画
面探索時探索画面ロッキング回路図として、ビデオヘッ
ドCH1にビデオ信号再生器10を連結させ上記ビデオ
ヘッドCH1で検出されたテープTのビデオ信号を再生
ビデオ信号で変換させる。そして、コントロールヘッド
CH2にVISS信号検出器70を連結させ上記コント
ロールヘッドCH2で検出されたVISS信号をパルス
信号で変換させ上記VISS信号検出器70にはVIS
Sパルス遅延部80を連結させて上記VISS信号検出
器70から出力されるパルスを一定時間遅延させる。か
つ、上記VISSパルス遅延部80にはモーター制御部
90を連結させ上記モーター制御部90は上記VISS
信号検出器70の出力パルスにより制御される。
【0006】一方、上記ビデオ信号再生器10には再生
ビデオ信号をディジタル信号で変換させるアナログディ
ジタル変換器50を連結させ上記VISSパルス遅延部
80,モーター制御部90及びアナログディジタル変換
器50には画像メモリ部60を連結させ上記アナログデ
ィジタル変換器50のディジタル信号を上記VISSパ
ルス遅延部80の遅延パルスでメモリさせクロック信号
CLKにより読み出されるようにする。
【0007】そして、上記画像メモリ部60にはディジ
タルアナログ変換器55を連結させ上記画像メモリ部6
0の出力信号をアナログ信号で変換させる。かつ、上記
ディジタルアナログ変換器55の出力信号と上記ビデオ
信号再生器10の再生ビデオ信号中の一つの信号を上記
VISSパルス遅延部80の遅延パルスで選択する出力
選択器20を上記ビデオ信号再生器10及びディジタル
アナログ変換器55に連結させる。40はTV等のモニ
ターであり、100はキャプスタンモーターである。そ
して、図2は本発明回路図の各部の波形を示したもので
ある。
【0008】このように構成された本発明で記録テープ
Tのプログラム始めの初期に記録されるVISS信号を
コントロールヘッドCH2で検出してVISS信号検出
器70に印加させるとVISS信号検出器70では、図
2の(A)でのようなVISSパルスを出力する。即
ち、テープTに記録されたVISS信号はコントロール
ヘッドCH2で検出されVISS信号検出器70に印加
されると、VISS信号検出器70では図2の(A)の
ようにVISS信号が記録された期間ハイレベルのVI
SSパルスを出力する。VISS信号検出器70から出
力されるVISS信号はVISSパルス遅延部80に印
加され一定時間tの間遅延されて出力される。即ち、V
ISSパルス遅延部80では図2の(B)のようにVI
SS信号検出器70のVISSパルスを一定時間tの間
遅延させて出力し、この時VISSパルス遅延部80で
遅延されたVISSパルスのハイレベル区間aが再生さ
れる期間でありローレベル区間bが巻戻しあるいは高速
前進の期間になる。
【0009】一方、テープTに記録されたビデオ信号は
ビデオヘッドCH1で検出されビデオ信号再生器10で
再生ビデオ信号で処理された後、出力選択器20の端子
1に印加される一方アナログディジタル変換器50を通
ってディジタル信号に変換された後画像メモリ部60に
記録される。この時画像メモリ部60の容量は1フレー
ムの画像を記録することができる程度なら良く、画像メ
モリ部60の記録及び読み出す動作は上記VISSパル
ス遅延部80の遅延パルスにより制御されクロックパル
スCKLにより動作される。即ち、画像メモリ部60は
アナログディジタル変換器50からディジタル信号で印
加されるビデオ信号の1フレームを記録及び読み出すこ
とになり、画像メモリ部60の記録動作はVISSパル
ス遅延部80の遅延パルスがハイレベルである区間なさ
れ、読み出す動作は遅延パルスがローレベルである区間
なされる(図2の(C)波形参照)。
【0010】そして、画像メモリ部60からクロックパ
ルスCKL周波数で読み出した1フレーム分のディジタ
ルビデオ信号はディジタルアナログ変換器55でアナロ
グ信号で変換された後出力選択器20の端子へ印加され
る。この時出力選択器20はVISSパルス遅延部80
の遅延パルスにより動作が制御されるもので遅延パルス
がハイレベルなら端子1に接続されローレベルなら端子
2に接続される。そして、出力選択器20で選択された
ビデオ信号はビデオ出力端に印加されてモニター40で
ディスプレイされて外部の出力ジャック等に印加され
る。キャプスタンモーター100の駆動を制御するモー
ター制御部90はVISSパルス遅延部80の遅延パル
スにより動作されるもので、VISSパルス遅延部80
の遅延パルスがハイレベルならモーター制御部90にキ
ャプスタンモーター100を正常回転させて再生動作さ
れるようにし、ローレベルならキャプスタンモーター1
00を高速回転させて高速前進あるいは巻戻しの動作に
なるようにする。
【0011】従って、VISS機能を選択するようにな
るとVISSパルス遅延部80では図2の(B)のよう
に遅延されたVISSパルスを出力させる一方、ビデオ
信号再生器10では再生ビデオ信号を出力させるように
なる。この時VISSパルス遅延部80の遅延パルスが
ハイレベルである区間では、モーター制御部90を制御
しキャプスタンモーター100を正常回転させる一方、
出力選択器20を端子1に接続させるとともに画像メモ
リ部60を記録動作させビデオ信号再生器10で再生さ
れアナログディジタル変換器50を通った信号を記録す
る。
【0012】即ち、VISS信号が検出されるプログラ
ムの初期では、VISSパルス遅延部80の遅延パルス
がハイレベルで出力される一定時間の間(約5秒)モー
ター制御部90でキャプスタンモーター100を制御し
て再生動作されるようにし、出力選択器20を端子1に
接続させてビデオ信号再生器10の再生ビデオ信号がモ
ニター40でディスプレイされるようにし、かつ画像メ
モリ部60でアナログディジタル変換器50のディジタ
ル信号出力をメモリさせる。この時画像メモリ部60の
メモリ容量は1フレームであるのでVISSパルス遅延
部80の遅延パルスがローレベルで落ちる時、画像メモ
リ部60には1フレームの最終画像がメモリされる。そ
してVISSパルス遅延部80の遅延パルスがローレベ
ルになると、モーター制御部90を制御してキャプスタ
ンモーター100を高速回転させるようにし、出力選択
器20の端子2を選択して画像メモリ部60の内容を出
力させる。即ち、VISSパルス遅延部80の遅延パル
スがローレベルになると画像メモリ部60は記録動作を
中止し、クロックパルスCKLにより読み出し動作を繰
り返すようになり、画像メモリ部60で読み出されたデ
ィジタル信号はディジタルアナログ変換器55を通った
後出力選択器20の端子2を通ってモニター40に印加
されることにより、モニター40では画像メモリ部60
にメモリされてあった1フレーム画像を停止画面でディ
スプレイさせる。
【0013】この状態で再び次のプログラムの始めの部
分からVISS信号が検出されると、VISSパルス遅
延部80の遅延パルスがハイレベルになり、モーター制
御部90と出力選択器20及び画像メモリ部60の動作
を制御することによりプログラムの初期部分を一定時間
再生して見られ、この時画像メモリ部60には再び再生
されるビデオ信号の最終画像に対する1フレームの画面
が記録される。
【0014】このようにVISS機能を利用して願うプ
ログラムを探す時プログラムが一定時間再生された後次
のプログラムの始め部分が探される時まで先ず再生され
た再生画面の最終画像が停止画面でディスプレーされる
ので、記録された内容を使用者が続けて認識することが
できるようになる。そして上記本発明はディジタルVT
Rでは予め画像をメモリするメモリが構成されているの
で、簡単に適用させることができ、アナログVTRでは
1チップで画像をメモリする画像メモリを利用して適用
させることができる。
【0015】
【発明の効果】以上のように本発明はVISS機能の利
用時プログラム初期の再生画面と次の再生画面の間に先
ず再生された最終画像を停止画面でディスプレーさせて
プログラム内容確認を続けることができ、かつ画面探索
の退屈を無くすことができるものである。
【図面の簡単な説明】
【図1】本発明による画面探索時探索画面のロッキング
回路である。
【図2】(A)〜(E)は図1の各部の波形図である。
【符号の説明】
10 ビデオ信号再生器 20 出力選択器 30 ビデオ出力端 40 モニター 50 アナログディジタル変換器 55 ディジタルアナログ変換器 60 画像メモリ部 70 VISS信号検出器 80 VISSパルス遅延部 90 モーター制御部 CH1 ビデオヘッド CH2 コントロールヘッド

Claims (2)

    【特許請求の範囲】
  1. 【請求項1】 ビデオヘッドCH1で検出されたビデオ
    信号を処理してビデオ出力端30に印加させるビデオ信
    号再生器10と、コントロールヘッドCH2で検出され
    たVISS信号をパルスで変換させるVISS信号検出
    器70と、上記VISS信号検出器70のパルス信号で
    キャプスタンモーター100の駆動を制御するモーター
    制御部90とから構成されVISS機能を行うVTRに
    おいて、上記VISS信号検出器70のパルス信号を一
    定時間遅延させるVISSパルス遅延部80と、上記ビ
    デオ信号再生器10の再生ビデオ信号を上記VISSパ
    ルス遅延部80の遅延パルスで記録させこれを読み出す
    画像メモリ手段と、上記画像メモリ手段に読み出された
    信号と上記ビデオ信号再生器10の出力信号を上記VI
    SSパルス遅延部80の遅延パルスで選択して出力させ
    る出力選択器20とを含んで成る画面探索時探索画面の
    ロッキング回路。
  2. 【請求項2】 上記画像メモリ手段は、ビデオ信号再生
    器10の再生ビデオ信号をディジタル信号で変換させる
    アナログディジタル変換器50と、上記アナログディジ
    タル変換器50のディジタル信号を上記VISSパルス
    遅延部80の遅延パルスで記録及び読み出す画像メモリ
    部60と、上記画像メモリ部60に読み出された信号を
    アナログ信号で変換させて出力選択器20に印加させる
    ディジタルアナログ変換器55とから成る請求項1記載
    の画面探索時探索画面のロッキング回路。
JP3206997A 1990-12-31 1991-08-19 画面探索時探索画面のロッキング回路 Pending JPH05342820A (ja)

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DE (1) DE4127416A1 (ja)
GB (1) GB2251332A (ja)

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GB2251332A (en) 1992-07-01
GB9117843D0 (en) 1991-10-09
DE4127416C2 (ja) 1992-09-24
DE4127416A1 (de) 1992-07-02
KR920013357A (ko) 1992-07-28

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