JPH05334804A - ディジタルｖｔｒのイコライザ - Google Patents
ディジタルｖｔｒのイコライザInfo
- Publication number
- JPH05334804A JPH05334804A JP16223692A JP16223692A JPH05334804A JP H05334804 A JPH05334804 A JP H05334804A JP 16223692 A JP16223692 A JP 16223692A JP 16223692 A JP16223692 A JP 16223692A JP H05334804 A JPH05334804 A JP H05334804A
- Authority
- JP
- Japan
- Prior art keywords
- delay line
- equalizer
- tape speed
- switching circuit
- characteristic
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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- Digital Magnetic Recording (AREA)
- Signal Processing For Digital Recording And Reproducing (AREA)
- Filters That Use Time-Delay Elements (AREA)
Abstract
(57)【要約】
【目的】パーシャル・レスポンス（１，０，−１）方式
のイコライザであって、その周波数特性がディジタルＶ
ＴＲのテープ速度に応じて変化し、等化を良好に行なう
ことができる。 【構成】受動遅延線１４に設けられた中間タップＤ１〜
Ｄ４および出力端Ｄ５がスイッチング回路１７によって
選択的に接地される。遅延線１４の入力端では、入射波
と逆相の反射波とが加算され、１−Ｄ2 の伝達特性が得
られる。スイッチング回路１７は、テープ速度に関連し
て形成された制御信号Ｓｃで制御される。ノーマル再生
時の遅延時間Ｄを基準とし、テープ速度が速い時には、
スイッチング回路１７によって遅延時間がＤより短いも
のに切り換えられる。テープ速度が遅い時には、その逆
の制御がされる。
のイコライザであって、その周波数特性がディジタルＶ
ＴＲのテープ速度に応じて変化し、等化を良好に行なう
ことができる。 【構成】受動遅延線１４に設けられた中間タップＤ１〜
Ｄ４および出力端Ｄ５がスイッチング回路１７によって
選択的に接地される。遅延線１４の入力端では、入射波
と逆相の反射波とが加算され、１−Ｄ2 の伝達特性が得
られる。スイッチング回路１７は、テープ速度に関連し
て形成された制御信号Ｓｃで制御される。ノーマル再生
時の遅延時間Ｄを基準とし、テープ速度が速い時には、
スイッチング回路１７によって遅延時間がＤより短いも
のに切り換えられる。テープ速度が遅い時には、その逆
の制御がされる。
Description
【０００１】
【産業上の利用分野】この発明は、ディジタルＶＴＲに
おけるデータ伝送のためのパーシャル・レスポンス
（１，０，−１）方式に使用される１−Ｄ2 の伝達特性
のイコライザに関する。
おけるデータ伝送のためのパーシャル・レスポンス
（１，０，−１）方式に使用される１−Ｄ2 の伝達特性
のイコライザに関する。
【０００２】
【従来の技術】ディジタルビデオ信号を磁気記録／再生
するディジタルＶＴＲでは、記録／再生の過程で符号間
干渉が生じても、正しい波形を再生側で復元することを
可能とするために、パーシャル・レスポンス方式が採用
されている。パーシャル・レスポンス方式の一つとし
て、ＰＲ（１，０，−１）方式が知られている。これ
は、直流成分を持たないものである。
するディジタルＶＴＲでは、記録／再生の過程で符号間
干渉が生じても、正しい波形を再生側で復元することを
可能とするために、パーシャル・レスポンス方式が採用
されている。パーシャル・レスポンス方式の一つとし
て、ＰＲ（１，０，−１）方式が知られている。これ
は、直流成分を持たないものである。
【０００３】図３は、ディジタルＶＴＲの再生回路に設
けられるＰＲ（１，０，−１）方式の構成を示す。１が
磁気テープからディジタルビデオデータを再生するため
の再生ヘッドであり、再生信号が再生アンプ２を介して
積分型のイコライザ３に供給される。ディジタルＶＴＲ
では、普通、再生ヘッド１が複数の回転ヘッドで構成さ
れるが、図１では、簡単のため、一つのヘッドと一つの
イコライザとを示す。イコライザ３は、再生ヘッド１の
微分特性を補正するために設けられている。
けられるＰＲ（１，０，−１）方式の構成を示す。１が
磁気テープからディジタルビデオデータを再生するため
の再生ヘッドであり、再生信号が再生アンプ２を介して
積分型のイコライザ３に供給される。ディジタルＶＴＲ
では、普通、再生ヘッド１が複数の回転ヘッドで構成さ
れるが、図１では、簡単のため、一つのヘッドと一つの
イコライザとを示す。イコライザ３は、再生ヘッド１の
微分特性を補正するために設けられている。
【０００４】イコライザ３の出力信号が１−Ｄ2 特性の
イコライザ４およびＰＬＬ５に供給される。このイコラ
イザ４によって再生データが３値信号に変換され、３レ
ベル検出回路６によって再生信号の３値が検出される。
この３レベル検出回路６の出力信号がラッチ７に供給さ
れる。ラッチ７には、ＰＬＬ５で再生信号から抽出され
たクロックパルスが供給される。ラッチ７の出力端子８
に再生データが発生する。この再生データは、図示しな
いが、ディジタルＴＢＣ（時間軸補償回路）に供給され
る。
イコライザ４およびＰＬＬ５に供給される。このイコラ
イザ４によって再生データが３値信号に変換され、３レ
ベル検出回路６によって再生信号の３値が検出される。
この３レベル検出回路６の出力信号がラッチ７に供給さ
れる。ラッチ７には、ＰＬＬ５で再生信号から抽出され
たクロックパルスが供給される。ラッチ７の出力端子８
に再生データが発生する。この再生データは、図示しな
いが、ディジタルＴＢＣ（時間軸補償回路）に供給され
る。
【０００５】イコライザ４に関する従来の構成を図４に
示す。入力端子２１からの再生信号がバッファアンプ２
２およびインピーダンスＺ0 のインピーダンス素子２３
を介して受動遅延線２４に供給される。この遅延線２４
の特性インピーダンスがＺ0である。遅延線２４の出力
端がＺ0 のインピーダンス素子２６を介して接地される
とともに、高入力インピーダンスのバッファアンプ２７
に接続される。バッファアンプ２７を介した遅延線２４
の出力信号が減算回路２８に供給される。この減算回路
２８には、バッファアンプ２２の出力信号がインピーダ
ンス素子２３、バッファアンプ２５を介して供給され
る。遅延線２４の入力端から出力端までの遅延時間が２
Ｄ（Ｄは遅延演算子）に設定されている。従って、減算
回路２８の出力では、１−Ｄ2 の伝達特性を得ることが
できる。
示す。入力端子２１からの再生信号がバッファアンプ２
２およびインピーダンスＺ0 のインピーダンス素子２３
を介して受動遅延線２４に供給される。この遅延線２４
の特性インピーダンスがＺ0である。遅延線２４の出力
端がＺ0 のインピーダンス素子２６を介して接地される
とともに、高入力インピーダンスのバッファアンプ２７
に接続される。バッファアンプ２７を介した遅延線２４
の出力信号が減算回路２８に供給される。この減算回路
２８には、バッファアンプ２２の出力信号がインピーダ
ンス素子２３、バッファアンプ２５を介して供給され
る。遅延線２４の入力端から出力端までの遅延時間が２
Ｄ（Ｄは遅延演算子）に設定されている。従って、減算
回路２８の出力では、１−Ｄ2 の伝達特性を得ることが
できる。
【０００６】
【発明が解決しようとする課題】ディジタルＶＴＲで
は、記録時のテープ速度と異なるテープ速度で再生を行
なう動作（スタント／シャトル再生と称される）が可能
とされるのが普通であり、再生データのレートがテープ
速度によって変化する。これに対して、１−Ｄ2 イコラ
イザの特性が固定であると、符号間干渉の増加を引き起
こすような等化誤差が発生する。
は、記録時のテープ速度と異なるテープ速度で再生を行
なう動作（スタント／シャトル再生と称される）が可能
とされるのが普通であり、再生データのレートがテープ
速度によって変化する。これに対して、１−Ｄ2 イコラ
イザの特性が固定であると、符号間干渉の増加を引き起
こすような等化誤差が発生する。
【０００７】従って、この発明の目的は、ディジタルＶ
ＴＲの変速再生動作時でも、等化誤差の発生を防止する
ことが可能な１−Ｄ2 特性のイコライザを提供すること
にある。
ＴＲの変速再生動作時でも、等化誤差の発生を防止する
ことが可能な１−Ｄ2 特性のイコライザを提供すること
にある。
【０００８】
【課題を解決するための手段】この発明は、複数の中間
タップを有し、特性インピーダンスがＺ0 の受動遅延線
と、受動遅延線の一端に接続され、受動遅延線をインピ
ーダンスＺ0 を介して駆動する入力回路と、受動遅延線
の一端に接続され、受動遅延線の出力信号を高インピー
ダンスで受けて出力する出力回路と、中間タップを選択
的に接地するスイッチング回路と、スイッチング回路を
ヘッド・テープ相対速度に応答して制御する回路からな
り、受動遅延線の入射波に対する反射波の遅延量をスイ
ッチング回路を制御することによって可変し、周波数−
利得特性がヘッド・テープ相対速度に応答して変更され
ることを特徴とするイコライザ。である。
タップを有し、特性インピーダンスがＺ0 の受動遅延線
と、受動遅延線の一端に接続され、受動遅延線をインピ
ーダンスＺ0 を介して駆動する入力回路と、受動遅延線
の一端に接続され、受動遅延線の出力信号を高インピー
ダンスで受けて出力する出力回路と、中間タップを選択
的に接地するスイッチング回路と、スイッチング回路を
ヘッド・テープ相対速度に応答して制御する回路からな
り、受動遅延線の入射波に対する反射波の遅延量をスイ
ッチング回路を制御することによって可変し、周波数−
利得特性がヘッド・テープ相対速度に応答して変更され
ることを特徴とするイコライザ。である。
【０００９】
【作用】スイッチング回路によって中間タップを切り換
えると、遅延線の反射位置が切り換えられ、遅延時間が
変更できる。テープ・ヘッド相対速度の変化に応答して
遅延時間を制御することによって、再生データのレート
が変化しても、良好な１−Ｄ2 特性を得ることができ
る。
えると、遅延線の反射位置が切り換えられ、遅延時間が
変更できる。テープ・ヘッド相対速度の変化に応答して
遅延時間を制御することによって、再生データのレート
が変化しても、良好な１−Ｄ2 特性を得ることができ
る。
【００１０】
【実施例】以下、この発明による１−Ｄ2 イコライザの
一例について図面を参照して説明する。図１において、
１１が従来の構成と同様に、積分型イコライザを介され
た再生データの入力端子である。この入力データがバッ
ファアンプ１２およびインピーダンス素子１３を介して
受動遅延線１４の入力端に供給される。遅延線１４の特
性インピーダンスをＺ0 とすると、インピーダンス素子
１３の値がＺ0 とされる。また、インピーダンス素子１
３と遅延線１４の入力端との接続点がバッファアンプ１
５を介して出力端子１６に導かれる。
一例について図面を参照して説明する。図１において、
１１が従来の構成と同様に、積分型イコライザを介され
た再生データの入力端子である。この入力データがバッ
ファアンプ１２およびインピーダンス素子１３を介して
受動遅延線１４の入力端に供給される。遅延線１４の特
性インピーダンスをＺ0 とすると、インピーダンス素子
１３の値がＺ0 とされる。また、インピーダンス素子１
３と遅延線１４の入力端との接続点がバッファアンプ１
５を介して出力端子１６に導かれる。
【００１１】遅延線１４は、４個の中間タップＤ１〜Ｄ
４と出力端Ｄ５とを有する。これらの中間タップおよび
出力端がスイッチング回路１７の端子ｔ１〜ｔ５とそれ
ぞれ接続される。スイッチング回路１７は、これらの端
子ｔ１〜ｔ５を選択的に接地する。スイッチング回路１
７を制御する制御信号Ｓｃが端子１８から供給される。
この制御信号Ｓｃは、ヘッド・テープ間の相対速度に応
答してスイッチング回路１７を制御する。
４と出力端Ｄ５とを有する。これらの中間タップおよび
出力端がスイッチング回路１７の端子ｔ１〜ｔ５とそれ
ぞれ接続される。スイッチング回路１７は、これらの端
子ｔ１〜ｔ５を選択的に接地する。スイッチング回路１
７を制御する制御信号Ｓｃが端子１８から供給される。
この制御信号Ｓｃは、ヘッド・テープ間の相対速度に応
答してスイッチング回路１７を制御する。
【００１２】遅延線１４に対しては、再生データと対応
する入射波が発生し、この入射波が接地位置で反射さ
れ、逆相の反射波が入力端に戻る。この入力端には、イ
ンピーダンス素子Ｚ0 が設けられているので、２回以上
反射しない。従って、入力端では、入射波と入力端から
接地位置迄の遅延時間の２倍遅延した反射波が加算され
たものとなる。この遅延時間をＤとすると、１−Ｄ2 特
性が実現される。ここでは、入力端から中間タップＤ４
迄の遅延時間がＤに設定されている。
する入射波が発生し、この入射波が接地位置で反射さ
れ、逆相の反射波が入力端に戻る。この入力端には、イ
ンピーダンス素子Ｚ0 が設けられているので、２回以上
反射しない。従って、入力端では、入射波と入力端から
接地位置迄の遅延時間の２倍遅延した反射波が加算され
たものとなる。この遅延時間をＤとすると、１−Ｄ2 特
性が実現される。ここでは、入力端から中間タップＤ４
迄の遅延時間がＤに設定されている。
【００１３】スイッチング回路１７を制御する制御信号
Ｓｃは、図示しないが、テープ速度を制御するサーボ回
路からのテープ速度信号に基づいて形成される。スタン
ト／シャトル再生時には、サーボ回路がテープ速度がノ
ーマル速度の何倍かを知っている。このテープ速度情報
から制御信号Ｓｃが形成される。この制御信号Ｓｃによ
って、テープ速度がノーマルのものより速くなり、その
結果、データレートが高くなる時には、遅延線１４の中
間タップＤ３、Ｄ２、Ｄ１の何れかを選択し、短くなる
方向に遅延量が制御される。テープ速度が遅くなる時に
は、出力端Ｄ５が選択される。
Ｓｃは、図示しないが、テープ速度を制御するサーボ回
路からのテープ速度信号に基づいて形成される。スタン
ト／シャトル再生時には、サーボ回路がテープ速度がノ
ーマル速度の何倍かを知っている。このテープ速度情報
から制御信号Ｓｃが形成される。この制御信号Ｓｃによ
って、テープ速度がノーマルのものより速くなり、その
結果、データレートが高くなる時には、遅延線１４の中
間タップＤ３、Ｄ２、Ｄ１の何れかを選択し、短くなる
方向に遅延量が制御される。テープ速度が遅くなる時に
は、出力端Ｄ５が選択される。
【００１４】図２は、図１に示すイコライザの周波数特
性である。図２において、破線で示す周波数特性Ｆ４が
中間タップＤ４をスイッチング回路１７が選択し、遅延
量が２Ｄの場合のものである。この周波数特性Ｆ４は、
ディジタルＶＴＲのノーマル再生動作時に適用される。
図２の周波数特性Ｆ１、Ｆ２、Ｆ３は、それぞれ中間タ
ップＤ１、Ｄ２、Ｄ３と対応するものである。これらの
周波数特性は、テープ速度がノーマル再生時よりも速い
時に適用される。特性Ｆ１が最もテープ速度が速い時に
適用されるものである。さらに、周波数特性Ｆ５は、出
力端Ｄ５が選択される時のものであり、テープ速度がノ
ーマル時よりも遅い時に適用される。
性である。図２において、破線で示す周波数特性Ｆ４が
中間タップＤ４をスイッチング回路１７が選択し、遅延
量が２Ｄの場合のものである。この周波数特性Ｆ４は、
ディジタルＶＴＲのノーマル再生動作時に適用される。
図２の周波数特性Ｆ１、Ｆ２、Ｆ３は、それぞれ中間タ
ップＤ１、Ｄ２、Ｄ３と対応するものである。これらの
周波数特性は、テープ速度がノーマル再生時よりも速い
時に適用される。特性Ｆ１が最もテープ速度が速い時に
適用されるものである。さらに、周波数特性Ｆ５は、出
力端Ｄ５が選択される時のものであり、テープ速度がノ
ーマル時よりも遅い時に適用される。
【００１５】スイッチング回路１７を制御するための制
御信号Ｓｃは、サーボ回路から得る以外に、再生データ
からクロックを抽出するためのＰＬＬのロック周波数を
弁別すること、テープ速度検出器の検出信号等から形成
しても良い。また、遅延線のタップ数は、速度変化範囲
等を考慮して適当なものに設定できる。
御信号Ｓｃは、サーボ回路から得る以外に、再生データ
からクロックを抽出するためのＰＬＬのロック周波数を
弁別すること、テープ速度検出器の検出信号等から形成
しても良い。また、遅延線のタップ数は、速度変化範囲
等を考慮して適当なものに設定できる。
【００１６】
【発明の効果】この発明は、ディジタルＶＴＲの変速再
生時に、ヘッド・テープ相対速度に適応して１−Ｄ2 特
性を可変するので、変速再生時の等化誤差を減少でき
る。また、従来のイコライザと比較して減算器を必要と
せず、遅延線の遅延量も半分で良く、回路規模をより小
さくできる。
生時に、ヘッド・テープ相対速度に適応して１−Ｄ2 特
性を可変するので、変速再生時の等化誤差を減少でき
る。また、従来のイコライザと比較して減算器を必要と
せず、遅延線の遅延量も半分で良く、回路規模をより小
さくできる。
【図１】この発明の一実施例の構成を示すブロック図で
ある。
ある。
【図２】この発明の一実施例の周波数特性を示す略線図
である。
である。
【図３】この発明を適用できるディジタルＶＴＲの再生
回路のブロック図である。
回路のブロック図である。
【図４】従来のイコライザの一例のブロック図である。
１３ インピーダンス素子 １４ 受動遅延線 １７ スイッチング回路
Claims (1)
- 【請求項１】 複数の中間タップを有し、特性インピー
ダンスがＺ0 の受動遅延線と、上記受動遅延線の一端に
接続され、上記受動遅延線をインピーダンスＺ0 を介し
て駆動する入力回路と、上記受動遅延線の一端に接続さ
れ、上記受動遅延線の出力信号を高インピーダンスで受
けて出力する出力回路と、上記中間タップを選択的に接
地するスイッチング手段と、上記スイッチング手段をヘ
ッド・テープ相対速度に応答して制御する手段からな
り、 上記受動遅延線の入射波に対する反射波の遅延量を上記
スイッチング手段を制御することによって可変し、周波
数−利得特性が上記ヘッド・テープ相対速度に応答して
変更されることを特徴とするディジタルＶＴＲのイコラ
イザ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16223692A JPH05334804A (ja) | 1992-05-28 | 1992-05-28 | ディジタルｖｔｒのイコライザ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16223692A JPH05334804A (ja) | 1992-05-28 | 1992-05-28 | ディジタルｖｔｒのイコライザ |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH05334804A true JPH05334804A (ja) | 1993-12-17 |
Family
ID=15750569
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP16223692A Pending JPH05334804A (ja) | 1992-05-28 | 1992-05-28 | ディジタルｖｔｒのイコライザ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH05334804A (ja) |
-
1992
- 1992-05-28 JP JP16223692A patent/JPH05334804A/ja active Pending
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