JPH0530377A - ハイビジヨン映像信号生成回路 - Google Patents
ハイビジヨン映像信号生成回路Info
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- JPH0530377A JPH0530377A JP3179382A JP17938291A JPH0530377A JP H0530377 A JPH0530377 A JP H0530377A JP 3179382 A JP3179382 A JP 3179382A JP 17938291 A JP17938291 A JP 17938291A JP H0530377 A JPH0530377 A JP H0530377A
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Abstract
(57)【要約】
【目的】ハイビジョンの同期信号を簡便に生成し、該同
期信号と画像信号を重畳し、ハイビジョン映像信号を生
成する。 【構成】１水平期間の同期信号波形を発生するハイビジ
ョン同期信号発生手段と、前記ハイビジョン同期信号発
生手段に出力を指示する同期信号生成手段と、画像信号
を記憶する画像記録手段と、画像信号と前記ハイビジョ
ン同期信号とを重畳してハイビジョン映像信号を生成す
る重畳手段とを具備するハイビジョン映像信号生成回
路。 【効果】複雑な同期信号波形を５種類に分類し、同期信
号発生回路の出力を順次出力するということから、非常
に簡素な回路構成でハイビジョン同期信号を生成し、該
同期信号と画像信号を重畳してハイビジョン映像信号を
生成することができる。
期信号と画像信号を重畳し、ハイビジョン映像信号を生
成する。 【構成】１水平期間の同期信号波形を発生するハイビジ
ョン同期信号発生手段と、前記ハイビジョン同期信号発
生手段に出力を指示する同期信号生成手段と、画像信号
を記憶する画像記録手段と、画像信号と前記ハイビジョ
ン同期信号とを重畳してハイビジョン映像信号を生成す
る重畳手段とを具備するハイビジョン映像信号生成回
路。 【効果】複雑な同期信号波形を５種類に分類し、同期信
号発生回路の出力を順次出力するということから、非常
に簡素な回路構成でハイビジョン同期信号を生成し、該
同期信号と画像信号を重畳してハイビジョン映像信号を
生成することができる。
Description
【０００１】
【産業上の利用分野】本発明は、コンピュータ等のメモ
リに蓄えられた画像信号に同期信号を付加してハイビジ
ョン映像信号を生成する方法に関する。
リに蓄えられた画像信号に同期信号を付加してハイビジ
ョン映像信号を生成する方法に関する。
【０００２】
【従来の技術】ハイビジョン同期信号の生成方法や画像
信号への付加方法について適切な従来例がないが、これ
に関連するものとして、特開昭６３−１５７５８８号公
報に記載のものがある。この従来例は、コントローラか
らの“Ｈ”，“Ｌ”信号により同期信号を発生させ、画
像信号に付加する構成となっている。
信号への付加方法について適切な従来例がないが、これ
に関連するものとして、特開昭６３−１５７５８８号公
報に記載のものがある。この従来例は、コントローラか
らの“Ｈ”，“Ｌ”信号により同期信号を発生させ、画
像信号に付加する構成となっている。
【０００３】上記従来技術では、同期信号の発生方法お
よび画像信号への重畳方法については記載されている
が、フィールドの偶数、奇数あるいは垂直帰線期間か、
それ以外かで、どのようなパターンの同期信号を発生さ
せるかについては、考慮されていない。
よび画像信号への重畳方法については記載されている
が、フィールドの偶数、奇数あるいは垂直帰線期間か、
それ以外かで、どのようなパターンの同期信号を発生さ
せるかについては、考慮されていない。
【０００４】
【発明が解決しようとする課題】ハイビジョン映像信号
に含まれる同期信号波形は、垂直帰線期間とそれ以外で
波形が異り、また垂直帰線期間においてもフィールドが
偶数か奇数かによって波形が異る。従来は、コントロ−
ラにおいて正しい同期信号を発生させるために、コント
ローラが非常に複雑な回路になるという問題があった。
に含まれる同期信号波形は、垂直帰線期間とそれ以外で
波形が異り、また垂直帰線期間においてもフィールドが
偶数か奇数かによって波形が異る。従来は、コントロ−
ラにおいて正しい同期信号を発生させるために、コント
ローラが非常に複雑な回路になるという問題があった。
【０００５】本発明の目的は、ハイビジョンの同期信号
を簡便に生成し、該同期信号と画像信号を重畳し、ハイ
ビジョン映像信号を生成することができるハイビジョン
映像信号生成回路を提供することにある。
を簡便に生成し、該同期信号と画像信号を重畳し、ハイ
ビジョン映像信号を生成することができるハイビジョン
映像信号生成回路を提供することにある。
【０００６】
【課題を解決するための手段】上記目的を達成するた
め、１水平期間の同期信号波形を発生するハイビジョン
同期信号発生手段と、前記ハイビジョン同期信号発生手
段をコントロール信号によって指示する同期信号生成手
段と、画像信号を記憶する画像記録手段と、画像信号と
前記ハイビジョン同期信号とを重畳してハイビジョン映
像信号を生成する重畳手段とを具備する。
め、１水平期間の同期信号波形を発生するハイビジョン
同期信号発生手段と、前記ハイビジョン同期信号発生手
段をコントロール信号によって指示する同期信号生成手
段と、画像信号を記憶する画像記録手段と、画像信号と
前記ハイビジョン同期信号とを重畳してハイビジョン映
像信号を生成する重畳手段とを具備する。
【０００７】上記ハイビジョン同期信号発生手段は１水
平期間の同期信号波形を、例えば、５つに分類して記憶
している。
平期間の同期信号波形を、例えば、５つに分類して記憶
している。
【０００８】上記重畳手段は、画像信号と前記ハイビジ
ョン同期信号とを切り換える切換手段を備えることがで
きる。
ョン同期信号とを切り換える切換手段を備えることがで
きる。
【０００９】上記ハイビジョン同期信号発生手段は、画
像信号とハイビジョン同期信号とを切り換える切り換え
信号を発生し、重畳手段の切換手段は、前記切り換え信
号により切り換わる構成とすることができる。
像信号とハイビジョン同期信号とを切り換える切り換え
信号を発生し、重畳手段の切換手段は、前記切り換え信
号により切り換わる構成とすることができる。
【００１０】上記同期信号生成手段は、５種類の波形に
分類されたハイビジョン同期信号発生手段を順番に指示
することができる。
分類されたハイビジョン同期信号発生手段を順番に指示
することができる。
【００１１】さらに、順次走査の画像信号を飛び越し走
査方式により変換する回路を備えることができる。
査方式により変換する回路を備えることができる。
【００１２】また、ハイビジョン信号をハイビジョン同
期信号と画像信号とに分離する同期分離手段と、アナロ
グの画像信号をデジタル信号に変換するアナログ−デジ
タル変換手段と、重畳手段から出力されたハイビジョン
映像信号をアナログ信号に変換するアナログ−デジタル
変換手段とをさらに備えることができる。
期信号と画像信号とに分離する同期分離手段と、アナロ
グの画像信号をデジタル信号に変換するアナログ−デジ
タル変換手段と、重畳手段から出力されたハイビジョン
映像信号をアナログ信号に変換するアナログ−デジタル
変換手段とをさらに備えることができる。
【００１３】
【作用】本発明は、ハイビジョン同期信号波形を５種類
に分類できることをみいだし、その５種類の波形をハイ
ビジョン同期信号発生手段に記憶し、この５つの同期信
号波形を同期信号生成手段により順次切換え出力するこ
とでハイビジョン同期信号を生成する。
に分類できることをみいだし、その５種類の波形をハイ
ビジョン同期信号発生手段に記憶し、この５つの同期信
号波形を同期信号生成手段により順次切換え出力するこ
とでハイビジョン同期信号を生成する。
【００１４】また、前記ハイビジョン同期信号発生手段
と、画像記録手段からの画像信号とを重畳手段において
切り換えることにより重畳されハイビジョン映像信号を
生成する。
と、画像記録手段からの画像信号とを重畳手段において
切り換えることにより重畳されハイビジョン映像信号を
生成する。
【００１５】
【実施例】以下、本発明の実施例を図を用いて説明す
る。
る。
【００１６】図１は本発明の実施例の構成を示すブロッ
ク図である。図１において、９は画像記録手段の画像メ
モリであり、画像信号を入力して記憶することができ、
画像データ１７を出力する。画像メモリ９は交換がで
き、読み書きが可能なメモリである。ＲＯＭａ１〜ＲＯ
Ｍｅ５はメモリ（ＲＯＭ：Readonly Memory)であり、１
水平期間の同期信号波形を５種類に分類してそれぞれ記
憶しているハイビジョン同期信号発生手段である。
ク図である。図１において、９は画像記録手段の画像メ
モリであり、画像信号を入力して記憶することができ、
画像データ１７を出力する。画像メモリ９は交換がで
き、読み書きが可能なメモリである。ＲＯＭａ１〜ＲＯ
Ｍｅ５はメモリ（ＲＯＭ：Readonly Memory)であり、１
水平期間の同期信号波形を５種類に分類してそれぞれ記
憶しているハイビジョン同期信号発生手段である。
【００１７】８はアドレス発生回路Ｂであり、ＲＯＭａ
１〜ＲＯＭｅ５のメモリのアドレスをアドレス信号２０
として出力し、ＲＯＭａ１〜ＲＯＭｅ５にアクセスす
る。ＲＯＭｆ６はメモリであり、１フレームのハイビジ
ョン同期信号を生成するため、前記ＲＯＭａ１〜ＲＯＭ
ｅ５の出力を選択する順序を記憶しており、アドレス発
生回路Ａ７から出力されるアドレス信号２１によりアク
セスされ、ＲＯＭ選択信号１６を出力する。アドレス発
生回路Ａ７およびアドレス発生回路Ｂ８で、同期信号生
成手段を構成している。
１〜ＲＯＭｅ５のメモリのアドレスをアドレス信号２０
として出力し、ＲＯＭａ１〜ＲＯＭｅ５にアクセスす
る。ＲＯＭｆ６はメモリであり、１フレームのハイビジ
ョン同期信号を生成するため、前記ＲＯＭａ１〜ＲＯＭ
ｅ５の出力を選択する順序を記憶しており、アドレス発
生回路Ａ７から出力されるアドレス信号２１によりアク
セスされ、ＲＯＭ選択信号１６を出力する。アドレス発
生回路Ａ７およびアドレス発生回路Ｂ８で、同期信号生
成手段を構成している。
【００１８】ＲＯＭｆ６から出力されるＲＯＭ選択信号
１６のＤ0〜Ｄ4は、スイッチ１１−１〜１１−５にそれ
ぞれ加えられる。スイッチ１１−１〜１１−５は、ＲＯ
Ｍｆ６のメモリ内容に従ってＯＮ／ＯＦＦする。１２は
切換スイッチであり切換手段を構成し、コントローラ１
０から出力される切換制御信号１４によって作動し、Ｒ
ＯＭａ１〜ＲＯＭｅ５から出力される同期信号１８と前
記画像メモリ９から出力される画像データ１７とを切り
換えることにより重畳する重畳手段でもある。
１６のＤ0〜Ｄ4は、スイッチ１１−１〜１１−５にそれ
ぞれ加えられる。スイッチ１１−１〜１１−５は、ＲＯ
Ｍｆ６のメモリ内容に従ってＯＮ／ＯＦＦする。１２は
切換スイッチであり切換手段を構成し、コントローラ１
０から出力される切換制御信号１４によって作動し、Ｒ
ＯＭａ１〜ＲＯＭｅ５から出力される同期信号１８と前
記画像メモリ９から出力される画像データ１７とを切り
換えることにより重畳する重畳手段でもある。
【００１９】画像メモリ９，ＲＯＭｆ６，アドレス発生
回路Ａ７，アドレス発生回路Ｂ８，切換スイッチ１２の
すべての動作のタイミングは、コントローラ１０で制御
される。１３はＤＡコンバ−タであり、重畳された同期
信号と画像デ−タとをデジタル−アナログ変換し、ハイ
ビジョン映像信号１９を出力する。２９は同期信号生成
回路であり、１点鎖線で囲まれた部分を示す。
回路Ａ７，アドレス発生回路Ｂ８，切換スイッチ１２の
すべての動作のタイミングは、コントローラ１０で制御
される。１３はＤＡコンバ−タであり、重畳された同期
信号と画像デ−タとをデジタル−アナログ変換し、ハイ
ビジョン映像信号１９を出力する。２９は同期信号生成
回路であり、１点鎖線で囲まれた部分を示す。
【００２０】次に、図１の構成による実施例の動作につ
いて、図２の同期信号の波形、図３のＲＯＭのテ−ブ
ル、図４の生成される信号波形を用いて説明する。
いて、図２の同期信号の波形、図３のＲＯＭのテ−ブ
ル、図４の生成される信号波形を用いて説明する。
【００２１】図２に示すように、ＲＯＭａ１からＲＯＭ
ｅ５のそれぞれに波形が、図中のＸのレベル“００”，
Ｙのレベル“０１”，Ｚのレベル“１０”というデジタ
ルデータでメモリされている。ＲＯＭを５つにするの
は、ハイビジョンのスタジオ規格（ＢＴＡ−ＳＯＯ１）
に準拠したハイビジョン同期信号波形は、１水平期間単
位で見ると５つのパターンに分類できるからである。こ
の５パターンの同期信号のうち４つは「同期信号の
み」、残りの１つは「画像信号と組合わされる部分の同
期信号波形」となっている。ＲＯＭａ１〜ＲＯＭｅ５に
は、共通アドレスが付与されており、図１に示すアドレ
ス発生回路８から出力されるアドレス信号により同期信
号を出力する。この時ＲＯＭａ１〜ＲＯＭｅ５それぞれ
から出力される５つの信号は図２に示す関係で常に同期
してそれぞれのＲＯＭから出力されている。
ｅ５のそれぞれに波形が、図中のＸのレベル“００”，
Ｙのレベル“０１”，Ｚのレベル“１０”というデジタ
ルデータでメモリされている。ＲＯＭを５つにするの
は、ハイビジョンのスタジオ規格（ＢＴＡ−ＳＯＯ１）
に準拠したハイビジョン同期信号波形は、１水平期間単
位で見ると５つのパターンに分類できるからである。こ
の５パターンの同期信号のうち４つは「同期信号の
み」、残りの１つは「画像信号と組合わされる部分の同
期信号波形」となっている。ＲＯＭａ１〜ＲＯＭｅ５に
は、共通アドレスが付与されており、図１に示すアドレ
ス発生回路８から出力されるアドレス信号により同期信
号を出力する。この時ＲＯＭａ１〜ＲＯＭｅ５それぞれ
から出力される５つの信号は図２に示す関係で常に同期
してそれぞれのＲＯＭから出力されている。
【００２２】図３にＲＯＭｆ６のメモリ内容を示す。そ
れぞれのアドレスに対応してＲＯＭ選択信号１６である
Ｄ0〜Ｄ4のデータがメモリされている。Ｄ0〜Ｄ4はそれ
ぞれ図１に示すスイッチ１１−１〜１１−５に対応して
おり、Ｄ0〜Ｄ4のいずれかが１のとき、それぞれ対応し
たスイッチのみがＯＮ状態となる。これにより必要な同
期信号波形が選択される。選択された同期信号１８と画
像メモリ９から出力される画像データ１７は切換スイッ
チ１２により重畳され、図４に示すような信号波形が生
成される。その後ＤＡコンバータ１３によりデジタル−
アナログ変換され、ハイビジョン映像信号１９が生成さ
れる。
れぞれのアドレスに対応してＲＯＭ選択信号１６である
Ｄ0〜Ｄ4のデータがメモリされている。Ｄ0〜Ｄ4はそれ
ぞれ図１に示すスイッチ１１−１〜１１−５に対応して
おり、Ｄ0〜Ｄ4のいずれかが１のとき、それぞれ対応し
たスイッチのみがＯＮ状態となる。これにより必要な同
期信号波形が選択される。選択された同期信号１８と画
像メモリ９から出力される画像データ１７は切換スイッ
チ１２により重畳され、図４に示すような信号波形が生
成される。その後ＤＡコンバータ１３によりデジタル−
アナログ変換され、ハイビジョン映像信号１９が生成さ
れる。
【００２３】本実施例によれば、ＲＯＭに同期信号のパ
タ−ンを記憶しておくことにより、ハイビジョン映像信
号を簡単に生成できるという効果がある。
タ−ンを記憶しておくことにより、ハイビジョン映像信
号を簡単に生成できるという効果がある。
【００２４】つぎに、本発明の第２の実施例を図５を用
いて説明する。
いて説明する。
【００２５】図５に第２の実施例の構成を示すブロック
図を示す。本実施例では、切換スイッチ１２の切換をコ
ントローラ１０から出力される制御信号１４によって行
うのではなく、ＲＯＭｃ３にメモリされている切換制御
信号１５によって行う。
図を示す。本実施例では、切換スイッチ１２の切換をコ
ントローラ１０から出力される制御信号１４によって行
うのではなく、ＲＯＭｃ３にメモリされている切換制御
信号１５によって行う。
【００２６】図５の構成による実施例の動作について、
図６の同期信号の波形、図７の動作説明図を用いて説明
する。
図６の同期信号の波形、図７の動作説明図を用いて説明
する。
【００２７】図６はＲＯＭｃ３のメモリ内容を示す。Ｒ
ＯＭｃ３には同期信号波形データ２ビット以外に切換制
御信号１５が１ビット付加されてメモリされている。図
６のＡで示す部分が画像データが重畳される部分であ
り、それ以外は同期信号波形のみの部分である。したが
って切換制御信号１５はＡの部分では“１”，Ａ以外の
部分では“０”となっている。図７に示すように、この
切換制御信号１５で切換スイッチを制御し、切換制御信
号１５が“１”のとき切換スイッチ１２を１側に、また
切換制御信号１５が“０”のときは切換スイッチ１２を
０側に切換える。これにより同期信号１８と画像データ
１７が重畳されたハイビジョン映像信号１９を得る。
ＯＭｃ３には同期信号波形データ２ビット以外に切換制
御信号１５が１ビット付加されてメモリされている。図
６のＡで示す部分が画像データが重畳される部分であ
り、それ以外は同期信号波形のみの部分である。したが
って切換制御信号１５はＡの部分では“１”，Ａ以外の
部分では“０”となっている。図７に示すように、この
切換制御信号１５で切換スイッチを制御し、切換制御信
号１５が“１”のとき切換スイッチ１２を１側に、また
切換制御信号１５が“０”のときは切換スイッチ１２を
０側に切換える。これにより同期信号１８と画像データ
１７が重畳されたハイビジョン映像信号１９を得る。
【００２８】本実施例によれば、同期信号と画像信号の
切換えを、同期信号波形を発生するＲＯＭｃ３で同時に
発生させることにより、簡便で、タイミングずれを生じ
させないでハイビジョン映像信号を生成することができ
る。
切換えを、同期信号波形を発生するＲＯＭｃ３で同時に
発生させることにより、簡便で、タイミングずれを生じ
させないでハイビジョン映像信号を生成することができ
る。
【００２９】つぎに、本発明の第３の実施例を図８を用
いて説明する。図８に第３の実施例の構成を示すブロッ
ク図を示す。本実施例では、ＲＯＭｆ６から出力される
ＲＯＭ選択信号１６とアドレス発生回路Ｂ８から出力さ
れるアドレス信号２０がスイッチ回路２２−１〜２２−
５を通してＲＯＭａ１〜ＲＯＭｅ５へ入力されている。
これによりＲＯＭ選択信号１６によって選択されたＲＯ
Ｍにのみアドレス信号２０が加えられ同期信号１８が出
力される。
いて説明する。図８に第３の実施例の構成を示すブロッ
ク図を示す。本実施例では、ＲＯＭｆ６から出力される
ＲＯＭ選択信号１６とアドレス発生回路Ｂ８から出力さ
れるアドレス信号２０がスイッチ回路２２−１〜２２−
５を通してＲＯＭａ１〜ＲＯＭｅ５へ入力されている。
これによりＲＯＭ選択信号１６によって選択されたＲＯ
Ｍにのみアドレス信号２０が加えられ同期信号１８が出
力される。
【００３０】つぎに、本発明の第４の実施例を図９を用
いて説明する。図９に第４の実施例の構成を説明するた
めのＲＯＭのテ−ブルを示す。本実施例は第１の実施例
におけるＲＯＭａ１〜ＲＯＭｅ５の部分を１つのメモリ
２８で構成した例である。メモリ２８への記憶単位であ
る１ワードは１０ビットで構成され、図９中のアドレス
ポインタが示す縦１列のデータ列が１ワードを示す。こ
のメモリ２８にアドレス信号を入力するとアドレスポイ
ンタが移動（図９では右方向へ）していき、ａ〜ｅまで
の同期信号データが出力される。
いて説明する。図９に第４の実施例の構成を説明するた
めのＲＯＭのテ−ブルを示す。本実施例は第１の実施例
におけるＲＯＭａ１〜ＲＯＭｅ５の部分を１つのメモリ
２８で構成した例である。メモリ２８への記憶単位であ
る１ワードは１０ビットで構成され、図９中のアドレス
ポインタが示す縦１列のデータ列が１ワードを示す。こ
のメモリ２８にアドレス信号を入力するとアドレスポイ
ンタが移動（図９では右方向へ）していき、ａ〜ｅまで
の同期信号データが出力される。
【００３１】本実施例によれば、５つの同期信号発生回
路を１つのメモリで構成することにより、非常に小型の
同期信号生成回路を実現することができる。
路を１つのメモリで構成することにより、非常に小型の
同期信号生成回路を実現することができる。
【００３２】つぎに、本発明の第５の実施例を図１０を
用いて説明する。図１０に第５の実施例の構成を示すブ
ロック図を示す。本実施例は本発明を利用したハイビジ
ョン信号のメモリ装置の１例である。本実施例は第１の
実施例に、ハイビジョン信号を画像信号と同期信号に分
離する同期分離回路２３と、アナグロ−デジタル変換を
するＡＤコンバータ２７を付加した構成となっている。
同期信号生成回路２９は図１中の１点鎖線で囲まれた部
分を示す。入力されるハイビジョン信号２６は同期分離
回路２３に入力され画像信号２４と同期信号２５に分離
される。画像信号２４はＡＤコンバータによりアナグロ
−デジタル変換され画像メモリ９へ書き込まれる。同期
信号２５はコントローラ１０へ入力され、画像メモリ９
への画像信号２４の書き込みの制御を行う。
用いて説明する。図１０に第５の実施例の構成を示すブ
ロック図を示す。本実施例は本発明を利用したハイビジ
ョン信号のメモリ装置の１例である。本実施例は第１の
実施例に、ハイビジョン信号を画像信号と同期信号に分
離する同期分離回路２３と、アナグロ−デジタル変換を
するＡＤコンバータ２７を付加した構成となっている。
同期信号生成回路２９は図１中の１点鎖線で囲まれた部
分を示す。入力されるハイビジョン信号２６は同期分離
回路２３に入力され画像信号２４と同期信号２５に分離
される。画像信号２４はＡＤコンバータによりアナグロ
−デジタル変換され画像メモリ９へ書き込まれる。同期
信号２５はコントローラ１０へ入力され、画像メモリ９
への画像信号２４の書き込みの制御を行う。
【００３３】本実施例によれば、ハイビジョン信号を画
像信号２４と同期信号２５に分離することにより画像メ
モリ９へのデータ書込が可能となり画像信号を取り出し
て処理することができる。画像メモリ９からの読出し動
作については図１の実施例と同様である。
像信号２４と同期信号２５に分離することにより画像メ
モリ９へのデータ書込が可能となり画像信号を取り出し
て処理することができる。画像メモリ９からの読出し動
作については図１の実施例と同様である。
【００３４】つぎに、本発明の第６の実施例を図１１を
用いて説明する。図１１に第６の実施例の構成を示すブ
ロック図を示す。本実施例は、上記第５の実施例を利用
したハイビジョン画像信号処理装置の１例である。本実
施例は、第５の実施例における画像メモリ９に、メモリ
制御用コンピュ−タ３０が接続されている。画像メモリ
９と、メモリ制御用コンピュ−タ３０とは相互にデ−タ
の交換が可能である。入力されるハイビジョン信号２６
は同期分離回路２３に入力され画像信号２４と同期信号
２５に分離される。画像信号２４はＡＤコンバータによ
りアナログ−デジタル変換され画像メモリ９へ書き込ま
れる。同期信号２５はコントローラ１０へ入力され、画
像メモリ９への画像信号２４の書き込みの制御を行う。
画像メモリ９へ書き込まれた画像信号２４は、メモリ制
御用コンピュ−タ３０により、文字のス−パ−インポ−
ズやデ−タ変換などの画像処理が行われる。この処理
は、入力される画像信号２４の垂直または水平のブラン
キング期間に行われ、リアルタイムで処理が可能であ
る。画像メモリ９からの読出し動作については図１の実
施例と同様である。
用いて説明する。図１１に第６の実施例の構成を示すブ
ロック図を示す。本実施例は、上記第５の実施例を利用
したハイビジョン画像信号処理装置の１例である。本実
施例は、第５の実施例における画像メモリ９に、メモリ
制御用コンピュ−タ３０が接続されている。画像メモリ
９と、メモリ制御用コンピュ−タ３０とは相互にデ−タ
の交換が可能である。入力されるハイビジョン信号２６
は同期分離回路２３に入力され画像信号２４と同期信号
２５に分離される。画像信号２４はＡＤコンバータによ
りアナログ−デジタル変換され画像メモリ９へ書き込ま
れる。同期信号２５はコントローラ１０へ入力され、画
像メモリ９への画像信号２４の書き込みの制御を行う。
画像メモリ９へ書き込まれた画像信号２４は、メモリ制
御用コンピュ−タ３０により、文字のス−パ−インポ−
ズやデ−タ変換などの画像処理が行われる。この処理
は、入力される画像信号２４の垂直または水平のブラン
キング期間に行われ、リアルタイムで処理が可能であ
る。画像メモリ９からの読出し動作については図１の実
施例と同様である。
【００３５】本実施例によれば、ハイビジョン信号を画
像信号２４と同期信号２５に分離し、画像デ−タを処理
することが可能となる。
像信号２４と同期信号２５に分離し、画像デ−タを処理
することが可能となる。
【００３６】つぎに、本発明の第７の実施例を図１２を
用いて説明する。図１２に第７の実施例の構成を示すブ
ロック図を示す。本実施例は、順次走査の画像信号を帯
域圧縮法である飛び越し走査方式に変換する回路を備
え、飛び越し走査された信号をさらにハイビジョン信号
として出力する装置の１例である。本実施例は、第５の
実施例における画像メモリ９を、奇数フィ−ルド用メモ
リと、偶数フィ−ルド用メモリに領域を分けておく。さ
らに、切り換えスイッチ３１および３２を設け、コント
ロ−ラ１０によりスイッチ３１、３２を制御する。スイ
ッチ３１は、奇数フィ−ルドと偶数フィ−ルドにより切
り換わり、奇数フィ−ルドの信号と偶数フィ−ルドの信
号がそれぞれのメモリへ書き込まれる。スイッチ３２
は、奇数フィ−ルドメモリと偶数フィ−ルドメモリの読
み出し先を切り換える。
用いて説明する。図１２に第７の実施例の構成を示すブ
ロック図を示す。本実施例は、順次走査の画像信号を帯
域圧縮法である飛び越し走査方式に変換する回路を備
え、飛び越し走査された信号をさらにハイビジョン信号
として出力する装置の１例である。本実施例は、第５の
実施例における画像メモリ９を、奇数フィ−ルド用メモ
リと、偶数フィ−ルド用メモリに領域を分けておく。さ
らに、切り換えスイッチ３１および３２を設け、コント
ロ−ラ１０によりスイッチ３１、３２を制御する。スイ
ッチ３１は、奇数フィ−ルドと偶数フィ−ルドにより切
り換わり、奇数フィ−ルドの信号と偶数フィ−ルドの信
号がそれぞれのメモリへ書き込まれる。スイッチ３２
は、奇数フィ−ルドメモリと偶数フィ−ルドメモリの読
み出し先を切り換える。
【００３７】つぎに、本実施例の動作を図１３を用いて
説明する。図１３は入力画像信号と、奇数フィ−ルドメ
モリへ入力される画像信号と、偶数フィ−ルドメモリへ
入力される画像信号と、出力画像信号のフレ−ム構成を
示している。本実施例では、画像信号がハイビジョン信
号の２倍のフレ−ム周波数を持つ場合を例にして説明す
る。
説明する。図１３は入力画像信号と、奇数フィ−ルドメ
モリへ入力される画像信号と、偶数フィ−ルドメモリへ
入力される画像信号と、出力画像信号のフレ−ム構成を
示している。本実施例では、画像信号がハイビジョン信
号の２倍のフレ−ム周波数を持つ場合を例にして説明す
る。
【００３８】まず、第１フレ−ムの画像信号が入力され
ると、スイッチ３１は奇数フィ−ルドメモリ側に切り換
わり奇数フィ−ルドの信号が奇数フィ−ルドメモリに入
力される。つぎに、第２フレ−ムの画像信号が入力され
ると、スイッチ３１は偶数フィ−ルドメモリ側に切り換
わり、偶数フィ−ルド画像信号が偶数フィ−ルドメモリ
に入力される。この時、画像メモリ９からは、先程書き
込んだ奇数フィ−ルドメモリのデ−タを読みだす。つぎ
に、第３フレ−ムのデ−タのうち奇数フィ−ルドの信号
を奇数フィ−ルドメモリに書き込み、同時に既に書き込
まれている偶数フィ−ルドメモリの第２フレ−ムのデ−
タを読みだす。以後、同様に書き込みと読み出しを繰返
す。
ると、スイッチ３１は奇数フィ−ルドメモリ側に切り換
わり奇数フィ−ルドの信号が奇数フィ−ルドメモリに入
力される。つぎに、第２フレ−ムの画像信号が入力され
ると、スイッチ３１は偶数フィ−ルドメモリ側に切り換
わり、偶数フィ−ルド画像信号が偶数フィ−ルドメモリ
に入力される。この時、画像メモリ９からは、先程書き
込んだ奇数フィ−ルドメモリのデ−タを読みだす。つぎ
に、第３フレ−ムのデ−タのうち奇数フィ−ルドの信号
を奇数フィ−ルドメモリに書き込み、同時に既に書き込
まれている偶数フィ−ルドメモリの第２フレ−ムのデ−
タを読みだす。以後、同様に書き込みと読み出しを繰返
す。
【００３９】本実施例によれば、順次走査の画像信号を
飛び越し走査された信号に変換して、さらにハイビジョ
ン信号として出力することが可能となる。
飛び越し走査された信号に変換して、さらにハイビジョ
ン信号として出力することが可能となる。
【００４０】
【発明の効果】本発明によれば、複雑な同期信号波形を
５種類に分類し、同期信号発生回路の出力を順次出力す
るということから、非常に簡素な回路構成でハイビジョ
ン同期信号を生成し、該同期信号と画像信号を重畳して
ハイビジョン映像信号を生成することができる。
５種類に分類し、同期信号発生回路の出力を順次出力す
るということから、非常に簡素な回路構成でハイビジョ
ン同期信号を生成し、該同期信号と画像信号を重畳して
ハイビジョン映像信号を生成することができる。
【図１】本発明の一実施例の構成を示すブロック図。
【図２】図１中のブロック図を説明するための同期信号
の波形図。
の波形図。
【図３】図１中のブロック図を説明するためのＲＯＭの
テ−ブルを示す説明図。
テ−ブルを示す説明図。
【図４】生成される信号波形図。
【図５】本発明の第２の実施例の構成を示すブロック
図。
図。
【図６】図５中の回路ブロックを説明するための同期信
号の波形図。
号の波形図。
【図７】図５で示す第２の実施例の動作説明図。
【図８】本発明の第３の実施例の構成を示すブロック
図。
図。
【図９】本発明の第４の実施例を説明するためのＲＯＭ
のテ−ブルを示す説明図。
のテ−ブルを示す説明図。
【図１０】本発明の第５の実施例の構成を示すブロック
図。
図。
【図１１】本発明の第６の実施例の構成を示すブロック
図。
図。
【図１２】本発明の第７の実施例の構成を示すブロック
図。
図。
【図１３】画像信号のフレ−ム構成を示す説明図。
１…ＲＯＭａ、２…ＲＯＭｂ、３…ＲＯＭｃ、４…ＲＯ
Ｍｄ、５…ＲＯＭｅ、６…ＲＯＭｆ、９…画像メモリ、
１０…コントロ−ラ、１１…スイッチ、１２…切換スイ
ッチ、１３…ＤＡコンバータ。
Ｍｄ、５…ＲＯＭｅ、６…ＲＯＭｆ、９…画像メモリ、
１０…コントロ−ラ、１１…スイッチ、１２…切換スイ
ッチ、１３…ＤＡコンバータ。
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フロントページの続き
(72)発明者 鷲谷 展宏
神奈川県横浜市戸塚区吉田町292番地 株
式会社日立画像情報システム内
(72)発明者 谷本 正康
神奈川県横浜市戸塚区吉田町292番地 株
式会社日立画像情報システム内
(72)発明者 田島 活利
神奈川県秦野市堀山下１番地 株式会社日
立製作所神奈川工場内
(72)発明者 阿部 仁
神奈川県秦野市堀山下１番地 株式会社日
立製作所神奈川工場内
Claims (7)
- 【請求項１】１水平期間の同期信号波形を発生するハイ
ビジョン同期信号発生手段と、前記ハイビジョン同期信
号発生手段に出力を指示する同期信号生成手段と、画像
信号を記憶する画像記録手段と、画像信号と前記ハイビ
ジョン同期信号とを重畳してハイビジョン映像信号を生
成する重畳手段とを具備したことを特徴としたハイビジ
ョン映像信号生成回路。 - 【請求項２】請求項１において、ハイビジョン同期信号
発生手段は、１水平期間の同期信号波形を５種類の波形
に分類して記憶することを特徴としたハイビジョン映像
信号生成回路。 - 【請求項３】請求項２において、重畳手段は、画像信号
と前記ハイビジョン同期信号とを切り換える切換手段を
備えることを特徴としたハイビジョン信号生成回路。 - 【請求項４】請求項３において、ハイビジョン同期信号
発生手段は、画像信号とハイビジョン同期信号とを切り
換える切り換え信号をさらに発生し、重畳手段の切換手
段は、前記切り換え信号により切り換わることを特徴と
したハイビジョン信号生成回路。 - 【請求項５】請求項２、３または４において、同期信号
生成手段は、５つに分類されたハイビジョン同期信号発
生手段を順番に指示することを特徴としたハイビジョン
映像信号生成回路。 - 【請求項６】請求項１、２、３、４または５において、
順次走査の画像信号を飛び越し走査方式により変換する
回路をさらに備えることを特徴としたハイビジョン映像
信号生成回路。 - 【請求項７】請求項１、２、３、４、５または６におい
て、ハイビジョン信号をハイビジョン同期信号と画像信
号とに分離する同期分離手段と、アナログの画像信号を
デジタル信号に変換するアナログ−デジタル変換手段
と、重畳手段から出力されたハイビジョン映像信号をア
ナログ信号に変換するアナログ−デジタル変換手段とを
さらに備えることを特徴としたハイビジョン映像信号生
成回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3179382A JPH0530377A (ja) | 1991-07-19 | 1991-07-19 | ハイビジヨン映像信号生成回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3179382A JPH0530377A (ja) | 1991-07-19 | 1991-07-19 | ハイビジヨン映像信号生成回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0530377A true JPH0530377A (ja) | 1993-02-05 |
Family
ID=16064885
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3179382A Pending JPH0530377A (ja) | 1991-07-19 | 1991-07-19 | ハイビジヨン映像信号生成回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0530377A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US7332997B2 (en) | 2003-12-11 | 2008-02-19 | Niles Co., Ltd. | Remote control device for vehicle |
| US7714935B2 (en) | 2002-05-31 | 2010-05-11 | Leader Electronics Corporation | Data structure for waveform synthesis data and method and apparatus for synthesizing waveform |
-
1991
- 1991-07-19 JP JP3179382A patent/JPH0530377A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US7714935B2 (en) | 2002-05-31 | 2010-05-11 | Leader Electronics Corporation | Data structure for waveform synthesis data and method and apparatus for synthesizing waveform |
| US7332997B2 (en) | 2003-12-11 | 2008-02-19 | Niles Co., Ltd. | Remote control device for vehicle |
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