JPH05284061A - プログラマブル応答器 - Google Patents

プログラマブル応答器

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JPH05284061A
JPH05284061A JP4220944A JP22094492A JPH05284061A JP H05284061 A JPH05284061 A JP H05284061A JP 4220944 A JP4220944 A JP 4220944A JP 22094492 A JP22094492 A JP 22094492A JP H05284061 A JPH05284061 A JP H05284061A
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デビツド・エルウツド
John Burne
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Abstract

(57)【要約】 （修正有） 【目的】出力信号を受信する出力アンテナと通信信号を
受信する通信アンテナとを有する受動応答器を提供する
ものとする。 【構成】情報発生回路が第１の通信信号に応答して第２
の通信信号を形成し、この第２の通信信号を通信アンテ
ナ１８を介して出力する。情報アンテナ回路は、出力信
号に応答して応答器１０に出力を与える電圧を供給する
電源１４により出力が与えられる。情報発生回路は、再
プログラマブルＥＥＰＲＯＭ２４と、第１の通信信号に
含まれる指示とデ−タとに応答してデ−タを引き出して
記憶することによりＥＥＰＲＯＭに対して動作を行なう
ＥＥＰＲＯＭインタ−フェ−ス回路２２とを備えてい
る。

Description

【発明の詳細な説明】
【０００１】
【産業上の利用分野】本発明は、受動応答器(passive t
ransponder) 、特に、埋め込みまたは植え込みが行なわ
れる対象物を識別するのに使用されるとともに、埋め込
まれあるいは植え込まれたときにプログラム化あるいは
再プログラム化する(reprogram) ことができる受動応答
器に関する。
【０００２】
【従来の技術】スキャナ装置に関連して使用される応答
器は、本技術分野において周知である。例えば、米国特
許第４，７３０，１８８号には、受動応答器からの信号
を送受信する質問器(interrogator)を備える質問器応答
器装置が開示されている。該装置の有効な実施例の１つ
として、動物即ち対象物に応答器を植え込んで識別を行
なうように構成されたものが開示されている。米国特許
第４，７３０，１８８号に開示されているこの装置は、
動物に埋め込まれた応答器が受信する４００ｋＨｚの信
号を送信するとともに、これに応答して４０ｋＨｚと５
０ｋＨｚの分割された信号を戻す単一の質問器アンテナ
を備えている。応答器の信号は、受動応答器に内蔵され
たチップに記憶されている予めプログラム化された(pre
programmed) ＩＤ番号に対応するように、送信信号の異
なる周波数成分の組み合わせに従ってエンコ−ドされ
る。ＩＤ番号は、製造時に予めプログラム化されるか、
あるいは植え込み後に１回だけを基準(one-time only b
asis) にプログラム化することができる。このＩＤ番号
により、応答器が埋め込まれた対象物を識別することが
できる。
【０００３】従来公知の応答器は、デ−タの送信と受信
の双方を行なうのに単一のアンテナコイルを利用してい
る。信号を受信しかつ送信するため、かかるコイルは整
流器とコイルの負荷とを利用している。そして、負荷の
変化を測定する。更に、受動応答器は、質問器が発生す
る質問信号から出力を得る。従って、高周波数の通信信
号が、出力源として作用する。
【０００４】
【発明が解決しようとする課題】かかる先行技術の応答
器は、高周波出力信号を使用すると、得ることができる
出力(power) の量が制限され、応答器と質問器との間の
通信距離を短くするので、完全に満足することができる
ものとはなっていない。応答器の一層高い周波数はＦＣ
Ｃにより規制され、かくして、応答器に供給される出力
の量、従って、読み取り距離(read distance) が制限さ
れる。更に、かかる先行技術の応答器は、応答器により
送信される情報の種類が一定のプログラム化された、あ
るいは初回にだけプログラム化される識別番号に限定さ
れるので、制限されたものとなる。従って、動物の識別
あるいは産業上の部分的な識別のような目的とする用途
においては、使用者は、応答器内に含まれる予めプログ
ラム化された識別番号または当初のプログラム化の際に
使用者が決める情報に限定される。従って、応答器のフ
レキシビリティは、特定の最初の用途に完全に限定され
る。かくして、使用者は、記憶されている情報あるいは
応答器が向けられるべき用途を、応答器に既に存在する
情報に合わせることが必要となり、応答器の使用をより
一層融通性のあるものとすることができなかったり、あ
るいは応答器を再使用することができないので、時間と
労力を要することになる。
【０００５】従って、読み取り距離を一層大きくするこ
とができるとともに、使用者が再プログラム化すること
ができる情報の形態でプログラム化を融通性をもって行
なうことができる受動応答器が所望されている。
【０００６】従って、本発明の目的は、改良された受動
応答器を提供することにある。
【０００７】本発明の別の目的は、再プログラム化する
ことができるメモリを有する受動応答器を提供すること
にある。
【０００８】本発明の別の目的は、応答器の読み取り距
離を大きくした状態で出力を維持することができる応答
器を提供することにある。
【０００９】本発明の更に別の目的と利点は、一部は自
明であり、一部は明細書および図面の記載から明らかと
なる。
【００１０】
【課題を解決するための手段】本発明によれば、第１の
通信信号と個別の出力信号とを受信するとともに、これ
に応答して第２の通信信号を送信する受動応答器が提供
されている。この受動応答器は、前記第１の通信信号を
受信する通信アンテナ手段と、前記出力信号を受信する
出力アンテナ手段と、前記第１の通信信号に応答して前
記第２の通信信号を形成する情報発生手段とを備え、前
記通信アンテナ手段は前記第２の通信信号を出力し、更
に前記出力信号に応答して前記情報発生手段に出力を供
給する出力供給手段を備えることを特徴とする構成に係
る。
【００１１】本発明によればまた、受動応答器が提供さ
れている。この受動応答器は、第１の通信信号を受信し
かつ該第１の通信信号に応答して第２の通信信号を送信
する通信アンテナ手段を備え、前記第１および第２の各
通信信号はデ−タと指示を含み、更に、複数のメモリア
ドレスを有し前記応答器により受信されるデ−タを記憶
する再プログラマブルメモリ手段と、前記第１の通信信
号に応答して前記第２の通信信号を形成する情報発生手
段とを備え、該情報発生手段は前記第１の通信手段に応
答して前記再プログラマブルメモリのアドレスを選択的
にアドレス処理するとともに前記第１の通信信号に応答
して前記選択的にアドレス処理されたメモリアドレスに
動作を行なうメモリインタ−フェ−ス手段を備え、前記
通信アンテナ手段は前記第２の通信信号を出力すること
を特徴とする構成に係る。
【００１２】従って、本発明は、以下の説明に例示され
ている構造、素子の組み合わせおよび部材の配置の特徴
からなるものであり、本発明の範囲は特許請求の範囲に
示されている。
【００１３】
【作用】本発明の受動応答器は、上記のように、質問器
が発生した通信信号を受信しかつ応答器に記憶されてい
るデ−タを通信信号に応答して送信する通信アンテナを
備えている。応答器はまた、低周波数で高出力の信号を
受信して出力(power) を応答器に提供する出力アンテナ
(power antenna) を備えている。デ−タは、通信信号を
形成するデ−タと指示とを利用する使用者により再プロ
グラム化される再プログラマブルメモリ回路内の応答器
に記憶される。
【００１４】
【実施例】先づ、図１について説明すると、本発明に従
って構成された応答器が、参照番号１０で全体示されて
いる。応答器１０は、質問器などから９ｋＨｚの出力信
号(output signal) を受信して応答器１０に出力を提供
するように単一の誘導コイルとして形成された出力アン
テナ１２を備えている。電源１４が大地(ground)と平滑
コンデンサ１６との間に接続されている。電源１４はま
た、出力アンテナ１２に接続されている。外部９ｋＨｚ
出力信号を提供する電磁場が、応答器１０をプログラミ
ング質問器（図示せず）などと、受動応答器の先行技術
において公知のようにして誘導結合するプログラミング
質問器により出力アンテナ１２に印加される。出力アン
テナ１２は、９ｋＨｚの電磁場を受けて、電源１４に入
力を提供する。電源１４とコンデンサ１６は９ｋＨｚの
出力信号を整流し、平滑にする。電源１４は、９ｋＨｚ
のクロック信号を出力するとともに、電圧ＶＣＣを提供
し、応答器１０に出力を与える。図示の実施例において
は、電源１４は、低順電圧整流器を備え、応答器をでき
るだけ弱い場で作動させることができるようにしてい
る。
【００１５】デ−タは、通信アンテナ１８を利用して、
応答器１０により受信されかつ応答器１０から送信され
る。出力信号のようなデ−タ信号は、プログラミング質
問器と応答器１０との誘導結合により送信される。質問
器は、マンチェスタ−エンコ−ド化され(Manchester en
coded)かつＦＳＫ変調される(FSK modulated) ４１０ｋ
Ｈｚ信号を出力する。
【００１６】通信アンテナ１８は、受信送信回路２０に
接続されている。通信アンテナ１８は、応答器１０とプ
ログラミング質問器との間の２方向通信を可能にするよ
うに受信機能と送信機能の双方に共通のコイル２０６を
備えている。コイル２０６は、受信送信回路２０の受信
入力部と大地２０４との間に接続されている。変調コイ
ル２００は、コイル２０６に誘導結合されているととも
に、受信送信回路２０の送信出力部と大地２０４との間
に接続されている。
【００１７】誘導器２００は４１０ｋＨｚに同調されて
いる。誘導器２００には負荷がかかっていないので、高
インピ−ダンスを有し、従って、プログラミング質問器
から受信される弱い通信信号の存在のもとで信号を提供
することができる。信号は、受信送信回路２０の送信出
力部において大地に低インピ−ダンスを生ずることによ
り応答器から出力される。この低インピ−ダンスは、送
信出力部からの送信信号に応答してコイルのインピ−ダ
ンスを変調する変調コイル２００を短絡させる(short)
。通信信号（４１０ｋＨｚ）は先行技術において行な
われているようにクロック処理しあるいは応答器に出力
を与えるようには使用されないので、通信信号は、正常
な応答器の機能を妨害せずに十分に変調することができ
る。これにより、以前よりも一層強力な復帰信号を得る
ことができる。
【００１８】受信送信回路２０は、信号を復調するとと
もに、デ−タと指示とを電気的消去書き込み可能読み出
し専用メモリ（ＥＥＰＲＯＭ）インタ−フェ−ス２２に
出力する。ＥＥＰＲＯＭ２２は、受信送信回路２０から
指示を受けて緩衝処理するとともに、この指示をデコ−
ドする。これに応答して、ＥＥＰＲＯＭインタ−フェ−
ス２２は、デ−タを、電気的消去書き込み可能読み出し
専用メモリ（ＥＥＰＲＯＭ）２４から読み取るのか、該
メモリに書き込むのか、あるいは該メモリから消去する
のかを決定する。以下において詳細に説明するように、
ＥＥＰＲＯＭインタ−フェ−ス２２は、指示をデコ−ド
するとともに、ＥＥＰＲＯＭ２４のメモリをアドレス処
理するシフトレジスタを備えている。読み取り操作の際
には、ＥＥＰＲＯＭインタ−フェ−ス２２は、ＥＥＰＲ
ＯＭ２４に該ＥＥＰＲＯＭに含まれるデ−タを受信送信
回路２０を介して出力させる。受信送信回路２０はデ−
タおよび指示をマンチェスタエンコ−ドしかつＦＳＫ変
調するとともに、通信アンテナ１８に５５ｋＨｚと３
６．６ｋＨｚとの間で変調されるマンチェスタエンコ−
ド化信号を送信させる。
【００１９】ＥＥＰＲＯＭインタ−フェ−ス２２と受信
送信回路２０は、クロック発生器２６により駆動され
る。クロック発生器２６は、２２０ｋＨｚオシレ−タ２
８から２２０ｋＨｚの入力を受ける。クロック発生器２
６はまた、電源１４から９ｋＨｚの信号を受信し、１１
ｋＨｚおよび１８ｋＨｚの内部クロックを発生してＥＥ
ＰＲＯＭインタ−フェ−ス２２と受信送信回路２０を駆
動する。デ−タを送信すると、受信送信回路２０とＥＥ
ＰＲＯＭ２２は、１１ｋＨｚの信号により駆動される。
デ−タを受信すると、受信送信回路２０とＥＥＰＲＯＭ
インタ−フェ−ス２２は、クロック発生器２６により出
力される１８ｋＨｚの信号により駆動される。
【００２０】応答器１０が適正に作動するためには、応
答器１０は、ノイズまたは異常に低い出力の検出されな
い信号がＥＥＰＲＯＭ２４にアクセスするのを防止する
ように、最低の電圧レベルを必要とする。従って、パワ
−オンリセット(power on reset)３０が電源１４から電
圧ＶＣＣを受けるとともに、検出された信号が適正な読
み出し電圧レベルを確保する３ボルトを越える場合には
リセット信号ＰＯＲに出力を供給する。リセット信号Ｐ
ＯＲの出力は、電圧が３ボルトよりも高くない場合に
は、クロック発生器２６とＥＥＰＲＯＭインタ−フェ−
ス２２において入力され、ＥＥＰＲＯＭインタ−フェ−
ス２２の出力アップ(powering up) を防止する。低電圧
抑止回路３２もまた、電圧入力ＶＣＣを受け、検出され
る電圧が４ボルトよりも低い場合には低電圧抑止信号Ｌ
ＶＩを出力する。低電圧抑止信号ＬＶＩは、電源１４か
ら発生される電圧ＶＣＣが４ボルトよりも低い場合にＥ
ＥＰＲＯＭインタ−フェ−ス２２に入力されてＥＥＰＲ
ＯＭインタ−フェ−ス２２のパワ−リングを防止するこ
とにより、ＥＥＰＲＯＭ２４を別の態様で隔離しかつ保
護する。パワ−オンリセットおよび低電圧抑止回路を配
設することにより、ＥＥＰＲＯＭ２４に対する不注意に
よるアクセスを防止して、ＥＥＰＲＯＭ２４に記憶され
ているデ−タの一体性を保持している。
【００２１】ＥＥＰＲＯＭ２４のメモリは、０乃至１５
の番号が付された１６頁３８としてフォ−マット化され
ている。各頁３８は、４つのワ−ド４０から形成されて
いる。各ワ−ド４０は、１６ビットのデ−タ列(string)
である。各頁３８の第１のワ−ド４１の第１のビット４
２が開始ビットである。第１のワ−ド４１の次の７つの
ビット４４が頁番号を記憶し、ＥＥＰＲＯＭ２４のアド
レス指定を可能にしている。残りのビットは、デ−タビ
ット４６と検査合計ビット(check sum bit) ４８との間
で分割される。検査合計ビット４８とデ−タビット４４
は、プログラミング質問器により発生され、ＥＥＰＲＯ
Ｍ２４において応答器１０により記憶される。検査合計
ビット４８は、デ−タビット４６の一体性を測定するの
に利用される。開始ビット４２と頁番号ビット４４は、
第１のワ−ド４１において必要とされるだけである。各
頁３８の第２乃至第４ワ−ド４０のワ−ド全体は、デ−
タビット４６と検査合計ビット４８全体から構成され
る。
【００２２】一般的に説明すると、プログラミング質問
器は、読み出し指示を送って、ＥＥＰＲＯＭ２４内の特
定の頁アドレスを読み出すとともに、書き込み指示を送
ってＥＥＰＲＯＭ２４の特定のアドレスにデ−タまたは
指示なしを書き込む。応答器１０は、プログラミング質
問器により送信される９ｋＨｚの電磁場に入るまで休止
状態を保つ。応答器１０は、電磁場に入ると、パワ−オ
ンリセット３０、低電圧抑止回路３２、受信送信回路２
０、ＥＥＰＲＯＭインタ−フェ−ス２２、ＥＥＰＲＯＭ
２４、クロック発生器２６および２２０ｋＨｚオシレ−
タ２８に電圧ＶＣＣを出力する電源１４により出力アッ
プを行なう。電源１４が４ボルトよりも高い電圧ＶＣＣ
を出力するようにこの場が十分に強い場合には、パワ−
オンリセット３０と低電圧抑止回路３２の双方はイネ−
ブル信号をＥＥＰＲＯＭインタ−フェ−ス２２に供給す
るとともに、パワ−オンリセット３０がイネ−ブル信号
をクロック発生器２６に供給する。
【００２３】応答器１０は、ＥＥＰＲＯＭ２４の第１の
６４ビットのデ−タ、即ち、第１の頁３８のデ−タを送
信することにより常に始動する。ＥＥＰＲＯＭインタ−
フェ−ス２２は、ＥＥＰＲＯＭ２４に、クロック発生器
２６からの１１ｋＨｚのクロックインパルスに応答し
て、受信送信回路２０の送信部を介して第１の頁の情報
を出力させる。受信送信回路２０は、デ−タをマンチェ
スタ−エンコ−ド化し、ＥＥＰＲＯＭ２４の記憶デ−タ
の第１の頁３８のデ−タに対応して通信アンテナ１８を
介して変調されたＦＳＫ信号を発生する。出力信号をタ
イミング信号および同期信号として使用すると、クロッ
ク発生器２６は、１８ｋＨｚの出力に切り換え、応答器
１０が質問器から指示を受けようとするときに受信モ−
ドにおいて同期させる。応答器１０は次に、プログラミ
ング質問器からの指示に注意を向ける(listen for)。応
答器１０が何の指示も受けない場合には、ＥＥＰＲＯＭ
に記憶されている次の６４ビットの情報、即ち、ＥＥＰ
ＲＯＭデ−タの次の頁３８（頁１）を送信し、次いで、
プログラミング質問器からの指示に注意を向ける。応答
器１０が通信アンテナ１８を介して読み出し指示信号を
受信すると、指示信号は受信送信回路４０により復調さ
れる。復調された信号は次に、ＥＥＰＲＯＭインタ−フ
ェ−ス２２によりかつ受信された信号に応答してデコ−
ドされ、クロック発生器２６の１８ｋＨｚのクロックは
ＥＥＰＲＯＭ２４内の特定されたアドレスの位置指定を
行ない、その情報を読み出す。このデ−タは次に、受信
送信回路２０によりマンチェスタ−コ−ド化されるとと
もに、ＦＳＫ変調され、通信アンテナ１８を介して出力
される。
【００２４】ＥＥＰＲＯＭインタ−フェ−ス２２により
デコ−ドされた受信情報が、受信された信号のデ−タを
ＥＥＰＲＯＭ２４に書き込むように応答器に指令を出す
指示である場合には、ＥＥＰＲＯＭインタ−フェ−ス２
２はこの情報をデコ−ドしかつ記憶する。応答器１０
は、第２の時間、第２の信号に注意を向ける。この信号
が同じ書き込み信号でない場合には、応答器は、デフォ
ルトモ−ド(default mode)に戻り、ＥＥＰＲＯＭ２４の
第１の６４ビットのデ−タを送信する。しかしながら、
第２の信号が第１の書き込み信号と同じである場合に
は、応答器１０に送信されるデ−タは、書き込み指令信
号により特定されるアドレスでＥＥＰＲＯＭ２４に書き
込まれ、デ−タを応答器のメモリにプログラム化するこ
とができるので一層フレキシブルな応答器メモリを提供
することができ、かくして、メモリに含まれる情報を変
更することができる。ＥＥＰＲＯＭを利用することによ
り、メモリにおけるデ−タの再書き込みおよび重ね書き
を行なうことができる。以下においてより詳細に説明す
るように、上記した操作の簡素化されたバ−ジョンの際
には、応答器とプログラミング質問器との間に２通りの
通信がある。上記操作においては、状況信号は応答器に
より出力され、クロックをプログラミング質問器と同期
させるとともに、次に何をすべきかをプログラミング質
問器に指示する応答器により行なわれているタスク(tas
k)および状況に関してプログラミング質問器に通報を行
なう。
【００２５】図示の実施例においては、応答器１０は、
少なくとも１６の内部タスクと、応答器１０がＥＥＰＲ
ＯＭ２４からデ−タを読み出している読み出しモ−ドに
おける８つのタスクとを行なうとともに、応答器１０が
デ−タをＥＥＰＲＯＭ２４に書き込む書き込みモ−ドに
あるときに８つのタスクを行なうことができる。基本的
なタスクは表１に示す通りである。
【００２６】
【表１】上記したように、クロック発生器２６は、ＥＥ
ＰＲＯＭインタ−フェ−ス２２への入力としてタスク番
号を出力し、ＥＥＰＲＯＭ２４に対してどのタスクが行
なわれるべきかを決定する。
【００２７】次に、クロック発生器の詳細なブロック図
である図３について説明する。クロック発生器２６は、
２２０ｋＨｚオシレ−タ２８からの入力と、電源１４か
らの９ｋＨｚ出力タイミング信号との双方を受けて、１
１ｋＨｚ送信クロックを出力する２０分割ディバイダ(d
ivide by 20 divider)５０を備えている。同時に、電源
１４からの９ｋＨｚ出力信号が、１８ｋＨｚ受信クロッ
クを出力するクロックダブラ(doubler) ５２に入力され
る。同期クロック５４が送信受信セレクタ５６から入力
を受ける。送信受信セレクタ５６は、応答器１０が読み
出しモ−ドにあるのかあるいは書き込みモ−ドにあるの
かを示すとともに、どのタスクが行なわれるべきかを示
すＥＥＰＲＯＭインタ−フェ−ス２２からの入力に基づ
き同期クロック５４にフラッグを出力する。モ−ド入力
およびタスク入力に基づき、送信受信セレクタ５６は、
応答器１０が受信状態にあるのかあるいは送信状態にあ
るのかをクロック発生器２６に示す。読み出しタスク１
−６と書き込みタスク２、５および６が送信状態で行な
われる。同期クロック５４は、フラッグに基づき、受信
送信回路２０により利用される同期パルスを出力し、プ
ログラミング質問器からの指示を受けたときに、プログ
ラミン質問器により利用されるクロックと応答器１０に
より利用される内部受信クロックとを同期させる。上記
したように、応答器１０のデフォルト操作は、メモリか
ら読み出しを行なう読み出しモ−ドのタスクであるの
で、セレクタ５６は、本質的に送信状態を選択する。
【００２８】読み出し対書き込みモ−ドが指示信号に基
づいて選択されると、実行されるべきタスクは、２０分
割カウンタ５０により発生される送信クロックまたは周
波数ダブラ５２により発生される受信クロックをクロッ
ク処理しかつ分割することにより決定される。タスクク
ロック５８は、送信クロックおよび受信クロックととも
に送信受信セレクタ５６の出力を受け、かつ、これに応
答して、受信クロックと送信クロックとの間で切り換え
を行なう。タスククロック５８は、タスククロック５８
およびビット／タスク設定回路(bits per task setting
circuit) ６２の入力に応答して、４または９または１
６まで計数するプリセッタブル(presettable) カウンタ
６０に出力を提供する。ビット／タスク設定回路６２
は、入力としてタスク番号を受けるとともに、操作モ−
ドに基づきＥＥＰＲＯＭインタ−フェ−ス２２から読み
出しまたは書き込み入力を受け、かつ、これに基づきプ
リセッタブルカウンタ６０に入力を提供する。プリセッ
タブルカウンタ６０の計数は、プリセッタブルカウンタ
６０から出力されるクロックごとに１／８タスクセレク
タ(1 of 8 task selector)６６を１だけ増分させる８分
割カウンタに入力される。１／８タスクセレクタ６６
は、表１の番号が付されたタスクに相当する１／８可能
出力(one of eight possible output)を提供する。１／
８タスクセレクタ６６は、ＥＥＰＲＯＭインタ−フェ−
ス２２への入力として次の命令されたタスクを出力する
ことにより、ＥＥＰＲＯＭインタ−フェ−ス２２に指示
された通りにＥＥＰＲＯＭ２４に対して動作を行なわせ
る。順序から外れてタスクを行なうことが必要な場合が
しばしばある。従って、分割カウンタ６４は、スキップ
タスク１発生器(skip task 1 generator) ６８の読み出
し／書き込みモ−ドの入力に応答してスキップ１入力を
受けることにより、カウンタ６４を所望の場合にタスク
２の計数にスキップさせる。場合によっては、タスク７
へジャンプすることも必要であり、タスク７へのジャン
プ発生器(jump to task 7 generator)６９は検査不履行
(verify failure)信号およびプログラム抑止信号に基づ
き８分割カウンタ６４に出力を行なう。
【００２９】タスククロック５８はまた、ビットクロッ
クスイッチ５９に入力を提供することにより、ビットク
ロックスイッチ５９に１８ｋＨｚ受信クロックと４分の
１サイクルディレイ(quater cycle delay)５７により４
分の１サイクルだけ遅延されている１１ｋＨｚ送信クロ
ックとの間で選択を行なわせる。この遅れにより、応答
器１０の論理回路が送信に先立ち所定の位置につく時間
を提供する。ビットクロックスイッチ５９の出力は、Ｅ
ＥＰＲＯＭ２４が読み出しまたは書き込みモ−ドにある
応答器１０に従って適正な速度でアクセスされるように
ＥＥＰＲＯＭインタ−フェ−ス２２の操作をクロック処
理する(clock) ＥＥＰＲＯＭインタ−フェ−ス２２への
ビットクロック入力である。
【００３０】例えば、応答器１０が読み出しモ−ドにあ
り、かつ、タスク６が実行されたとすると、応答器１０
は読み出されている頁３８の最後の１６ビットのデ−タ
を送信した状態にある。従って、読み出しモ−ドは、次
の番号が付されたタスクであるタスク番号７とともに、
送信受信セレクタ５６に対する入力として提供される。
次のタスクであるタスク７は、プログラミング質問器に
従おうとすることにより、タスククロック５８に入力と
して１８ｋＨｚの受信クロックを選択させるするととも
に、同期クロック５４に受信送信回路２０へ１８ｋＨｚ
の同期パルスを出力させ、しかもビットクロックスイッ
チ５９を付勢して１８ｋＨｚの受信クロックをＥＥＰＲ
ＯＭインタ−フェ−ス２２に供給してタスク７に従って
作動させる。更に、送信受信セレクタ５６から出力され
るタスクに基づいて切り換えられるタスククロック５８
は、入力をプリセッタブルカウンタ６０に提供する。プ
リセッタブルカウンタ６０は、８分割カウンタ６４に入
力を供給することにより、１／８タスクセレクタ６６
に、次のタスク、即ち、ＥＥＰＲＯＭインタ−フェ−ス
２２に出力されるタスク８に対する選択を増分させる。
【００３１】表１に示すように、読み出しモ−ドにおけ
るタスク７により、応答器１０にプログラマからの指示
に注意を向けさせる。指示への注目が行なわれると、指
示が受け取られ、次に、タスク８即ち次の選択タスクに
従って、この指示がデコ−ドされる。これが読み出しモ
−ドである場合には、クロック発生器２６は、次の逐次
タスクである読み出しモ−ドのタスク１へジャンプし、
ＥＥＰＲＯＭインタ−フェ−ス２２にＥＥＰＲＯＭ２４
への指示をクロック処理させる。デコ−ドされた指示が
書き込み機能を示す場合には、応答器１０は書き込みモ
−ドのタスク１へジャンプし、送信受信セレクタ５６は
タスククロック５８に１８ｋＨｚの受信クロックを選択
させるとともに、応答器１０はプログラミング質問器か
らの指示の繰り返しを待つ。読み出し指示も書き込み指
示も受けない場合には、スキップタスク１発生器６８
は、８分割カウンタ６４に出力を提供して該カウンタに
タスク１をスキップさせるとともに、タスクセレクタ６
６に出力を提供することにより読み出しモ−ドのタスク
２を実行させ、プログラマブル質問器へ低同期信号を送
信する。応答器１０が書き込みモ−ドにありかつ指示を
受けていない場合には、スキップタスク１発生器６８は
入力を提供せず、ＥＥＰＲＯＭ２４の第１の１６ビット
デ−タはＥＥＰＲＯＭインタ−フェ−ス２２により読み
出される。
【００３２】次に、ＥＥＰＲＯＭインタ−フェ−ス２２
のブロック図である図４について説明する。ＥＥＰＲＯ
Ｍインタ−フェ−ス２２は、受信送信回路２０から復調
デ−タを受信する指示レジスタ７０を備えている。ＡＮ
Ｄゲ−ト７２は、イネ−ブル入力(enabling input)を指
示レジスタ７０に提供する。遅延した送信クロックまた
は受信クロックに対応してクロック発生器２６即ちビッ
トクロックスイッチ５９からのビットクロックが、ＡＮ
Ｄゲ−ト７２への第１の入力である。シフトレジスタク
ロックイネ−ブル７４がＡＮＤゲ−ト７２に対する第２
の入力であり、読み出しまたは書き込みモ−ド入力とタ
スク番号入力とに応答してイネ−ブル出力を提供する。
シフトレジスタクロックイネ−ブル７４は、書き込みタ
スク１、３、４および７に関して高く、読み出しタスク
１および７に関して高い。指示レジスタ７０は、応答器
１０が電磁場に最初に入ったときに、不履行として、読
み出しデ−タ指示を応答器１０の当初の操作の際に提供
する出力を与える読み出しアドレス０指示発生器７６か
らの第３の入力を受ける。パワ−オンリセット信号ＰＯ
Ｒに応答して、読み出しアドレス０指示発生器７６は、
アドレス０を指示レジスタ７０に装荷させるとともに、
８分割カウンタ６４を指示レジスタ７０の内容がＥＥＰ
ＲＯＭ２４にシフトされるタスク１に増分させることが
できる。
【００３３】指示レジスタ７０は、指示をデコ−ドする
指示デコ−ダ７８に、記憶された指示を出力する。指示
レジスタ７０の記憶された情報および入力されたタスク
番号に応答して、指示デコ−ダ７８は、入ってきたデ−
タ信号が読み出しタスクを示すのか、あるいは書き込み
タスクを示すのかにより、送信／受信セレクタ５６およ
び応答器１０のその他の回路の読み出し／書き込み（Ｒ
／Ｗ）入力である読み出しまたは書き込み信号を出力す
る。指示デコ−ダ７８は、新しい信号が受信されずかつ
以前のモ−ドが書き込みモ−ドである場合にはリスタ−
ト信号を出力することにより、読み出しアドレス０指示
発生器７６は指示レジスタ７０にアドレス０を装荷する
とともに、８分割カウンタ６４を、指示レジスタ７０の
内容がＥＥＰＲＯＭ２４にシフトされるタスク１に増分
させることにより、ＥＥＰＲＯＭ２４の第１のデ−タア
ドレスにアクセスさせる。更に、新たな指示を受けてお
らず、かつ、以前のモ−ドが読み出しモ−ドである場合
には、スキップタスク１発生器は、８分割カウンタ６４
にタスク１をスキップさせるとともに、次の１６ビット
のデ−タがＥＥＰＲＯＭ２４から読み出されるタスク２
において開始させる。ＡＮＤゲ−ト７２はＡＮＤゲ−ト
であるので、復調デ−タを指示レジスタ７０にシフトさ
せる書き込みタスク１、３、４および７と読み出しタス
ク１および７に出力されるシフトレジスタクロックイネ
−ブル７４と同期して指示レジスタ７０を介してビット
クロックをゲ−ト処理する。
【００３４】指示検査器(instruction verifier)８０
が、指示レジスタ７０のシフトされた出力を受け、これ
を、読み出しまたは書き込みモ−ド入力およびタスク番
号入力に応答して指示レジスタ７０に入力される変調デ
−タと比較する。指示検査器８０は、書き込みモ−ドタ
スク１の際に動作を行なうだけである。書き込みモ−ド
の際には、２つの指示が同じ入力でない場合には、指示
検査器８０は、受信送信回路２０とタスク７へのジャン
プ発生器６９とに入力される不履行信号を発生すること
により、８分割カウンタ６４を書き込みモ−ドのタスク
７へジャンプさせるとともに、応答器１０は適正な指示
に再度注目する。受信送信回路２０は、信号が書き込み
タスク２に従って検査されていないことをプログラミン
グ質問器に示す高い信号を出力する。しかしながら、２
つの指示が一致する場合には、指示検査器は、信号が検
査されたことをプログラミング質問器に示す連続した低
信号を送信受信回路２０が出力するタスク２まで８分割
カウンタ６４に計数を継続させることにより、書き込み
モ−ドは指示レジスタの内容をＥＥＰＲＯＭ２４へのシ
フトを進めることができる。
【００３５】ＥＥＰＲＯＭ２４はまた、ＡＮＤゲ−ト８
２から入力を受ける。ＡＮＤゲ−ト８２の一方の入力
は、上記したように、１１ｋＨｚ周波数または１８ｋＨ
ｚ周波数を有するクロック発生器２６により発生される
ビットレ−トクロック(bit rate clock)である。このビ
ットレ−トクロックは、インバ−タ８５により変換され
る。ＥＥＰＲＯＭクロックイネ−ブル８４が、読み出し
または書き込み決定入力とタスク番号入力を受けるとと
もに、ＡＮＤゲ−ト８２に対し第２の入力を提供する。
ＥＥＰＲＯＭクロックイネ−ブル８４により、クロック
発生器からのビットクロックを、読み出しタスク１およ
び３−６、ＥＥＰＲＯＭ２４への指示のクロック処理お
よびＥＥＰＲＯＭ２４からのデ−タのシフトとともに、
書き込み指示３および４、指示のクロック処理並びにＥ
ＥＰＲＯＭ２４へのデ−タに関してＥＥＰＲＯＭ２４へ
入力させることができる。読み出しの際には、指示レジ
スタ７０に記憶された指示によりアドレスされる内容
は、タスク３乃至６において受信送信回路２０のマンチ
ェスタ−エンコ−ダ８６へクロック処理される。マンチ
ェスタ−エンコ−ダ８６はまた、ビットクロック出力を
受け、ビットクロックはＥＥＰＲＯＭ２４からのデ−タ
と混合されて、その出力部においてマンチェスタ−エン
コ−ドされたデ−タを生ずる。同期信号発生器８８が、
同期クロック５４とともに、読み出しまたは書き込みモ
−ド入力およびタスク入力に応答して、入力をマンチェ
スタ−エンコ−ダにより出力されるマンチェスタ−エン
コ−ドされたデ−タとともにＯＲゲ−ト９０に供給す
る。状況信号発生器８７もまた、タスク入力、Ｒ／Ｗモ
−ド、不履行信号およびプログラム抑止に応答してＯＲ
ゲ−ト９０に入力を与える。ＯＲゲ−ト９０の出力は、
受信送信回路２０のデ−タ変調器に入力される。デ−タ
変調器は、受信送信回路２０が高い信号を受けたときに
高い周波数（５５ｋＨｚ）を送信させるとともに、低い
信号に応答して低周波数（３６．６ｋＨｚ）を送信させ
ることにより、ＯＲゲ−ト９０の出力に応答する。同期
信号発生器８８は先づ、書き込みモ−ドに入るときに同
期信号である送信同期信号を発生する。
【００３６】次に、図５および図６について説明する。
図５および図６は、本発明に係る応答器１０の動作を詳
細に示すフロ−チャ−ト図である。応答器１０は、所定
の強さの電磁場がないときには休止している。応答器１
０が９ｋＨｚの信号を有する適宜の電磁場に置かれる
と、電源１４が最小電圧ＶＣＣを発生して、パワ−オン
リセット３０にリセット信号ＰＯＲに対する出力を提供
させるとともに、低電圧抑止回路３２に低電圧抑止信号
ＬＶＩを出力させることにより、ステップ１００に従っ
て応答器１０を出力アップさせる。応答器１０は、時間
Ｔ0 （図７）で電磁場に入り、時限Ｔ1 に亘って出力ア
ップを行なっている際に、高い信号を発生する。図示の
実施例においては、Ｔ1 は、実質上、持続されている電
磁場に入ってから約７ミリ秒生ずる。
【００３７】上記したように、応答器１０のデフォルト
モ−ドは読み出しモ−ドである。従って、読み出しアド
レス０指示発生器７６は、パワ−オンリセット信号ＰＯ
Ｒに応答し、ステップ１０２に従って、ＥＥＰＲＯＭ２
４の第１のアドレスを読み出す指示を指示レジスタ７０
に入力する。受信／送信セレクタ５６は、送信モ−ドを
選択する。次に、第１の読み出しモ−ドタスクが、ステ
ップ１０４に従って、指示レジスタ７０からＥＥＰＲＯ
Ｍ２４へのこれらの指示をクロック処理することにより
行なわれる。ステップ１０４により、読み出しタスク２
が行なわれ、次に、同期信号発生器８８がＴ1 において
周波数変調同期信号を受信送信回路２０により発生され
る信号を発生することにより、プログラミング質問器は
この信号を応答器１０の出力として認識する。図７の実
施例においては、周波数変調同期信号は、１１ｋＨｚ送
信クロックの４1/4 サイクル（Ｔ1 乃至Ｔ2 ）の期間を
有する定常低周波数信号(steady low frequency signa
l) （３６ｋＨｚ）である。ここで、質問器は応答器１
０を認識して、質問器と応答器とが相互間でデ−タを送
信することができるようにする。
【００３８】詳細に上記したように、クロック発生器２
０の１１ｋＨｚ送信クロックの継続入力により、タスク
セレクタ６６の出力の増分が行なわれ、次の読み出しタ
スク３により、第１の１６ビットのＥＥＰＲＯＭデ−タ
がステップ１０８に従ってマンチェスタ−エンコ−ダ８
６を介して受信送信回路２０に出力される。クロック処
理が継続しかつタスクセレクタ６６が増分されると、読
み出しタスク４乃至６を実行することによりこの処理が
繰り返され、ステップ１１０、１１２および１１４に従
って、ＥＥＰＲＯＭ２４のデ−タの第１の頁の残りのワ
−ド４０を出力する。この処理は、図７に示すように、
Ｔ2 からＴ3 を介して行なわれる。
【００３９】デ−タの読み出しが完了すると、１／８タ
スクセレクタ６６は、応答器がプログラマからの指示に
注目するタスク７に増分される。タスク７の選択に応答
して、送信受信セレクタ５６は受信モ−ドを選択し、１
８ｋＨｚ受信クロックパルスの同期信号を発生器８８に
発生する同期クロック５４に入力を提供することによ
り、応答器１０が信号を受信しているのでクロック同期
信号を出力させる。タスククロック５８は、応答器１０
を１８ｋＨｚ受信クロックで作動させ、該クロックは単
に９ｋＨｚ出力クロック(power clock) の周波数の倍増
に過ぎないので、９ｋＨｚ出力信号クロックと同期して
発生される。
【００４０】発生した同期信号はＴ4 で終了する定常高
信号(steady high signal)であり、１８ｋＨｚクロック
の１サイクル分低信号が続く。これは、９ｋＨｚの過渡
(transition)が生じて、応答器１０に出力を供給するの
に利用される質問器の内部クロックとデ−タを受けるた
めに応答器１０により利用される受信クロックとを同期
させることができると応答器が考えていることをプログ
ラミング質問器に示す。プログラム化された質問器の同
期シ−ケンスはステップ１１６に従って送信される。
【００４１】次に、送信受信回路２０の送信器部が使用
禁止にされ、受信送信回路２０はステップ１１８に従っ
て信号に注目する。プログラミング質問器は、ステップ
１１８の際に、デ−タと指示とを応答器１０に送信す
る。受信されたデ−タは、受信送信回路２０により復調
され、指示レジスタ７０に入力され、ステップ１２０お
よび読み出しモ−ドのタスク８に従って指示デコ−ダ７
８によりデコ−ドされる。指示が読み出し指示である場
合には、タスククロック５８は１１ｋＨｚ送信クロック
を選択し、受信送信回路２０にステップ１２２に従って
プログラミング質問器に対して定常高信号を出力させ
る。次に、指示は指示レジスタ７０からＥＥＰＲＯＭ２
４へシフトされ、デ−タをＥＥＰＲＯＭ２４から特定の
アドレスでデ−タを読み出す。指示がＥＥＰＲＯＭ２４
に移送されているときには、送信受信回路は定常高信号
を出力する。この信号は、指示が応答器１０で受信され
たことを検査するためにプログラミング質問器が使用す
ることができる。次に、ステップ１０４乃至１１８が繰
り返され、低マンチェスタ−エンコ−ド化同期信号が発
生され、次いで、デ−タがＴ20が図９に示すように続
く。ステップ１１８において指示が受信されずあるいは
認識されていない指示が受信されると、定常高信号が再
度ステップ１２４において出力され、同時にデコ−ドが
行なわれる。指示がノイズである場合、あるいは指示が
ない場合には、応答器１０は、指示を無視し、読み出し
タスク２およびステップ１０６に従って定常低マンチェ
スタ−エンコ−ド化信号の送信を継続し、ステップ１０
２乃至１１８においてＥＥＰＲＯＭ２４から次の頁のデ
−タの送信を開始する。
【００４２】ステップ１２０において、書き込み指示が
受信されたことが認められると、ステップ１２６に従っ
て、ＥＥＰＲＯＭ２４のプログラミングが禁止されるべ
きかどうか、即ち、電圧ＶＣＣが４ボルトを越えること
によりＥＥＰＲＯＭ２４における書き込みを行なうこと
ができるかどうかが先づ決定される。電圧ＶＣＣが４ボ
ルトよりも低いと、ＥＥＰＲＯＭインタ−フェ−ス２２
は使用可能とはならず、ＥＥＰＲＯＭ２４への書き込み
を許容することができない。応答器１０は、図８のＴ7
において、ステップ１２８に従って点線で示すように定
常低信号を出力する。ステップ１３０においては、応答
器１０は、１８ｋＨｚ受信クロックを再度発生し、ステ
ップ１３２においてプログラミング質問器からの指示に
注目する。図８のＴ8 およびＴ9 に示すように、プログ
ラマ同期信号は、応答器が使用不能になる前に発生さ
れ、指示を受けることができる。この指示は、ステップ
１３４においてデコ−ドされる。読み出し指示が検出さ
れると、応答器１０はステップ１２２に復帰し、ステッ
プ１０４においてＥＥＰＲＯＭ２４を読み出すためのシ
−ケンスを再び開始する。ステップ１３４でデコ−ドさ
れた指示が認識されずあるいは存在しない場合には、別
の定常高信号がステップ１３５において出力され、応答
器１０はステップ１０２のデフォルトモ−ドに復帰して
再始動することにより、読み出しアドレス０指示発生器
７６は、第１の頁３８において開始するＥＥＰＲＯＭ２
４に記憶されているデ−タの読み出しを開始する指示レ
ジスタ７０に入力を提供する。
【００４３】デコ−ドされた指示が書き込み指示である
場合には、応答器１０はプログラミングがステップ１２
６において禁止されるかどうかを再度決定する。プログ
ラミングが禁止されない場合には、応答器１０はステッ
プ１２８に従ってＴ7 （図９）において定常高信号を出
力する。Ｔ8 およびＴ9 における送信プログラマ同期シ
−ケンスが、ステップ１３１に従って出力される。Ｔ9
の後に、送信機が使用不能になると、応答器１０は書き
込みタスク１を行ない、ステップ１３２において書き込
み指示の繰り返しに注目する。
【００４４】ステップ３４においては、指示検査器８０
は、指示レジスタ７０に記憶されている指示を、受信送
信回路２０により入力される復調されたデ−タに対応す
る指示と比較する。タスクセレクタ６６は、タスク番号
をタスク２に増分させる。指示が同じでない場合には、
ＥＥＰＲＯＭ２４への書き込みが禁止され、デ−タの一
体性を保持するＥＥＰＲＯＭ２４における不注意による
書き込みを防止している。指示がステップ１３４におい
て決定されるように同じでない場合には、タスク２が選
択され、１１ｋＨｚの送信クロックを利用して定常状態
の高信号(steady state high signal)が、ステップ１３
６に従って図８の点線で示すＴ10で出力され、指示が適
正に受けられず、以前の指示を再度送ることをプログラ
ミング質問器に示す。次に、応答器１０がステップ１３
０に従ってプログラマ同期シ−ケンスを送信し、かつ、
タスク７にスキップしてステップ１３０におけるプログ
ラマからの指示に再び注目を行なう。
【００４５】ステップ１３４において比較された指示が
合致しかつ同じである場合には、指示検査器８０は送信
受信回路にステップ１３８に従って実線で示すＴ10にお
いて１１ｋＨｚ送信クロックによりクロック処理される
定常低信号を出力させる。ステップ１４０においては、
どのタイプの指示が受信されたかが示される。書き込み
イネ−ブル指示が受信されあるいは書き込み処理の完了
時に書き込み不能指示が受信された場合には、指示レジ
スタ７０の内容はＥＥＰＲＯＭ２４にシフトされ、送信
クロックによりクロック処理された定常高信号がステッ
プ１４２において出力される。次に、応答器１０は、ス
テップ１３０において追従書き込み指示または別のタス
ク指示を受ける状態となる。
【００４６】書き込み指示がステップ１４０において受
信された場合には、同期信号発生器８８は、ステップ１
４２に従い、１８ｋＨｚの受信クロックによりクロック
処理された定常状態の高い信号でＴ121 において同期シ
−ケンスを送信するとともに、Ｔ12において定常状態の
低い信号を送信する。Ｔ13においては、受信送信回路２
０の送信部は使用不能となり、送信回路２０はプログラ
ミング質問器から１６ビットのデ−タを受信することが
できる。１８ｋＨｚの受信クロックにより、クロック発
生器２６は、タスク３が実行されるようにタスク番号を
１増分させる。シフトレジスタクロックイネ−ブル７４
は高出力を提供することにより、ＡＮＤゲ−ト７２に１
６ビットのデ−タにおいてクロック処理を行なわせ、一
方、指示シフトレジスタ７０からの指示、アドレスおよ
び最初の７デ−タビットはステップ１４４に従ってＥＥ
ＰＲＯＭ２４にシフトされる。ステップ１４６に従い、
タスククロック５８とビットクロック５９はいずれも１
１ｋＨｚ送信クロックに切り換わり、タスクはタスク４
へ増分し、最後の９ビットデ−タは指示レジスタ７０か
らＥＥＰＲＯＭ２４へクロック処理され、同時に、応答
器は定常状態の低い信号を出力する。
【００４７】デ−タのプログラミングまたはＥＥＰＲＯ
Ｍ２４へのデ−タの書き込みの際には、応答器１０は、
ＥＥＰＲＯＭが現在使用されていることをプログラマ質
問器に知らせなければならない。従って、タスククロッ
ク５８は１１ｋＨｚ送信クロックへ切り換わり、タスク
は１だけ増分し、書き込みモ−ドにおいてタスク５とな
り、応答器１０にプログラムサイクルを開始させるとと
もに、ＥＥＰＲＯＭがプログラミングを完了するまでス
テップ１４８に従い、Ｔ14において１１ｋＨｚ送信クロ
ックによりクロック処理された定常状態の低い信号を送
信させる。次いで、ステップ１５０およびタスク６に従
い、受信送信回路２０はＴ15において１１ｋＨｚクロッ
クの４サイクルに関して定常状態の高い信号を出力し、
応答器１０がＥＥＰＲＯＭ２４のプログラミングを行な
ったことをプログラミング質問器に通知する。
【００４８】次いで、タスクセレクタ６６が１だけ増分
され、応答器１０は、タスク７に従い、次のサイクルの
指示処理を開始するためにステップ１３０に従って次の
プログラミング信号に注目する。
【００４９】
【発明の効果】本発明は、以上のように出力アップ用の
コイルと、デ−タおよび指示を２方向に通信するコイル
とからなる２つの異なるコイルを有するプログラマブル
応答器を提供することにより、通信に高周波数を使用し
てデ−タ速度を一層大きくすることができ、しかも応答
器の出力を上げるのに一層低い規制されていない(unreg
ulated) 周波数を使用することができるので、プログラ
ミング質問器から供給される出力(power) の制限を取り
除くことができるとともに、可能な通信距離を大きくす
ることができる。更に、応答器を出力アップするのに通
信エネルギを消費せず、出力は全てデ−タと指示を運ぶ
ためにのみ使用されるので、通信を、必要とする出力を
少なくして一層効率的に行なうことができる。また、回
路内にパワ−オンリセットおよび低電圧抑止回路を配設
したことにより、メモリの状態を変えた場合の邪魔な騒
音を抑止することができるので、メモリに対する操作が
十分な電圧で行なわれることにより、有効な指示のみが
メモリに対して利用され、プログラミングのエラ−を最
小にすることができる。デ−タと指示の双方を含むプロ
グラミング質問器からの通信信号に応答してタスクの指
示を発生するＥＥＰＲＯＭインタ−フェ−スと協働する
クロック発生器を設けたので、メモリ内の任意のアドレ
スに対する選択的なアドレス処理および操作が可能にな
るとともに、メモリ内の選択されたアドレスにおける書
き重ねが可能となり、一層フレキシブルな応答器を提供
することができる。
【図面の簡単な説明】
【図１】この図は、本発明に従って構成された応答器の
ブロック図である。
【図２】この図は、本発明に従って構成されたＥＥＰＲ
ＯＭのメモリ−フォ−マットを示す線図である。
【図３】この図は、本発明に従って構成された応答器の
クロック発生器を示すブロック図である。
【図４】この図は、本発明に従って構成された応答器の
ＥＥＰＲＯＭインタ−フェ−スを示すブロック図であ
る。
【図５】この図は、本発明に係る応答器の動作を示すフ
ロ−チャ−ト図である。
【図６】この図は、本発明に係る応答器の動作を示すフ
ロ−チャ−ト図である。
【図７】この図は、本発明に従って作動する応答器の出
力を示すタイミングチャ−ト図である。
【図８】この図は、本発明に従って作動する応答器の出
力を示すタイミングチャ−ト図である。
【図９】この図は、本発明に従って作動する応答器の出
力を示すタイミングチャ−ト図である。
【符号の説明】
１０ 応答器 １２ 出力アンテナ １４ 電源 １６ 平滑コンデンサ １８ 通信アンテナ ２０ 受信送信回路 ２２ ＥＥＰＲＯＭインタ−フェ−ス ２４ ＥＥＰＲＯＭ ２６ クロック発生器 ２８ オシレ−タ ３０ パワ−オンリセット ３２ 低電圧抑止回路 ３８ 頁 ４０ ワ−ド ４１ 第１のワ−ド ４２ ビット ４４ ビット ４６ デ−タビット ４８ 検査合計ビット ５０ ２０分割ディバイダ ５２ クロックダブラ ５４ 同期クロック ５６ 送信受信セレクタ ５７ ４分の１サイクルディレイ ５８ ビットクロックスイッチ ５８ タスククロック ６０ プリセットダブルカウンタ ６２ ビット／タスク設定回路 ６４ ８分割カウンタ ６６ １／８タスクセレクタ ６８ スキップタスク１発生器 ６９ タスク７へのジャンプ発生器 ７０ 指示レジスタ ７２ ＡＮＤゲ−ト ７４ シフトレジスタクロックイネ−ブル ７６ 読み出しアドレス０指示発生器 ７８ 指示デコ−ダ ８０ 指示検査器 ８２ ＡＮＤゲ−ト ８４ ＥＥＰＲＯＭクロックイネ−ブル ８５ インバ−タ ８６ マンチェスタ−エンコ−ダ ８７ 状況信号発生器 ８８ 同期信号発生器 ９０ ＯＲゲ−ト 化学式等を記載した書面
【表１】 タスク 読み出しモ−ド 書き込みモ−ド 番号 １ ＥＥＰＲＯＭへの指示をクロ 指示の繰り返しを待つ ック ２ 同期信号（ＬＯ）を送信 検査信号（ＬＯ）または非検査信 号（ＨＩ）を送信 ３ １６ビットのデ−タを送信 ＥＥＰＲＯＭへの指示をクロック ４ １６ビットのデ−タを送信 ＥＥＰＲＯＭへのデ−タのクロッ クを終了、送信（ＬＯ） ５ １６ビットのデ−タを送信 プログラムサイクルを開始、送信 （ＬＯ） ６ １６ビットのデ−タを送信 プログラムサイクル（ＬＯ）の際 に話中信号を、サイクル（ＨＩ） の終了時に終了信号を送信 ７ プログラマに同期信号を送信し プログラマに同期信号を送信し、 、プログラマからの指示に注目 プログラマからの指示に注目 ８ 指示をデコ−ドし、送信（ＨＩ） 指示をデコ−ドし、送信（ＨＩ）
フロントページの続き (72)発明者 デビツド・エルウツド アメリカ合衆国、コロラド州 80439、ゴ ールデン、サウス・ホールマン・ウエイ 16、ナンバー４デイ (72)発明者 ジヨン・バーネ アメリカ合衆国、コロラド州 80457、キ ツトリツジ、ラインズ・レーン 25972

Claims (3)

    【特許請求の範囲】
  1. 【請求項１】第１の通信信号と個別の出力信号とを受信
    するとともに、これに応答して第２の通信信号を送信す
    る受動応答器において、前記第１の通信信号を受信する
    通信アンテナ手段と、前記出力信号を受信する出力アン
    テナ手段と、前記第１の通信信号に応答して前記第２の
    通信信号を形成する情報発生手段とを備え、前記通信ア
    ンテナ手段は前記第２の通信信号を出力し、更に前記出
    力信号に応答して前記情報発生手段に出力を供給する出
    力供給手段を備えることを特徴とする受動応答器。
  2. 【請求項２】受信クロックと送信クロックとを発生する
    クロック発生手段を更に備え、前記情報発生手段は第３
    の周波数を有する前記受信クロックに応答して前記第１
    の通信信号においてクロック処理することにより前記第
    １の通信信号を受信し、かつ、第４の周波数を有する前
    記送信クロックに応答して前記第２の通信信号をクロッ
    ク処理することにより前記第２の通信信号を出力するこ
    とを特徴とする請求項１に記載の受動応答器。
  3. 【請求項３】第１の通信信号を受信しかつ該第１の通信
    信号に応答して第２の通信信号を送信する通信アンテナ
    手段を備え、前記第１および第２の各通信信号はデ−タ
    と指示を含み、更に、複数のメモリアドレスを有し前記
    応答器により受信されるデ−タを記憶する再プログラマ
    ブルメモリ手段と、前記第１の通信信号に応答して前記
    第２の通信信号を形成する情報発生手段とを備え、該情
    報発生手段は前記第１の通信手段に応答して前記再プロ
    グラマブルメモリのアドレスを選択的にアドレス処理す
    るとともに前記第１の通信信号に応答して前記選択的に
    アドレス処理されたメモリアドレスに動作を行なうメモ
    リインタ−フェ−ス手段を備え、前記通信アンテナ手段
    は前記第２の通信信号を出力することを特徴とする受動
    応答器。
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